JP2022162192A - 半導体装置及びそれを用いた半導体モジュール - Google Patents

半導体装置及びそれを用いた半導体モジュール Download PDF

Info

Publication number
JP2022162192A
JP2022162192A JP2021066882A JP2021066882A JP2022162192A JP 2022162192 A JP2022162192 A JP 2022162192A JP 2021066882 A JP2021066882 A JP 2021066882A JP 2021066882 A JP2021066882 A JP 2021066882A JP 2022162192 A JP2022162192 A JP 2022162192A
Authority
JP
Japan
Prior art keywords
heat sink
semiconductor device
terminal
heat
notch
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2021066882A
Other languages
English (en)
Other versions
JP7118205B1 (ja
Inventor
将司 酒井
Shoji Sakai
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP2021066882A priority Critical patent/JP7118205B1/ja
Priority to US17/506,286 priority patent/US11694948B2/en
Priority to CN202210319498.2A priority patent/CN115206905A/zh
Application granted granted Critical
Publication of JP7118205B1 publication Critical patent/JP7118205B1/ja
Publication of JP2022162192A publication Critical patent/JP2022162192A/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/367Cooling facilitated by shape of device
    • H01L23/3672Foil-like cooling fins or heat sinks
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/42Fillings or auxiliary members in containers or encapsulations selected or arranged to facilitate heating or cooling
    • H01L23/433Auxiliary members in containers characterised by their shape, e.g. pistons
    • H01L23/4334Auxiliary members in encapsulations
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49568Lead-frames or other flat leads specifically adapted to facilitate heat dissipation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01BCABLES; CONDUCTORS; INSULATORS; SELECTION OF MATERIALS FOR THEIR CONDUCTIVE, INSULATING OR DIELECTRIC PROPERTIES
    • H01B17/00Insulators or insulating bodies characterised by their form
    • H01B17/56Insulating bodies
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49517Additional leads
    • H01L23/49524Additional leads the additional leads being a tape carrier or flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49541Geometry of the lead-frame
    • H01L23/49562Geometry of the lead-frame for devices being provided for in H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49575Assemblies of semiconductor devices on lead frames
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001Core members of the layer connector
    • H01L2224/29099Material
    • H01L2224/291Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001Core members of the layer connector
    • H01L2224/29099Material
    • H01L2224/29198Material with a principal constituent of the material being a combination of two or more materials in the form of a matrix with a filler, i.e. being a hybrid material, e.g. segmented structures, foams
    • H01L2224/29298Fillers
    • H01L2224/29299Base material
    • H01L2224/293Base material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29338Base material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/29339Silver [Ag] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L2224/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • H01L2224/37001Core members of the connector
    • H01L2224/3701Shape
    • H01L2224/37011Shape comprising apertures or cavities
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L2224/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • H01L2224/37001Core members of the connector
    • H01L2224/3701Shape
    • H01L2224/37012Cross-sectional shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L2224/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • H01L2224/401Disposition
    • H01L2224/40135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/40137Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L2224/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L2224/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • H01L2224/401Disposition
    • H01L2224/40151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/40221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/40245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/4501Shape
    • H01L2224/45012Cross-sectional shape
    • H01L2224/45014Ribbon connectors, e.g. rectangular cross-section
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45117Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/45124Aluminium (Al) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45147Copper (Cu) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/48137Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • H01L2224/48139Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate with an intermediate bond, e.g. continuous wire daisy chain
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4911Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
    • H01L2224/49113Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain the connectors connecting different bonding areas on the semiconductor or solid-state body to a common bonding area outside the body, e.g. converging wires
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/4917Crossed wires
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838Bonding techniques
    • H01L2224/83801Soldering or alloying
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/373Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
    • H01L23/3735Laminates or multilayers, e.g. direct bond copper ceramic substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/36Structure, shape, material or disposition of the strap connectors prior to the connecting process
    • H01L24/37Structure, shape, material or disposition of the strap connectors prior to the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/34Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
    • H01L24/39Structure, shape, material or disposition of the strap connectors after the connecting process
    • H01L24/40Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/07Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
    • H01L25/072Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00 the devices being arranged next to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/18Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19107Disposition of discrete passive components off-chip wires

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • Materials Engineering (AREA)
  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
  • Cooling Or The Like Of Electrical Apparatus (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Abstract

【課題】半導体装置が当接する絶縁部材の大型化を抑制した半導体装置を提供する。【解決手段】半導体装置100は、板状に形成された放熱板5と、放熱板5の一方の面に接合された複数のスイッチング素子6と、放熱板5と離間した状態で、放熱板5から離れる方向に延出し、第一導電体(ボンディング部材のボンディングワイヤ7a及びボンディングワイヤ7b)を介して、素子実装面5aの側とは反対側の面に接続された第一端子4bと、複数のスイッチング素子6、放熱板5及び第一端子4bを封止するモールド樹脂1と、を備える。放熱板5の外周部には切欠きが設けられ、第一端子4bの放熱板5の側の部分が、放熱板5の一方の面に垂直な方向に見て、切欠きにより切り欠いている領域と重複し、放熱板5の他方の面の外周部に、内側に引っ込んだ引っ込み部が形成されている。【選択図】図2

Description

本願は、半導体装置及びそれを用いた半導体モジュールに関するものである。
電気自動車またはプラグインハイブリッド自動車のような電動車両には、高電圧バッテリーの電力を変換するための電力変換装置が設けられる。電力変換装置には、スイッチング動作にて電力を変換する半導体装置が用いられる。
半導体装置は、放熱性を有した金属板に接合された半導体スイッチング素子を備える。半導体スイッチング素子は、電力変換用のパワー回路を形成する主端子及びスイッチング制御を行う制御回路と接続される制御端子と、DLB(Direct-Lead-Bonding)もしくはワイヤボンディング等の方法によって接続される。半導体スイッチング素子は樹脂またはゲル等の封止部材によって封止され、半導体スイッチング素子を取り囲んで封止部が形成される。同一の半導体スイッチング素子に対応した主端子及び制御端子が、封止部のひとつの突出面から突出すると共に突出面に沿って並んで配置されている半導体装置が開示されている(例えば、特許文献1参照)。
開示された半導体装置では、半導体素子の裏面の主電極に接続された放熱板を介して、半導体素子の主電極と主端子とが電気的に接続されている。一方、半導体素子の制御電極には、ボンディングワイヤを介して制御端子が接続されている。これらの主端子及び制御端子が、封止部のひとつの突出面から突出するとともに、突出面に沿って並んで配置されている。
特開2015-185834号公報
上記特許文献1における半導体装置の構造では、放熱板は半導体素子の裏面の主電極に接続されているため、放熱板には電流が流れる。そのため、半導体装置は絶縁板などの絶縁部材を介して、冷却器に取り付けられる。絶縁板を介して半導体装置を冷却器に取り付けた場合、放熱板と冷却器との間に沿面距離を確保する必要があるため、半導体装置が当接する絶縁板が大型化するという課題があった。
そこで、本願は、半導体装置が当接する絶縁部材の大型化を抑制した半導体装置を得ること、及び大型化を抑制した半導体モジュールを得ることを目的とする。
本願に開示される半導体装置は、板状に形成された放熱板と、放熱板の一方の面に接合された複数のスイッチング素子と、放熱板と離間した状態で、放熱板から離れる方向に延出した端子であって、第一導電体を介して、複数のスイッチング素子における放熱板の側とは反対側の面と接続された第一端子と、複数のスイッチング素子、放熱板、及び第一端子を封止する封止部材とを備え、放熱板の外周部には、切欠きが設けられ、第一端子の放熱板の側の部分が、放熱板の一方の面に垂直な方向に見て、切欠きにより切り欠いている領域と重複し、放熱板の他方の面の外周部に、内側に引っ込んだ引っ込み部が形成されているものである。
本願に開示される半導体モジュールは、本願に開示された半導体装置と、引っ込み部を除いた放熱板の他方の面に当接した板状の絶縁部材と、を備えたものである。
本願に開示される半導体装置によれば、板状に形成された放熱板と、放熱板の一方の面に接合された複数のスイッチング素子とを備え、放熱板の他方の面の外周部に内側に引っ込んだ引っ込み部が形成されているため、半導体装置が絶縁板を介して冷却器に取り付けられる際の放熱板と冷却器との間の沿面距離における放熱板の側面の部分から絶縁板の側面までの水平距離を引っ込み部が形成されていない場合の水平距離よりも小さくすることができるので、半導体装置が当接する絶縁板の大型化を抑制することができる。
本願に開示される半導体モジュールによれば、本願に開示された半導体装置と、引っ込み部を除いた放熱板の他方の面に当接した板状の絶縁部材とを備えたため、絶縁板の大型化が抑制されるので、半導体モジュールの大型化を抑制することができる。
実施の形態1に係る半導体モジュールの外観を示す上面図である。 実施の形態1に係る半導体装置の構成の概略を示す平面図である。 実施の形態1に係る半導体装置の外観を示す側面図である。 実施の形態1に係る半導体装置の放熱板の概略を示す平面図である。 図2のA-A断面位置で切断した半導体装置の概略を示す断面図である。 実施の形態1に係る半導体装置の放熱板の外観を示す斜視図である。 図2のA-A断面位置で切断した半導体装置の要部の概略を示す断面図である。 比較例に係る半導体装置の要部を示す断面図である。 実施の形態2に係る半導体装置の放熱板の外観を示す斜視図である。 実施の形態3に係る半導体装置の放熱板の外観を示す斜視図である。 実施の形態3に係る半導体装置の放熱板の外観を示す側面図である。 実施の形態4に係る半導体装置の放熱板の外観を示す側面図である。 実施の形態4に係る半導体装置の別の放熱板の外観を示す側面図である。 実施の形態5に係る半導体装置の放熱板の外観を示す側面図である。 実施の形態6に係る半導体装置の放熱板の外観を示す側面図である 実施の形態7に係る半導体装置の外観を示す上面図である。 実施の形態7に係る半導体装置の構成の概略を示す平面図である。 実施の形態7に係る半導体装置の構成の概略を示す別の平面図である。 実施の形態7に係る半導体装置の構成の概略を示す別の平面図である。 実施の形態7に係る半導体装置の外観を示す側面図である。 実施の形態7に係る半導体装置の要部を示す側面図である。
以下、本願の実施の形態による半導体装置を図に基づいて説明する。なお、各図において同一、または相当部材、部位については同一符号を付して説明する。
実施の形態1.
図1は実施の形態1に係る半導体モジュール500の外観を示す上面図、図2は半導体装置100の構成の概略を示す平面図、図3は半導体装置100の外観を示す側面図、図4は半導体装置100の放熱板5の概略を示す平面図で、素子実装面5aの側から見た図、図5は図2のA-A断面位置で切断した半導体装置100の概略を示す断面図で、引っ込み部5eを省略して示した図、図6は半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aとは反対側の冷却面5fの側から見た図、図7は図2のA-A断面位置で切断した半導体装置100と周囲の部材の概略を封止部材であるモールド樹脂1を取り除いて示す断面図で、特にP端子2と放熱板5の近傍を拡大して示した図、図8は比較例に係る半導体装置300の要部を示す断面図で、図7と同等の部分を示す図ある。図2はモールド樹脂1を取り除いて示した図で、破線はモールド樹脂1の外形である。半導体装置100は複数のスイッチング素子6を有し、スイッチング動作にて電力を変換する装置である。
<半導体装置100>
半導体装置100には、図1に示すように、主端子であるP端子2及びN端子3と制御端子4とがモールド樹脂1から外部に露出して設けられる。本実施の形態では、P端子2と制御端子4は同じモールド樹脂1の側面から外部に露出し、N端子3はP端子2と制御端子4が露出する側面とは反対側の側面から露出する。各端子の露出する側面はこれに限るものではない。これらの端子は、外部の機器と接続される端子である。本実施の形態では、半導体装置100は3つの制御端子4を備える。3つの制御端子4は、第一端子であるゲート端子4b、第二端子であるセンス端子4c、及びセンスソース端子4aである。モールド樹脂1は直方体状に設けられるが、モールド樹脂1の形状はこれに限るものではない。各端子は、図3に示すように、モールド樹脂1の側面の同じ高さから露出している。なお、各端子を設ける高さは、接続される外部の機器の端子配置等に応じて異なる高さに設けても構わない。
半導体装置100は、図2に示すように、板状に形成された放熱板5、放熱板5の一方の面である素子実装面5aに接合された複数のスイッチング素子6、P端子2、N端子3、制御端子4、及び複数のスイッチング素子6と放熱板5とP端子2とN端子3と制御端子4とを封止するモールド樹脂1を備える。本実施の形態では、半導体装置100はトランスファーモールド成型されたものであるがこれに限るものではなく、ゲル等の封止部材を用いても構わない。ゲルを用いて封止する場合、例えばスイッチング素子6等を収めた樹脂ケースにゲルが注入される構成となる。
図4に示した放熱板5は、熱伝導性に優れると共に、電気伝導性を備えた銅またはアルミニウム等の金属から矩形状に作製される。放熱板5は、例えば銅製のヒートスプレッダである。放熱板5の材質及び形状はこれに限るものでない。放熱板5は、銅製のベース板に金属箔がロウ付けなどで接合された絶縁材であるセラミクス絶縁基板を接合したDBC(Direct Bonded Copper)基板等、その他の基板材料で作製されても構わない。放熱板5とスイッチング素子6とは、例えばはんだにより電気的かつ熱的に接合される。放熱板5とスイッチング素子6との接合ははんだに限るものではなく、高熱伝導で低電気抵抗な特性を備えた材料であればよく、例えば銀を主成分としたペースト材であっても構わない。スイッチング素子6で生じた熱は放熱板5を介して外部に拡散されるので、スイッチング素子6は効果的に冷却される。放熱板5が有した切欠き5b及び引っ込み部5e(図4において図示せず)については後述する。
スイッチング素子6は4つのスイッチング素子6a、6b、6c、6dを備える。スイッチング素子6には、MOSFET(金属酸化膜型電界効果トランジスタ、Metal Oxide Semiconductor Field Effect Transistor)、IGBT(絶縁ゲート型バイポーラトランジスタ、Insulated Gate Bipolar Transistor)などの電力制御用半導体素子、もしくは還流ダイオードなどが用いられる。スイッチング素子6はこれらに限るものではなく、バイポーラトランジスタなどのその他のスイッチング素子でも構わない。本実施の形態では、MOSFETを用いてMOSFETの寄生ダイオードを還流ダイオードとして使用した構成とするが、IGBT等の寄生ダイオードを有さないスイッチング素子を用いる場合などにおいて還流ダイオードを並列で付与する構成としても構わない。スイッチング素子6は、炭化ケイ素、シリコン、もしくは窒化ガリウムなどの材料からなる半導体基板に形成される。
半導体装置100は、図2に示すように、放熱板5の素子実装面5aおいて切欠き5bに隣接して配置されたセンス素子8を備える。センス素子8は、放熱板5を介してスイッチング素子6の周辺の温度を測定する素子である。センス素子8がスイッチング素子6の周辺の温度を測定することで、スイッチング素子6の温度上昇を抑制することができる。センス素子8は、例えばサーミスタである。センス素子8は、センス端子4c及びセンスソース端子4aと第二導電体であるボンディング部材のボンディングワイヤ7cを介して接続される。
<端子>
P端子2、N端子3、及び制御端子4の各端子は、電気伝導性を備えた銅またはアルミニウム等の金属から作製される。P端子2は一方の側が放熱板5の素子実装面5aに接合され、他方の側がモールド樹脂1の外部に露出して外部で他の機器と接続される。N端子3は一方の側がスイッチング素子6における放熱板5の側とは反対側の面に設けられた電極に接合され、他方の側がモールド樹脂1の外部に露出して外部で他の機器と接続される。センスソース端子4aは、N端子3の本体部分からN端子3が外部に露出した部分とは反対側に延出したN端子3の延出部分である。センスソース端子4aはN端子3と同電位である。本実施の形態ではセンスソース端子4aとN端子3とは一体化されているが、センスソース端子4aとN端子3とを別に設けてボンディングワイヤ等で双方を接続する構成でも構わない。また、本実施の形態のP端子2及びN端子3のモールド樹脂1の外部に露出する部分が同じ高さになるように、P端子2及びN端子3のモールド樹脂1の内部で接続される部分は、図5に示すように、接続される側にへこませて設けられる。
ゲート端子4bは、放熱板5と離間した状態で、放熱板5から離れる方向に延出した端子であって、第一導電体であるボンディング部材のボンディングワイヤ7a及びボンディングワイヤ7bを介して、複数のスイッチング素子6における放熱板5の側とは反対側の面と接続される。スイッチング素子6の接続される部分は、スイッチング素子6のそれぞれが有したゲート電極9である。センス端子4cは、放熱板5と離間した状態で、放熱板5から離れる方向に延出した端子であって、ボンディングワイヤ7cを介してセンス素子8と接続される。ボンディングワイヤ7a、7b、7cは例えばアルミ製にワイヤであるがこれに限るものではなく、銅製リボンなどその他の導電体でも構わない。第一導電体及び第二導電体の一方または双方にボンディング部材を用いた場合、DLBと比較して導電体の断面積を小さく構成できるため、半導体装置100を小型化することができる。
素子実装面5aに接合されたP端子2は、放熱板5を介してスイッチング素子6の放熱板5の側の面に設けられた電極と接続される。N端子3は上述したようにスイッチング素子6の放熱板5の側とは反対側の面に設けられた電極と接続される。これらの接続により、スイッチング素子6のドレイン電極間とソース電極間は電気的に並列接続され、一組のアームが構成される。
<半導体モジュール500>
半導体モジュール500は、図1に示すように、半導体装置100と、後述する引っ込み部5eを除いた放熱板5の他方の面に当接した板状の絶縁部材である絶縁板15とを備える。絶縁板15は、例えば樹脂で形成される。絶縁部材は絶縁板15に限るものではなく、絶縁シートでも構わない。スイッチング素子6の冷却を促進させるために、半導体装置100の他方の面である冷却面5f(図1において図示せず)に冷却器が取り付けられる。放熱板5はスイッチング素子6の主電極に接続されているため、放熱板5には電流が流れる。そのため、半導体装置100と絶縁板15とから半導体モジュール500が形成され、半導体装置100は絶縁板15を介して冷却器に取り付けられる。半導体装置100と冷却器との間には、予め定めた沿面距離が設けられる。
<切欠き5b>
放熱板5の外周部には、図4に示すように、切欠き5bが設けられる。切欠き5bは、放熱板5の外周から内部に向けて切り欠かれた部分である。切欠き5bは、放熱板5が図4に示した放熱板5である場合、図4において破線で囲まれた領域である。本実施の形態では切欠き5bを矩形状に設けているが、切欠き5bの形状はこれに限るものではなく、曲線で囲まれた部分であっても構わない。放熱板5をプレス加工で作製する場合、プレス加工時に切欠き5bを同時に形成することができる。放熱板5の作製後に、放熱板5の一部を切削加工等で削除して切欠き5bを形成しても構わない。
ゲート端子4bの放熱板5の側の部分が、図2に示すように、放熱板5の素子実装面5aに垂直な方向に見て、切欠き5bにより切り欠いている領域と重複している。センス端子4cの放熱板5の側の部分が、放熱板5の素子実装面5aに垂直な方向に見て、切欠き5bにより切り欠いている領域と重複している。
このように構成することで、切欠き5bを有さない放熱板の外周よりも内側にゲート端子4b及びセンス端子4cを配置できるため、ゲート端子4b及びセンス端子4cの延出する方向における半導体装置100の大型化を抑制することができる。ワイヤボンディング工程において、ゲート端子4b及びセンス端子4cは切欠き5bの領域で治具により支持できるため、放熱板5とゲート端子4b及びセンス端子4cとの間を支持する必要はない。放熱板5とゲート端子4b及びセンス端子4cとの間を支持する新たな支持部材をワイヤボンディング工程に用いる必要がないので、ワイヤボンディング工程を煩雑化させることはない。また、ゲート端子4b及びセンス端子4cを素子実装面5aと同一平面上に容易に配置することができる。また、切欠き5bを有さない放熱板の外周よりも内側にゲート端子4bが配置されるため、半導体装置100の電流経路長は短縮されるので、半導体装置100の回路インダクタンスの増大を抑制することができる。
また、切欠き5bの分だけ放熱板5の体積が削減され、切欠き5bの部分には放熱板5に用いる部材よりも密度の小さいモールド樹脂1が充填されるため、半導体装置100を軽量化することができる。また、切欠き5bを設けることで、部材間の線膨張係数差に起因した反りを抑制することができる。また、モールド樹脂1と放熱板5との接触する面積が増加するため、モールド樹脂1と放熱板5との密着性を向上させることができる。
<比較例>
本願の要部である引っ込み部5eの説明に先立ち、図8を用いて比較例について説明する。図8は、図2のA-A断面位置と同等の位置で切断した半導体装置300と周囲の部材の概略を示す断面図で、特にP端子2と放熱板51の近傍を拡大してモールド樹脂1を取り除いて示した図である。放熱板51の素子実装面51aに接合されたスイッチング素子(図8において図示せず)で生じた熱は、放熱板51を介して外部に拡散される。絶縁板15を介して半導体装置300を冷却器14に取り付けた場合、放熱板51と冷却器14との間に沿面距離16を確保する必要がある。沿面距離16は図8に示した矢印の部分の距離であり、絶縁板15に当接した放熱板51の側面の部分から絶縁板15の側面までの水平距離16aと絶縁板15の厚みとを足し合わせた距離である。沿面距離16を確保するために、半導体装置300が当接する絶縁板15が放熱板51の側面から離れる方向に大型化すると共に、絶縁板15を備えた半導体モジュール600は大型化する。
<引っ込み部5e>
放熱板5の冷却面5fの外周部に、図6に示すように、内側に引っ込んだ引っ込み部5eが形成されている。引っ込み部5eを形成することで、冷却面5fの端面は冷却面5fの内側に面積が縮小される。本実施の形態では、引っ込み部5eは冷却面5fの外周部に沿って面取りされた面取り部である。引っ込み部5eを形成することで、図7に示すように、沿面距離16における水平距離16bを、図8に示した引っ込み部5eを形成しない水平距離16aよりも小さくすることができる。水平距離16bが小さくなるので、半導体装置100が当接する絶縁板15が放熱板5の側面から離れる方向に大型化することを抑制することができる。絶縁板15の大型化が抑制されるので、絶縁板15を備えた半導体モジュール600の大型化を抑制することができる。
面取り部は、例えば放熱板5の冷却面5fの外周部を金型で押すことで形成される。本実施の形態では、引っ込み部5eとして面取り部を形成したが引っ込み部5eの形状はこれに限るものではない。面取り部で引っ込み部5eを形成することで、引っ込み部5eを容易に形成することができる。引っ込み部5eが容易に形成されるので、半導体装置100の生産性を向上させることができる。
<スイッチング素子6の配置>
複数のスイッチング素子6は、図2に示すように、放熱板5の素子実装面5aにおける切欠き5bを挟んだ両側の領域に、切欠き5bを挟んで一列に並べられている。本実施の形態では、複数のスイッチング素子6は、矩形状の放熱板5の長辺に沿って一列に並べられている。また、放熱板5の素子実装面5aにおける切欠き5bを挟んだ一方側の領域にスイッチング素子6a、6bが配置され、他方側の領域にスイッチング素子6c、6dが配置される。このように構成することで、スイッチング素子6は切欠き5bを挟んだ一方側の領域と他方側の領域に離間して配置されるため、異なる領域に配置されたスイッチング素子6からの熱干渉を受けにくくなる。異なる領域に配置されたスイッチング素子6からの熱干渉を受けにくくなるため、スイッチング素子6の放熱性を向上させることができる。
ゲート端子4bのボンディングワイヤ7a及びボンディングワイヤ7bと接続された部分とゲート電極9とは、放熱板5の素子実装面5aに平行な方向に一列に並べられている。このように構成することで、複数のスイッチング素子6を近接して配置でき、ボンディングワイヤ7a及びボンディングワイヤ7bの長さを短縮することができる。ボンディングワイヤ7a及びボンディングワイヤ7bの長さを短縮することができるので、半導体装置100の生産性を向上させることができる。
放熱板5の素子実装面5aにおける切欠き5bを挟んだ一方側の領域及び他方側の領域のそれぞれにおいて、互いに隣接している2つのスイッチング素子6のそれぞれのゲート電極9の間が、ボンディングワイヤ7aまたはボンディングワイヤ7bにより接続される。切欠き5bに隣接して配置された、一方側の領域の1つのスイッチング素子6bのゲート電極9とゲート端子4bとの間が、ボンディングワイヤ7aにより接続されている。切欠き5bに隣接して配置された、他方側の領域の1つのスイッチング素子6cのゲート電極9とゲート端子4bとの間が、ボンディングワイヤ7bより接続されている。本実施の形態では、このようにステッチボンディングにより各々のゲート電極9がゲート端子4bと並列に接続された例を示している。ボンディングワイヤ7aは、一方側の領域に配置されたスイッチング素子6a、6bとゲート端子4bとを接続するステッチ配線である。ボンディングワイヤ7bは、他方側の領域に対置されたスイッチング素子6c、6dとゲート端子4bとを接続するステッチ配線である。
このように構成することで、複数のスイッチング素子6と接続されるゲート端子4bを切欠き5bの領域に複数のスイッチング素子6に近接して配置することができる。ゲート端子4bを切欠き5bの領域に複数のスイッチング素子6に近接して配置することができるので、半導体装置100を小型化することができる。また、ボンディングワイヤ7a、7bは、スイッチング素子6が並べられた方向に沿ってほぼ直線的に延出し、低ループで短いワイヤの配置となるため、樹脂封止工程においてボンディングワイヤ7a、7bが変形して生じる短絡不良が起きにくく、半導体装置100の生産性を向上させることができる。本実施の形態ではステッチボンディングにより各々のゲート電極9がゲート端子4bと並列に接続された例を示したがこれに限るものではなく、各々のゲート電極9とゲート端子4bとを異なるワイヤで接続しても構わない。
一方側の領域に配置されたスイッチング素子6a、6bと他方側の領域に配置されたスイッチング素子6c、6dとは、放熱板5の素子実装面5aに垂直な方向に見て、スイッチング素子6が並べられた方向と直行する第一基準線Xに対して線対称に配置される。このように構成することで、ボンディングワイヤ7a、7bが同等の長さになり、配線長に起因した制御信号のばらつきを抑制することができる。
本実施の形態では、一方側の領域と他方側の領域のそれぞれに2つのスイッチング素子6を配置したがスイッチング素子6の配置数はこれに限るものではなく、それぞれに1つ、あるいは3つ以上配置しても構わない。また、1アームあたり4つのスイッチング素子6を並列接続しているが、スイッチング素子6の並列数は4に限定されるものではない。また、複数のスイッチング素子6のそれぞれのゲート電極9は一つのゲート端子4bと接続されているが、複数のゲート端子4bを配置して、それぞれのゲート端子4bが何れかのゲート電極9と接続された構成でも構わない。
以上のように、実施の形態1による半導体装置100において、板状に形成された放熱板5と離間した状態で、放熱板5から離れる方向に延出した端子であって、第一導電体を介して、複数のスイッチング素子6における放熱板5の側とは反対側の面と接続されたゲート端子4bを備え、放熱板5の外周部には切欠き5bが設けられ、ゲート端子4bの放熱板5の側の部分が、放熱板5の素子実装面5aに垂直な方向に見て、切欠き5bにより切り欠いている領域と重複しているため、新たな支持部材をワイヤボンディング工程に用いずに、切欠き5bを有さない放熱板5の外周よりも内側にゲート端子4bを配置できるので、ワイヤボンディング工程を煩雑化させることなく、ゲート端子4bの延出する方向における半導体装置100の大型化を抑制することができる。
放熱板5の冷却面5fの外周部に、内側に引っ込んだ引っ込み部5eが形成されているため、沿面距離16における水平距離16bを引っ込み部5eが形成されていない水平距離16aよりも小さくすることができるので、半導体装置100が当接する絶縁板15の大型化を抑制することができる。また、絶縁板15の大型化が抑制されるので、絶縁板15を備えた半導体モジュール600の大型化を抑制することができる。引っ込み部5eが冷却面5fの外周部に沿って面取りされた面取り部である場合、引っ込み部5eを容易に形成することができる。引っ込み部5eが容易に形成されるので、半導体装置100の生産性を向上させることができる。
実施の形態2.
実施の形態2に係る半導体装置100について説明する。図9は実施の形態2に係る半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aとは反対側の冷却面5fの側から見た図である。実施の形態2に係る半導体装置100は、引っ込み部5eの形成される部分が実施の形態1とは異なる構成になっている。
切欠き5bの部分を除いた放熱板5の冷却面5fの外周部に、引っ込み部5eが形成されている。引っ込み部5eは、冷却面5fの外周部に沿って面取りされた面取り部である。実施の形態1に係る放熱板5の形状では、モールド樹脂1で封止して半導体装置100を形成する際に、特に切欠き5bの奥側に位置する部分(図9の破線で囲んだ部分)の引っ込み部5e及び引っ込み部5eの周囲においてガスが溜まる場合があった。ガスが溜まることで、モールド樹脂1の流動性が阻害されるので、半導体装置100にモールド樹脂1で封止されない箇所が生じる場合があった。
以上のように、実施の形態2による半導体装置100において、切欠き5bの部分を除いた放熱板5の冷却面5fの外周部に引っ込み部5eが形成されているため、切欠き5bには引っ込み部5eが形成されておらず、モールド樹脂1で封止して半導体装置100を形成する際に切欠き5bの引っ込み部5e及び引っ込み部5eの周囲にガスが溜まらないので、モールド樹脂1の流動性を向上させることができる。モールド樹脂1の流動性が向上するので、半導体装置100にモールド樹脂1で封止されない箇所が生じることを抑制することができる。
実施の形態3.
実施の形態3に係る半導体装置100について説明する。図10は実施の形態3に係る半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aとは反対側の冷却面5fの側から見た図、図11は半導体装置100の放熱板5の外観を示す側面図である。実施の形態3に係る半導体装置100は、引っ込み部5eの形状が実施の形態2とは異なる構成になっている。
引っ込み部5eは、放熱板5の冷却面5fの外周部が放熱板5の素子実装面5aの側に引っ込んだ段差により形成されている。切欠き5bの部分を除いた放熱板5の冷却面5fの外周部に、引っ込み部5eが形成されている。段差は、例えば放熱板5の冷却面5fの外周部を金型で押すことで形成される。実施の形態2に示した面取り部も、本実施の形態で示す段差も同じ製造方法で形成することができる。段差は金型の平面部分で冷却面5fの外周部に対して垂直に押すため、高い寸法精度で形成しやすい。一方、面取り部は金型の斜めの面で冷却面5fの外周部を押すため、寸法精度が低くなる傾向がある。
以上のように、実施の形態3による半導体装置100において、引っ込み部5eが放熱板5の冷却面5fの外周部が放熱板5の素子実装面5aの側に引っ込んだ段差により形成されているため、引っ込み部5eを高い寸法精度で形成することができる。引っ込み部5eが高い寸法精度で形成されるため、放熱板5と冷却器14との間の沿面距離16を安定して確保することができる。沿面距離16が安定して確保されるので、半導体装置100の信頼性を向上させることができる。
実施の形態4.
実施の形態4に係る半導体装置100について説明する。図12は実施の形態4に係る半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aの側から見た図である。実施の形態4に係る半導体装置100は、切欠き5bの奥側に位置する放熱板5の部分の形状が実施の形態3とは異なる構成になっている。
切欠き5bの奥側に位置する放熱板5の部分である奥側部分において、奥側部分における放熱板5の素子実装面5aに、内側に引っ込んだ奥側引っ込み部5gが形成されている。本実施の形態における奥側引っ込み部5gは、奥側部分における切欠き5bの側の面に形成された傾斜面により形成される。傾斜面は、放熱板5の冷却面5fから素子実装面5aに向かうに従って、次第に切欠き5bの側から放熱板5の側に傾斜している。傾斜面の傾斜の角度は図12に示した角度に限るものではなく、例えばさらに浅い角度であっても構わない。また、図13の変形例に示すように、傾斜面が冷却面5fの側から形成されていなくても構わない。図13は実施の形態4に係る半導体装置100の別の放熱板5の外観を示す斜視図で、素子実装面5aの側から見た図である。
以上のように、実施の形態4による半導体装置100において、切欠き5bの奥側に位置する放熱板5の部分である奥側部分において、奥側部分における放熱板5の素子実装面5aに、内側に引っ込んだ奥側引っ込み部5gが形成されているため、図12に示す矢印の方向のモールド樹脂1の流動性を向上させることができる。奥側引っ込み部5gが奥側部分における切欠き5bの側の面に形成された傾斜面により形成され、傾斜面が放熱板5の冷却面5fから素子実装面5aに向かうに従って次第に切欠き5bの側から放熱板5の側に傾斜している場合、モールド樹脂1は傾斜面に沿って流動するので図12に示す矢印の方向のモールド樹脂1の流動性を向上させることができる。
実施の形態5.
実施の形態5に係る半導体装置100について説明する。図14は実施の形態5に係る半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aの側から見た図である。実施の形態5に係る半導体装置100は、奥側引っ込み部5gの形状が実施の形態4とは異なる構成になっている。
奥側引っ込み部5gは、切欠き5bの奥側に位置する奥側部分における放熱板5の素子実装面5aが放熱板5の冷却面5fの側に引っ込んだ段差により形成されている。段差は、放熱板5の切欠き5bの設けられた側面と切欠き5bの設けられた側面の反対側の側面を連通して設けられる。
以上のように、実施の形態5による半導体装置100において、奥側引っ込み部5gが奥側部分における放熱板5の素子実装面5aが放熱板5の冷却面5fの側に引っ込んだ段差により形成されているため、図14に示す矢印の方向のモールド樹脂1を流動させる部分が拡大されるので、矢印の方向のモールド樹脂1の流動性をさらに向上させることができる。
実施の形態6.
実施の形態6に係る半導体装置100について説明する。図15は実施の形態6に係る半導体装置100の放熱板5の外観を示す斜視図で、素子実装面5aの側から見た図である。実施の形態6に係る半導体装置100は、奥側引っ込み部5gの形状が実施の形態5とは異なる構成になっている。
奥側引っ込み部5gは、切欠き5bの奥側に位置する奥側部分における切欠き5bの側の面に形成された傾斜面により形成されると共に、奥側部分における放熱板5の素子実装面5aが放熱板5の冷却面5fの側に引っ込んだ段差により形成されている。段差は、放熱板5の切欠き5bの設けられた側面と切欠き5bの設けられた側面の反対側の側面を連通して設けられる。
以上のように、実施の形態6による半導体装置100において、奥側引っ込み部5gが傾斜面と段差により形成されているため、モールド樹脂1は傾斜面に沿って流動するので図15に示す矢印の方向のモールド樹脂1の流動性を向上し、段差により図15に示す矢印の方向のモールド樹脂1を流動させる部分が拡大されるので、矢印の方向のモールド樹脂1の流動性をさらに向上させることができる。
実施の形態7.
実施の形態7に係る半導体装置200について説明する。図16は実施の形態2に係る半導体装置200の外観を示す上面図、図17はモールド樹脂1を取り除いて半導体装置200の構成の概略を示した平面図、図18は図17から負アームN端子11を取り除いて示した半導体装置200の構成の概略を示す平面図、図19は図18からインナーリード13を取り除いて示した半導体装置200の構成の概略を示す平面図、図20は半導体装置200の外観を示す側面図、図21は半導体装置200の要部を示す側面図で、モールド樹脂1を取り除いて示した図である。図17に示した破線は、モールド樹脂1の外形である。実施の形態7に係る半導体装置200は、複数のスイッチング素子6と放熱板5とゲート端子4bとセンス端子4cとが二組設けられた構成になっている。
<半導体装置200>
半導体装置200は、スイッチング素子6によって構成される正と負のアームを備える。正のアームと負のアームは、直列接続されている。正のアームと負のアームは、モールド樹脂1により一体成形されている。これは一般に2in1モジュールと呼ばれる形態である。本実施の形態では2in1の構造について説明するが、半導体装置200は4in1の構造もしくは6in1の構造であっても構わない。
半導体装置200には、図16に示すように、主端子である正アームP端子10、負アームN端子11及び交流端子12と制御端子4とがモールド樹脂1から外部に露出して設けられる。本実施の形態では、正アームP端子10及び負アームN端子11は同じモールド樹脂1の側面から外部に露出し、交流端子12は正アームP端子10及び負アームN端子11が露出する側面とは反対側の側面から露出する。制御端子4はそれぞれの側面に設けられる。各端子の露出する側面はこれに限るものではない。これらの端子は、外部の機器と接続される端子である。各端子は、図20に示すように、モールド樹脂1の側面の同じ高さから露出している。なお、各端子を設ける高さは、接続される外部の機器の端子配置等に応じて異なる高さに設けても構わない。
半導体装置200は、図19に示すように、複数のスイッチング素子6、放熱板5、ゲート端子4b、及びセンス端子4cを二組備える。図19において、上側が正アーム側で第一組、下側が負アーム側で第二組とする。第一組の放熱板5c及び第二組の放熱板5dは、同一平面上に隣接して配置される。本実施の形態では、第一組の放熱板5c及び第二組の放熱板5dは矩形状に形成され、互いの長辺が対向し、長辺に沿った第二基準線Yに対して第一組の放熱板5c、第二組の放熱板5d、及び複数のスイッチング素子6が線対称に配置される。第一組の放熱板5cにはスイッチング素子6a、6b、6c、6dが接合され、第二組の放熱板5dにはスイッチング素子6e、6f、6g、6hが接合される。第一組の放熱板5cの切欠き5bは、第二組の放熱板5dとは反対側の第一組の放熱板5cの外周部に設けられる。第二組の放熱板5dの切欠き5bは、第一組の放熱板5cとは反対側の第二組の放熱板5dの外周部に設けられる。第一組のゲート端子4b及びセンス端子4cは、第二組の放熱板5dとは反対側に延出している。第二組のゲート端子4b及びセンス端子4cは、第一組の放熱板5cとは反対側に延出している。
ゲート端子4bのそれぞれの第一組の放熱板5c及び第二組の放熱板5dの側の部分が、第一組の放熱板5c及び第二組の放熱板5dの素子実装面5aに垂直な方向に見て、切欠き5bにより切り欠いている領域と重複している。センス端子4cのそれぞれの第一組の放熱板5c及び第二組の放熱板5dの側の部分が、第一組の放熱板5c及び第二組の放熱板5dの素子実装面5aに垂直な方向に見て、切欠き5bにより切り欠いている領域と重複している。
このように構成することで、同一平面上に隣接して配置された第一組の放熱板5c及び第二組の放熱板5dの双方に切欠き5bを形成できるので、ゲート端子4b及びセンス端子4cの延出する方向における半導体装置200の大型化を抑制することができる。また、切欠き5bを有さない放熱板の外周よりも内側にゲート端子4bが配置されるため、半導体装置200の電流経路長は短縮されるので、半導体装置200の回路インダクタンスの増大を抑制することができる。
<インナーリード13>
半導体装置200は、図18に示すように、インナーリード13と第三端子であるセンスソース端子4aを備える。インナーリード13は、第一組の放熱板5cの素子実装面5aに接合されたスイッチング素子6a、6b、6c、6dの第一組の放熱板5cの側とは反対側の面に設けられた電極と、第二組の放熱板5dの素子実装面5aとを接続する。インナーリード13は、本体部分から第二組の放熱板5dとは反対側に延出した延出部13aを有する。センスソース端子4aは、第一組の放熱板5cと離間した状態で、第一組の放熱板5cから離れる方向に延出した端子である。第二組の放熱板5dは、素子実装面5aがスイッチング素子6e、6f、6g、6hの第二組の放熱板5dの側の面に設けられた電極と接合される。センスソース端子4aの第一組の放熱板5cの側の部分と延出部13aは、第一組の放熱板5cの素子実装面5aに垂直な方向に見て、第一組の放熱板5cの切欠き5bの領域にそれぞれ重なって配置され、延出部13aは第三導電体であるボンディング部材のボンディングワイヤ7dを介してセンスソース端子4aに接続されている。第三導電体にボンディング部材を用いた場合、DLBと比較して導電体の断面積を小さく構成できるため、半導体装置100を小型化することができる。
このように構成することで、切欠き5bを有さない放熱板の外周よりも内側にセンスソース端子4a及び延出部13aを配置できるため、センスソース端子4a及び延出部13aの延出する方向における半導体装置200の大型化を抑制することができる。ワイヤボンディング工程において、センスソース端子4a及び延出部13aは切欠き5bの領域で治具により支持できるため、放熱板5とセンスソース端子4a及び延出部13aとの間を支持する必要はない。放熱板5とセンスソース端子4a及び延出部13aとの間を支持する新たな支持部材をワイヤボンディング工程に用いる必要がないので、ワイヤボンディング工程を煩雑化させることはない。また、切欠き5bを有さない放熱板の外周よりも内側にセンスソース端子4aが配置されるため、半導体装置200の電流経路長は短縮されるので、半導体装置200の回路インダクタンスの増大を抑制することができる。
<半導体装置200のアーム構成>
半導体装置200の正と負のアームについて説明する。スイッチング素子6a、6b、6c、6dは、図18に示すように、第一組の放熱板5cとインナーリード13とで並列接続され、正アームを構成する。スイッチング素子6e、6f、6g、6hは、図17に示すように、第二組の放熱板5dと負アームN端子11とで並列接続され、負アームを構成する。負アームN端子11は、第二組の放熱板5dの一方の面に接合されたスイッチング素子6e、6f、6g、6hの第二組の放熱板5dの側とは反対側の面に設けられた電極と接続され、隙間を空けてインナーリード13に重ねて配置される。正アームP端子10は一方の側が正アームの第一組の放熱板5cの素子実装面5aに接合され、他方の側がモールド樹脂1の外部に露出して外部で他の機器と接続される。交流端子12は一方の側が負アームの第二組の放熱板5dの素子実装面5aに接合され、他方の側がモールド樹脂1の外部に露出して外部で他の機器と接続される。負アームのドレイン電位となる第二組の放熱板5dは、インナーリード13と接続されることで、正アームのソース電位と接続される。インナーリード13は、正アームと負アームとを接続する。インナーリード13と負アームN端子11は2層で構成されている。
半導体装置200の製造工程において、図16に示すモールド樹脂1から外部に露出した各端子は同じリードフレームに支持されている。リードフレームに各端子が支持された状態でモールド樹脂1により封止された後、リードフレームから各端子は分断される。この工程は、半導体装置を製造する一般的な製造工程である。封止工程において、リードフレームは樹脂成形金型の上型と下型で挟持される。
本実施の形態では、インナーリード13と負アームN端子11を2層で構成している。2層の構成では、これらと樹脂成形金型との干渉を避けるために、インナーリード13はモールド樹脂1の内部に配置される。そのため、正アームに係るセンスソース端子4aは、スイッチング素子6a、6b、6c、6dのソース電位と同電位であるが、インナーリード13とは分断されている必要がある。よって、インナーリード13と正アームに係るセンスソース端子4aは別に設けて、ボンディングワイヤ7dにより接続する構成としている。
<貫通孔11a、13b>
インナーリード13と負アームN端子11とは、図21に示すように、第一組の放熱板5cと第二組の放熱板5dとの間の隙間の部分(図21において破線で囲まれた部分)に連通する貫通孔を有している。インナーリード13の貫通孔13bと負アームN端子11の貫通孔11aは、素子実装面5aに垂直な方向に見て、重なって配置される。インナーリード13と負アームN端子11とが重なって配置されているため、貫通孔11a、13bを有さない場合、第一組の放熱板5cと第二組の放熱板5dとの間の隙間の部分に流れ込んだモールド樹脂1がインナーリード13と負アームN端子11との間の隙間には流れ込みにくかった。貫通孔11a、13bを有した構成とすることで、インナーリード13と負アームN端子11との間の隙間にも図21の矢印で示すように容易にモールド樹脂1を流動させることができる。インナーリード13と負アームN端子11との間の隙間にモールド樹脂1が設けられるので、インナーリード13と負アームN端子11の絶縁性を向上させることができる。インナーリード13と負アームN端子11の絶縁性が向上するので、半導体装置200の信頼性を向上させることができる。本実施の形態では、図17に示すように、半導体装置200が2つの貫通孔を備える構成としたが、貫通孔の個数はこれに限るものではなく、さらに多くの貫通孔を備えた構成でも構わない。
以上のように、実施の形態7による半導体装置200において、複数のスイッチング素子6、放熱板5、ゲート端子4b、及びセンス端子4cを二組備え、第一組の放熱板5c及び第二組の放熱板5dは同一平面上に隣接して配置され、第一組の放熱板5cの切欠き5bは第二組の放熱板5dとは反対側の第一組の放熱板5cの外周部に設けられ、第二組の放熱板5dの切欠き5bは第一組の放熱板5cとは反対側の第二組の放熱板5dの外周部に設けられ、第一組のゲート端子4b及びセンス端子4cは第二組の放熱板5dとは反対側に延出し、第二組のゲート端子4b及びセンス端子4cは第一組の放熱板5cとは反対側に延出しているため、同一平面上に隣接して配置された第一組の放熱板5c及び第二組の放熱板5dの双方に切欠き5bを形成できるので、ゲート端子4b及びセンス端子4cの延出する方向における半導体装置200の大型化を抑制することができる。
インナーリード13と負アームN端子11とが第一組の放熱板5cと第二組の放熱板5dとの間の隙間の部分に連通する貫通孔を有しているため、インナーリード13と負アームN端子11との間の隙間にも容易にモールド樹脂1を流動させることができるので、インナーリード13と負アームN端子11の絶縁性を向上させることができる。また、インナーリード13と負アームN端子11の絶縁性が向上するので、半導体装置200の信頼性を向上させることができる。
また本願は、様々な例示的な実施の形態及び実施例が記載されているが、1つ、または複数の実施の形態に記載された様々な特徴、態様、及び機能は特定の実施の形態の適用に限られるのではなく、単独で、または様々な組み合わせで実施の形態に適用可能である。
従って、例示されていない無数の変形例が、本願明細書に開示される技術の範囲内において想定される。例えば、少なくとも1つの構成要素を変形する場合、追加する場合または省略する場合、さらには、少なくとも1つの構成要素を抽出し、他の実施の形態の構成要素と組み合わせる場合が含まれるものとする。
1 モールド樹脂、2 P端子、3 N端子、4 制御端子、4a センスソース端子、4b ゲート端子、4c センス端子、5 放熱板、5a 素子実装面、5b 切欠き、5c 第一組の放熱板、5d 第二組の放熱板、5e 引っ込み部、5f 冷却面、5g 奥側引っ込み部、6 スイッチング素子、7a ボンディングワイヤ、7b ボンディングワイヤ、7c ボンディングワイヤ、7d ボンディングワイヤ、8 センス素子、9 ゲート電極、10 正アームP端子、11 負アームN端子、11a 貫通孔、12 交流端子、13 インナーリード、13a 延出部、13b 貫通孔、14 冷却器、15 絶縁板、16 沿面距離、16a 水平距離、16b 水平距離、100 半導体装置、200 半導体装置、300 半導体装置、500 半導体モジュール、600 半導体モジュール、X 第一基準線、Y 第二基準線

Claims (9)

  1. 板状に形成された放熱板と、
    前記放熱板の一方の面に接合された複数のスイッチング素子と、
    前記放熱板と離間した状態で、前記放熱板から離れる方向に延出した端子であって、第一導電体を介して、複数の前記スイッチング素子における前記放熱板の側とは反対側の面と接続された第一端子と、
    複数の前記スイッチング素子、前記放熱板、及び前記第一端子を封止する封止部材と、を備え、
    前記放熱板の外周部には、切欠きが設けられ、
    前記第一端子の前記放熱板の側の部分が、前記放熱板の一方の面に垂直な方向に見て、前記切欠きにより切り欠いている領域と重複し、
    前記放熱板の他方の面の外周部に、内側に引っ込んだ引っ込み部が形成されている半導体装置。
  2. 前記引っ込み部は、面取り部である請求項1に記載の半導体装置。
  3. 前記引っ込み部は、前記放熱板の他方の面の外周部が前記放熱板の一方の面の側に引っ込んだ段差により形成されている請求項1に記載の半導体装置。
  4. 前記切欠きの部分を除いた前記放熱板の他方の面の外周部に、前記引っ込み部が形成されている請求項1から3のいずれか1項に記載の半導体装置。
  5. 前記切欠きの奥側に位置する前記放熱板の部分である奥側部分において、前記奥側部分における前記放熱板の一方の面に、内側に引っ込んだ奥側引っ込み部が形成されている請求項4に記載の半導体装置。
  6. 前記奥側引っ込み部は、前記奥側部分における前記切欠きの側の面に形成された傾斜面により形成され、前記傾斜面は、前記放熱板の他方の面から一方の面に向かうに従って、次第に切欠きの側から放熱板の側に傾斜している請求項5に記載の半導体装置。
  7. 前記奥側引っ込み部は、前記奥側部分における前記放熱板の一方の面が、前記放熱板の他方の面の側に引っ込んだ段差により形成されている請求項5または6に記載の半導体装置。
  8. 複数の前記スイッチング素子と、前記放熱板と、前記第一端子と、が二組設けられ、
    第一組の放熱板及び第二組の放熱板は、同一平面上に隣接して配置され、
    前記第一組の放熱板の前記切欠きは、前記第二組の放熱板とは反対側の前記第一組の放熱板の外周部に設けられ、
    前記第二組の放熱板の前記切欠きは、前記第一組の放熱板とは反対側の前記第二組の放熱板の外周部に設けられ、
    第一組の前記第一端子は、前記第二組の放熱板とは反対側に延出し、
    第二組の前記第一端子は、前記第一組の放熱板とは反対側に延出し、
    前記第一組の放熱板の一方の面に接合された前記スイッチング素子の前記放熱板の側とは反対側の面に設けられた電極と、前記第二組の放熱板の一方の面とを接続したインナーリードと、
    前記第二組の放熱板の一方の面に接合された前記スイッチング素子の前記放熱板の側とは反対側の面に設けられた電極と接続され、隙間を空けて前記インナーリードに重ねて配置された負アームN端子と、を備え、
    前記インナーリードと前記負アームN端子とは、第一組の放熱板と第二組の放熱板との間の隙間の部分に連通する貫通孔を有している請求項1から7のいずれか1項に記載の半導体装置。
  9. 請求項1から8のいずれか1項に記載の前記半導体装置と、
    前記引っ込み部を除いた前記放熱板の他方の端面に当接した板状の絶縁部材と、を備えた半導体モジュール。
JP2021066882A 2021-04-12 2021-04-12 半導体装置及びそれを用いた半導体モジュール Active JP7118205B1 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2021066882A JP7118205B1 (ja) 2021-04-12 2021-04-12 半導体装置及びそれを用いた半導体モジュール
US17/506,286 US11694948B2 (en) 2021-04-12 2021-10-20 Semiconductor device and semiconductor module using same
CN202210319498.2A CN115206905A (zh) 2021-04-12 2022-03-29 半导体装置和使用该半导体装置的半导体模块

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2021066882A JP7118205B1 (ja) 2021-04-12 2021-04-12 半導体装置及びそれを用いた半導体モジュール

Publications (2)

Publication Number Publication Date
JP7118205B1 JP7118205B1 (ja) 2022-08-15
JP2022162192A true JP2022162192A (ja) 2022-10-24

Family

ID=82847603

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2021066882A Active JP7118205B1 (ja) 2021-04-12 2021-04-12 半導体装置及びそれを用いた半導体モジュール

Country Status (3)

Country Link
US (1) US11694948B2 (ja)
JP (1) JP7118205B1 (ja)
CN (1) CN115206905A (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7118204B1 (ja) * 2021-04-12 2022-08-15 三菱電機株式会社 半導体装置

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006216641A (ja) * 2005-02-02 2006-08-17 Toyota Motor Corp 半導体モジュール
JP2009224560A (ja) * 2008-03-17 2009-10-01 Denso Corp 半導体装置およびその製造方法
JP2012147040A (ja) * 2012-05-11 2012-08-02 Renesas Electronics Corp 電子装置
JP2012178504A (ja) * 2011-02-28 2012-09-13 Rohm Co Ltd 半導体装置、および、半導体装置の実装構造
WO2013099545A1 (ja) * 2011-12-26 2013-07-04 三菱電機株式会社 電力用半導体装置及びその製造方法
JP2014207490A (ja) * 2014-08-08 2014-10-30 富士電機株式会社 絶縁基板、その製造方法、半導体モジュールおよび半導体装置

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6252293B2 (ja) 2014-03-26 2017-12-27 株式会社デンソー 半導体装置
JP6344215B2 (ja) * 2014-11-21 2018-06-20 株式会社デンソー 半導体装置及びパワーモジュール
WO2016174697A1 (ja) * 2015-04-28 2016-11-03 新電元工業株式会社 半導体モジュール及び半導体モジュールの製造方法

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006216641A (ja) * 2005-02-02 2006-08-17 Toyota Motor Corp 半導体モジュール
JP2009224560A (ja) * 2008-03-17 2009-10-01 Denso Corp 半導体装置およびその製造方法
JP2012178504A (ja) * 2011-02-28 2012-09-13 Rohm Co Ltd 半導体装置、および、半導体装置の実装構造
WO2013099545A1 (ja) * 2011-12-26 2013-07-04 三菱電機株式会社 電力用半導体装置及びその製造方法
JP2012147040A (ja) * 2012-05-11 2012-08-02 Renesas Electronics Corp 電子装置
JP2014207490A (ja) * 2014-08-08 2014-10-30 富士電機株式会社 絶縁基板、その製造方法、半導体モジュールおよび半導体装置

Also Published As

Publication number Publication date
US20220328384A1 (en) 2022-10-13
CN115206905A (zh) 2022-10-18
US11694948B2 (en) 2023-07-04
JP7118205B1 (ja) 2022-08-15

Similar Documents

Publication Publication Date Title
CN106952897B (zh) 半导体装置及其制造方法
CN108735692B (zh) 半导体装置
US10217690B2 (en) Semiconductor module that have multiple paths for heat dissipation
US9159715B2 (en) Miniaturized semiconductor device
US9385107B2 (en) Multichip device including a substrate
US11876028B2 (en) Package with electrically insulated carrier and at least one step on encapsulant
JP2010034350A (ja) 半導体装置
JP5734216B2 (ja) 電力用半導体装置および電力用半導体装置の製造方法
JP7379886B2 (ja) 半導体装置
JP2017054842A (ja) 配線基板、半導体装置、及び半導体パッケージ
US11735557B2 (en) Power module of double-faced cooling
JP2021125545A (ja) 半導体モジュール及び半導体モジュールの製造方法
JP7118205B1 (ja) 半導体装置及びそれを用いた半導体モジュール
JP2012142466A (ja) 半導体装置
JP2017112131A (ja) 半導体モジュールおよび半導体装置
CN111354710B (zh) 半导体装置及其制造方法
JP2017054855A (ja) 半導体装置、及び半導体パッケージ
US20230260861A1 (en) Semiconductor packages with increased power handling
JP7512659B2 (ja) 半導体モジュール及び半導体モジュールの製造方法
JP7118204B1 (ja) 半導体装置
JP7392319B2 (ja) 半導体装置
JP7147186B2 (ja) 半導体装置
JP5724415B2 (ja) 半導体モジュール
JP7278439B1 (ja) 半導体装置及びそれを用いた電力変換装置
US20240014106A1 (en) Semiconductor device

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20210412

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20220705

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20220802

R151 Written notification of patent or utility model registration

Ref document number: 7118205

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151