JP2018060484A - 演算装置および制御装置 - Google Patents
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Abstract
Description
本発明の別の局面に従う制御装置は、演算装置と、1または複数の機能ユニットとを含む。演算装置は、通信線を介して1または複数の機能ユニットとデータを遣り取りするための通信回路と、通信線を介してデータを送信または受信するための第1要求を予め定められた周期毎に発行するための第1処理と、予め定められた条件が満たされたときに通信線を介してデータを送信するための第2要求を発行する第2処理とを実行するプロセッサと、プロセッサにより発行される第1要求および第2要求に応答して、通信回路を起動する制御回路とを含む。制御回路は、第1処理の実行周期に対応付けて、第2要求を無効化する禁止期間を設定する手段を含む。
まず、本実施の形態に係るPLCの装置構成について説明する。図1は、本実施の形態に係るPLCの要部構成を示す模式図である。
次に、ローカルネットワーク126上を転送されるいくつかの通信フレームについて説明する。
次に、図2に示すような通信フレームの送信に係る構成を説明する。図3は、本実施の形態に係るPLC1において通信フレームの送信処理を実現するための装置構成を示す模式図である。
次に、プロセッサ102と通信回路120とを仲介する制御回路110に関する関連技術について説明する。
本実施の形態に係るPLC1においては、I/Oリフレッシュフレーム180の送信周期(すなわち、I/Oリフレッシュ処理210の実行周期)に対応付けて、イベントフレーム送信要求(第2要求)を無効化する禁止期間を設定する。このような禁止期間は、プロセッサ102とは独立した制御回路110によって設定される。これにより、プロセッサ102でのプログラム実行において生じる時間ゆらぎの影響を受けることなく、I/Oリフレッシュフレーム180の送信周期を保証できる。
次に、図5に示す禁止期間200を設定する方法の一例について説明する。図7は、本実施の形態に係るPLC1における禁止期間の設定方法を説明するための模式図である。
次に、プロセッサ102において実行される処理に対して、制御回路110が設定する禁止期間200の通知について説明する。
上述の実施の形態においては、プロセッサ102と制御回路110との組合せによって、通信回路120による通信フレームの送信処理を制御する構成について例示したが、プロセッサ102および制御回路110を2つのプロセッサまたはコアで実現してもよい。
上述においては、CPUユニット100とローカルネットワーク126を介して接続された1または複数の機能ユニット150に対して、通信フレーム(I/Oリフレッシュフレーム180およびイベントフレーム190)を送信する構成について主として説明した。しかしながら、フィールドネットワークを介して接続される1または複数の機能ユニット150に対しても、同様のスキームを適用可能である。
本実施の形態に係るPLC1においては、I/Oリフレッシュフレームの送信周期(すなわち、I/Oリフレッシュ処理の実行周期)に対応付けて、I/Oリフレッシュフレーム以外の通信フレームの送信を禁止する禁止期間を設定する。このような禁止期間は、プロセッサ102とは独立した制御回路110によって設定される。これにより、プロセッサ102でのプログラム実行において生じる時間ゆらぎの影響を受けることなく、I/Oリフレッシュフレームの送信周期を保証できる。
Claims (8)
- 制御装置を構成する演算装置であって、
通信線を介して1または複数の機能ユニットとデータを遣り取りするための通信回路と、
前記通信線を介してデータを送信または受信するための第1要求を予め定められた周期毎に発行するための第1処理と、予め定められた条件が満たされたときに前記通信線を介してデータを送信するための第2要求を発行する第2処理とを実行するプロセッサと、
前記プロセッサにより発行される前記第1要求および前記第2要求に応答して、前記通信回路を起動する制御回路とを備え、
前記制御回路は、前記第1処理の実行周期に対応付けて、前記第2要求を無効化する禁止期間を設定する手段を備える、演算装置。 - 前記制御回路は、前記禁止期間内に前記第2要求を受信すると、当該受信した第2要求に応じた前記通信回路の起動を、当該禁止期間の終了後まで延期する、請求項1に記載の演算装置。
- 前記制御回路は、前記第1処理の実行タイミングより予め定められた時間だけ前もって前記禁止期間を開始する、請求項1または2に記載の演算装置。
- 前記制御回路は、前記プロセッサでの前記第1処理および前記第2処理の実行を管理するスケジューラから、前記第1処理の実行タイミングを取得して、前記禁止期間を設定する、請求項1〜3のいずれか1項に記載の演算装置。
- 前記第1要求は、前記1または複数の機能ユニットへデータを送信するための要求、および、前記1または複数の機能ユニットが保持しているデータを取得するための要求、のうち少なくとも一方を含む、請求項1〜4のいずれか1項に記載の演算装置。
- 前記第1要求は、前記1または複数の機能ユニットのうち、特定の機能ユニットへメッセージを送信するための要求を含む、請求項1〜5のいずれか1項に記載の演算装置。
- 前記制御回路は、FPGAまたはASICを用いて実装される、請求項1〜6のいずれか1項に記載の演算装置。
- 制御装置であって、
演算装置と、
1または複数の機能ユニットとを備え、
前記演算装置は、
通信線を介して前記1または複数の機能ユニットとデータを遣り取りするための通信回路と、
前記通信線を介してデータを送信または受信するための第1要求を予め定められた周期毎に発行するための第1処理と、予め定められた条件が満たされたときに前記通信線を介してデータを送信するための第2要求を発行する第2処理とを実行するプロセッサと、
前記プロセッサにより発行される前記第1要求および前記第2要求に応答して、前記通信回路を起動する制御回路とを備え、
前記制御回路は、前記第1処理の実行周期に対応付けて、前記第2要求を無効化する禁止期間を設定する手段を備える、制御装置。
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A912 | Re-examination (zenchi) completed and case transferred to appeal board |
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C211 | Notice of termination of reconsideration by examiners before appeal proceedings |
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C22 | Notice of designation (change) of administrative judge |
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C13 | Notice of reasons for refusal |
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A521 | Request for written amendment filed |
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C23 | Notice of termination of proceedings |
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C03 | Trial/appeal decision taken |
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C30A | Notification sent |
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