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Abstract
Description
図1に、本発明の一態様に係る表示装置10の構成例をブロック図で示す。図1に示す表示装置10は、コントローラ11と、表示部12とを有する。コントローラ11は、イメージプロセッサ13と、メモリ14とを有する。また、表示部12は、駆動回路15と、画素部16とを有する。
次いで、図10に、本発明の一態様に係る表示装置10のより詳細な構成の一例を示す。具体的に、図10には、表示装置10に加えて、入力装置109と、ホスト185とを図示している。入力装置109は、表示部12の動作を制御する信号を表示装置10に供給する機能を有する。入力装置109またはホスト185は、表示装置10に含まれていても良い。
本実施の形態では、本発明の一態様に係る表示装置10が有する、ソースドライバ21の構成の一例について説明する。図11に、ソースドライバ21の構成例をブロック図で示す。
本実施の形態では、反射型表示素子と発光型表示素子とを用いた表示装置が有する、画素の構成例について説明する。なお、本実施の形態では、反射型表示素子として液晶素子を用い、発光型表示素子としてEL材料を用いた発光素子を用いる場合を例に挙げて、本発明の一態様に係る画素17の構成例について説明する。
トランジスタ67は、ゲート(フロントゲート)が配線MLに電気的に接続され、バックゲートが配線GLに電気的に接続され、ソース又はドレインの一方が配線MLに電気的に接続され、ソース又はドレインの他方が発光素子61に電気的に接続されている。容量素子66は、一方の電極が配線ALに電気的に接続され、他方の電極がトランジスタ64のゲートに電気的に接続されている。
次いで、本実施の形態では、反射型表示素子と発光型表示素子とを用いた表示装置の構成例について説明する。なお、本実施の形態では、反射型表示素子として液晶素子を用い、発光型表示素子としてEL材料を用いた発光素子を用いる場合を例に挙げて、表示装置の構成例について説明する。
次いで、図19に、本発明の一態様に係る表示装置10の、外観の一例を示す。図19に示す表示装置10は、基板500上に画素部501と、ゲートドライバ502と、ゲートドライバ503とを有する。
次いで、図1に示す表示装置10が有するメモリ14の構成例について説明する。
図23に、本発明の一態様に係る表示装置を用いた電子機器の具体例を示す。
11 コントローラ
12 表示部
13 イメージプロセッサ
14 メモリ
15 駆動回路
16 画素部
17 画素
18 サブ画素
19 サブ画素
19a サブ画素
19b サブ画素
19c サブ画素
19d サブ画素
19g サブ画素
19r サブ画素
19w サブ画素
20 ゲートドライバ
21 ソースドライバ
30 SDC
32 D−LAT
33 LS
34 PTL
35 AMP
50 メモリセル
51 セルアレイ
52 センスアンプ
53 カラムデコーダ
54 トランジスタ
55 容量素子
56 トランジスタ
60 液晶素子
61 発光素子
62 トランジスタ
63 容量素子
64 トランジスタ
65 トランジスタ
66 容量素子
66a 容量素子
66b 容量素子
67 トランジスタ
109 入力装置
143 光センサ
144 開閉センサ
146 加速度センサ
150 インターフェース
152 デコーダ
153 センサコントローラ
154 信号コントローラ
155 クロック生成回路
160 画像処理部
170 メモリ
171 AP
173 タイミングコントローラ
175 レジスタ
181 タッチパネル
182 キーボード
183 ポインティングデバイス
185 ホスト
201 基板
202 基板
203 発光素子
204 液晶素子
205 トランジスタ
206 トランジスタ
207 画素電極
208 共通電極
209 液晶層
210 層
210a 層
210b 層
250 基板
251 基板
300 導電層
301 絶縁層
302 液晶層
303 絶縁層
304a 導電層
304b 導電層
305 絶縁層
306 導電層
307 絶縁層
308 導電層
309 導電層
310 導電層
311 絶縁層
312 半導体層
313 半導体層
314 導電層
315 導電層
316 導電層
317 導電層
319 絶縁層
320 半導体層
321 導電層
322 導電層
323 絶縁層
324 絶縁層
325 導電層
326 樹脂層
327 絶縁層
328 導電層
329 EL層
330 導電層
331 樹脂層
333 絶縁層
334 封止層
500 基板
501 画素部
502 ゲートドライバ
503 ゲートドライバ
504 IC
505 IC
506 配線
508 FPC
509 FPC
510 FPC
511 配線
512 配線
513 画素
514w 表示領域
515b 表示領域
515g 表示領域
515r 表示領域
515y 表示領域
560 単結晶シリコンウエハ
561 CMOS層
562 トランジスタ層
563 ゲート
565 電極
5001 筐体
5002 筐体
5003 表示装置
5004 表示装置
5005 マイクロホン
5006 スピーカ
5007 操作キー
5008 スタイラス
5201 筐体
5202 表示装置
5203 ベルト
5204 光センサ
5205 スイッチ
5301 筐体
5302 筐体
5303 表示装置
5304 光センサ
5305 光センサ
5306 スイッチ
5307 ヒンジ
5701 筐体
5702 表示装置
5801 筐体
5802 筐体
5803 表示装置
5804 操作キー
5805 レンズ
5806 接続部
5901 筐体
5902 表示装置
5903 カメラ
5904 スピーカ
5905 ボタン
5906 外部接続部
5907 マイク
Claims (2)
- コントローラとソースドライバと画素部とを有し、
前記画素部は、第1の画素と第2の画素とを有し、
前記第1の画素は、第1のサブ画素と第2のサブ画素とを有し、
前記第2の画素は、第3のサブ画素と第4のサブ画素とを有し、
前記第1のサブ画素と前記第3のサブ画素とは、第1ラインに含まれ、
前記第2のサブ画素と前記第4のサブ画素とは、第2ラインに含まれ、
前記コントローラは、1フレーム分の前記第1の画像信号と、1フレーム分の前記第2の画像信号とを、前記第1の画素と前記第2の画素との配列順に合わせて並び替えることで、第3の画像信号を生成する機能を有し、
前記コントローラは、前記第3の画像信号を、前記第1のサブ画素と前記第2のサブ画素と前記第3のサブ画素と前記第4のサブ画素との配列順に合わせて並び替えることで、第4の画像信号を生成する機能を有し、
前記ソースドライバは、前記第4の画像信号を前記第1のサブ画素と前記第2のサブ画素と前記第3のサブ画素と前記第4のサブ画素とに供給する機能を有し、
前記第1のサブ画素または前記第2のサブ画素の一方は、液晶素子を有し、
前記第1のサブ画素または前記第2のサブ画素の他方は、発光素子を有し、
前記第3のサブ画素または前記第4のサブ画素の一方は、液晶素子を有し、
前記第3のサブ画素または前記第4のサブ画素の他方は、発光素子を有する表示装置。 - 請求項1において、
前記第4の画像信号が、前記第1のサブ画素に対応する電位の極性の情報と、前記第2のサブ画素に対応する電位の極性の情報と、前記第3のサブ画素に対応する電位の極性の情報と、前記第4のサブ画素に対応する電位の極性の情報と、を有しており、
前記ソースドライバは、前記第1のサブ画素に対応する電位の極性の情報と、前記第2のサブ画素に対応する電位の極性の情報と、前記第3のサブ画素に対応する電位の極性の情報と、前記第4のサブ画素に対応する電位の極性の情報と、を用いて前記第4の画像信号をデジタルからアナログに変換する機能を有する表示装置。
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