JP2017225050A - 二重系制御システム - Google Patents
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- 第一の制御システムと、第二の制御システムとを有し、前記第一の制御システムと前記第二の制御システムがそれぞれ第一の通信ケーブルと第二の通信ケーブルで接続され、前記第一の制御システムと前記第二の制御システムとの間でクロック信号に同期して通信を行う二重系制御システムであって、
前記第一の制御システムは、
第一の送信部から送信される第一のデジタルデータを第一の送信用フォトカプラを含む第一の送信用伝送要素群を介して前記第一の通信ケーブルに送信する第一の送信用伝送系と、前記第二の通信ケーブルから伝送された第二のデジタルデータを第一の受信用フォトカプラを含む第一の受信用伝送要素群を介して受信する第一の受信用伝送系と、前記第一のデジタルデータが送信されるタイミングと前記第二のデジタルデータを受信するタイミングとの差分から第一の遅延時間を測定し、前記測定した第一の遅延時間を測定手段に転送する第一の遅延測定回路と、を備え、
前記第二の制御システムは、
第二の送信部から送信される第二のデジタルデータを第二の送信用フォトカプラを含む第二の送信用伝送要素群を介して前記第二の通信ケーブルに送信する第二の送信用伝送系と、前記第一の通信ケーブルから伝送された前記第一のデジタルデータを第二の受信用フォトカプラを含む第二の受信用伝送要素群を介して受信する第二の受信用伝送系と、前記第二のデジタルデータが送信されるタイミングと前記第一のデジタルデータを受信するタイミングとの差分から第二の遅延時間を測定し、前記測定した第二の遅延時間を前記測定手段に転送する第二の遅延測定回路と、を備え、
前記測定手段は、
前記第一の遅延測定回路から転送された前記第一の遅延時間と基準値とを比較し、当該比較結果から前記第一の送信用伝送系と前記第二の受信用伝送系を含む第一の送受信用伝送系の故障の有無を判定し、
前記第二の遅延測定回路から転送された前記第二の遅延時間と前記基準値とを比較し、当該比較結果から前記第二の送信用伝送系と前記第一の受信用伝送系を含む第二の送受信用伝送系の故障の有無を判定することを特徴とする二重系制御システム。 - 請求項1に記載の二重系制御システムであって、
前記第一の遅延測定回路は、
前記第一の送信部から送信される前記第一のデジタルデータのフレームフォーマットの特定のエッジと、前記第一の受信用伝送要素群を介して受信した前記第二のデジタルデータのフレームフォーマットの特定のエッジをそれぞれ抽出し、前記各抽出した特定のエッジの間隔を前記第一の遅延時間として測定し、
前記第二の遅延測定回路は、
前記第二の送信部から送信される前記第二のデジタルデータのフレームフォーマットの特定のエッジと、前記第二の受信用伝送要素群を介して受信した前記第一のデジタルデータのフレームフォーマットの特定のエッジをそれぞれ抽出し、前記各抽出した特定のエッジの間隔を前記第二の遅延時間として測定することを特徴とする二重系制御システム。 - 請求項1に記載の二重系制御システムであって、
前記第一の遅延測定回路は、
前記第一の送信部から送信される前記第一のデジタルデータのフレームフォーマット先頭の立上がりエッジと、前記第一の受信用伝送要素群を介して受信した前記第二のデジタルデータのフレームフォーマット先頭の立上がりエッジをそれぞれ抽出し、前記各抽出した立上がりエッジの間隔を前記第一の遅延時間として測定し、
前記第二の遅延測定回路は、
前記第二の送信部から送信される前記第二のデジタルデータのフレームフォーマット先頭の立上がりエッジと、前記第二の受信用伝送要素群を介して受信した前記第一のデジタルデータのフレームフォーマット先頭の立上がりエッジをそれぞれ抽出し、前記各抽出した立上がりエッジの間隔を前記第二の遅延時間として測定することを特徴とする二重系制御システム。 - 請求項1に記載の二重系制御システムであって、
前記第一の遅延測定回路は、
前記第一の送信部から送信される前記第一のデジタルデータのフレームフォーマット先頭の立下がりエッジと、前記第一の受信用伝送要素群を介して受信した前記第二のデジタルデータのフレームフォーマット先頭の立下がりエッジをそれぞれ抽出し、前記各抽出した立下がりエッジの間隔を前記第一の遅延時間として測定し、
前記第二の遅延測定回路は、
前記第二の送信部から送信される前記第二のデジタルデータのフレームフォーマット先頭の立下がりエッジと、前記第二の受信用伝送要素群を介して受信した前記第一のデジタルデータのフレームフォーマット先頭の立下がりエッジをそれぞれ抽出し、前記各抽出した立下がりエッジの間隔を前記第二の遅延時間として測定することを特徴とする二重系制御システム。 - 請求項1に記載の二重系制御システムであって、
前記測定手段は、
前記第一の送信用フォトカプラと前記第二の送信用フォトカプラと前記第一の受信用フォトカプラ及び前記第二の受信用フォトカプラの劣化状態を規定した時間に関連づけて前記基準値を設定し、前記第一の遅延時間が前記基準値以下の場合、前記第二の送信用フォトカプラ又は前記第一の受信用フォトカプラの故障と判定し、前記第二の遅延時間が前記基準値以下の場合、前記第一の送信用フォトカプラ又は前記第二の受信用フォトカプラの故障と判定することを特徴とする二重系制御システム。 - 請求項3に記載の二重系制御システムであって、
前記第一の遅延測定回路は、
前記第一の送信部から送信される前記第一のデジタルデータのフレームフォーマット先頭の立上がりエッジを検出したときに検出信号を出力する第一の送信データエッジ検出回路と、前記第一の受信用伝送要素群を介して受信した前記第二のデジタルデータのフレームフォーマット先頭の立上がりエッジを検出したときに検出信号を出力する第一の受信データエッジ検出回路と、前記第一の送信データエッジ検出回路からの検出信号でカウントを開始し、前記第一の受信データエッジ検出回路からの検出信号で前記カウントを停止し、前記カウントの開始から前記カウントの停止までのカウント値を前記第一の遅延時間として測定する第一のカウンタと、前記第一のカウンタにより測定された前記第一の遅延時間を保持し、前記保持した第一の遅延時間を前記測定手段に転送する第一のカウント値保持回路とから構成され、
前記第二の遅延測定回路は、
前記第二の送信部から送信される前記第二のデジタルデータのフレームフォーマット先頭の立上がりエッジを検出したときに検出信号を出力する第二の送信データエッジ検出回路と、前記第二の受信用伝送要素群を介して受信した前記第一のデジタルデータのフレームフォーマット先頭の立上がりエッジを検出したときに検出信号を出力する第二の受信データエッジ検出回路と、前記第二の送信データエッジ検出回路からの検出信号でカウントを開始し、前記第二の受信データエッジ検出回路からの検出信号で前記カウントを停止し、前記カウントの開始から前記カウントの停止までのカウント値を前記第二の遅延時間として測定する第二のカウンタと、前記第二のカウンタにより測定された前記第二の遅延時間を保持し、前記保持した第二の遅延時間を前記測定手段に転送する第二のカウント値保持回路とから構成されることを特徴とする二重系制御システム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016120295A JP6571593B2 (ja) | 2016-06-16 | 2016-06-16 | 二重系制御システム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2016120295A JP6571593B2 (ja) | 2016-06-16 | 2016-06-16 | 二重系制御システム |
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JP2017225050A true JP2017225050A (ja) | 2017-12-21 |
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ID=60688579
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2016120295A Active JP6571593B2 (ja) | 2016-06-16 | 2016-06-16 | 二重系制御システム |
Country Status (1)
Country | Link |
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JP (1) | JP6571593B2 (ja) |
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2016
- 2016-06-16 JP JP2016120295A patent/JP6571593B2/ja active Active
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JP6571593B2 (ja) | 2019-09-04 |
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