JP2015502688A - 広帯域信号の処理 - Google Patents
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Abstract
Description
Claims (23)
- 広帯域信号を処理する回路であって、
第一段および第二段を備え、
前記第一段が、
入力信号を受け取る第1の加算器回路と、
この加算器回路の出力を受け取る第1の複数の積分器ラインとを含み、
当該第1の複数の積分器ラインの各積分器ラインが、少なくとも1つの積分器回路を有しており、前記第1の加算器回路は、前記第1の複数の積分器ラインの各積分器ラインの出力を受け取り、
前記第二段が、
前記第1の加算器回路の前記出力を受け取る第2の複数の積分器ラインであって、前記第2の複数の積分器ラインの各積分器ラインが、少なくとも1つの積分器回路を有する、第2の複数の積分器ラインと、
前記第2の複数の積分器ラインの各積分器ラインの出力を受け取る第2の加算器回路とを含み、
前記第2の加算器回路は、さらに、出力信号を出力する、広帯域信号処理回路。 - 請求項1の広帯域信号処理回路において、前記第二段が、さらに、前記第1の加算器回路の前記出力を前記第2の加算器回路の入力に選択的に接続するスイッチを含む、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第1および前記第2の複数の積分器ラインの前記少なくとも1つの積分器回路が、調節可能なゲインを有する、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第1の複数の積分器ラインと前記第2の複数の積分器ラインのそれぞれが、調節可能なゲインを有する複数の積分器回路を有する、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第1および前記第2の複数の積分器ラインのうちの少なくとも1つの積分器ラインが、複数の積分器回路を有する、広帯域信号処理回路。
- 請求項5に記載の広帯域信号処理回路において、前記複数の積分器回路のうちの少なくとも1つの積分器回路が、調節可能なゲインを有する、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第1の複数の積分器ラインが、共通の入力ノードに接続されている、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第2の複数の積分器ラインが、共通の入力ノードに接続されている、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第1の複数の積分器ラインの各積分器ラインの前記出力が、前記第1の加算器回路において反転される、広帯域信号処理回路。
- 請求項1に記載の広帯域信号処理回路において、前記第2の複数の積分器ラインの各積分器ラインの前記出力が、前記第2の加算器回路において選択的に反転される、広帯域信号処理回路。
- 広帯域信号を処理する回路であって、
第一段および第二段を備え、
前記第一段が、
入力信号を受け取る第1の加算器回路と、
この加算器回路の出力を受け取る第1の積分器ラインであって、少なくとも1つの積分器回路を有する、第1の積分器ラインと、
この第1の積分器ラインに入力が結合した第1のロスパッドとを含み、
前記第1の加算器回路は、前記第1の積分器ラインの出力および前記第1のロスパッドの出力を受け取り、
前記第二段が、
前記第1の加算器回路の前記出力を受け取る第2の積分器ラインであって、少なくとも1つの積分器回路を有する、第2の積分器ラインと、
この第2の積分器ラインに入力が結合した第2のロスパッドと、
前記第2の積分器ラインの出力および前記第2のロスパッドの出力を受け取る第2の加算器回路とを含み、
前記第2の加算器回路は、さらに、出力信号を出力する、広帯域信号処理回路。 - 請求項11に記載の広帯域信号の処理回路において、前記第二段が、さらに、前記第1の加算器回路の前記出力を前記第2の加算器回路の入力に選択的に接続するスイッチを含む、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1および前記第2の積分器ラインの前記少なくとも1つの積分器回路が、調節可能なゲインを有する、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1の積分器ラインと前記第2の積分器ラインのそれぞれが、調節可能なゲインを有する複数の積分器回路を有する、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1および前記第2の積分器ラインのうちの少なくとも1つの積分器ラインが、複数の積分器回路を有する、広帯域信号処理回路。
- 請求項15に記載の広帯域信号処理回路において、前記複数の積分器回路のうちの少なくとも1つの積分器回路が、調節可能なゲインを有する、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1のロスパッドの前記入力が、前記第1の積分器ラインの第1の積分器回路の出力および第2の積分器回路の入力に結合したノードに接続されている、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第2のロスパッドの前記入力が、前記第2の積分器ラインの第1の積分器回路の出力および第2の積分器回路の入力に結合したノードに接続されている、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1および第2のロスパッドのうちの少なくとも1つのロスパッドが、調節可能な損失値を有する、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1の積分器ラインの前記出力が、前記第1の加算器回路において反転される、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第1のロスパッドの前記出力が、前記第1の加算器回路において反転される、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第2の積分器ラインの前記出力が、前記第2の加算器回路において選択的に反転される、広帯域信号処理回路。
- 請求項11に記載の広帯域信号処理回路において、前記第2のロスパッドの前記出力が、前記第2の加算器回路において選択的に反転される、広帯域信号処理回路。
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