JP2015195280A - 薄膜トランジスタアレイ、その製造方法および画像表示装置 - Google Patents
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Abstract
【課題】チャネル部の半導体層を侵食することなく、半導体層をパターニングした薄膜トランジスタアレイ、その製造方法、および画像表示装置を提供する。【解決手段】複数のトランジスタ素子を備える薄膜トランジスタアレイであって、基板と、基板上に形成されたゲート電極と、基板とゲート電極との上に形成されたゲート絶縁体層と、ゲート絶縁体層上に形成された半導体層と、半導体層上に形成されたソース電極およびドレイン電極と、半導体層、ソース電極およびドレイン電極の上に、複数のトランジスタ素子の領域にわたってストライプ形状に形成された保護層とを有し、半導体層は、保護層、ソース電極およびドレイン電極のいずれかにより被覆され、保護層におけるストライプ形状の形成方向は、半導体層のソース電極およびドレイン電極間のチャネル部を流れる電流の方向と直交する方向である。【選択図】図４
Description
本発明は薄膜トランジスタアレイ、その製造方法および画像表示装置に関する。
薄膜トランジスタではゲート絶縁膜上に半導体層を形成し、半導体層上にソース・ドレイン電極を形成し、ソース・ドレイン電極上に保護層のパターンを形成する（特許文献２）。半導体層および保護層のパターン形成は、フォトリソグラフィー法などのパターン形成法やインクジェット印刷によって行われている。フォトリソグラフィー法などのパターン形成法やインクジェット印刷のいずれにおいてもアライメント合わせの工程がその都度必要となる。一方で、半導体層上に、保護層のみパターン形成し、保護層をマスクとすることでアライメントを合わせる方法もある（特許文献１）。
薄膜トランジスタや薄膜トランジスタが複数配列された薄膜トランジスタアレイの製造では、半導体層に保護層のアライメントを合わせなければならない。保護層のアライメントにずれが生じると後工程のアライメントがずれてしまう、もしくは半導体層が保護されない構造となってしまう問題がある。
そこで、保護層をマスクとして、半導体層をパターニングする方法がある。しかし、パターニングの形状によっては、半導体層を除去する際にチャネル部の半導体層を侵食してしまう恐れがある。
本発明は、チャネル部の半導体層を侵食することなく半導体層をパターニングしたトランジスタアレイ、その製造方法、および画像表示装置の提供を目的とする。
上記課題を解決するための本発明の一局面は、複数のトランジスタ素子を備える薄膜トランジスタアレイであって、基板と、基板上に形成されたゲート電極と、基板とゲート電極との上に形成されたゲート絶縁体層と、ゲート絶縁体層上に形成された半導体層と、半導体層上に形成されたソース電極およびドレイン電極と、半導体層、ソース電極およびドレイン電極の上に複数のトランジスタ素子の領域にわたってストライプ形状に形成された保護層とを有し、半導体層は、保護層、ソース電極およびドレイン電極のいずれかにより被覆され、保護層におけるストライプ形状の形成方向は、半導体層のソース電極およびドレイン電極間のチャネル部を流れる電流の方向と直交する方向である、薄膜トランジスタアレイである。
また、半導体層が有機物を含む材料からなってもよい。
また、保護層が無機化合物を含む材料からなってもよい。
また、保護層が有機物を含む材料からなってもよい。
また、保護層が無機化合物と有機物の混合物を含む材料からなってもよい。
また、本発明の他の局面は、複数のトランジスタ素子を備える薄膜トランジスタアレイの製造方法であって、基板上にゲート電極を形成する工程と、基板と前記ゲート電極との上にゲート絶縁体層を形成する工程と、ゲート絶縁体層上に半導体層を形成する工程と、半導体層上にソース電極とドレイン電極とを形成する工程と、半導体層、ソース電極およびドレイン電極上に保護層を形成する工程と、半導体層の保護層、ソース電極およびドレイン電極のいずれによっても被覆されていない箇所を除去する工程とを有し、保護層を形成する工程において、保護層を複数のトランジスタ素子の領域にわたってゲート電極を含む面と平行な面内を半導体層のソース電極とドレイン電極との間のチャネル部を流れる電流の方向と直交する方向に延伸するストライプ状に形成する、薄膜トランジスタアレイの製造方法である。
また、半導体層を形成する工程において、半導体層を塗布法にて形成してもよい。
また、保護層を形成する工程において、保護層を塗布法にて形成してもよい。
また、半導体層を除去する工程において、半導体層を、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかで洗い流すことで除去してもよい。
また、半導体層を除去する工程において、半導体層を、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかの蒸気にさらすことで除去してもよい。
また、上述の塗布法は、凸版印刷、凹版印刷、平版印刷、スクリーン印刷、インクジェット、熱転写印刷、ディスペンサ、スピンコート、ダイコート、マイクログラビアコート、ディップコートのいずれかであってもよい。
また、本発明の他の局面は、上述の薄膜トランジスタアレイと、ソース電極および前記ドレイン電極上に形成された層間絶縁膜と、層間絶縁膜上に形成された共通電極とを含む画素表示媒体を有する、画像表示装置である。
また、画素表示媒体は、電気泳動型反射表示装置、透過型液晶表示装置、反射型液晶表示装置、半透過型液晶表示装置、有機ＥＬ表示装置および無機ＥＬ表示装置のいずれかであってもよい。
本発明によれば、簡便な方法で、チャネル部の半導体層を侵食することなく半導体層をパターニングすることができる。
本発明の一実施形態に係る薄膜トランジスタアレイの製造方法を図面を参照して説明する。
図１〜図４は、本発明に係る薄膜トランジスタアレイの製造方法の一実施形態を模式的に説明する図であり、各製造過程における薄膜トランジスタアレイの一部についての側面断面図（ａ）および平面図（ｂ）である。
まず、図１に示す工程では、基板１にストライプ状にゲート電極２のパターンを形成する。その後、基板１およびゲート電極２の上面（図１の（ａ）において、紙面上方をいう。以下同じ）にゲート絶縁体層３を形成する。さらに、ゲート絶縁体層３の全面にわたって、その上面に半導体層４を形成する。
次いで、図２に示す工程では、半導体層４の上面にソース電極５およびドレイン電極６のパターンを形成する。
次いで、図３に示す工程では、半導体層４とソース電極５およびドレイン電極６の上に、保護層７を前記ゲート電極２を含む面に平行な面内を、ソース電極５とドレイン電極６との間のチャネル部を流れる電流の方向と直交する方向に延伸するストライプ状に形成する。保護層７は、ゲート電極２、ソース電極５、ドレイン電極６、半導体層４等が構成する複数のトランジスタ素子にわたって形成される。なお、チャネル部を流れる電流の方向とは図２に示す矢印８の方向（図２の（ｂ）において、紙面左右方向）である。
次いで、図４に示す工程では、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかで保護層７とソース電極５およびドレイン電極６のいずれにも被覆されていない半導体層４を除去する。これにより、半導体層４の保護層７とソース電極５およびドレイン電極６のいずれかにより被覆されている箇所が残る。また、半導体層４のチャネル部は、保護層７とソース電極５およびドレイン電極６により被覆されているため、侵食されることなくパターン形成がされる。また、除去方法には、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかで洗い流す方法、蒸気にさらす方法を用いることができる。
本発明の実施形態において、基板１に用いる材料は特に限定されるものではなく、一般に用いられる材料として、例えばポリエチレンテレフタレート（ＰＥＴ）やポリイミド、ポリエーテルスルホン（ＰＥＳ）、ポリエチレンナフタレート（ＰＥＮ）、ポリカーボネートなどのフレキシブルなプラスチック材料、石英などのガラス基板やシリコンウェハーなどがある。しかしながら、フレキシブル化や各プロセス温度などを考慮すると、基板１としてＰＥＮやポリイミドなどを用いることが望ましい。
本発明の実施形態において、ゲート電極２、ソース電極５およびドレイン電極６の電極材料として用いられる材料は特に限定されるものではないが、一般に用いられる材料には金、白金、ニッケル、インジウム錫酸化物などの金属あるいは酸化物の薄膜若しくはポリ（エチレンジオキシチオフェン）／ポリスチレンスルホネート（ＰＥＤＯＴ／ＰＳＳ）やポリアニリンなどの導電性高分子や金や銀、ニッケルなどの金属コロイド粒子を分散させた溶液若しくは銀など金属粒子を導電材料として用いた厚膜ペーストなどがある。ゲート電極２、ソース電極５およびドレイン電極６を形成する方法としては、インクジェット法、フレキソ印刷、スクリーン印刷、ディスペンサなどがある。
本発明の実施形態において、ゲート絶縁体層３として用いられる材料は特に限定されるものではないが、一般に用いられる材料にはポリビニルフェノール、ポリメタクリル酸メチル、ポリイミド、ポリビニルアルコールなどの高分子溶液、アルミナやシリカゲルなどの粒子を分散させた溶液などがある。
本発明の実施形態において、半導体層４の半導体材料として用いられる材料は特に限定されるものではないが、一般に用いられる材料にはポリチオフェン、ポリアリルアミン、フルオレンビチオフェン共重合体、およびそれらの誘導体のような高分子有機半導体材料、ペンタセン、テトラセン、銅フタロシアニン、ペリレン、およびそれらの誘導体のような低分子有機半導体材料を用いることができるが、低コスト化、フレキシブル化、大面積化を考慮すると印刷法が適用できる有機半導体を用いることが望ましい。半導体層４の形成には、塗布法を用いることができる。塗布法の具体例としては、凸版印刷、凹版印刷、平版印刷、スクリーン印刷、インクジェット、熱転写印刷、ディスペンサ、スピンコート、ダイコート、マイクログラビアコート、ディップコートなどがある。
本発明の実施形態において、保護層７の封止材料として用いる材料は特に限定されるものではないが、一般的に用いられる材料としてはフッ素系樹脂やポリビニルアルコールなどが挙げられる。すなわち、無機化合物、有機物または無機化合物と有機物の混合物を含む材料から適宜選択可能である。保護層７の形成には、塗布法を用いることができる。また、保護層７には必要に応じて遮光性を付与することも出来る。さらに、保護層７の形成には、塗布法を用いることができる。塗布法の具体例としては、凸版印刷、凹版印刷、平版印刷、スクリーン印刷、インクジェット、熱転写印刷、ディスペンサ、スピンコート、ダイコート、マイクログラビアコート、ディップコートなどがある。
本発明の実施形態に係る製造方法により製造された薄膜トランジスタアレイを用いて、例えば、ソース電極６とドレイン電極７の上に層間絶縁膜を形成し、層間絶縁膜の上にドレイン電極７に電気的に接続された画素電極を形成し、画素電極の上に共通電極を形成して画素表示媒体を得ることができる。また、この画像表示媒体は、電子ペーパー、電気泳動型反射表示装置、透過型液晶表示装置、反射型液晶表示装置、半透過型液晶表示装置、有機ＥＬ表示装置および無機ＥＬ表示装置等に適用でき、これらを含む画像表示装置に用いることができる。
（実施例１）
図４に示すような薄膜トランジスタアレイの実施例１について説明する。まず、基板１の材料として、厚さ１２５μｍのポリエチレンナフタレート（ＰＥＮ）を用いた。
図４に示すような薄膜トランジスタアレイの実施例１について説明する。まず、基板１の材料として、厚さ１２５μｍのポリエチレンナフタレート（ＰＥＮ）を用いた。
次に、ゲート電極２の材料として、ナノ銀とポリエチレングリコールからなり、それぞれの重量比が８：１であるナノ銀インキを用いた。ナノ銀インキを転写印刷法によりＰＥＮ基板１上に印刷し、１８０℃で１時間ベークしてゲート電極２を形成した。
次に、ゲート絶縁体層３の材料として、ポリビニルフェノールをシクロヘキサノンに１０重量％溶解させた溶液を用いた。ゲート絶縁体層３の溶液をダイコータ法により塗布し、１８０℃で１時間乾燥させて形成した。
次に、半導体層４の材料として、フルオレン−ビチオフェンコポリマー（Ｆ８Ｔ２）をテトラリンで１．０重量％になるように溶解した溶液を用いた。半導体層４は、塗布法を用いて全面に塗布し、１００℃で６０分乾燥させて形成した。
次に、ソース電極５およびドレイン電極６の材料として、ナノ銀とポリエチレングリコールからなり、それぞれの重量比が８：１であるナノ銀インキを用いた。ナノ銀インキを転写印刷法により印刷し、１８０℃で１時間乾燥させてソース電極５およびドレイン電極６を形成した。
次に、保護層７の材料として、ポリビニルアルコールを純水に５重量％で溶解させたインキを用い、複数のトランジスタにわたってストライプ状にゲート電極を含む面と平行な面内をチャネル部を流れる電流の方向と直交する方向に延伸する保護層７を形成した。
半導体層４のうち、保護層７とソース電極５およびドレイン電極６のいずれにも被覆されていない箇所をトルエンで洗い流すことで素子の分離を行った。この結果、チャネル部の半導体層４が侵食されることなく素子が分離され、トランジスタ特性を劣化させることなく、オフ状態での電流（リーク電流）値を小さくすることができた。
（実施例２）
実施例２に係る薄膜トランジスタアレイは、保護層７を形成する工程までは、実施例１と全く同様な方法で製造した。
実施例２に係る薄膜トランジスタアレイは、保護層７を形成する工程までは、実施例１と全く同様な方法で製造した。
次に、半導体層４のうち、保護層７とソース電極５およびドレイン電極６のいずれにも被覆されていない箇所をトルエンの蒸気にさらすことで素子の分離を行った。この結果、チャネル部の半導体層４が侵食されることなく素子が分離され、トランジスタ特性を劣化させることなく、オフ状態での電流（リーク電流）値を小さくすることができた。
（比較例１）
比較例１に係る薄膜トランジスタアレイは、ソース電極５およびドレイン電極６を形成する工程までは、実施例１と全く同様な方法で製造した。
比較例１に係る薄膜トランジスタアレイは、ソース電極５およびドレイン電極６を形成する工程までは、実施例１と全く同様な方法で製造した。
次に、保護層７としてポリビニルアルコールを純水に５重量％で溶解させたインキを用い、チャネル部のみに保護層７を形成した。
次に、半導体層４のうち、保護層７とソース電極５およびドレイン電極６のいずれにも被覆されていない箇所をトルエンで洗い流すことで素子の分離を行った。この結果、チャネル部を流れる電流の方向端部の半導体層４が侵食されてしまい、トランジスタ特性が劣化した。
（比較例２）
比較例２に係る薄膜トランジスタアレイは、ソース電極５およびドレイン電極６を形成する工程までは、実施例１と全く同様な方法で製造した。
比較例２に係る薄膜トランジスタアレイは、ソース電極５およびドレイン電極６を形成する工程までは、実施例１と全く同様な方法で製造した。
次に、保護層７としてポリビニルアルコールを純水に５重量％で溶解させたインキを用い、チャネル部のみ保護層７を形成した。
次に、半導体層４のうち、保護層７とソース電極５およびドレイン電極６のいずれにも被覆されていない箇所をトルエンの蒸気にさらすことで素子の分離を行った。この結果、チャネル部を流れる電流の方向端部の半導体層４が侵食されてしまい、トランジスタ特性が劣化した。
以上の結果から、実施例に係るトランジスタアレイの製造方法によれば、チャネル部の半導体層が侵食されてトランジスタ特性が劣化することなく、簡便な方法でトランジスタ素子の分離を実現し良好な素子特性を示す薄膜トランジスタアレイを製造できることが確認できた。
１ 基板
２ ゲート電極
３ ゲート絶縁体層
４ 半導体層
５ ソース電極
６ ドレイン電極
７ 保護層
８ チャネル部を流れる電流の向き
２ ゲート電極
３ ゲート絶縁体層
４ 半導体層
５ ソース電極
６ ドレイン電極
７ 保護層
８ チャネル部を流れる電流の向き
Claims (13)
- 複数のトランジスタ素子を備える薄膜トランジスタアレイであって、基板と、前記基板上に形成されたゲート電極と、前記基板と前記ゲート電極との上に形成されたゲート絶縁体層と、前記ゲート絶縁体層上に形成された半導体層と、前記半導体層上に形成されたソース電極およびドレイン電極と、前記半導体層、前記ソース電極およびドレイン電極の上に、前記複数のトランジスタ素子の領域にわたってストライプ形状に形成された保護層とを有し、
前記半導体層は、前記保護層、前記ソース電極および前記ドレイン電極のいずれかにより被覆され、
前記保護層におけるストライプ形状の形成方向は、前記半導体層の前記ソース電極および前記ドレイン電極間のチャネル部を流れる電流の方向と直交する方向である、薄膜トランジスタアレイ。 - 前記半導体層が有機物を含む材料からなる、請求項１に記載の薄膜トランジスタアレイ。
- 前記保護層が無機化合物を含む材料からなる、請求項１又は２に記載の薄膜トランジスタアレイ。
- 前記保護層が有機物を含む材料からなる、請求項１乃至３のいずれかに記載の薄膜トランジスタアレイ。
- 前記保護層が無機化合物と有機物との混合物を含む材料からなる、請求項１乃至４のいずれかに記載の薄膜トランジスタアレイ。
- 複数のトランジスタ素子を備える薄膜トランジスタアレイの製造方法であって、
基板上にゲート電極を形成する工程と、
前記基板と前記ゲート電極との上にゲート絶縁体層を形成する工程と、
前記ゲート絶縁体層上に半導体層を形成する工程と、
前記半導体層上にソース電極とドレイン電極とを形成する工程と、
前記半導体層と前記ソース電極および前記ドレイン電極上に保護層を形成する工程と、
前記半導体層の前記保護層、前記ソース電極および前記ドレイン電極のいずれによっても被覆されていない箇所を除去する工程とを有し、
前記保護層を形成する工程において、前記保護層を前記複数のトランジスタ素子の領域にわたって、前記ゲート電極を含む面と平行な面内を、前記半導体層の前記ソース電極と前記ドレイン電極との間のチャネル部を流れる電流の方向と直交する方向に延伸するストライプ状に形成する、薄膜トランジスタアレイの製造方法。 - 前記半導体層を形成する工程において、前記半導体層を塗布法にて形成する、請求項６に記載の薄膜トランジスタアレイの製造方法。
- 前記保護層を形成する工程において、前記保護層を塗布法にて形成する、請求項６又は７に記載の薄膜トランジスタアレイの製造方法。
- 前記半導体層を除去する工程において、前記半導体層を、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかで洗い流すことで除去する、請求項６乃至８のいずれかに記載の薄膜トランジスタアレイの製造方法。
- 前記半導体層を除去する工程において、前記半導体層を、有機系溶剤、無機系溶剤、およびこれらの混合溶液のいずれかの蒸気にさらすことで除去する、請求項６乃至９のいずれかに記載の薄膜トランジスタアレイの製造方法。
- 前記塗布法は、凸版印刷、凹版印刷、平版印刷、スクリーン印刷、インクジェット、熱転写印刷、ディスペンサ、スピンコート、ダイコート、マイクログラビアコート、ディップコートのいずれかである、請求項７または８に記載の薄膜トランジスタアレイの製造方法。
- 請求項１乃至５のいずれかに記載の薄膜トランジスタアレイと、前記ソース電極および前記ドレイン電極の上に形成された層間絶縁膜と、前記層間絶縁膜の上に形成された共通電極とを含む画素表示媒体を有する画像表示装置。
- 前記画素表示媒体は、電気泳動型反射表示装置、透過型液晶表示装置、反射型液晶表示装置、半透過型液晶表示装置、有機ＥＬ表示装置および無機ＥＬ表示装置のいずれかである、請求項１２に記載の画像表示装置。
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| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2014072740A JP2015195280A (ja) | 2014-03-31 | 2014-03-31 | 薄膜トランジスタアレイ、その製造方法および画像表示装置 |
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| JP2014072740A JP2015195280A (ja) | 2014-03-31 | 2014-03-31 | 薄膜トランジスタアレイ、その製造方法および画像表示装置 |
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| JP2015195280A true JP2015195280A (ja) | 2015-11-05 |
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| JP2014072740A Pending JP2015195280A (ja) | 2014-03-31 | 2014-03-31 | 薄膜トランジスタアレイ、その製造方法および画像表示装置 |
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Citations (4)
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| JP2007318025A (ja) * | 2006-05-29 | 2007-12-06 | Dainippon Printing Co Ltd | 有機半導体素子、および、有機半導体素子の製造方法 |
| JP2008270744A (ja) * | 2007-03-28 | 2008-11-06 | Toppan Printing Co Ltd | 薄膜トランジスタアレイ、薄膜トランジスタアレイの製造方法、およびアクティブマトリスクディスプレイ |
| WO2011122205A1 (ja) * | 2010-03-30 | 2011-10-06 | 凸版印刷株式会社 | 薄膜トランジスタの製造方法並びに薄膜トランジスタ及び画像表示装置 |
| JP2013201201A (ja) * | 2012-03-23 | 2013-10-03 | Toppan Printing Co Ltd | 薄膜トランジスタアレイ、薄膜トランジスタアレイ製造方法、画像表示装置 |
-
2014
- 2014-03-31 JP JP2014072740A patent/JP2015195280A/ja active Pending
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