JP2014090148A - Wiring board and method of manufacturing the same - Google Patents
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Abstract
Description
本発明は、上面に半導体素子が搭載される素子搭載部を有するベース配線基板の上面に、素子搭載部を囲繞する開口部を有するフレーム配線基板を接合して成る配線基板およびその製造方法に関するものである。 The present invention relates to a wiring substrate formed by bonding a frame wiring substrate having an opening surrounding an element mounting portion to an upper surface of a base wiring substrate having an element mounting portion on which a semiconductor element is mounted, and a method for manufacturing the same. It is.
図5(a)および(b)に従来の配線基板Bを示す。配線基板Bは、半導体素子Sが搭載されるベース配線基板30と上にフレーム配線基板40が接合されて成る。ここで、図5(a)は、図5(b)に示すW−W間を通る断面図である。配線基板Bは、複数の製品領域X2と、製品領域X2の周囲に切断領域Z2を挟んで一体的に形成された捨て代領域Y2とを有しており、製品領域X2同士の間、および製品領域X2と捨て代領域Y2との間の切断領域Z2を切断することで、個々の製品が同時に多数個製造される。
5 (a) and 5 (b) show a conventional wiring board B. FIG. The wiring board B is formed by bonding a
ベース配線基板30は、上下に貫通する複数のスルーホール22を有する絶縁基板21と、絶縁基板21の上下面およびスルーホール22内に被着された配線導体層23と、絶縁基板21と配線導体層23の上に被着されたソルダーレジスト層24とを有している。なお、スルーホール22の内部は孔埋め樹脂により充填されている。
The
ベース配線基板30の上面には、半導体素子Sを搭載するための素子搭載部21aが形成されている。この素子搭載部21aには、半導体素子Sの電極Tと電気的に接続するための複数の半導体素子接続パッド25が配線導体層23の一部により形成されている。これらの半導体素子接続パッド25は、ソルダーレジスト層24に設けた開口部24a内に露出している。そして、この半導体素子接続パッド25に半導体素子Sの電極Tを半田バンプHを介して接続することにより、半導体素子Sとベース配線基板30とが電気的に接続される。さらに、ベース配線基板30の上面には、フレーム配線基板40が接合される枠状のフレーム接合部21bが素子搭載部21aを囲繞するようにして形成されている。このフレーム接合部21bには、フレーム配線基板40と電気的に接続するための複数の第1の接合パッド26が配線導体層23の一部により形成されている。これらの第1の接合パッド26は、隣接する製品領域X2間の切断領域Z2を挟んで線対称な位置に配置されており、ソルダーレジスト層24に設けた開口部24b内に露出している。なお、これらの第1の接合パッド26と半導体素子接続パッド25の一部とは、互いに電気的に接続されている。また、ベース配線基板30の下面には、外部の電気回路基板と接続するための複数の外部接続パッド27が配線導体層23の一部により形成されている。これらの外部接続パッド27は、ソルダーレジスト層24に設けた開口部24c内に露出している。これらの外部接続パッド27は、スルーホール22を介して半導体素子接続パッド25に電気的に接続されている。
An
フレーム配線基板40は、上下に貫通する複数のスルーホール32を有する絶縁基板31と、絶縁基板31やスルーホール32内に被着された配線導体層33と、絶縁基板31の上下面に被着されたソルダーレジスト層34とを有している。なお、スルーホール32の内部は孔埋め樹脂により充填されている。このフレーム配線基板40には、素子搭載部21aを囲繞する大きさの開口部35が形成されている。また、フレーム配線基板40の下面には、ベース配線基板30の第1の接合パッド26に対応する位置に複数の第2の接合パッド36が配線導体層33の一部により形成されている。これらの第2の接合パッド36は、ソルダーレジスト層34に設けた開口部34a内に露出している。そして、これらの第2の接合パッド36と第1の接合パッド26とが半田バンプHを介して互いに接合されており、これによりベース配線基板30の配線導体層23の一部とフレーム配線基板40の配線導体層33とが電気的に接続されている。また、フレーム配線基板40の上面には、複数の第3の接合パッド37が配線導体層33の一部により形成されている。これらの第3の接合パッド37は、ソルダーレジスト層34に設けた開口部34b内に露出している。この第3の接合パッド37には、さらに他の配線基板や導電性の蓋体が開口部35を覆うようにして接合される。
The
さらに、フレーム接合部21b上におけるベース配線基板30とフレーム配線基板40との間には、封止樹脂38が充填されている。この封止樹脂38は、ベース配線基板30とフレーム配線基板40とを強固に接合するとともに、ベース配線基板30とフレーム配線基板40との接合部の隙間から素子搭載部21a側に水分や異物などが浸入することを防止することで半導体素子Sを保護する機能を有している。
Further, a
なお、ベース配線基板30上にフレーム配線基板40を接合するには、以下の方法が採用されている。まず、ベース配線基板30の第1の接合パッド26またはフレーム配線基板40の第2の接合パッド36の少なくとも一方に半田バンプH用の半田を溶着する。半田の溶着には、半田ペーストを印刷した後にリフローさせる方法や、半田ボールを載置した後にリフローさせる方法を用いる。次に、互いに対応する第1の接合パッド26と第2の接合パッド36とが対向するようにベース配線基板30上にフレーム配線基板40を載置するとともに半田をリフローさせ、それぞれ対応する第1の接合パッド26と第2の接合パッド36とをリフローされた半田から成る半田バンプHを介して接合する。このとき、フレーム接合部21b上におけるベース配線基板30とフレーム配線基板40との間には、半田バンプHに対応する高さの隙間が形成される。次に、フレーム接合部21b上におけるベース配線基板30とフレーム配線基板40との隙間に液状の封止樹脂38を注入するとともに硬化させる。なお、ベース配線基板30とフレーム配線基板40との間に液状の封止樹脂38を注入するには、フレーム配線基板40の上面から下面にかけて貫通する樹脂注入孔39を複数設けておくとともに、フレーム配線基板40の上面側から樹脂注入孔39を介して封止樹脂38を注入する方法が採用されている。
In order to join the
ところで、ベース配線基板30とフレーム配線基板40との隙間に注入された液状の封止樹脂38は、注入直後には樹脂注入孔39を起点にして放射状に濡れ広がっていく。次に、封止樹脂38が最初の半田バンプHに接触すると、その半田バンプHから張力を受けてその半田バンプHの方向に優先的に濡れ広がっていく。そして、封止樹脂38は、その半田バンプHを起点にしてさらに放射状に濡れ広がり、次に最も近くに隣接する半田バンプHに接触してその半田バンプHの方向に優先的に濡れ広がっていくことを繰り返す。ところが、従来の配線基板Bのように、半田バンプHが切断領域Z2を挟んで線対称に配置されていると、切断領域Z2を挟んで斜めに隣接する半田バンプH同士の距離が切断領域Z2に沿って隣接する半田バンプH同士の距離よりも長くなってしまう。したがって、封止樹脂38は、図6(a)に示すように、最初に接触した半田バンプHから切断領域Z2に沿って隣接する半田バンプHに先に接触してその方向に順次優先的に濡れ広がっていく。このため、切断領域Z2を挟んで対角線方向には封止樹脂38の濡れ広がりが遅くなり、図6(b)に示すように、切断領域Z2上に空気が取り残されて封止樹脂38による充填のない空隙が生じることがある。その結果、切断領域Z2を切断して個々の製品を製造したときに、ベース配線基板30とフレーム配線基板40との隙間に露出した空隙から、水分や異物などが浸入して半導体素子Sの機能を損なう場合がある。
By the way, the
本発明は、各製品領域間の切断領域上に空隙が生じることを防いで、個々の製品におけるベース配線基板とフレーム配線基板との隙間から水分や異物などが浸入することを防止する。それにより各製品に搭載される半導体素子を安定的に作動させることができる配線基板を提供することを課題とする。 The present invention prevents a gap from being generated on a cutting region between each product region, and prevents moisture, foreign matter, and the like from entering from a gap between the base wiring substrate and the frame wiring substrate in each product. Accordingly, it is an object to provide a wiring board capable of stably operating semiconductor elements mounted on each product.
本発明の配線基板は、上面に素子搭載部および素子搭載部を囲繞する枠状のフレーム接合部を有する複数の製品領域が間に切断領域を挟んで縦横の並びに一体的に形成された平板状のベース配線基板と、ベース配線基板上に接合されており、製品領域に対応する製品領域および切断領域に対応する切断領域を有するとともに各素子搭載部を囲繞する複数の開口部を有するフレーム配線基板とを具備して成り、各フレーム接合部に設けられた複数の第1の接合パッドと、フレーム配線基板の下面における前記第1の接合パッドと対応する位置に設けられた複数の第2の接合パッドとを半田バンプを介して接合するとともに、フレーム接合部上のベース配線基板とフレーム配線基板との間に封止樹脂を充填して成る配線基板であって、第1および第2の接合パッドは、切断領域に沿う方向に切断領域を挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域に沿う接合パッド同士よりも切断領域を挟んだ接合パッド同士の方が狭いことを特徴とするものである。 The wiring board of the present invention has a flat plate shape in which a plurality of product regions having an element mounting portion and a frame-shaped frame joint portion surrounding the element mounting portion on the upper surface are integrally formed vertically and horizontally with a cutting region in between. Base wiring board, and a frame wiring board that is bonded onto the base wiring board, has a product area corresponding to the product area and a cutting area corresponding to the cutting area, and has a plurality of openings surrounding each element mounting portion And a plurality of first bonding pads provided at each frame bonding portion and a plurality of second bonding pads provided at positions corresponding to the first bonding pads on the lower surface of the frame wiring board. A wiring board formed by filling a pad with a sealing resin between a base wiring board and a frame wiring board on a frame joint portion while bonding pads to each other through solder bumps. The two bonding pads have two pad rows arranged in a staggered manner adjacent to each other across the cutting region in a direction along the cutting region, and the adjacent spacing between the bonding pads in the two pad rows is the cutting region. The bonding pads sandwiching the cutting region are narrower than the bonding pads along.
本発明の配線基板の製造方法は、上面に素子搭載部および素子搭載部を囲繞する枠状のフレーム接合部を有する複数の製品領域が間に切断領域を挟んで縦横の並びに一体的に形成されるとともに、それぞれのフレーム接合部上に複数の第1の接合パッドが形成された平板状のベース配線基板と、製品領域に対応する製品領域および切断領域に対応する切断領域を有するとともに各素子搭載部を囲繞する開口部を有し、下面における第1の接合パッドに対応する位置に複数の第2の接合パッドが形成されたフレーム配線基板と、を準備する工程と、次に、ベース配線基板とフレーム配線基板とを、それぞれ対応する第1の接合パッドと第2の接合パッドとが対向するように配置するとともに、対向する第1の接合パッドと第2の接合パッドとを半田バンプを介して接合する工程と、次に、フレーム接合部上のベース配線基板とフレーム配線基板との間に封止樹脂を注入するとともに硬化させる工程と、を行なう配線基板の製造方法において、第1および第2の接合パッドは、切断領域に沿う方向に切断領域を挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域に沿う接合パッド同士よりも切断領域を挟んだ接合パッド同士の方が狭いことを特徴とするものである。 In the method for manufacturing a wiring board according to the present invention, a plurality of product regions having an element mounting portion and a frame-shaped frame joint portion surrounding the element mounting portion on an upper surface are formed integrally in a vertical and horizontal manner with a cutting region interposed therebetween. In addition, a flat base wiring board having a plurality of first bonding pads formed on each frame bonding portion, a product area corresponding to the product area, and a cutting area corresponding to the cutting area, and mounting each element A frame wiring board having an opening surrounding the part and having a plurality of second bonding pads formed at positions corresponding to the first bonding pads on the lower surface, and then a base wiring board And the frame wiring board are arranged so that the corresponding first bonding pad and the second bonding pad face each other, and the first bonding pad and the second bonding pad that face each other are arranged. In the method of manufacturing a wiring board, the step of bonding through the bumps and the step of injecting a sealing resin between the base wiring board on the frame bonding portion and the frame wiring board and curing the sealing resin, The first and second bonding pads have two pad rows arranged in a staggered manner adjacent to each other across the cutting region in a direction along the cutting region, and the adjacent spacing between the bonding pads in the two pad rows However, the bonding pads sandwiching the cutting region are narrower than the bonding pads along the cutting region.
本発明の配線基板によれば、第1および第2の接合パッドは、切断領域に沿う方向に切断領域を挟んで互いに隣接して千鳥状に並ぶ2列のパッド列における接合パッド同士の隣接間隔が切断領域に沿う接合パッド同士よりも切断領域を挟んだ接合パッド同士の方が狭い状態に配置されている。したがって、ベース配線基板とフレーム配線基板との間に液状の封止樹脂を注入するときに、封止樹脂が最初に接触した半田バンプを起点にして濡れ広がっていくと、切断領域に沿って隣接する接合パッドよりも切断領域を挟んで隣接する接合パッドに先に接触してさらにその接合パッドを起点に切断領域を挟んで千鳥状に配置された半田バンプを順次伝って切断領域上に優先的に濡れ広がっていく。さらに、切断領域上に濡れ広がった封止樹脂は切断領域を挟んだ両側に濡れ広がっていく。それにより、切断領域上に空隙が生じることを防止することができる。その結果、各製品に搭載される半導体素子を安定的に作動させることが可能な配線基板を提供することができる。 According to the wiring board of the present invention, the first and second bonding pads are adjacent to each other in the two pad rows arranged in a staggered manner adjacent to each other across the cutting region in the direction along the cutting region. However, the bonding pads sandwiching the cutting region are arranged in a narrower state than the bonding pads along the cutting region. Therefore, when liquid sealing resin is injected between the base wiring board and the frame wiring board, if the sealing resin wets and spreads starting from the solder bump that first contacts, it is adjacent along the cutting area. Prior to contact with the adjacent bonding pads across the cutting area, the solder pads arranged in a staggered manner with the cutting pad as a starting point are sequentially transferred to the cutting area. It spreads wet. Further, the sealing resin wet and spread on the cutting area spreads wet on both sides of the cutting area. Thereby, it can prevent that a space | gap arises on a cutting area | region. As a result, it is possible to provide a wiring board capable of stably operating semiconductor elements mounted on each product.
本発明の配線基板の製造方法によれば、隣接する製品領域の間で、第1および第2の接合パッドを、切断領域に沿う方向に切断領域を挟んで互いに隣接して千鳥状に並ぶ2列のパッド列における接合パッド同士の隣接間隔が切断領域に沿う接合パッド同士よりも切断領域を挟んだ接合パッド同士の方が狭い状態に配置しておき、第1の接合パッドと第2の接合パッドを半田バンプを介して接合した後、ベース配線基板およびフレーム配線基板の隙間に封止樹脂を注入する。したがって、ベース配線基板とフレーム配線基板との間に液状の封止樹脂を注入するときに、封止樹脂が最初に接触した半田バンプを起点にして濡れ広がっていくと、切断領域に沿って隣接する接合パッドよりも切断領域を挟んで隣接する接合パッドに先に接触してさらにその接合パッドを起点に切断領域を挟んで千鳥状に配置された半田バンプを順次伝って切断領域上に優先的に濡れ広がっていく。さらに、切断領域上に濡れ広がった封止樹脂は切断領域を挟んだ両側に濡れ広がっていく。それにより、切断領域上に空隙が生じることを防止することができる。その結果、各製品に搭載される半導体素子を安定的に作動させることが可能な配線基板を提供することができる。 According to the method for manufacturing a wiring board of the present invention, between the adjacent product regions, the first and second bonding pads are arranged in a staggered manner adjacent to each other across the cutting region in a direction along the cutting region. In the pad row of the row, the adjoining distance between the bonding pads is arranged so that the bonding pads sandwiching the cutting region are narrower than the bonding pads along the cutting region, and the first bonding pad and the second bonding are arranged. After bonding the pads via the solder bumps, a sealing resin is injected into the gap between the base wiring board and the frame wiring board. Therefore, when liquid sealing resin is injected between the base wiring board and the frame wiring board, if the sealing resin wets and spreads starting from the solder bump that first contacts, it is adjacent along the cutting area. Prior to contact with the adjacent bonding pads across the cutting area, the solder pads arranged in a staggered manner with the cutting pad as a starting point are sequentially transferred to the cutting area. It spreads wet. Further, the sealing resin wet and spread on the cutting area spreads wet on both sides of the cutting area. Thereby, it can prevent that a space | gap arises on a cutting area | region. As a result, it is possible to provide a wiring board capable of stably operating semiconductor elements mounted on each product.
次に、本発明の配線基板の実施形態の一例を図1〜図3を基に詳細に説明する。 Next, an example of an embodiment of the wiring board according to the present invention will be described in detail with reference to FIGS.
図1(a)および(b)に本発明の実施形態の一例である配線基板Aを示す。配線基板Aは、半導体素子Sが搭載されるベース配線基板10と上にフレーム配線基板20が接合されて成る。ここで、図1(a)は、図1(b)に示すV−V間を通る断面図である。配線基板Aは、複数の製品領域Xと、製品領域Xの周囲に切断領域Zを挟んで一体的に形成された捨て代領域Yとを有しており、製品領域X同士の間、および製品領域Xと捨て代領域Yとの間の切断領域Zを切断することで、個々の製品が同時に多数個製造される。なお、後述のベース配線基板10およびフレーム配線基板20における製品領域Xに対応する部分をXbおよびXf、捨て代領域Yに対応する部分をYbおよびYf、切断領域Zに対応する部分をZbおよびZfの符号を付して説明する。
1A and 1B show a wiring board A which is an example of an embodiment of the present invention. The wiring board A is formed by bonding a
ベース配線基板10は、上下に貫通する複数のスルーホール2を有する絶縁基板1と、絶縁基板1の上下面およびスルーホール2内に被着された配線導体層3と、絶縁基板1および配線導体層3上に被着されたソルダーレジスト層4とを有している。なお、スルーホール2の内部は孔埋め樹脂により充填されている。
The
ベース配線基板10の上面には、半導体素子Sを搭載するための素子搭載部1aが形成されている。この素子搭載部1aには、半導体素子Sの電極Tと電気的に接続するための複数の半導体素子接続パッド5が配線導体層3の一部により形成されている。これらの半導体素子接続パッド5は、ソルダーレジスト層4に設けた開口部4a内に露出している。そして、この半導体素子接続パッド5に半導体素子Sの電極Tを半田バンプHを介して接続することにより、半導体素子Sとベース配線基板10とが電気的に接続される。
さらに、ベース配線基板10の上面には、フレーム配線基板20が接合される枠状のフレーム接合部1bが素子搭載部1aを囲繞するようにして形成されている。このフレーム接合部1bには、フレーム配線基板20と電気的に接続するための複数の第1の接合パッド6が配線導体層3の一部により形成されている。そして、第1の接合パッド6は、切断領域Zbに沿う方向に切断領域Zbを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zbに沿う接合パッド同士よりも切断領域Zbを挟んだ接合パッド同士の方が狭い状態に形成されている。これらの第1の接合パッド6は、ソルダーレジスト層4に設けた開口部4b内に露出している。なお、これらの第1の接合パッド6と半導体素子接続パッド5の一部とは、互いに電気的に接続されている。
また、ベース配線基板10の下面には、外部の電気回路基板と接続するための複数の外部接続パッド7が配線導体層3の一部により形成されている。これらの外部接続パッド7は、ソルダーレジスト層4に設けた開口部4c内に露出している。これらの外部接続パッド7は、スルーホール2を介して半導体素子接続パッド5に電気的に接続されている。さらにベース配線基板10には、その下面からフレーム接合部1b上面にかけて貫通する樹脂注入孔8が複数形成されている。この樹脂注入孔8を介して後述する封止樹脂18がベース配線基板10のフレーム接合部1bとフレーム配線基板20との間に充填されている。
An element mounting portion 1 a for mounting the semiconductor element S is formed on the upper surface of the
Further, a frame-shaped frame
A plurality of
フレーム配線基板20は、上下に貫通する複数のスルーホール12を有する絶縁基板11と、絶縁基板11やスルーホール12内に被着された配線導体層13と、絶縁基板11の上下面に被着されたソルダーレジスト層14とを有している。なお、スルーホール12の内部は孔埋め樹脂により充填されている。このフレーム配線基板20には、素子搭載部1aを囲繞する大きさの開口部15が形成されている。また、フレーム配線基板20の下面にはベース配線基板10の第1の接合パッド6に対応する位置に複数の第2の接合パッド16が配線導体層13の一部により形成されている。したがって、第2の接合パッド16は、切断領域Zfに沿う方向に切断領域Zfを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zfに沿う接合パッド同士よりも切断領域Zfを挟んだ接合パッド同士の方が狭い状態に形成されている。これらの第2の接合パッド16は、ソルダーレジスト層14に設けた開口部14a内に露出している。
そして、これらの第2の接合パッド16と第1の接合パッド6とが半田バンプHを介して互いに接合されており、これによりベース配線基板10の配線導体層3の一部とフレーム配線基板20の配線導体層13とが電気的に接続されている。
また、フレーム配線基板20の上面には、複数の第3の接合パッド17が配線導体層13の一部により形成されている。これらの第3の接合パッド17は、ソルダーレジスト層14に設けた開口部14b内に露出している。この第3の接合パッド17には、さらに他の配線基板や導電性の蓋体が開口部15を覆うようにして接合される。
さらに、フレーム接合部1bにおけるベース配線基板10とフレーム配線基板20との間には、封止樹脂18が充填されている。この封止樹脂18は、ベース配線基板10とフレーム配線基板20とを強固に接合するとともに、ベース配線基板10とフレーム配線基板20との接合部から素子搭載部1a側に水分や異物などが隙間に浸入することを防止することで半導体素子Sを保護する機能を有している。
The
The
A plurality of
Further, a sealing
絶縁基板1、11は、例えばガラスクロスにエポキシ樹脂やビスマレイミドトリアジン樹脂等の熱硬化性樹脂を含浸させた電気絶縁材料から成る。また、配線導体層3、13は例えば銅箔や銅めっき等の良導電性材料により形成されている。そして、ソルダーレジスト層4、14は、例えばアクリル変性エポキシ樹脂等の感光性を有する熱硬化性樹脂を硬化させた電気絶縁材料から成る。
The insulating
なお、図2にベース配線基板10の切断領域Z付近の拡大図を示す。図2のように、本例の配線基板Aにおいては、第1および第2(不図示)の接合パッド6および16は、切断領域Zに沿う方向に切断領域Zを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有している。さらに、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zに沿う接合パッド同士の間隔d2よりも、切断領域Zを挟んだ接合パッド同士の間隔d1の方が狭い状態で配置されている。したがって、ベース配線基板10とフレーム配線基板20との間に液状の封止樹脂18を注入するときに、封止樹脂18が最初に接触した半田バンプHを起点にして濡れ広がっていくと、図3(a)に示すように、切断領域Zに沿って隣接する接合パッドよりも切断領域Zを挟んで隣接する接合パッドに先に接触して濡れ広がる。さらに、図3(b)に示すように、その接合パッドを起点に切断領域Zを挟んで千鳥状に配置された半田バンプHを順次伝って切断領域Z上に優先的に濡れ広がっていく。さらに、切断領域Z上に濡れ広がった封止樹脂18は切断領域Zを挟んだ両側に濡れ広がっていく。それにより、切断領域Z上に空隙が生じることを防止することができる。その結果、各製品に搭載される半導体素子Sを安定的に作動させることが可能な配線基板Aを提供することができる。
FIG. 2 shows an enlarged view near the cutting region Z of the
次に、本発明の配線基板の製造方法の一例について、図4(a)〜(c)を基にして詳細に説明する。なお、図4(a)〜(c)において、図1を基に説明した配線基板Aと同一の箇所には同一の符号を付し、その詳細な説明は省略する。まず、図4(a)に示すように、ベース配線基板10とフレーム配線基板20とを準備する。
Next, an example of a method for manufacturing a wiring board according to the present invention will be described in detail with reference to FIGS. 4A to 4C, the same reference numerals are given to the same portions as those of the wiring board A described with reference to FIG. 1, and the detailed description thereof is omitted. First, as shown in FIG. 4A, a
ベース配線基板10は、上述したように、上下に貫通する複数のスルーホール2を有する絶縁基板1と、絶縁基板1の上下面およびスルーホール2内に被着された配線導体層3と、絶縁基板1および配線導体層3上に被着されたソルダーレジスト層4とを有している。
ベース配線基板10の上面には、素子搭載部1aおよび素子搭載部1aを囲繞する枠状のフレーム接合部1bが形成されている。素子搭載部1aには、複数の半導体素子接続パッド5が形成されている。また、フレーム接合部1bには、複数の第1の接合パッド6が形成されている。第1の接合パッド6は、切断領域Zbに沿う方向に切断領域Zbを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zbに沿う接合パッド同士よりも切断領域Zbを挟んだ接合パッド同士の方が狭い状態に形成されている。
ベース配線基板10の下面には外部接続パッド7が形成されている。そして半導体素子接続パッド5と第1の接合パッド6と外部接続パッド7とは、対応するもの同士が電気的に接続されている。
上面側のソルダーレジスト層4はベース配線基板10上面の素子搭載部1aからフレーム接合部1bにかけて被着されている。上面側のソルダーレジスト層4は、素子搭載部1aにおいて半導体素子接続パッド5を露出させる開口部4aを有しているとともに、フレーム接合部1bにおいて第1の接合パッド6を露出させる開口部4bを有している。下面側のソルダーレジスト層4は、外部接続パッド7を露出させる開口部4cを有している。さらに、ベース配線基板10は、その下面からフレーム接合部1b上面にかけて貫通する複数の樹脂注入孔8を有している。
As described above, the
On the upper surface of the
The solder resist
このようなベース配線基板10は、例えば次のように形成される。まず、ガラスクロスにエポキシ樹脂やビスマレイミドトリアジン樹脂等の熱硬化性樹脂を含浸させてなる絶縁板の両面に12〜18μm程度の銅箔が被着された両面銅張り板を用意する。次にドリル加工やレーザ加工、あるいはブラスト加工によりφ50〜300μm程度のスルーホール2を複数形成する。次に、スルーホール2の内壁に銅めっき層を被着させるとともに、周知のサブトラクティブ法により絶縁板上およびスルーホール2内に所定のパターンを有する配線導体層3を形成する。次に、半導体素子接続パッド5を露出させる開口部4aおよび第1の接合パッド6を露出させる開口部4bを有する上面側のソルダーレジスト層4ならびに外部接続パッド7を露出させる開口部4cを有する下面側のソルダーレジスト層4を形成する。次に、フレーム接合部1bに上面から下面に貫通するφ0.8〜2mm程度の樹脂注入孔8をドリル加工により形成することでベース配線基板10が形成される。
Such a
フレーム配線基板20は、上述したように、上下に貫通する複数のスルーホール12を有する絶縁基板11と、絶縁基板11やスルーホール12内に被着された配線導体層13と、絶縁基板11の上下面に被着されたソルダーレジスト層14とを有している。そして、ベース配線基板10の素子搭載部1aに対応する位置に素子搭載部1aを囲繞する大きさの開口部15を有している。
フレーム配線基板20の下面には、ベース配線基板10における第1の接合パッド6に対応する位置に複数の第2の接合パッド16が形成されている。したがって、切断領域Zfに沿う方向に切断領域Zfを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zfに沿う接合パッド同士よりも切断領域Zfを挟んだ接合パッド同士の方が狭い状態に形成されている。フレーム配線基板20の上面には、第3の接合パッド17が形成されている。下面側のソルダーレジスト層14は、第2の接合パッド16を露出させる開口部14aを有している。上面側のソルダーレジスト層14は、第3の接合パッド17を露出させる開口部14bを有している。
As described above, the
On the lower surface of the
このようなフレーム配線基板20は、例えば次のように形成される。まず、ガラスクロスにエポキシ樹脂やビスマレイミドトリアジン樹脂等の熱硬化性樹脂を含浸させてなる絶縁板の両面に12〜18μm程度の銅箔が被着された両面銅張り板を用意する。次にドリル加工やレーザ加工、あるいはブラスト加工によりφ50〜300μm程度のスルーホール12を複数形成するとともに、ルータ加工やレーザ加工、あるいはブラスト加工により開口部15を形成する。次に、スルーホール12内に銅めっき層を被着させるとともに、周知のサブトラクティブ法により絶縁板上およびスルーホール12内に所定のパターンを有する配線導体層13を形成する。次に第2の接合パッド16を露出させる開口部14aを有する下面側のソルダーレジスト層14と第3の接合パッド17を露出させる開口部14bを有する上面側のソルダーレジスト層14とを形成する。
Such a
次に図4(b)に示すように、ベース配線基板10とフレーム配線基板20とを、それぞれ対応する第1の接合パッド6と第2の接合パッド16とが対向するように配置するとともに、対向する第1の接合パッド6と第2の接合パッド16とを半田バンプHを介して接合する。なお、半田バンプHを介した接合は、例えば次のようにして行なわれる。まず第1の接合パッド6または第2の接合パッド16の少なくとも一方に半田バンプH用の半田を溶着させる。次に対応する第1の接合パッド6と第2の接合パッド16とが対向するようにベース配線基板10上にフレーム配線基板20を載置する。次にリフロー処理により半田を溶融させ、それぞれ対応する第1の接合パッド6と第2の接合パッド16とを半田バンプHを介して接合させる。
Next, as shown in FIG. 4B, the
次に、図4(c)に示すように、フレーム配線基板20を下側にした状態で樹脂注入孔8から液状の封止樹脂18をベース配線基板10とフレーム配線基板20との間に注入する。このとき、本例の配線基板Aの製造方法においては、隣接する製品領域Xの間で、第1の接合パッド6および第2の接合パッド16は、切断領域Zに沿う方向に切断領域Zを挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、2列のパッド列における接合パッド同士の隣接間隔が切断領域Zに沿う接合パッド同士よりも切断領域Zを挟んだ接合パッド同士の方が狭い状態に配置されていることから、ベース配線基板10とフレーム配線基板20との間に液状の封止樹脂18を注入するときに、封止樹脂18が最初に接触した半田バンプHを起点にして濡れ広がっていくと、切断領域Zに沿って隣接する接合パッドよりも切断領域Zを挟んで隣接する接合パッドに先に接触してさらにその接合パッドを起点に切断領域Zを挟んで千鳥状に配置された半田バンプHを順次伝って切断領域Z上に優先的に濡れ広がっていく。さらに、切断領域Z上に濡れ広がった封止樹脂18は切断領域Zを挟んだ両側に濡れ広がっていく。それにより、切断領域Z上に空隙が生じることを防止することができる。その結果、各製品に搭載される半導体素子Sを安定的に作動させることが可能な配線基板Aを提供することができる。
Next, as shown in FIG. 4C, a
最後に、ベース配線基板10とフレーム配線基板20との間に注入した封止樹脂18を硬化させることにより、図1に示した配線基板Aが完成する。
Finally, the sealing
1a 素子搭載部
1b フレーム接合部
6 第1の接合パッド
10 ベース配線基板
15 開口部
16 第2の接合パッド
18 封止樹脂
20 フレーム配線基板
A 配線基板
H 半田バンプ
Xb、Xf 製品領域
Zb、Zf 切断領域
DESCRIPTION OF SYMBOLS 1a
Claims (5)
次に、前記ベース配線基板と前記フレーム配線基板とを、それぞれ対応する前記第1の接合パッドと第2の接合パッドとが対向するように配置するとともに、対向する前記第1の接合パッドと第2の接合パッドとを半田バンプを介して接合する工程と、
次に、前記フレーム接合部上の前記ベース配線基板と前記フレーム配線基板との間に封止樹脂を注入するとともに硬化させる工程と、を行なう配線基板の製造方法において、前記第1および第2の接合パッドは、前記切断領域に沿う方向に該切断領域を挟んで互いに隣接して千鳥状に並ぶ2列のパッド列を有し、該2列のパッド列における接合パッド同士の隣接間隔が前記切断領域に沿う接合パッド同士よりも前記切断領域を挟んだ接合パッド同士の方が狭いことを特徴とする配線基板の製造方法。 A plurality of product regions having an element mounting portion and a frame-shaped frame joint portion surrounding the element mounting portion on the upper surface are integrally formed vertically and horizontally with a cutting region interposed therebetween, and on each frame joint portion A flat base wiring board having a plurality of first bonding pads formed thereon, a product region corresponding to the product region, and a cutting region corresponding to the cutting region, and an opening surrounding each element mounting portion Preparing a frame wiring board having a plurality of second bonding pads formed at positions corresponding to the first bonding pads on the lower surface;
Next, the base wiring board and the frame wiring board are arranged so that the corresponding first bonding pad and second bonding pad respectively face each other, and the first bonding pad and the second bonding pad that face each other are arranged. Bonding the two bonding pads to each other via solder bumps;
Next, in the method of manufacturing a wiring board, the step of injecting a sealing resin between the base wiring board on the frame joint and the frame wiring board and curing the sealing resin is performed. The bonding pad has two rows of pads arranged in a staggered manner adjacent to each other across the cutting region in a direction along the cutting region, and the adjacent spacing between the bonding pads in the two rows of pads is the cutting distance. A method of manufacturing a wiring board, wherein the bonding pads sandwiching the cutting region are narrower than the bonding pads along the region.
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2016199437A1 (en) * | 2015-06-12 | 2016-12-15 | 株式会社ソシオネクスト | Semiconductor device |
JP2019096735A (en) * | 2017-11-22 | 2019-06-20 | 株式会社伸光製作所 | Assembled circuit board and manufacturing method thereof |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08162733A (en) * | 1994-12-08 | 1996-06-21 | Mitsubishi Electric Corp | Printed board and cutting method therefor |
JP2001144386A (en) * | 1999-11-16 | 2001-05-25 | Sharp Corp | Printed circuit board and manufacturing method therefor |
JP2004221320A (en) * | 2003-01-15 | 2004-08-05 | Matsushita Electric Ind Co Ltd | Semiconductor device and method for manufacturing the same |
JP2004349343A (en) * | 2003-05-20 | 2004-12-09 | Seiko Epson Corp | Method for manufacturing semiconductor device and electronic device |
JP2006253167A (en) * | 2005-03-08 | 2006-09-21 | Nec Corp | Method of manufacturing cavity structure printed wiring board and mounting structure |
US20110140268A1 (en) * | 2009-12-16 | 2011-06-16 | Bok Eng Cheah | High-density inter-package connections for ultra-thin package-on-package structures, and processes of forming same |
US20120081864A1 (en) * | 2010-09-30 | 2012-04-05 | Kyocera Slc Technologies Corporation | Collective printed circuit board |
-
2012
- 2012-10-31 JP JP2012240757A patent/JP2014090148A/en active Pending
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08162733A (en) * | 1994-12-08 | 1996-06-21 | Mitsubishi Electric Corp | Printed board and cutting method therefor |
JP2001144386A (en) * | 1999-11-16 | 2001-05-25 | Sharp Corp | Printed circuit board and manufacturing method therefor |
JP2004221320A (en) * | 2003-01-15 | 2004-08-05 | Matsushita Electric Ind Co Ltd | Semiconductor device and method for manufacturing the same |
JP2004349343A (en) * | 2003-05-20 | 2004-12-09 | Seiko Epson Corp | Method for manufacturing semiconductor device and electronic device |
JP2006253167A (en) * | 2005-03-08 | 2006-09-21 | Nec Corp | Method of manufacturing cavity structure printed wiring board and mounting structure |
US20110140268A1 (en) * | 2009-12-16 | 2011-06-16 | Bok Eng Cheah | High-density inter-package connections for ultra-thin package-on-package structures, and processes of forming same |
US20120081864A1 (en) * | 2010-09-30 | 2012-04-05 | Kyocera Slc Technologies Corporation | Collective printed circuit board |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2016199437A1 (en) * | 2015-06-12 | 2016-12-15 | 株式会社ソシオネクスト | Semiconductor device |
JPWO2016199437A1 (en) * | 2015-06-12 | 2018-03-29 | 株式会社ソシオネクスト | Semiconductor device |
US10269774B2 (en) | 2015-06-12 | 2019-04-23 | Socionext Inc. | Semiconductor device |
JP2019096735A (en) * | 2017-11-22 | 2019-06-20 | 株式会社伸光製作所 | Assembled circuit board and manufacturing method thereof |
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