JP2014086062A - 記憶制御装置、記憶装置、情報処理システム、および、記憶制御方法 - Google Patents
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Abstract
【解決手段】標準リード要求部は、メモリ上のリードアドレスに対して標準の精度によるリードを要求する。エラー訂正部は、標準の精度によるリード要求に応答してメモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行う。高精度リード要求部は、エラー訂正によって訂正できないエラーが発生した場合にはリードアドレスに対して標準の精度より高い精度によるリードを再度要求する。
【選択図】図1
Description
1.第1の実施の形態(基本的制御)
2.第2の実施の形態(エラー訂正ログに基づく制御例)
3.第3の実施の形態(アクセス領域に基づく制御例)
4.第4の実施の形態(エラー訂正コードを二重にした場合の制御例)
5.第5の実施の形態(アクセス頻度に基づく制御例)
6.第6の実施の形態(リフレッシュを併用した制御例)
7.変形例
[情報処理システムの構成]
図1は、本技術の実施の形態における情報処理システムの構成例を示す図である。この情報処理システムは、ホストコンピュータ100と、メモリコントローラ200と、不揮発性メモリ300とを備えている。メモリコントローラ200および不揮発性メモリ300は、メモリシステムを構成する。ホストコンピュータ100は、メモリシステムに対してデータのリードまたはライト等を要求するコマンドを発行するものである。
図3は、本技術の第1の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第1の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、不揮発性メモリ300上のリードアドレスに対してリードリクエストを発行する(ステップS913)。この場合、リードモード設定部241において、リードモードとして通常アクセスが設定される。すなわち、これにより不揮発性メモリ300において、高速であるが比較的精度の低い通常のリード方法によりリードアクセスが行われる。
上述の第1の実施の形態では、リードコマンドを受け取るたびに、まず通常アクセスによるリードを実行し、エラー訂正不可能な場合にのみ高精度アクセスによるリードを行っていた。この第2の実施の形態では、エラー訂正部260によるエラーログを参照して、状況に応じて通常アクセスを省略して、当初から高精度アクセスによるリードを実行する。なお、情報処理システムの基本的な構成は、図1および図2により説明したものと同様であるため、説明を省略する。
図4は、本技術の第2の実施の形態におけるエラーログ保持部242の構成例を示す図である。このエラーログ保持部242は、エラー訂正部260における1回のエラー訂正において訂正されたビットエラーのビット数が所定の閾値を超えた場合に、その際のリードアドレスをエラー訂正ログとして記録管理するものである。この例では、所定の閾値を超えるエラービット数が発生したリードアドレスを16進数により保持している。そして、ログ上に記録された不揮発性メモリのリードアドレスに対してリード処理を行う場合には、高精度アクセスを使用することにより、訂正不可能エラーの発生を未然に防ぐことができる。
図5は、本技術の第2の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第2の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、エラーログ保持部242を参照して、そのリードアドレスがエラーログ保持部242に記録されているか否かを判断する。
上述の第1の実施の形態では、リード対象となるアドレスが何れの領域であっても、まず通常アクセスによるリードを実行し、エラー訂正不可能な場合にのみ高精度アクセスによるリードを行っていた。この第3の実施の形態では、リード対象のアドレスに応じて、通常アクセスを省略して、当初から高精度アクセスによるリードを実行する。なお、情報処理システムの基本的な構成は、図1および図2により説明したものと同様であるため、説明を省略する。
図6は、本技術の第3の実施の形態において想定される論理ページと物理ページの対応関係の一例を示す図である。この第3の実施の形態では、不揮発性メモリをストレージ装置として使用することを想定し、論理ページ610を物理ページ620にマッピングしてアクセスすることにしている。ストレージ装置としての領域を管理するファイルシステムなどの管理情報は正常に読み出されることが必要であり、このようなデータの領域は予め論理フォーマットとして領域を指示するアドレス空間が固定される。そこで、そのような管理情報については高精度アクセスを優先することにより、訂正不可能エラーの発生を抑制する。
図7は、本技術の第3の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第3の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、そのリードアドレスがシステム領域の末尾を超えるか否を判断する。
上述の第1の実施の形態では、エラー訂正コード生成部230、エラー検出部250、および、エラー訂正部260が取り扱うエラー訂正コードは一種類である。すなわち、リード対象となるサイズ等にかかわらず単一のエラー訂正コードを用いることを前提として、まず通常アクセスによるリードを実行し、その後、エラー訂正不可能な場合にのみ高精度アクセスによるリードを行っていた。この第4の実施の形態では、全てのデータに対して512バイトを単位とした第1のエラー訂正コードと、4096バイトを単位とした第2のエラー訂正コードとを付与する。一般に、エラー訂正コードは符号長が長いほどエラー訂正の能力が向上するとされており、ここでは512バイトを単位にした第1のエラー訂正コードよりも、4096バイトを単位とした第2のエラー訂正コードのエラー訂正能力が高いものとする。この第4の実施の形態では、このような二重のエラー訂正コードを想定し、訂正能力の比較的低い512バイト単位のエラー訂正コードを用いるアクセス方法については通常アクセスを省略して、当初から高精度アクセスによるリードを実行する。なお、情報処理システムの基本的な構成は、図1および図2により説明したものと同様であるため、説明を省略する。
図8は、本技術の第4の実施の形態において想定されるデータとエラー訂正コード(ECC)の対応関係の一例を示す図である。この第4の実施の形態では、第1サイズのデータに対しては第1のエラー訂正コードに基づいてエラー訂正を行う。また、第1サイズよりも大きい第2サイズのデータに対しては第1のエラー訂正コードよりも訂正能力の高い第2のエラー訂正コードに基づいてエラー訂正を行う。以下では、一例として、第1サイズを512バイトとし、第2サイズを4Kバイトとして説明する。
図9は、本技術の第4の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第4の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、リード対象となるデータサイズが参照される。
上述の第1の実施の形態では、リード対象となるデータがどのような性質を有するものであっても、まず通常アクセスによるリードを実行し、エラー訂正不可能な場合にのみ高精度アクセスによるリードを行っていた。この第5の実施の形態では、リード対象のデータの性質に応じて、通常アクセスを省略して、当初から高精度アクセスによるリードを実行する。なお、情報処理システムの基本的な構成は、図1および図2により説明したものと同様であるため、説明を省略する。
図10は、本技術の第5の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第5の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、そのリードデータがホットデータであるかコールドデータであるかを判断する。ホットデータであるかコールドデータであるかの判断は、様々な手法により実現できる。例えば、リードコマンドに情報が含まれる場合にはその情報から判断することができる。また、リードアクセスするデータの記録時にライトコマンドに情報が含まれておりメモリコントローラが保持している場合には、その保持している情報から判断することができる。また、ライト処理の後にリードコマンドやライトコマンドとは異なるコマンドにより、該当データに対する情報がメモリコントローラに指示される場合には、その指示された情報から判断することができる。また、メモリコントローラがアクセス頻度等を計数して判断するようにしてもよい。
不揮発性メモリ上に保存されたデータは保存期間が長期になるほど劣化が進み、再度書き込み直すことによって、その保持特性もリフレッシュされることが知られている。そこで、この第6の実施の形態においては、通常アクセスによるリードにおいて、ビットエラーの訂正数が所定の閾値を越えた場合には、そのメモリセルに対してリフレッシュが必要であると判断する。そのリフレッシュ動作では正しいデータがリードされることが必要であり、また、リフレッシュ動作自体はホストコンピュータからのデータアクセスではなくリード時間が長くても問題とはならないため、高精度アクセスを適用することができる。なお、情報処理システムの基本的な構成は、図1および図2により説明したものと同様であるため、説明を省略する。
図11は、本技術の第6の実施の形態における情報処理システムのリード処理の手順例を示す図である。この第6の実施の形態では、リード処理部240はホストコンピュータ100からのリードコマンドを受け取ると、不揮発性メモリ300上のリードアドレスに対してリードリクエストを発行する(ステップS963)。この場合、リードモード設定部241において、リードモードとして通常アクセスが設定される。すなわち、これにより不揮発性メモリ300において、高速であるが比較的精度の低い通常のリード方法によりリードアクセスが行われる。
図12は、本技術の第6の実施の形態における情報処理システムのリフレッシュ処理(ステップS968)の手順例を示す図である。リフレッシュ処理においては、不揮発性メモリ300のリフレッシュアドレスから高精度アクセスによるリードが行われる(ステップS971)。この高精度アクセスによるリードが行われると、リードデータおよびそのエラー訂正コードがエラー検出部250に供給される。エラー検出部250は、リードデータおよびそのエラー訂正コードに基づいて、エラー発生の有無を検出する。そして、エラーの発生が検出された場合には、エラー訂正部260がリードデータおよびそのエラー訂正コードに基づいてエラー訂正を行う。その結果、エラー訂正部260において訂正不可能なエラーが発生した場合には(ステップS972:Yes)、リード処理をエラー終了する。
上述の実施の形態では、将来的にエラー訂正不可能となる可能性のバロメータとして、訂正されたエラービット数が所定の閾値を超えていることを要件としたが、これ以外にも様々な変形例が考えられる。
(1)メモリ上のリードアドレスに対して標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する記憶制御装置。
(2)前記エラー訂正によって全てのエラーが訂正された場合においてその訂正されたビット数が一定の要件を満たした際には前記リードアドレスを記録する記録部をさらに具備し、
新たなリード要求に係る新たなリードアドレスが前記記録部に記録されている場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記新たなリードアドレスに対して行う
前記(1)に記載の記憶制御装置。
(3)前記記録部は、前記訂正されたビット数が所定の閾値を超えた場合に前記一定の要件を満たしたものとして前記リードアドレスを記録する
前記(2)に記載の記憶制御装置。
(4)前記リードアドレスが所定のアドレス領域に該当する場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
前記(1)から(3)のいずれかに記載の記憶制御装置。
(5)前記所定のアドレス領域はシステム領域である前記(4)に記載の記憶制御装置。
(6)前記エラー訂正部は、第1サイズのデータに対しては第1のエラー訂正コードに基づいてエラー訂正を行い、前記第1サイズよりも大きい第2サイズのデータに対しては前記第1のエラー訂正コードよりも訂正能力の高い第2のエラー訂正コードに基づいてエラー訂正を行い、
前記リードアドレスに対するリード要求が前記第1サイズを超えない場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
前記(1)から(5)のいずれかに記載の記憶制御装置。
(7)前記リードアドレスへのアクセス頻度が一定の要件を満たす場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
前記(1)から(6)のいずれかに記載の記憶制御装置。
(8)前記エラー訂正によって全てのエラーが訂正された場合においてその訂正されたビット数が一定の要件を満たした際には前記リードアドレスに対してリフレッシュを要求するリフレッシュ要求部をさらに具備する
前記(1)から(7)のいずれかに記載の記憶制御装置。
(9)前記リフレッシュ要求部は、前記リードアドレスにおいて前記標準の精度より高い精度によるリードを行ってそのリード結果を前記リードアドレスにライトする旨を前記リフレッシュ要求として指示する
前記(8)に記載の記憶制御装置。
(10)標準の精度によるリードおよび前記標準の精度より高い精度によるリードの何れのリード要求にも対応するメモリと、
前記メモリ上のリードアドレスに対して前記標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する記憶装置。
(11)標準の精度によるリードおよび前記標準の精度より高い精度によるリードの何れのリード要求にも対応するメモリと、
前記メモリへのリードアクセスを発行するホストコンピュータと、
前記リードアクセスに応答して前記メモリ上のリードアドレスに対して前記標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する情報処理システム。
(12)メモリ上のリードアドレスに対して標準の精度によるリードを要求する標準リード要求手順と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正手順と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求手順と
を具備する記憶制御方法。
200 メモリコントローラ
210 ホストインターフェース
220 ライト処理部
230 エラー訂正コード生成部
240 リード処理部
241 リードモード設定部
242 エラーログ保持部
250 エラー検出部
260 エラー訂正部
270 メモリインターフェース
300 不揮発性メモリ
310 制御インターフェース
320 メモリバッファ
330 メモリセルアレイ
Claims (12)
- メモリ上のリードアドレスに対して標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する記憶制御装置。 - 前記エラー訂正によって全てのエラーが訂正された場合においてその訂正されたビット数が一定の要件を満たした際には前記リードアドレスを記録する記録部をさらに具備し、
新たなリード要求に係る新たなリードアドレスが前記記録部に記録されている場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記新たなリードアドレスに対して行う
請求項1記載の記憶制御装置。 - 前記記録部は、前記訂正されたビット数が所定の閾値を超えた場合に前記一定の要件を満たしたものとして前記リードアドレスを記録する
請求項2記載の記憶制御装置。 - 前記リードアドレスが所定のアドレス領域に該当する場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
請求項1記載の記憶制御装置。 - 前記所定のアドレス領域はシステム領域である請求項4記載の記憶制御装置。
- 前記エラー訂正部は、第1サイズのデータに対しては第1のエラー訂正コードに基づいてエラー訂正を行い、前記第1サイズよりも大きい第2サイズのデータに対しては前記第1のエラー訂正コードよりも訂正能力の高い第2のエラー訂正コードに基づいてエラー訂正を行い、
前記リードアドレスに対するリード要求が前記第1サイズを超えない場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
請求項1記載の記憶制御装置。 - 前記リードアドレスへのアクセス頻度が一定の要件を満たす場合には前記標準の精度によるリード要求を行うことなく前記高精度によるリード要求を前記リードアドレスに対して行う
請求項1記載の記憶制御装置。 - 前記エラー訂正によって全てのエラーが訂正された場合においてその訂正されたビット数が一定の要件を満たした際には前記リードアドレスに対してリフレッシュを要求するリフレッシュ要求部をさらに具備する
請求項1記載の記憶制御装置。 - 前記リフレッシュ要求部は、前記リードアドレスにおいて前記標準の精度より高い精度によるリードを行ってそのリード結果を前記リードアドレスにライトする旨を前記リフレッシュ要求として指示する
請求項8記載の記憶制御装置。 - 標準の精度によるリードおよび前記標準の精度より高い精度によるリードの何れのリード要求にも対応するメモリと、
前記メモリ上のリードアドレスに対して前記標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する記憶装置。 - 標準の精度によるリードおよび前記標準の精度より高い精度によるリードの何れのリード要求にも対応するメモリと、
前記メモリへのリードアクセスを発行するホストコンピュータと、
前記リードアクセスに応答して前記メモリ上のリードアドレスに対して前記標準の精度によるリードを要求する標準リード要求部と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正部と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求部と
を具備する情報処理システム。 - メモリ上のリードアドレスに対して標準の精度によるリードを要求する標準リード要求手順と、
前記標準の精度によるリード要求に応答して前記メモリから返送されたデータおよびエラー訂正コードに基づいてエラー訂正を行うエラー訂正手順と、
前記エラー訂正によって訂正できないエラーが発生した場合には前記リードアドレスに対して前記標準の精度より高い精度によるリードを再度要求する高精度リード要求手順と
を具備する記憶制御方法。
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