JP2012516115A - シャッフルされたアダマール関数を用いた信号の符号化 - Google Patents
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Abstract
Description
本出願は、2004年9月16日に出願した米国特許出願第10/943677号の一部継続出願、および、2003年3月28日に出願した米国特許出願第10/402878号の一部継続出願である、2009年1月21日に出願した米国特許出願第12/356791号の優先権を主張するものであり、米国特許出願第10/943677号は、2000年12月5日に出願し、現在は米国特許第6829289号である、米国特許出願第09/730697号の継続出願である。
203 ユーザデータ、ユーザデータストリーム、シリアルデータストリーム、データストリーム、データ
208 受信機
210A シンボル、第1のシンボル
210B シンボル、第2のシンボル
210C〜210N シンボル
213 符号化関数、エンコーダ、符号化スキーム
219 送信回路
222 受信回路
225A〜225N 相関器
226 シンボル選択器
Claims (24)
- 電子送信機デバイスで、電子受信機デバイスとの通信のために、複数の所定のデータ値の1つに対応する第1のデータ値を受け取るステップと、
その行がランダムに、または疑似ランダムにシャッフルされた2N×2Nアダマール行列の形をとるデータビットの行列から、前記第1のデータ値に関連するデータビットの列を特定するステップと、
前記電子受信機デバイスに、前記第1のデータ値の代わりに、データビットの前記特定された列を送信するステップと
を含む方法。 - 前記電子受信機でデータを受信するステップと、
前記受信データをデータビットの前記特定された列に相関させるステップと、
前記電子受信機によるさらなる処理のために、前記第1のデータ値を提供するステップと
をさらに含む、請求項1に記載の方法。 - 前記受信データをデータビットの前記特定された列に相関させるステップは、
前記受信データと、前記所定のデータ値の1つが関連する、データビットの前記行列内の各列との間の相関を計算するステップと、
前記受信データが、データビットの前記特定された列に最も強く相関されていることを判定するステップと
を含む、請求項2に記載の方法。 - 計算するステップは、前記相関の符号を計算するステップを含み、判定するステップは、前記計算された符号に基づいて判定するステップを含む、請求項3に記載の方法。
- 前記受信データをデータビットの前記特定された列に相関させるステップは、アダマール変換または高速アダマール変換を計算するステップを含む、請求項2に記載の方法。
- 前記第1のデータ値が、前記電子受信機により、データビットの前記送信される列から、前記電子送信機デバイスにより送信される他のデータと区別して判定され得るように、前記第1のデータ値をデータビットの前記列に関連付けるステップをさらに含む、請求項1に記載の方法。
- データビットの前記列を特定するステップは、データビットの前記行列からのビットの2つ以上の列に論理関数を適用するステップを含む、請求項1に記載の方法。
- 前記2つ以上の列内の各列は、2の累乗の列インデックスを有する、請求項7に記載の方法。
- 前記論理関数を適用するステップは、ビット単位で、排他的OR関数を、前記2つ以上の列に適用するステップを含む、請求項7に記載の方法。
- データビットの前記列を特定するステップは、第mの列を特定するステップを含み、前記論理関数を適用するステップは、ビット単位で、排他的OR関数を、その第mの行が第1の所定の値に等しい値を有する、ビットの前記行列内のそれぞれの2の累乗の列に適用するステップを含む、請求項7に記載の方法。
- 前記電子送信機デバイスおよび前記電子受信機デバイスのそれぞれに含まれるメモリデバイスに、2の累乗のインデックスを有するデータビットの前記行列の列に対応する2N×N行列を格納するステップをさらに含む、請求項7に記載の方法。
- データビットの前記特定された列を送信するステップは、順に、および一度に1ビットで、前記特定された列に含まれる各ビットを送信するステップを含む、請求項1に記載の方法。
- 前記所定のデータ値のそれぞれは、一定数の1つまたは複数のデータビットを有する、請求項1に記載の方法。
- 電子送信機デバイスで、電子受信機デバイスとの通信のために、複数の所定のデータ値の1つに対応する第1のデータ値を受け取るステップと、
その行がランダムに、または疑似ランダムにシャッフルされた2N×2Nアダマール行列の形をとるデータビットの行列から、前記第1のデータ値に関連するデータビットの第mの列を特定するステップと、
ビットの前記第mの列を生成するステップであって、ビット単位で、排他的OR関数を、その第mの行が第1の所定の値に等しい値を有する、ビットの前記行列からの、1つまたは複数の2の累乗の列に適用するステップを含むステップと、
前記電子受信機デバイスに、前記第1のデータ値の代わりに、データビットの前記動的に生成された第mの列を送信するステップと
を含む方法。 - データビットの前記2N×2Nアダマール行列を、圧縮された2N×N行列で格納するステップをさらに含み、2の累乗の列インデックスを有するデータビットの前記行列の列のみが、前記電子送信機デバイスに格納される、請求項14に記載の方法。
- ビットの前記第mの列を生成するステップは、その第mの行が前記第1の値に等しい値を有する、前記圧縮された2N×N行列内の1つまたは複数の列を判定するステップと、ビット単位で、排他的OR関数を、前記1つまたは複数の列に適用するステップとを含む、請求項15に記載の方法。
- 電子受信機と、
前記電子受信機との通信のために、複数の所定のデータ値の1つに対応する第1のデータ値を受け取る電子送信機と
を備えるシステムであって、
前記電子送信機は、その行がランダムに、または疑似ランダムにシャッフルされた2N×2Nアダマール行列の形をとるデータビットの行列から、前記第1のデータ値に関連するデータビットの列を特定し、前記電子受信機デバイスに、前記第1のデータ値の代わりに、データビットの前記特定された列を送信し、
前記電子受信機は、データを受信し、前記受信データをデータビットの前記特定された列に相関させ、さらなる処理のために、前記電子受信機内の回路に前記第1のデータ値を提供するシステム。 - 前記電子送信機は、データビットの前記2N×2Nアダマール行列を、圧縮された2N×N行列で格納するメモリデバイスを備え、2の累乗の列インデックスを有するデータビットの前記行列の列のみが格納される、請求項17に記載のシステム。
- データビットの前記特定された列は、データビットの前記行列の第mの列を含み、
前記電子送信機は、ビット単位で、排他的OR関数を、その第mの行が第1の値を有する、圧縮された2N×N行列内の1つまたは複数の列に適用することにより、前記圧縮された2N×N行列から、第mの列を生成するための回路をさらに備える、
請求項17に記載のシステム。 - 前記電子受信機は、前記受信データと、前記複数の所定のデータ値の中のデータ値が関連する、データビットの前記行列の対応する複数の列のそれぞれとの間の相関を計算する、複数の相関器を備える、請求項17に記載のシステム。
- 前記電子受信機は、(a)データビットの前記行列からの前記対応する列のどれが、前記受信データとの最も強い計算された相関を有するかを判定し、(b)前記判定された対応する列に関連する、前記複数の所定のデータ値からのデータ値を出力する回路をさらに備える、請求項20に記載のシステム。
- 電子受信機と、
前記電子受信機との通信のために、複数の所定のデータ値の1つに対応する第1のデータ値を受け取る電子送信機と、
その行がランダムに、または疑似ランダムにシャッフルされた2N×2Nアダマール行列の形を有する行列からのデータビットを、前記第1のデータ値の代わりに、前記送信機から送信するための手段と
を備えるシステム。 - 前記電子受信機でデータを受信するための、および、前記受信データが前記第1のデータ値に相関されていることを判定するための手段をさらに備える、請求項22に記載のシステム。
- 電子受信機と、
前記電子受信機との通信のために、複数の所定のデータ値の1つに対応する第1のデータ値を受け取る電子送信機と
を備えるシステムであって、
前記送信機は、その行がランダムに、または疑似ランダムにシャッフルされた2N×2Nアダマール行列の形を有するデータビットの行列から、前記複数の所定のデータ値の1つに関連するデータビットの列を特定し、前記電子受信機デバイスに、前記第1のデータ値の代わりに、および前記第1のデータ値に基づいて、データビットの前記特定された列、または、データビットの前記特定された列の補数を送信し、
前記電子受信機は、データを受信し、前記受信データをデータビットの前記特定された列または前記補数に相関させ、さらなる処理のために、前記電子受信機内の回路に前記第1のデータ値を提供するシステム。
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