JP2012191237A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法 Download PDFInfo
- Publication number
- JP2012191237A JP2012191237A JP2012133686A JP2012133686A JP2012191237A JP 2012191237 A JP2012191237 A JP 2012191237A JP 2012133686 A JP2012133686 A JP 2012133686A JP 2012133686 A JP2012133686 A JP 2012133686A JP 2012191237 A JP2012191237 A JP 2012191237A
- Authority
- JP
- Japan
- Prior art keywords
- chip
- semiconductor chip
- image
- light
- semiconductor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies
- H01L24/75—Apparatus for connecting with bump connectors or layer connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32135—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/32145—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
- H01L2224/48465—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/10251—Elemental semiconductors, i.e. Group IV
- H01L2924/10253—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/156—Material
- H01L2924/15786—Material with a principal constituent of the material being a non metallic, non metalloid inorganic material
- H01L2924/15788—Glasses, e.g. amorphous oxides, nitrides or fluorides
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
Landscapes
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Length Measuring Devices By Optical Means (AREA)
- Die Bonding (AREA)
- Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)
Abstract
【解決手段】カメラCAM1は鏡筒KT1の一端と接続され、鏡筒KT1の他端には対物レンズが取り付けられ、この対物レンズを通してチップ1Cの主面の画像を撮影する構成とし、鏡筒KT1とチップ1Cとの間には、面発光照明SSL1、拡散板KB1およびハーフミラーTK1を内部に備え、カメラCAM1と同じ光軸でチップ1Cの主面に光を照射する同軸落射照明の機能を有する鏡筒KT2を配置する。
【選択図】図14
Description
(a)主面が分割領域によって複数のチップ領域に区画され、前記チップ領域の各々に集積回路が形成され、裏面に粘着テープが貼付された半導体ウエハを用意する工程、
(b)前記分割領域に沿って前記半導体ウエハを切断して複数の半導体チップに分割し、前記複数の半導体チップを前記粘着テープで保持する工程、
(c)前記粘着テープで保持された前記複数の半導体チップのうち、前記粘着テープからの剥離対象となる第1の半導体チップの上面に第1の光源からの第1の照射光を上方から照射し、前記第1の半導体チップの前記上面からの第1の反射光を撮像手段によって受光し、前記第1の半導体チップの前記上面の第1の画像を取得する工程、
(d)前記(c)工程にて取得した前記第1の画像から前記第1の半導体チップの有無および前記第1の半導体チップが良品か否かを識別し、前記第1の画像から良品の前記第1の半導体チップの存在を確認した場合には、前記第1の半導体チップの前記上面を吸着コレットで吸着および保持することにより、前記第1の半導体チップを前記粘着テープから剥離する工程、
(e)前記(d)工程後、前記第1の半導体チップの前記上面を前記吸着コレットで吸着および保持しつつ、前記第1の半導体チップの下面をチップ実装領域にダイボンディングする工程。
前記鏡筒内には、前記第1の光源から発せされた前記第1の照射光を拡散させる第1の拡散板が配置され、
前記第1の照射光は、前記拡散板を通過した後に前記第1の半導体チップの前記上面に照射され、
前記第1の照射光および前記第1の反射光は、前記鏡筒内を進行する。
(a)主面が分割領域によって複数のチップ領域に区画され、前記チップ領域の各々に集積回路が形成され、裏面に粘着テープが貼付された半導体ウエハを用意する工程、
(b)前記分割領域に沿って前記半導体ウエハを切断して複数の半導体チップに分割し、前記複数の半導体チップを前記粘着テープで保持する工程、
(c)前記粘着テープで保持された前記複数の半導体チップのうち、前記粘着テープからの剥離対象となる第1の半導体チップの上面に第1の光源からの第1の照射光を上方から照射し、さらに平面で前記第1の半導体チップを挟むように配置された2つの第2の光源から前記第1の半導体チップの前記上面に第2の照射光を照射し、前記第1の半導体チップの前記上面からの第1の反射光を撮像手段によって受光し、前記第1の半導体チップの前記上面の第1の画像を取得する工程、
(d)前記(c)工程にて取得した前記第1の画像から前記第1の半導体チップの有無および前記第1の半導体チップが良品か否かを識別し、前記第1の画像から良品の前記第1の半導体チップの存在を確認した場合には、前記第1の半導体チップの前記上面を吸着コレットで吸着および保持することにより、前記第1の半導体チップを前記粘着テープから剥離する工程、
(e)前記(d)工程後、前記第1の半導体チップの前記上面を前記吸着コレットで吸着および保持しつつ、前記第1の半導体チップの下面をチップ実装領域にダイボンディングする工程。
(1)ダイシングテープ等の粘着テープに保持されている半導体チップを粘着テープから剥離してピックアップする際に、面発光照明を用い、さらにその面発光照明からの照射光を拡散板を透過させた後にピックアップ対象のチップの主面に照射し、その反射光を撮像手段によって受光することによってピックアップ対象のチップの主面の画像を取得するので、鮮明な画像を得ることができる。
(2)ダイシングテープ等の粘着テープに保持されている半導体チップを粘着テープから剥離してピックアップする際に、ピックアップ対象のチップの主面にローアングルで照射光を照射し、その反射光を撮像手段によって受光することによってピックアップ対象のチップの主面の画像を取得するので、鮮明な画像を得ることができる。
(3)ダイシングテープ等の粘着テープに保持されている半導体チップを粘着テープから剥離してピックアップする際に、平面でピックアップ対象のチップの四辺とそれぞれ対向するように4つの光源を配置し、その4つの光源のうちの選択されたものからピックアップ対象のチップの主面にローアングルで照射光を照射し、その反射光を撮像手段によって受光することによってピックアップ対象のチップの主面の画像を取得する。それにより、チップの主面のパターンの特徴が少ない場合でも、チップの主面の特徴を際立たせて抽出することができる。
本実施の形態1は、配線基板上にチップを実装する半導体パッケージの製造に適用したものであり、その製造方法を図1〜図32を用いて工程順に説明する。
次に、本実施の形態2について説明する。
次に、本実施の形態3について説明する。
次に、本実施の形態4について説明する。
次に、本実施の形態5について説明する。
次に、本実施の形態6について説明する。
1CA チップ形成領域(チップ領域)
1W ウエハ
3 バックグラインドテープ
4 ダイシングテープ(粘着テープ)
5 ウエハリング
6 ダイシングブレード
7 押さえ板
8 エキスパンドリング
11 配線基板(実装基板)
12、15 Auワイヤ
13、16 電極
14 第2のチップ
17 モールド樹脂
18 積層パッケージ
102 吸着駒
103 吸引口
104 溝
110A 第1のブロック
110B 第2のブロック
110C 第3のブロック
111A 第1の圧縮コイルばね
111B 第2の圧縮コイルばね
112 プッシャ
AL1〜AL4 弧状照明(第2の光源)
BH ボンディングヘッド
CAM1 カメラ(撮像手段)
DSL1 同軸スポット照明
DSL2、DSL3、DSL4、DSL5 同軸スポット照明(第2の光源)
FC1、FC2 基板カセット
HT XYテーブル
KB1 拡散板(第1の拡散板)
KB2、KB3 拡散板
KT1、KT2 鏡筒
P1〜P12 工程
P101〜P103 工程
P201〜P209 工程
PIC1 画像(第9の画像)
PIC2 画像(第1の画像)
PT1 パターン
PT2 パターン
PTAR1、PTAR2 領域
RL1 リング照明
S 隙間
SSL1 面発光照明(第1の光源、第1の面発光光源)
SSL2、SSL3、SSL4、SSL5 面発光照明(第2の光源)
TK1 ハーフミラー(半透過鏡)
WC ウエハカセット
Claims (6)
- 以下の工程を含む半導体装置の製造方法:
(a)主面が分割領域によって複数のチップ領域に区画され、前記チップ領域の各々に集積回路が形成され、裏面に粘着テープが貼付された半導体ウエハを用意する工程、
(b)前記分割領域に沿って前記半導体ウエハを切断して複数の半導体チップに分割し、前記複数の半導体チップを前記粘着テープで保持する工程、
(c)前記粘着テープで保持された前記複数の半導体チップのうち、前記粘着テープからの剥離対象となる第1の半導体チップの上面に第1の光源からの第1の照射光を上方から照射し、前記第1の半導体チップの前記上面からの第1の反射光を撮像手段によって受光し、前記第1の半導体チップの前記上面の第1の画像を取得する工程、
前記(c)の工程はさらに以下の工程を含む、
(c−1)前記第1の画像から前記第1の半導体チップの有無を識別する工程、
(c−2)前記第1の画像から前記第1の半導体チップのピックアップ位置からの位置ずれ量を算出する工程、
(c−3)前記位置ずれ量を基に前記半導体ウエハを移動させ、前記第1の半導体チップをピックアップ位置に配置する工程、
(c−4)前記第1の画像から前記第1の半導体チップが良品か否かを識別する工程、
(d)前記(c−4)工程にて良品の前記第1の半導体チップを確認した場合には、前記第1の画像から前記第1の半導体チップの前記上面を吸着コレットで吸着および保持することにより、前記第1の半導体チップを前記粘着テープから剥離する工程、
(e)前記(d)工程後、前記第1の半導体チップの前記上面を前記吸着コレットで吸着および保持しつつ、前記第1の半導体チップの下面をチップ実装領域にダイボンディングする工程。
ここで、前記第1の光源は、鏡筒内に配置され面型の発光面より均一な照射を行う第1の面発光光源から形成され、
前記鏡筒内には、前記第1の光源から発せられた前記第1の照射光を拡散させる第1の拡散板が配置され、
前記第1の照射光は、前記拡散板を通過した後に前記第1の半導体チップの前記上面に照射され、
前記第1の照射光および前記第1の反射光は、前記鏡筒内を進行する。 - 請求項1記載の半導体装置の製造方法において、
前記鏡筒内には、半透過鏡が配置され、
前記第1の照射光は、前記半透過鏡を介して前記第1の半導体チップの前記上面に照射され、前記第1の反射光は、前記半透過鏡を介して前記撮像手段へ入射する。 - 請求項1記載の半導体装置の製造方法において、
前記第1の半導体チップの厚さは100μm以下である。 - 請求項1記載の半導体装置の製造方法において、
前記鏡筒外部に第2の照射光を発する第2の光源が配置され、
前記第2の照射光は、前記第1の半導体チップの前記上面および側面に照射され、前記第1の半導体チップの前記側面および前記側面からの第2の反射光は、半透過鏡を介して前記撮像手段へ入射する。 - 請求項4記載の半導体装置の製造方法において、
前記(c)工程において、前記第1の半導体チップの位置が認識できなかった場合、前記第2の光源を点灯もしくは消灯する手段により、前記第1の半導体チップへの光の照射条件を変えて再度前記撮像手段によってピックアップ対象の前記第1の半導体チップの主面を撮影し、取得した画像から前記第1の半導体チップの前記ピックアップ位置からの位置ずれ量を算出する。 - 以下の工程を含む半導体装置の製造方法:
(a)主面が分割領域によって複数のチップ領域に区画され、前記チップ領域の各々に集積回路が形成され、裏面に粘着テープが貼付された半導体ウエハを用意する工程、
(b)前記分割領域に沿って前記半導体ウエハを切断して複数の半導体チップに分割し、前記複数の半導体チップを前記粘着テープで保持する工程、
(c)前記粘着テープで保持された前記複数の半導体チップのうち、前記粘着テープからの剥離対象となる第1の半導体チップの上面に第1の光源からの第1の照射光を上方から照射し、前記第1の半導体チップの前記上面からの第1の反射光を撮像手段によって受光し、前記第1の半導体チップの前記上面の第1の画像を取得する工程、
(d)前記(c)工程にて取得した前記第1の画像から前記第1の半導体チップの有無および前記第1の半導体チップが良品か否かを識別し、前記第1の画像から良品の前記第1の半導体チップの存在を確認した場合には、前記第1の半導体チップの前記上面を吸着コレットで吸着および保持することにより、前記第1の半導体チップを前記粘着テープから剥離する工程、
(e)前記(d)工程後、前記第1の半導体チップの前記上面を前記吸着コレットで吸着および保持しつつ、前記第1の半導体チップの下面をチップ実装領域にダイボンディングする工程。
ここで、前記第1の光源は、鏡筒内に配置され面型の発光面より均一な照射を行う第1の面発光光源から形成され、
前記鏡筒内には、前記第1の光源から発せられた前記第1の照射光を拡散させる第1の拡散板が配置され、
前記第1の照射光は、前記拡散板を通過した後に前記第1の半導体チップの前記上面に照射され、
前記第1の照射光および前記第1の反射光は、前記鏡筒内を進行し、
前記撮像手段は、赤色、緑色および青色のうちの1色以上を選択して受光し、前記赤色、前記緑色および前記青色のすべてを受光することで取得される第2の画像と、前記赤色のみを受光することで取得される第3の画像と、前記緑色のみを受光することで取得される第4の画像と、前記青色のみを受光することで取得される第5の画像と、前記赤色および前記緑色を受光することで取得される第6の画像と、前記赤色および前記青色を受光することで取得される第7の画像と、前記緑色および前記青色を受光することで取得される第8の画像との中から、前記第1の半導体チップの前記上面の特長が最も出ているものを自動的に前記第1の画像とする。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2012133686A JP5438165B2 (ja) | 2012-06-13 | 2012-06-13 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2012133686A JP5438165B2 (ja) | 2012-06-13 | 2012-06-13 | 半導体装置の製造方法 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2006241559A Division JP5054949B2 (ja) | 2006-09-06 | 2006-09-06 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2012191237A true JP2012191237A (ja) | 2012-10-04 |
| JP5438165B2 JP5438165B2 (ja) | 2014-03-12 |
Family
ID=47083970
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2012133686A Active JP5438165B2 (ja) | 2012-06-13 | 2012-06-13 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP5438165B2 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106920762A (zh) * | 2015-12-24 | 2017-07-04 | 捷进科技有限公司 | 半导体制造装置、半导体器件的制造方法及芯片贴装机 |
| CN117352415A (zh) * | 2023-12-05 | 2024-01-05 | 南京阿吉必信息科技有限公司 | 一种红光led倒装芯片结构的制备方法 |
| JP2024021053A (ja) * | 2022-08-02 | 2024-02-15 | 梭特科技股▲分▼有限公司 | ダイの剥離方法 |
| US20240295461A1 (en) * | 2023-03-03 | 2024-09-05 | Gudeng Equipment Co., Ltd. | Inspection device for sub-element of reticle pod |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5999581A (ja) * | 1982-11-30 | 1984-06-08 | Fujitsu Ltd | パタ−ン認識方法及びその装置 |
| JPH05343447A (ja) * | 1992-06-04 | 1993-12-24 | Rohm Co Ltd | 画像認識装置における照明装置 |
| JPH07190726A (ja) * | 1993-12-27 | 1995-07-28 | Nichiden Mach Ltd | 同軸照明装置および方法 |
| JP2001127080A (ja) * | 1999-10-28 | 2001-05-11 | Nec Machinery Corp | ボンダ |
| JP2006041090A (ja) * | 2004-07-26 | 2006-02-09 | Nidec Tosok Corp | ボンディング装置 |
-
2012
- 2012-06-13 JP JP2012133686A patent/JP5438165B2/ja active Active
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5999581A (ja) * | 1982-11-30 | 1984-06-08 | Fujitsu Ltd | パタ−ン認識方法及びその装置 |
| JPH05343447A (ja) * | 1992-06-04 | 1993-12-24 | Rohm Co Ltd | 画像認識装置における照明装置 |
| JPH07190726A (ja) * | 1993-12-27 | 1995-07-28 | Nichiden Mach Ltd | 同軸照明装置および方法 |
| JP2001127080A (ja) * | 1999-10-28 | 2001-05-11 | Nec Machinery Corp | ボンダ |
| JP2006041090A (ja) * | 2004-07-26 | 2006-02-09 | Nidec Tosok Corp | ボンディング装置 |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106920762A (zh) * | 2015-12-24 | 2017-07-04 | 捷进科技有限公司 | 半导体制造装置、半导体器件的制造方法及芯片贴装机 |
| KR20170076545A (ko) * | 2015-12-24 | 2017-07-04 | 파스포드 테크놀로지 주식회사 | 반도체 제조 장치 및 반도체 장치의 제조 방법 |
| JP2024021053A (ja) * | 2022-08-02 | 2024-02-15 | 梭特科技股▲分▼有限公司 | ダイの剥離方法 |
| JP7641328B2 (ja) | 2022-08-02 | 2025-03-06 | 梭特科技股▲分▼有限公司 | ダイの剥離方法 |
| US20240295461A1 (en) * | 2023-03-03 | 2024-09-05 | Gudeng Equipment Co., Ltd. | Inspection device for sub-element of reticle pod |
| CN117352415A (zh) * | 2023-12-05 | 2024-01-05 | 南京阿吉必信息科技有限公司 | 一种红光led倒装芯片结构的制备方法 |
| CN117352415B (zh) * | 2023-12-05 | 2024-02-23 | 南京阿吉必信息科技有限公司 | 一种红光led倒装芯片结构的制备方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP5438165B2 (ja) | 2014-03-12 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP5054949B2 (ja) | 半導体装置の製造方法 | |
| CN106920762B (zh) | 半导体制造装置、半导体器件的制造方法及芯片贴装机 | |
| JP4640173B2 (ja) | ダイシング装置 | |
| CN108206150B (zh) | 芯片接合机 | |
| JP5438165B2 (ja) | 半導体装置の製造方法 | |
| TWI858453B (zh) | 半導體製造裝置、檢查裝置及半導體裝置的製造方法 | |
| JP2014036060A (ja) | 半導体装置の製造方法及び半導体装置の製造装置 | |
| WO2016051660A1 (ja) | 貼り合わせ不良部の検出方法及び検査システム | |
| JP2020155737A (ja) | 半導体製造装置および半導体装置の製造方法 | |
| TWI832143B (zh) | 晶粒接合裝置及半導體裝置的製造方法 | |
| JP2002289628A (ja) | 画像認識方法及び画像認識装置並びに半導体装置の製造方法及び製造装置 | |
| JP2011044497A (ja) | 半導体装置の製造方法 | |
| JP2620723B2 (ja) | 半導体装置の製造方法 | |
| JP2024042228A (ja) | 実装装置および半導体装置の製造方法 | |
| CN117594480A (zh) | 半导体制造装置及半导体器件的制造方法 | |
| TWI883479B (zh) | 安裝裝置及半導體裝置之製造方法 | |
| US20250277752A1 (en) | Optical inspection system, method of optical inspection, and method of manufacturing semiconductor package | |
| JP7682715B2 (ja) | ダイボンディング装置および半導体装置の製造方法 | |
| JP5175610B2 (ja) | 半導体装置の製造方法 | |
| TWI877661B (zh) | 黏晶裝置,黏晶方法及半導體裝置的製造方法 | |
| JP2024016319A (ja) | 実装装置および半導体装置の製造方法 | |
| TWI906766B (zh) | 半導體製造裝置、檢查裝置及半導體裝置的製造方法 | |
| US20250054815A1 (en) | Manufacturing method of substrate with protective member | |
| JP2024016866A (ja) | 実装装置および半導体装置の製造方法 | |
| CN120709172A (zh) | 半导体制造装置、检查装置以及半导体器件的制造方法 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20130621 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20130702 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20130830 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20131119 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20131212 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 5438165 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |