JP2011522301A - クロス・ページ・セクタ、マルチ・ページ符号化およびパー・ページ符号化を使用して多重レベル・セル・フラッシュ・メモリ・デバイスにデータを記憶するための方法および装置 - Google Patents
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Abstract
Description
本出願は、参照により本明細書に組み込まれている、2008年3月11日に出願した米国仮出願第61/068934号の利益を主張するものである。
多重レベル・セル・フラッシュ・メモリの場合、通常、閾値検出器を使用して、特定のセルに関連する電圧値が定義済みメモリ状態に変換される。図2は、参照により本明細書に組み込まれている米国特許第6522580号の教示に基づく、図1の例示的多重レベル・セル・フラッシュ・メモリ130のための一例示的閾値電圧分布を示したものである。図2に示されている例示的実施形態では、個々の記憶素子には、2つのビットのデータを個々のメモリ・セルに記憶するために4つの可能データ状態が使用されている。図2には、個々のピークが1つの状態に対応している4つのピーク210〜213が示されている。多重レベル・セル・フラッシュ・デバイスの場合、セルに2つのビットを記憶するために、閾値電圧分布グラフ200の異なるピーク210〜213が使用される。
本発明の一態様によれば、語線内の個々のページは、任意選択で、異なる符号レートまたは異なるタイプの符号(または両方)を使用して符号化することができる。例えば、Low Density Parity Check Codes(LDPC)、Bose−Chaudhuri−Hocquenghem(BCH)およびReed Solomon(RS)符号を使用することができる。一実施形態では、より高い信頼性を必要とするページには、より強力な符号またはより低い符号レートを使用することができる。例えば、より大きいページ番号は、場合によっては誤りを生じる可能性がより高い。したがってこれらのページは、これらのページの性能を改善する符号または符号レート(または両方)を使用して符号化することができる。誤り率がより高い上位ページには、より強力な誤り修正符号(より低いレートの符号およびLDPC符号など)を使用することができ、また、誤り率がより低い下位ページには、微力な誤り修正符号(より高いレートの符号および代数符号など)を使用することができる。
本発明の他の態様によれば、ページ・レベル、マルチ・ページ・レベルまたは語線レベルに基づいてマルチ・ページ・セル・フラッシュ・メモリ130にアクセスすることができる。上で既に示したように、既存のフラッシュ・デバイスには、ページ・レベル・アクセス技法が使用されており、ページは、フラッシュ・メモリ・デバイスに書き込むことができ、あるいはフラッシュ・メモリ・デバイスから読み出すことができる最小単位である。さらに、本発明によれば、(i)フラッシュ・メモリ・デバイスを符号化し、フラッシュ・メモリ・デバイスに書き込み、あるいはフラッシュ・メモリ・デバイスから読み出すための最小単位として複数のページを使用することができるマルチ・ページ・レベル・アクセス技法、および(ii)語線が、データを符号化し、読み出し、あるいは書き込むための最小データ単位である語線レベル・アクセス技法が可能である。本発明は、この方法で、ページの境界を越えた符号語の符号化を可能にし、あるいは語線内における異なるページのための可変符号レートを可能にすることによって、より優れた柔軟性および有効性を提供している。さらに、本発明によれば、複数のページをまとめて符号化するLDPC符号化技法などの改良型符号化スキームおよび復号化スキームを使用することができる。
図4は、本発明の一態様による、図3のマルチ・ページ・セル・フラッシュ・アレイ300のための一例示的符号器400を示したものである。上で既に示したように、例示的フラッシュ・メモリ130内の個々のページは、独立して符号化することができる。図4に示されているように、例示的語線内の3つの例示的ページに対して、3つの全く異なる符号器420−1ないし420−3が使用されている。これらの3つの符号器420−1ないし420−3は、符号化のタイプ(例えばLDPC、BCHおよびRS)または符号レートあるいはその両方の点で異なっていてもよい。上で示したように、下位ページ・レベルは、中位ページ・レベルおよび上位ページ・レベルより高い符号レートで符号化することができる(その逆についても同様である)。一変形形態では、十分な信頼性を有するいくつかのページ・レベルは、全く符号化することができない。図4に示されているように、以下でさらに説明するデータ管理ユニット110内でのデータ分割の後、フラッシュ・セル・アレイ300の適切なセルに記憶される前に、1つのセル内の個々のビットが個別の符号器420−1ないし420−3によって符号化される。
上で既に示したように、本発明の一態様によれば、個々のページ毎に異なる符号および/または符号レートを使用して語線内の個々のページを独立して符号化および復号化することができる。一変形形態では、語線内の個々のページは、異なる符号レートを使用して符号化することができる。図7は、語線内の個々のページが異なる符号レートで同じ長さに符号化される、本発明の特徴を組み込んだ可変符号レート符号化スキーム700を示したものである。図7の例示的実施態様に示されているように、下位ページおよび中位ページ711、712は、同じ符号レートを使用して符号化され、また、同じ量のユーザ・データ720およびパリティ・ビット730を備えている。上位ページ713は、ページ711、712と比較すると、より低い符号レートを使用して符号化され、したがってより少ないユーザ・データ720を符号化し、利用可能なより多くの数のパリティ・ビット730を有している。例えば、符号化された下位ページおよび中位ページ711、712は、7個のセクタを備えることができ、一方、符号化された上位ページ713は、6個のセクタを備えることができる。以下、図8ないし11に関連して、図7の可変符号レート符号化スキーム700をサポートするための適切な書込みプロセスおよび読出しプロセスについてさらに説明する。
本発明の他の実施形態では、ページは、物理ページの境界を越えてあふれ出ることができる。その場合、図3に示されているように、データを分割し、かつ、符号化するために使用される論理ページと、語線中に記憶される物理ページとを区別することができる。論理ページは、例えば図4に示されている符号化スキームを使用して符号化することができる。通常、語線中の論理ページは、同じ非符号化長(つまり同じ量のユーザ・データ)を有することができるが、符号化長は異なっている。例えば、同じユーザ・データ長を有する論理ページのための可変符号レート実施態様は、長さが異なる符号化論理ページに導くことができ、その場合、論理ページの一部が語線内の1つのページからその語線内の他のページへスピルオーバすることになる。本発明は、この方法で、語線内のセル(スピルオーバ・セルと呼ばれている)の一部を使用して、物理ページ境界を越える論理データ部分を記憶することを企図している。この場合、スピルオーバ・セルは、通常のセルとは異なり、同じ論理ページに属する少なくとも2つのビットを記憶することができる。以下で説明するように、スピルオーバ・セルは、語線内の他のセルと同時にプログラムすることができ、あるいは物理ページ中にシフトする他の論理ページがプログラムされた後にプログラムすることも可能である。一例示的実施態様では、スピルオーバ・セル1220を使用して、上位ページ2のための追加パリティ・ビットを記憶することができる。
図13は、本発明の特徴を組み込んだ多段復号器1300の略ブロック図である。図13に示されているように、多段復号器1300では、対応する復号器1310−0ないし1310−2によってコンポーネント符号が連続的に復号化される。一例示的多段復号器1300についてのより詳細な説明については、例えば、参照により本明細書に組み込まれている、U.Wachsmannら、「Multilevel Codes:Theoretical Concepts and Practical Design Rules」、IEEE Trans.on Information Theory、Vol.45、No.5、1361〜91頁(1999)を参照されたい。
本明細書における多くの流れ図は、複数のステップの一例示的シーケンスを記述したものであるが、シーケンスの変更が可能であることも同じく本発明の一実施形態である。アルゴリズムの様々な置換は、本発明の代替実施形態として企図されている。以上、本発明の例示的実施形態について、ソフトウェア・プログラムにおける処理ステップに関連して説明したが、当業者には明らかであるように、ソフトウェア・プログラムにおける処理ステップとしてのディジタル領域の中で、回路エレメントまたは状態マシンによるハードウェアの中で、あるいはソフトウェアとハードウェアの両方の組合せの中で様々な機能を実施することができる。このようなソフトウェアは、例えばディジタル信号プロセッサ、専用集積回路、マイクロ・コントローラあるいは汎用コンピュータに使用することができる。このようなハードウェアおよびソフトウェアは、集積回路内で実施される回路の中で具体化することができる。
Claims (35)
- 複数のセルを有する多重レベル・セル・フラッシュ・メモリ・デバイスにデータを記憶するための方法であって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットであり、前記方法が、
複数の前記ページを蓄積することと、
前記複数のページを単一のブロックとして符号化することと、
前記単一のブロックを前記多重レベル・セル・フラッシュ・メモリ・デバイスに記憶することと
を含む方法。 - 前記記憶された単一のブロックを復号化するステップをさらに含む、請求項1に記載の方法。
- 前記記憶された単一のブロックを復号化する前記ステップが、前記複数の前記ページを提供し、また、前記方法が、要求されたセクタを前記複合化された複数のページから獲得するステップをさらに含む、請求項2に記載の方法。
- 前記複数のページが前記多重レベル・セル・フラッシュ・メモリ内の単一の語線に対応する、請求項1に記載の方法。
- 前記複数のページが、前記多重レベル・セル・フラッシュ・メモリ・デバイスからの読出しおよび前記多重レベル・セル・フラッシュ・メモリ・デバイスへの書込みのためのものであってもよい最小データ単位である、請求項1に記載の方法。
- 少なくとも1つのセクタが複数のページにまたがる、請求項1に記載の方法。
- 前記複数のページを単一のブロックとして符号化するステップが、単一の符号および単一の符号レートを使用して前記複数のページを符号化する、請求項1に記載の方法。
- 前記複数のページを単一のブロックとして符号化するステップが、複数の符号および複数の符号レートのうちの1つまたは複数を使用して前記複数のページを符号化する、請求項1に記載の方法。
- 前記複数のページを単一のブロックとして符号化するステップが、独自の符号および独自の符号レートのうちの1つまたは複数を使用して前記複数のページの各々を符号化する、請求項1に記載の方法。
- 前記複数の前記ページを蓄積する前記ステップが、jが前記多重レベル・セル・フラッシュ・メモリ・デバイス内の語線当たりのページ数であり、また、kがページ当たりの前記セクタの数であるj×k個のセクタを蓄積するステップをさらに含む、請求項1に記載の方法。
- 前記符号化された単一のブロックを複数のページに分割するステップをさらに含み、また、前記記憶するステップが、前記複数のページの各々を前記多重レベル・セル・フラッシュ・メモリ・デバイスに記憶するステップを含む、請求項1に記載の方法。
- 複数のセルを有する多重レベル・セル・フラッシュ・メモリ・デバイスにデータを記憶するための方法であって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットであり、前記方法が、
前記多重レベル・セル・フラッシュ・メモリ・デバイスに書き込むべき現在のページのページ・タイプを決定することと、
前記決定されたページ・タイプに関連する符号および符号レートのうちの少なくとも1つを決定することと、
前記決定された少なくとも1つの符号および符号レートを使用して前記現在のページを符号化することと、
前記符号化された現在のページを前記多重レベル・セル・フラッシュ・メモリ・デバイスに記憶することと
を含む方法。 - 前記現在のページを符号化する前記ステップに先立って、前記決定されたページ・タイプに関連するページ当たりのセクタの数を決定するステップと、前記決定された数のセクタを蓄積するステップとをさらに含む、請求項12に記載の方法。
- 第2のページ・タイプより強力な符号および第2のページ・タイプより低い符号レートのうちの1つまたは複数を使用して、前記第2のページ・タイプより低い信頼性を有する第1のページ・タイプが符号化される、請求項12に記載の方法。
- 対応する符号レートを使用して、語線内の個々のページが実質的に同様の長さに符号化される、請求項12に記載の方法。
- 少なくとも1つのセクタを読み出す要求を受け取るステップと、前記要求されたセクタを有する前記多重レベル・セル・フラッシュ・メモリ・デバイス内のページを識別するステップと、前記識別されたページに関連する前記少なくとも1つの符号および符号レートを使用して、前記識別されたページを読み出し、かつ、前記読み出されたページを復号化するステップと、メモリ・マップを使用して前記要求されたセクタを前記復号化されたページから獲得するステップとをさらに含む、請求項12に記載の方法。
- 語線内の複数のページを復号化するために、複数の復号化段を備えた多段復号器を使用して1つまたは複数のページを復号化するステップをさらに含む、請求項12に記載の方法。
- 第1のページのための復号化段が他のページのための復号化段に決定を提供する、請求項17に記載の方法。
- 前記決定がハード決定およびソフト決定のうちの1つまたは複数である、請求項18に記載の方法。
- 第1のページが復号化され、前記方法が、前記第1のページに対する復号化誤りが検出されると少なくとも1つの追加ページを復号化するステップをさらに含む、請求項17に記載の方法。
- 複数のセルを有する多重レベル・セル・フラッシュ・メモリ・デバイスにデータを記憶するための方法であって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットであり、前記方法が、
前記多重レベル・セル・フラッシュ・メモリ・デバイスに書き込むべき現在のページのページ・タイプを決定することと、
前記決定されたページ・タイプに関連するページ当たりのセクタの数を決定することと、
前記決定されたセクタの数を蓄積することと、
前記蓄積されたセクタを符号化することと、
前記蓄積されたセクタを前記多重レベル・セル・フラッシュ・メモリ・デバイスに記憶することと
を含む方法。 - 少なくとも1つのセクタが複数のページにまたがり、前記記憶ステップの間、マルチ・ページ・アクセス・スキームおよび語線レベル・アクセス・スキームのうちの1つまたは複数が使用される、請求項21に記載の方法。
- ページ当たりの前記セクタの数が非整数個であり、少なくとも1つのセクタが複数のページにまたがる、請求項21に記載の方法。
- 後続するページのためにセクションの1つまたは複数のごく一部をバッファリングするステップをさらに含む、請求項21に記載の方法。
- 前記蓄積されたセクタを記憶する前記ステップが、マルチ・ページ・アクセス・スキームおよび語線レベル・アクセス・スキームのうちの1つまたは複数を使用する、請求項21に記載の方法。
- 少なくとも1つのセクタを読み出す要求を受け取るステップと、前記要求されたセクタを有する前記多重レベル・セル・フラッシュ・メモリ・デバイス内の1つまたは複数のページを識別するステップと、ページ・レベル・アクセス・スキーム、マルチ・ページ・アクセス・スキームおよび語線レベル・アクセス・スキームを使用して前記識別された1つまたは複数のページを読み出すステップとをさらに含む、請求項21に記載の方法。
- 前記読み出され、識別された1つまたは複数のページを前記識別された1つまたは複数のページに関連する符号および符号レートのうちの少なくとも1つを使用して復号化するステップと、メモリ・マップを使用して前記要求されたセクタを前記復号化された1つまたは複数のページから獲得するステップとをさらに含む、請求項26に記載の方法。
- それぞれ複数の物理ページおよび複数のセルを備えた複数の語線を有する多重レベル・セル・フラッシュ・メモリ・デバイスにデータを記憶するための方法であって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なる論理ページからのビットであり、前記論理ページの各々がユーザ・データの複数のセクタを備え、前記方法が、
第1のセットの論理ページを記憶することであって、前記第1のセットの論理ページ内の個々の論理ページの符号化サイズが前記複数の物理ページのサイズより小さいことと、
第2のセットの論理ページを記憶することであって、前記第2のセットの論理ページ内の個々の論理ページの符号化サイズが前記複数の物理ページのサイズより大きく、かつ、前記第2のセットの論理ページの少なくとも一部がスピルオーバ領域に記憶されることと
を含む方法。 - 前記第1のセットの論理ページを記憶する前記ステップに引き続いて前記スピルオーバ領域がプログラムされる、請求項28に記載の方法。
- 前記第1のセットの論理ページを記憶する前記ステップに先立って前記スピルオーバ領域がプログラムされる、請求項28に記載の方法。
- 前記多重レベル・セル・フラッシュ・メモリ・デバイスが、それぞれ複数の前記ページを備えた複数の語線をさらに備え、前記複数のページの各々が、前記複数のページの各々の非符号化長が実質的に同様の長さになり、また、前記複数のページの各々の符号化長が異なるように関連する符号レートを有する、請求項28に記載の方法。
- 前記多重レベル・セル・フラッシュ・メモリ・デバイスが、それぞれ複数の前記ページを備えた複数の語線をさらに備え、前記複数のページの各々が、前記複数のページの各々の非符号化長が異なり、また、前記複数のページの各々の符号化長が実質的に同様の長さになるように関連する符号レートを有する、請求項28に記載の方法。
- 多重レベル・セル・フラッシュ・メモリ・デバイスであって、
複数のセルであって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットである複数のセルと、
それぞれ複数の前記ページを備えた複数の語線であって、前記複数のページの各々が、前記複数のページの各々の非符号化長が実質的に同様の長さになり、また、前記複数のページの各々の符号化長が異なるように関連する符号レートを有する複数の語線と
を備えた多重レベル・セル・フラッシュ・メモリ・デバイス。 - 多重レベル・セル・フラッシュ・メモリ・デバイスであって、
複数のセルであって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットである複数のセルと、
それぞれ複数の前記ページを備えた複数の語線であって、前記複数のページの各々が、前記複数のページの各々の非符号化長が異なり、また、前記複数のページの各々の符号化長が実質的に同様の長さになるように関連する符号レートを有する複数の語線と
を備えた多重レベル・セル・フラッシュ・メモリ・デバイス。 - 多重レベル・セル・フラッシュ・メモリ・デバイスであって、
複数のセルであって、前記多重レベル・セル・フラッシュ・メモリ・デバイスの個々のセルが複数のビットを記憶することができ、前記複数のビットの各々が異なるページからのビットである複数のセルと、
それぞれ複数の前記ページを備えた複数の語線であって、少なくとも1つのセクタが前記複数のページにまたがっている複数の語線と
を備えた多重レベル・セル・フラッシュ・メモリ・デバイス。
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