JP2010118817A - 適応等化器およびタップ係数制御方法 - Google Patents
適応等化器およびタップ係数制御方法 Download PDFInfo
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Abstract
【解決手段】適応等化器は、入力受信信号1を等化するフィルタリング回路100と、入力受信信号1に含まれる受信パイロット信号5を検出するパイロット信号検出回路104と、受信パイロット信号5とこのパイロット信号の既知の信号パターンとの誤差を計算し、この誤差に基づいてフィルタリング回路100のタップ係数を計算する係数更新回路102と、係数更新回路102で計算された誤差が所定の上限閾値より大きい場合はフィルタリング回路100のタップ数を増加させ、誤差が所定の下限閾値より小さい場合はタップ数を減少させる係数制御回路103とを備える。
【選択図】 図1
Description
一方、特許文献2には、伝送路の遅延広がりを推定し、推定した遅延広がりに適したタップ係数制御を行う適応等化器が開示されている。
また、特許文献2に開示された適応等化器によれば、伝送路の遅延広がりに適したタップ数に設定できるとしている。しかしながら、特許文献2に開示された適応等化器では、伝送路の遅延広がりを推定し、推定した遅延広がりに適したタップ数を選択する技術について具体的な解決手段が明示されていない。したがって、タップ数を可変制御したとしても、選択したタップ数が伝送路の特性に適合しない可能性があった。
以下、本発明の実施の形態について図面を参照して説明する。本実施の形態は、トランスバーサル型適応等化器において、無線伝搬特性が良好な場合に等化に使用するタップ数を減少させることで、無線通信装置の消費電力を低減できることを特徴としている。図1は本発明の第1の実施の形態に係る適応等化器の構成を示すブロック図である。
フィルタリング回路100は、n個の遅延素子101−1,101−2,・・・,101−k,・・・,101−nと、n個の乗算器105−1,105−2,・・・,105−k,・・・,105−nと、加算器106とから構成される。
係数更新回路102は、タップ数指定信号7に従ってタップ数を切り替える。係数更新回路102は、係数制御回路103が等化に使用すると判断したタップについては前述のようにタップ係数を計算し、使用しないと判断したタップについてはタップ係数を0とする。本実施の形態では、物理的なタップ数はn個に固定されており、係数制御回路103がタップ数減少と判断した場合に、使用しないタップ係数を0にする。未使用のタップ係数を0とすることで、フィルタリング回路100の演算量を減少させることができるので、無線通信装置の消費電力を削減することができる。
適応等化器201は、図1の構成を持つ等化器であり、受信入力信号1に対して等化処理を行い、等化出力信号4をデマッピング回路202に送出する。
フレーム同期回路203は、デマッピング信号2024に対してフレーム同期検出処理を行い、受信ディジタルデータ信号2034を出力する。また、フレーム同期回路203は、フレーム同期検出処理によって特定したパイロット信号の位置を示すパイロット信号検出情報20を適応等化器201へ出力する。
なお、本実施の形態では、タップ数の増減量を±1としているが、使用する無線通信装置や通信環境に応じて、タップ数の増減量を別の値に設定してもよい。
次に、本発明の第2の実施の形態について説明する。本実施の形態においても、適応等化器の構成は第1の実施の形態と同様であるので、図1の符号を用いて説明する。本実施の形態では、図1の適応等化器において、係数制御回路103がタップ数減少と判断した場合に、センタータップを適応等化器の遅延時間が最小になる位置へ移動させる。
以上の動作により、本実施の形態では、適応等化器の遅延量を最小限に抑えることができるという効果が得られる。
Claims (11)
- 入力信号を等化するトランスバーサルフィルタリング手段と、
前記入力信号に含まれるパイロット信号を検出するパイロット信号検出手段と、
前記パイロット信号とこのパイロット信号の既知の信号パターンとの誤差を計算し、この誤差に基づいて前記トランスバーサルフィルタリング手段のタップ係数を計算する係数更新手段と、
前記誤差が所定の上限閾値より大きい場合は前記トランスバーサルフィルタリング手段のタップ数を増加させ、前記誤差が所定の下限閾値より小さい場合は前記タップ数を減少させる係数制御手段とを備えることを特徴とする適応等化器。 - 請求項1記載の適応等化器において、
前記係数更新手段は、予め定められた頻度で前記タップ係数の更新を行い、更新時に前記係数制御手段が決定したタップ数に応じて、前記等化に使用するタップについては前記タップ係数を計算し、使用しないタップについては前記タップ係数を0とすることを特徴とする適応等化器。 - 請求項2記載の適応等化器において、
前記係数更新手段は、前記係数制御手段が決定したタップ数に応じて、適応等化器の遅延時間が最小になる位置にセンタータップを設定することを特徴とする適応等化器。 - 請求項3記載の適応等化器において、
前記係数更新手段は、前記タップ数の最大値がn(nは2以上の整数)で、前記係数制御手段からタップ数=p(pは1以上n以下の整数)の指定を受けたとき、m(mは(p+1)/2以上の整数のうち最小の整数)番目のタップ係数をセンタータップとし、1番目からp番目までのタップ係数のみ等化に使用し、(p+1)番目からn番目までのタップ係数を0とすることを特徴とする適応等化器。 - 請求項1記載の適応等化器において、
前記トランスバーサルフィルタリング手段は、
前記入力信号を遅らせる直列接続されたn(nは2以上の整数)個の遅延素子と、
各遅延素子の出力信号とこれに対応するタップ係数とを乗算するn個の乗算器と、
各乗算器の出力信号を合成する加算器とからなることを特徴とする適応等化器。 - 請求項1記載の適応等化器において、
前記係数更新手段は、前記誤差の2乗値が最小となるように前記タップ係数を計算することを特徴とする適応等化器。 - 入力信号に含まれるパイロット信号を検出するパイロット信号検出手順と、
前記パイロット信号とこのパイロット信号の既知の信号パターンとの誤差を計算し、前記入力信号を等化するトランスバーサルフィルタリング手段のタップ係数を前記誤差に基づいて計算する係数更新手順と、
前記誤差が所定の上限閾値より大きい場合は前記トランスバーサルフィルタリング手段のタップ数を増加させ、前記誤差が所定の下限閾値より小さい場合は前記タップ数を減少させる係数制御手順とを備えることを特徴とする適応等化器のタップ係数制御方法。 - 請求項7記載の適応等化器のタップ係数制御方法において、
前記係数更新手順は、予め定められた頻度で前記タップ係数の更新を行い、更新時に前記係数制御手順で決定されたタップ数に応じて、前記等化に使用するタップについては前記タップ係数を計算し、使用しないタップについては前記タップ係数を0とすることを特徴とする適応等化器のタップ係数制御方法。 - 請求項8記載の適応等化器のタップ係数制御方法において、
前記係数更新手順は、前記係数制御手順が決定したタップ数に応じて、適応等化器の遅延時間が最小になる位置にセンタータップを設定することを特徴とする適応等化器のタップ係数制御方法。 - 請求項9記載の適応等化器のタップ係数制御方法において、
前記係数更新手順は、前記タップ数の最大値がn(nは2以上の整数)で、前記係数制御手順でタップ数=p(pは1以上n以下の整数)と決定されたとき、m(mは(p+1)/2以上の整数のうち最小の整数)番目のタップ係数をセンタータップとし、1番目からp番目までのタップ係数のみ等化に使用し、(p+1)番目からn番目までのタップ係数を0とすることを特徴とする適応等化器のタップ係数制御方法。 - 請求項7記載の適応等化器のタップ係数制御方法において、
前記係数更新手順は、前記誤差の2乗値が最小となるように前記タップ係数を計算することを特徴とする適応等化器のタップ係数制御方法。
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