JP2010003299A - 共有されるエラー・ビット・コードをもつ共通フレームにおいてデータおよびデータ・マスク・ビットを転送するためのシステム、方法および装置 - Google Patents
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Abstract
【解決手段】メモリ・システムは、ホストとメモリ・デバイスとの間でデータを転送するためにデータ・フレームを使用する。システムは(別個のビット・レーンを介してではなく)データ・フレーム内で一つまたは複数のデータ・マスク・ビットも転送してもよい。システムは、データ・ビットおよびデータ・マスク・ビットをカバーするエラー・ビット・チェックサム(巡回冗長符号すなわちCRCのような)を生成してもよい。データ・ビット、データ・マスク・ビットおよびチェックサム・ビットは共通フレームにおいて転送される。
【選択図】図1
Description
1)Q[71:0]={DM[7:0].q[63:0]} と設定する
2)CRC[7:0]=Q[71:0]を0b0 10010111で割ったときの余り と設定する。
3)R[7:0]=Q[71:0]を0b0 10010111で割ったときの余り と設定する。
4)R[7:0]≠CRC[7:0]であれば、受け取った符号語は一つまたは複数の誤りを含む。
5)DRAMからERROR〔エラー〕信号を使って誤りが報告される。
D(70) xor D(69) xor D(67) xor D(64) xor D(63) xor D(61) xor
D(59) xor D(58) xor D(54) xor D(53) xor D(51) xor D(50) xor
D(49) xor D(46) xor D(45) xor D(44) xor D(42) xor D(38) xor
D(37) xor D(36) xor D(35) xor D(33) xor D(32) xor D(31) xor
D(30) xor D(27) xor D(25) xor D(24) xor D(23) xor D(22) xor
D(21) xor D(15) xor D(12) xor D(11) xor D(10) xor D(9) xor
D(8) xor D(7) xor D(5) xor D(3) xor D(0);
CRC(1):=
D(71) xor D(69) xor D(68) xor D(67) xor D(65) xor D(63) xor
D(62) xor D(61) xor D(60) xor D(58) xor D(55) xor D(53) xor
D(52) xor D(49) xor D(47) xor D(44) xor D(43) xor D(42) xor
D(39) xor D(35) xor D(34) xor D(30) xor D(28) xor D(27) xor
D(26) xor D(21) xor D(16) xor D(15) xor D(13) xor D(7) xor
D(6) xor D(5) xor D(4) xor D(3) xor D(1) xor D(0);
CRC(2):=
D(68) xor D(67) xor D(66) xor D(62) xor D(58) xor D(56) xor
D(51) xor D(49) xor D(48) xor D(46) xor D(43) xor D(42) xor
D(40) xor D(38) xor D(37) xor D(33) xor D(32) xor D(30) xor
D(29) xor D(28) xor D(25) xor D(24) xor D(23) xor D(21) xor
D(17) xor D(16) xor D(15) xor D(14) xor D(12) xor D(11) xor
D(10) xor D(9) xor D(6) xor D(4) xor D(3) xor D(2) xor
D(1) xor D(0);
CRC(3):=
D(70) xor D(68) xor D(64) xor D(61) xor D(58) xor D(57) xor
D(54) xor D(53) xor D(52) xor D(51) xor D(47) xor D(46) xor
D(45) xor D(43) xor D(42) xor D(41) xor D(39) xor D(37) xor
D(36) xor D(35) xor D(34) xor D(32) xor D(29) xor D(27) xor
D(26) xor D(23) xor D(21) xor D(18) xor D(17) xor D(16) xor
D(13) xor D(9) xor D(8) xor D(4) xor D(2) xor D(1) xor
D(0);
CRC(4):=
D(71) xor D(69) xor D(65) xor D(62) xor D(59) xor D(58) xor
D(55) xor D(54) xor D(53) xor D(52) xor D(48) xor D(47) xor
D(46) xor D(44) xor D(43) xor D(42) xor D(40) xor D(38) xor
D(37) xor D(36) xor D(35) xor D(33) xor D(30) xor D(28) xor
D(27) xor D(24) xor D(22) xor D(19) xor D(18) xor D(17) xor
D(14) xor D(10) xor D(9) xor D(5) xor D(3) xor D(2) xor
D(1);
CRC(5):=
D(69) xor D(67) xor D(66) xor D(64) xor D(61) xor D(60) xor
D(58) xor D(56) xor D(55) xor D(51) xor D(50) xor D(48) xor
D(47) xor D(46) xor D(43) xor D(42) xor D(41) xor D(39) xor
D(35) xor D(34) xor D(33) xor D(32) xor D(30) xor D(29) xor
D(28) xor D(27) xor D(24) xor D(22) xor D(21) xor D(20) xor
D(19) xor D(18) xor D(12) xor D(9) xor D(8) xor D(7) xor
D(6) xor D(5) xor D(4) xor D(2) xor D(0);
CRC(6):=
D(70) xor D(68) xor D(67) xor D(65) xor D(62) xor D(61) xor
D(59) xor D(57) xor D(56) xor D(52) xor D(51) xor D(49) xor
D(48) xor D(47) xor D(44) xor D(43) xor D(42) xor D(40) xor
D(36) xor D(35) xor D(34) xor D(33) xor D(31) xor D(30) xor
D(29) xor D(28) xor D(25) xor D(23) xor D(22) xor D(21) xor
D(20) xor D(19) xor D(13) xor D(10) xor D(9) xor D(8) xor
D(7) xor D(6) xor D(5) xor D(3) xor D(1);
CRC(7):=
D(71) xor D(69) xor D(68) xor D(66) xor D(63) xor D(62) xor
D(60) xor D(58) xor D(57) xor D(53) xor D(52) xor D(50) xor
D(49) xor D(48) xor D(45) xor D(44) xor D(43) xor D(41) xor
D(37) xor D(36) xor D(35) xor D(34) xor D(32) xor D(31) xor
D(30) xor D(29) xor D(26) xor D(24) xor D(23) xor D(22) xor
D(21) xor D(20) xor D(14) xor D(11) xor D(10) xor D(9) xor
D(8) xor D(7) xor D(6) xor D(4) xor D(2)。
102 コマンド/アドレス・レーン(C/Aレーン)
104 データ・レーン(DQレーン)
106 データ・フレーム
110 ホスト(たとえばメモリ・コントローラ)
112 CRC論理
114 フレーム処理論理
116 有効化/無効化論理
120 メモリ・デバイス(たとえばDRAM)
122 CRC論理
124 フレーム処理論理
126 有効化/無効化論理
200 x8フレーム
300 x8フレーム
400 x4フレーム
500 ホスト
502 コア論理
504 CRC生成器
506 TXフレーム処理ユニット
508 データ・マスク・ビット
510 データ・ビット
512 書き込みデータ・フレーム
600 メモリ・デバイス
610 バス
602 メモリ・アレイ
604 TXフレーム処理ユニット
606 Rd_CRC生成器
608 CRC無効化論理
702 少なくとも部分的に複数のデータ・ビットおよび対応する複数のデータ・マスク・ビットに基づいてエラー・ビット・チェックサムを生成
704 複数のデータ・ビット、対応する複数のデータ・マスク・ビットおよびエラー・ビット・チェックサムを含む書き込みフレームを生成
706 書き込みフレームを動的ランダム・アクセス・メモリ(DRAM)・デバイスに転送
708 受信エラー?
710 データ再送信
712 データは有効
Claims (29)
- 集積回路であって:
当該集積回路からメモリ・デバイスに転送されるべきフレームについてエラー・ビット・カバレッジが有効にされているかどうかを示す論理と;
エラー・ビット・カバレッジが有効にされている場合、前記フレームをカバーするエラー・ビット・チェックサムを生成するエラー・ビット生成論理と;
前記フレームを生成するフレーム処理論理とを有しており、前記フレーム処理論理は、複数のデータ・ビット、複数のデータ・マスク・ビットおよび対応するエラー・ビット・チェックサムをもつ第一のフレーム型を含むいくつかの異なるフレーム型に基づいて前記フレームを生成できる、
集積回路。 - 前記フレームが前記第一のフレーム型に基づく、請求項1記載の集積回路。
- 前記データ・マスク・ビットDMが前記フレームの上位ビット位置に位置される、請求項2記載の集積回路。
- 前記エラー・ビット論理がチェックサムCを、少なくとも部分的には、Qを巡回冗長符号(CRC)生成多項式で割ることに基づいて生成する、請求項3記載の集積回路。
- 前記Cが、前記Qを前記CRC生成多項式で割ったときの余りを含む、請求項4記載の集積回路。
- 前記CRC生成多項式が、二進法で表現0b0 10010111によって表される、請求項5記載の集積回路。
- 前記フレームがx8動的ランダム・アクセス・メモリ(DRAM)・デバイスに転送されるものであり、前記Qが少なくとも部分的に、次の表現:Q[71:0]={DM[7:0].q[63:0]}に基づく、請求項6記載の集積回路。
- 前記CがQ[71:0]を0b0 10010111で割ったときの余りである、請求項7記載の集積回路。
- 前記フレーム処理論理が、複数のデータ・ビットおよび対応するエラー・ビット・チェックサムを含む第二のフレーム型に基づいて前記フレームを生成できる、請求項1記載の集積回路。
- 前記フレームが前記第二のフレーム型に基づき、前記メモリ・デバイスがx4の動的ランダム・アクセス・メモリ(DRAM)・デバイスである、請求項9記載の集積回路。
- 前記フレームのビット[71:32]であるQが0と設定される、請求項10記載の集積回路。
- 前記チェックサムCが、Q[71:0]を0b0 10010111で割ったときの余りである、請求項11記載の集積回路。
- 当該集積回路と前記メモリ・デバイスとの間で転送されるフレームについての長さを決定するためのフレーム長制御論理をさらに有する、
請求項1記載の集積回路。 - 読み出しトランザクションについて、前記フレーム長制御論理が、エラー・ビット・カバレッジが有効にされていれば単位区間(UI: unit interval)N個ぶんのフレーム長さを指定し、エラー・ビット・カバレッジが有効にされていなければUI M個ぶんのフレーム長さを指定する、請求項13記載の集積回路。
- 書き込みトランザクションについて、前記フレーム長制御論理が、エラー・ビット・カバレッジが有効にされている場合に、単位区間(UI)N個ぶんのフレーム長を指定する、請求項13記載の集積回路。
- 書き込みトランザクションについて、前記フレーム長制御論理が、エラー・ビット・カバレッジが有効にされていない場合、完全書き込みフレームについてはUI N個ぶんのフレーム長を指定し、部分書き込みフレームについてはUI M個ぶんのフレーム長を指定する、請求項15記載の集積回路。
- Nが10であり、Mが8である、請求項13記載の集積回路。
- 当該集積回路がメモリ・コントローラを含む、請求項1記載の集積回路。
- 少なくとも部分的に、複数のデータ・ビットおよび対応する複数のデータ・マスク・ビットに基づいてエラー・ビット・チェックサムを生成する段階と;
前記複数のデータ・ビット、前記対応する複数のデータ・マスク・ビットおよび前記エラー・ビット・チェックサムを含む書き込みフレームを生成する段階とを有する、
方法。 - 前記書き込みフレームがx8動的ランダム・アクセス・メモリ(DRAM)・デバイスに転送されるものであり、Qが少なくとも部分的に、次の表現:Q[71:0]={DM[7:0].q[63:0]}に基づく、請求項19記載の方法。
- 前記エラー・ビット・チェックサムCが、Q[71:0]を0b0 10010111で割ったときの余りである、請求項20記載の方法。
- ホストであって:
前記ホストから動的ランダム・アクセス・メモリ(DRAM)・デバイスに転送されるべきフレームについて巡回冗長符号(CRC)カバーが有効にされているかどうかを示す論理と;
CRCカバーが有効にされている場合、前記フレームをカバーするCRCチェックサムを生成するCRC生成論理と;
前記フレームを生成するフレーム処理論理とを有しており、前記フレーム処理論理は、複数のデータ・ビット、複数のデータ・マスク・ビットおよび対応するCRCチェックサムをもつ第一のフレーム型を含むいくつかの異なるフレーム型に基づいて前記フレームを生成できる、ホストと;
前記ホストに結合された前記DRAMデバイスとを有する、
システム。 - 前記DRAMデバイスが、
少なくとも部分的に、前記フレームをCRC生成多項式で割ることに基づいてローカルなCRCチェックサムを生成するCRC生成論理と;
前記ローカルなCRCチェックサムを前記CRCチェックサムと比較する比較論理とを有する、
請求項22記載のシステム。 - 前記フレームが前記第一のフレーム型に基づく、請求項23記載のシステム。
- 前記データ・マスク・ビットDMが前記フレームの上位ビット位置に位置される、請求項24記載のシステム。
- 前記エラー・ビット論理がチェックサムCを、少なくとも部分的には、Qを巡回冗長符号(CRC)生成多項式で割ることに基づいて生成する、請求項25記載のシステム。
- 前記Cが、前記Qを前記CRC生成多項式で割ったときの余りを含む、請求項26記載のシステム。
- 前記CRC生成多項式が、二進法で表現0b0 10010111によって表される、請求項27記載のシステム。
- 前記フレームがx8動的ランダム・アクセス・メモリ(DRAM)・デバイスに転送されるものであり、前記Qが少なくとも部分的に、次の表現:Q[71:0]={DM[7:0].q[63:0]}に基づく、請求項28記載のシステム。
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