JP2009139774A - 表示装置 - Google Patents
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- G09G3/3611—Control of matrices with row and column drivers
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Abstract
RGB時分割駆動において、ドレイン線の変動の影響から、容量カップリングが発生しコモン変動の収束が遅れる事により所望の表示輝度からずれる画質劣化(横スメア)が発生する為、画質劣化(横スメア)の改善が課題となる。
【解決手段】
RGB時分割駆動において、時分割順番をフレーム毎に入れ替える、もしくは水平ライン方向で入れ替える。
【選択図】 図2
Description
102…走査回路
103…液晶パネル
104…時分割スイッチ群
105…時分割スイッチ制御信号
106…スイッチ素子
107…コモン信号
1001…ソース信号生成回路
1002…走査回路
1003…液晶パネル
1004…時分割スイッチ群
1005…時分割スイッチ制御信号
1006…スイッチ素子
1007…コモン信号
1101…ソース信号生成回路
1102…走査回路
1103…液晶パネル
1104…時分割スイッチ群
1105…時分割スイッチ制御信号
1106…スイッチ素子
1107…コモン信号
Claims (16)
- 互いに交差する複数本のドレイン線と複数本のゲート線を形成し、その交差部に対応して液晶セルとスイッチング素子からなる画素を形成した液晶表示部と、
所定の時分割数に応じた複数の前記ドレイン線から、任意にドレイン線を選択する事が出来る時分割スイッチと、
前記時分割スイッチの選択、非選択状態を制御する複数の制御信号線と、
複数の前記時分割スイッチに表示信号を伝播する複数の表示信号線と、
前記表示信号を所定の時分割数に対応した時系列で出力端子から前記表示信号線へ出力するソース信号生成回路とを有し、
任意の垂直周期期間で、前記所定の時分割数で分割した複数の選択期間に、第1選択から第N(N≧2の自然数)選択期間では時分割スイッチを選択し、第1時分割スイッチから第N(N≧2の自然数)時分割スイッチの順番で時分割スイッチを選択し、該時分割スイッチを介したドレイン線に適切な表示信号を印加し、或る1垂直周期期間からX番目(X≧1の自然数)の垂直周期期間では、前記第1選択期間から第N選択期間の時分割スイッチの選択順番を逆の順番とし、該時分割スイッチを介して、表示信号を該ドレイン線に印加する事で該ドレイン線に表示信号を順に保持させていき、選択状態にある前記ゲート線上の液晶セルを活性化し、
前記ソース信号生成回路は、該各選択期間で保持状態となる画素に対応した表示信号を、前記所定の時分割数に応じて時系列で出力することを特徴とする液晶表示装置。 - 請求項1記載の液晶表示装置において、
任意の1垂直周期期間で、前記所定の時分割数で分割された複数の選択期間において、第1選択期間から第N(N≧2の自然数)選択期間では時分割スイッチを選択し、第1時分割スイッチから第N(N≧2の自然数)時分割スイッチの順番で時分割スイッチを選択して該時分割スイッチを介したドレイン線に適切な表示信号を印加し、第1選択期間では、第1時分割スイッチと第1選択期間以外で選択すべき時分割スイッチを1または複数選択し、第1選択期間の終了時には、第1時分割スイッチと前記選択された第1選択期間以外で選択すべき時分割スイッチの内の第2選択期間で選択すべき第2時分割スイッチ以外を非選択状態とし、該時分割スイッチを介して、表示信号を該ドレイン線に印加する事で該ドレイン線に表示信号を順に保持させていき、選択状態にある前記ゲート線上の液晶セルを活性化し、
前記ソース信号生成回路は、該各選択期間で保持状態となる画素に対応した表示信号を、前記所定の時分割数に応じて時系列で出力することを特徴とする事を特徴とした液晶表示装置。 - 請求項1記載の液晶表示装置において、
R,G,Bのサブ画素で1ピクセルを構成し、
Rのサブ画素に対応する第1のドレイン線及び第1の時分割スイッチ、Gのサブ画素に対応する第2のドレイン線及び第2の時分割スイッチ、Bのサブ画素に対応する第3のドレイン線及び第3の時分割スイッチの構成を1制御単位とし、
前記1制御単位を制御する時分割スイッチの制御信号線は3本存在し、3本の制御信号線は、第1の制御単位内において、第1の時分割スイッチに対して第1の制御信号線で制御し、第2の時分割スイッチに対して第2の制御信号線で制御し、第3の時分割スイッチに対して第3の制御信号線で制御するとした場合、第1の制御単位に隣接した第2の制御単位では、第2の時分割スイッチに対して第1の制御信号線で制御し、第3の時分割スイッチに対して第2の制御信号線で制御し、第1の時分割スイッチに対して第3の制御信号線で制御し、第1及び第2の制御単位に隣接した第3の制御単位では、第3の時分割スイッチに対して第1の制御信号線で制御し、第1の時分割スイッチに対して第2の制御信号線で制御し、第2の時分割スイッチに対して第3の制御信号線で制御し、該時分割スイッチを介して、表示信号を該ドレイン線に印加する事で該ドレイン線に表示信号を順に保持させていき、選択状態にある前記ゲート線上の液晶セルを活性化し、
前記ソース信号生成回路は、該各選択期間で保持状態となる画素に対応した表示信号を、前記所定の時分割数に応じて時系列で出力することを特徴とした液晶表示装置。 - 請求項1記載の液晶表示装置において、
R,G,Bのサブ画素で1ピクセルを構成し、
Rのサブ画素に対応する第1のドレイン線及び第1の時分割スイッチ、Gのサブ画素に対応する第2のドレイン線及び第2の時分割スイッチ、Bのサブ画素に対応する第3のドレイン線及び第3の時分割スイッチ、及びBのサブ画素に対応する第3のドレイン線を制御する第4の時分割スイッチの構成を1制御単位とし、
前記1制御単位を制御する時分割スイッチの制御信号線は3本存在し、3本の制御信号線は、第1の制御単位内において、第1の時分割スイッチと第4の時分割スイッチに対して第1の制御信号線で制御し、第2の時分割スイッチに対して第2の制御信号線で制御し、第3の時分割スイッチに対して第3の制御信号線で制御し、該時分割スイッチを介して、表示信号を該ドレイン線に印加する事で該ドレイン線に表示信号を順に保持させていき、選択状態にある前記ゲート線上の液晶セルを活性化し、
前記ソース信号生成回路は、該各選択期間で保持状態となる画素に対応した表示信号を、前記所定の時分割数に応じて時系列で出力することを特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
所定の時分割数で分割された複数の選択期間における最初の選択期間は、他選択期間と比べて長い事を特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
1水平期間内のゲート線選択期間の終了タイミングは、1水平期間内を所定の時分割数で分割された複数の選択期間における最後の選択期間の終了タイミングよりも早い事を特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
選択状態にある前記ゲート線上の全液晶セルを活性化させる際に、前記ソース信号生成回路は、奇数番目と偶数番目の出力端子から同極性(正極性又は負極性)の表示信号を出力することを特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
選択状態にある前記ゲート線上の全液晶セルを活性化させる際に、前記ソース信号生成回路は、奇数番目と偶数番目の出力端子から、互いに逆極性(正極性と負極性)の表示信号を出力することを特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
選択状態にある前記ゲート線上の全液晶セルを活性化させる際に、選択したゲート線が奇数番目である状態と偶数番目である場合で、前記ソース信号生成回路は逆極性(正極性と負極性)の表示信号を出力する事を特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
選択状態にある前記ゲート線上の全液晶セルを活性化させる際に、奇数フレームと偶数フレームで、前記ソース信号生成回路は同一ゲート線に逆極性(正極性と負極性)の表示信号を出力する事を特徴とした液晶表示装置。 - 請求項1、2、3の何れかに記載の液晶表示装置において、
前記ゲート走査駆動回路、前記時分割スイッチ、及び前記スイッチング素子等を、ポリシリコンを用いた薄膜トランジスタで構成していることを特徴とした液晶表示装置。 - R用サブ画素、G用サブ画素、B用サブ画素を含む各画素が配列された表示パネルと、
R用表示信号、G用表示信号、B用表示信号の各々を、前記R用サブ画素、前記G用サブ画素、前記B用サブ画素の各々へ、1水平期間内に時分割で供給する駆動回路とを備えた表示装置において、
前記駆動回路は、前記1水平期間内で最後に画素へ供給する表示信号のRGBの種別を、フレームごとに切り替えることを特徴とした表示装置。 - 請求項12に記載の表示装置において、
前記駆動回路は、前記1水平期間内で画素へ供給する表示信号のRGBの種別をフレームごとに切り替える場合に、RGBの何れか1つを固定し、他の2つを、2フレーム周期でフレームごとに切り替えることを特徴とした表示装置。 - 請求項12に記載の表示装置において、
前記駆動回路は、前記1水平期間内で画素へ供給する表示信号のRGBの種別をフレームごとに切り替える場合に、3フレーム周期でフレームごとに切り替えることを特徴とした表示装置。 - R用サブ画素、G用サブ画素、B用サブ画素を含む各画素がマトリックス状に配列された表示パネルと、
R用表示信号、G用表示信号、B用表示信号の各々を、前記R用サブ画素、前記G用サブ画素、前記B用サブ画素の各々へ、1水平期間内に時分割で供給する駆動回路とを備えた表示装置において、
前記駆動回路は、前記1水平期間内で最後に画素へ供給する表示信号のRGBの種別を、画素ごとに切り替えることを特徴とした表示装置。 - 請求項15に記載の表示装置において、
前記表示パネルは、列方向又は行方向のうちの何れかの方向に配列された画素に共通の共通電極を有し、
前記駆動回路は、前記1水平期間内で最後に画素へ供給する表示信号のRGBの種別を、前記共通電極が共通の方向上で画素ごとに切り替えることを特徴とした表示装置。
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