JP2009105291A - 接合構造体およびその製造方法 - Google Patents
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Abstract
【課題】Poly−Siボンディングパッドを有する接合構造体においてAl系ワイヤを用いたウェッジボンディングを行った場合でも、Poly−Si膜ボンディングパッドとAl系ワイヤとを安定してワイヤボンディングできる接合構造体と製造方法を提供する。
【解決手段】Si4上にSiO2膜5が形成され、SiO2膜5上にBPSG膜6が形成され、BPSG膜6上にSiN膜7が形成され、SiN膜7上にPoly−Si膜ボンディングパッド1が形成され、Poly−Si膜ボンディングパッド1上にAl系ワイヤ2が接合されて接合構造体が構成されている。また、Poly−Si膜ボンディングパッド1の表面平均粗さが22nm以下である。Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8を小さくできるので、Al系ワイヤ2とPoly−Si膜ボンディングパッド1との接合面における空隙が小さくなって接合面積が増え、ワイヤボンディング性を向上できる。
【選択図】図1
【解決手段】Si4上にSiO2膜5が形成され、SiO2膜5上にBPSG膜6が形成され、BPSG膜6上にSiN膜7が形成され、SiN膜7上にPoly−Si膜ボンディングパッド1が形成され、Poly−Si膜ボンディングパッド1上にAl系ワイヤ2が接合されて接合構造体が構成されている。また、Poly−Si膜ボンディングパッド1の表面平均粗さが22nm以下である。Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8を小さくできるので、Al系ワイヤ2とPoly−Si膜ボンディングパッド1との接合面における空隙が小さくなって接合面積が増え、ワイヤボンディング性を向上できる。
【選択図】図1
Description
本発明はPoly−Si膜とAl系ワイヤとの接合構造体およびその製造方法に関するものである。
近年、半導体の微細加工技術を用いて電気機械部品を形成するMEMS(Micro Electro Mechanical Systems)技術が注目を浴びており、機械分野・エレクトロニクス分野・通信分野・医療分野などの各種分野において、MEMS技術に関する開発が活発化してきている。
MEMS技術において、フッ酸系薬液でSiをエッチングして所望の形状に加工することが一般的に行われている。この場合には、装置外部と入出力信号との電気的な導通を得る手段として、導通用部品の材料としてフッ酸系薬液でエッチングされる材料を用いることができないため、フッ酸系薬液でエッチングした後にAuやAlワイヤと容易にボンディングできるように、ボンディングパッドをAuやAlで形成する手法が行われている。なお、特許文献1によると、ボンディングパッドにAlを用いた場合、ボンディングパッド表面において、凹凸形状があると、ボンディングワイヤ等のパッドに接触する部材の密着性向上に寄与するとされている。
特開2004−247522公報
しかしながら、AlボンディングパッドをめっきやCVDで形成する場合、この形成工程においてマスクが必要であり、かつ工程が増えて製造コストが大きく上昇し、これに伴って部品コストが高くなる欠点を生じてしまう。
これに対処する方法としては、Alボンディングパッドを形成することなく、フッ酸系薬液にエッチングされないPoly−Si等でボンディングパッドを形成することが考えられる。しかし、この場合に、Poly−Siは、特許文献1に示されるような塑性変形しやすいAlと異なり、塑性変形しにくい性質を有するため、図5に示すように、Poly−Si膜ボンディングパッド1の表面の凹凸が大きいと、Al系ワイヤ2を接合する際に接合部に空隙3ができてしまい、この結果、十分な接合面積が確保できず、ボンディング性能が低下するおそれがある。なお、図5において、1はPoly−Si膜ボンディングパッド、2はAl系ワイヤ、3は空隙である。
本発明は、上記課題を解決するもので、Poly−Si膜ボンディングパッドを有する接合構造体においてAl系ワイヤを用いたウェッジボンディングを行った場合でも、Poly−Si膜ボンディングパッドとAl系ワイヤとを安定してワイヤボンディングすることができる接合構造体およびその製造方法を提供することを目的とする。
上記目的を達成するために本発明の接合構造体は、下記のような特徴を有している。
本発明の請求項1記載の接合構造体は、Si上にSiO2膜が形成され、前記SiO2膜上にBPSG膜またはPSG膜が形成され、前記BPSG膜またはPSG膜上にSiN膜が形成され、前記SiN膜上にPoly−Si膜が形成され、前記Poly−Si膜上にAl系ワイヤが接合されていることを特徴とする。
本発明の請求項1記載の接合構造体は、Si上にSiO2膜が形成され、前記SiO2膜上にBPSG膜またはPSG膜が形成され、前記BPSG膜またはPSG膜上にSiN膜が形成され、前記SiN膜上にPoly−Si膜が形成され、前記Poly−Si膜上にAl系ワイヤが接合されていることを特徴とする。
請求項2記載の接合構造体は、前記構成において、Poly−Si膜表面の平均粗さが、BPSG膜またはPSG膜表面の粗さよりも小さいもしくは同等であることを特徴とする。
請求項3記載の接合構造体は、前記構成において、Poly−Si膜表面の粗さが22nm以下であることを特徴とする。
請求項4記載の接合構造体は、前記構成において、Poly−Si膜の厚みが200nm以上であることを特徴とする。
請求項4記載の接合構造体は、前記構成において、Poly−Si膜の厚みが200nm以上であることを特徴とする。
また、本発明の請求項5記載の接合構造体の製造方法は、Si上にSiO2膜を形成する工程と、前記SiO2膜上にBPSG膜またはPSG膜を形成する工程と、前記BPSG膜またはPSG膜上にSiN膜を形成する工程と、前記SiN膜上にPoly−Si膜を形成する工程と、前記Poly−Si膜上にAl系ワイヤを接合する工程とを有することを特徴とする。
本発明による接合構造体およびその製造方法によれば、ボンディングパッドとしてのPoly−Si膜上にAlやAuを形成するプロセスを必要としないため、従来と比較して製造期間を短縮することができるとともに、マスクの削減もでき、安価な製造プロセスで、Poly−Si膜とAl系ワイヤとの接合構造体を製造することが可能となる。また、本発明によれば、Poly−Si膜の表面平均粗さを小さくできるので、Al系ワイヤとPoly−Si膜との接合面における空隙が小さくなって接合面積が増え、ワイヤボンディング性を向上できる。
以上のように本発明によれば、Poly−Si膜とAl系ワイヤとの直接接合が可能となり、ボンディングパッドとして用いられるPoly−Si膜上にAlやAuを形成するプロセスを必要としないため、AlやAuを形成するマスクや工程の削減を実現することができる。また、Poly−Si膜の表面平均粗さを小さくできるので、Al系ワイヤとPoly−Si膜との接合面積が増え、ワイヤボンディング性能を向上できる。
以下、本発明の実施の形態に係る接合構造体およびその製造方法について図面を参照しながら説明する。
図1および図2は、本発明の実施の形態に係る接合構造体を示す断面図およびPoly−Si膜ボンディングパッド表面の拡大図である。
図1および図2は、本発明の実施の形態に係る接合構造体を示す断面図およびPoly−Si膜ボンディングパッド表面の拡大図である。
図1に示すように、本発明の実施の形態に係る接合構造体は、Si4上にSiO2膜5が形成され、SiO2膜5上にBPSG膜6が形成され、BPSG膜6上にSiN膜7が形成され、SiN膜7上にPoly−Si膜ボンディングパッド1が形成され、Poly−Si膜ボンディングパッド1上にAl系ワイヤ2が接合されて構成されている。なお、図2における8はパッド表面平均粗さである。
この接合構造体は以下のようにして製造される。
1000〜1200℃の酸素雰囲気中でSi4の上にSiO2膜5を形成し、このSiO2膜5を常圧CVD法によりSiH4、O2、PH3およびB2H6ガスを含む雰囲気中において350〜450℃で反応させることにより、SiO2膜5の上にBPSG膜6を形成する。そして、850〜950℃で熱処理を行い、減圧CVDによりSiH2Cl2とNH3ガスを含む雰囲気中において700〜800℃で反応させることによりBPSG膜6の上にSiN膜7を形成し、減圧CVD法によりSiH4ガスを含む雰囲気中において600〜700℃で反応させることによりSiN膜7の上にPoly−Si膜ボンディングパッド1を形成する。この際、Poly−Si膜ボンディングパッド1のパッド表面粗さ8(図2参照)は、BPSG膜6の表面粗さよりも小さいもしくは同等に形成させる。このようにBPSG膜6の表面粗さをコントロールすることにより、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8を抑制して小さくすることが可能である。
1000〜1200℃の酸素雰囲気中でSi4の上にSiO2膜5を形成し、このSiO2膜5を常圧CVD法によりSiH4、O2、PH3およびB2H6ガスを含む雰囲気中において350〜450℃で反応させることにより、SiO2膜5の上にBPSG膜6を形成する。そして、850〜950℃で熱処理を行い、減圧CVDによりSiH2Cl2とNH3ガスを含む雰囲気中において700〜800℃で反応させることによりBPSG膜6の上にSiN膜7を形成し、減圧CVD法によりSiH4ガスを含む雰囲気中において600〜700℃で反応させることによりSiN膜7の上にPoly−Si膜ボンディングパッド1を形成する。この際、Poly−Si膜ボンディングパッド1のパッド表面粗さ8(図2参照)は、BPSG膜6の表面粗さよりも小さいもしくは同等に形成させる。このようにBPSG膜6の表面粗さをコントロールすることにより、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8を抑制して小さくすることが可能である。
図3は、図1のPoly−Si膜ボンディングパッド1とAl系ワイヤ2との接合部を拡大したものである。Poly−Si膜ボンディングパッド1にAl系ワイヤ2を接合する際、Poly−Si膜ボンディングパッド1の表面の状態が、Al系ワイヤ2の塑性変形に関して支配的に影響する。つまり、Poly−Siボンディングパッド1の表面が粗いと、Al系ワイヤ2が変形しても接合面に空隙3が大きくなり、十分な接合強度が得られないが、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8が小さくなることで、Al系ワイヤ2をPoly−Si膜ボンディングパッド1に接合する際、接合面における空隙3が小さくなり、Poly−Si膜ボンディングパッド1とAl系ワイヤ2との接合面積が増えるため、ワイヤボンディング性の劣化を防止することができる。
図4は、Poly−Si膜ボンディングパッド1とAl系ワイヤ2とをワイヤボンディングした後に、プルテスト(引張試験)した際のプル強度と、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8との関係を示したグラフである。図4に示す実験結果より、Poly−Si膜ボンディングパッド1とAl系ワイヤ2との接合構造体において、ワイヤプルテストを実施した場合、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8が22nmより大きくなると、Poly−Si膜ボンディングパッド1とAl系ワイヤ2との接合部界面で破壊し、プル強度が低下する現象の発生が認められるが、Poly−Si膜ボンディングパッド1のパッド表面平均粗さ8が、22nm以下になると、Al系ワイヤ2中での破壊となり、安定したプル強度が得られることがわかる。プルテスト結果からも、Poly−Si膜ボンディングパッド1のパッド表面粗さ8を小さくすることで、Poly−Si膜ボンディングパッド1とAl系ワイヤ2との安定したボンディング性を可能にすることができると考えられる。
前記したBPSG膜6を常圧CVDで形成する場合、B濃度を1wt%以上、P濃度を5.9wt%以上とし、850〜950℃の熱処理をして、BPSG膜6の表面粗さをコントロールすることにより、前記のPoly−Si膜ボンディングパッド1のパッド表面平均表面粗さ8を22nm以下にすることができるため、Poly−Si膜ボンディングパッド1とAl系ワイヤ2とのワイヤボンディング性を安定させることが可能になる。
なお、Poly−Si膜ボンディングパッド1の膜厚を200nm以上とすることで、ワイヤボンディング時のPoly−Si膜ボンディングパッド1にかかるストレスに起因して発生するPoly−Si膜の脆性破壊を防止することができ、Poly−Si膜ボンディングパッド1の膜剥がれを発生させずに、安定したワイヤボンディングをすることが可能となる。
また、上記構成によれば、Poly−Si膜ボンディングパッド1上にAlやAuを形成するプロセスを必要としないため、従来と比較して製造期間を短縮することができるとともに、マスクの削減もできるため、安価な製造プロセスで、Poly−Si膜ボンディングパッド1とAl系ワイヤ2とを安定してワイヤボンディングすることができる接合構造体を提供できる。
なお、前記BPSG膜6は、PSG膜等の層間絶縁膜であってもよい。
以上説明したように、本発明は、特にMEMS技術分野におけるSi系部材とAl系部材の接合構造体について有用である。
1 Poly−Si膜ボンディングパッド
2 Al系ワイヤ
4 Si
5 SiO2膜
6 BPSG膜
7 SiN膜
8 パッド表面平均粗さ
2 Al系ワイヤ
4 Si
5 SiO2膜
6 BPSG膜
7 SiN膜
8 パッド表面平均粗さ
Claims (5)
- Si上にSiO2膜が形成され、前記SiO2膜上にBPSG膜またはPSG膜が形成され、前記BPSG膜またはPSG膜上にSiN膜が形成され、前記SiN膜上にPoly−Si膜が形成され、前記Poly−Si膜上にAl系ワイヤが接合されていることを特徴とする接合構造体。
- Poly−Si膜表面の平均粗さが、BPSG膜表面またはPSG膜表面の粗さよりも小さいもしくは同等であることを特徴とする請求項1記載の接合構造体。
- Poly−Si膜表面の粗さが22nm以下であることを特徴とする請求項1または2に記載の接合構造体。
- Poly−Si膜の厚みが200nm以上であることを特徴とする請求項1〜3の何れか1項に記載の接合構造体。
- Si上にSiO2膜を形成する工程と、前記SiO2膜上にBPSG膜またはPSG膜を形成する工程と、前記BPSG膜またはPSG膜上にSiN膜を形成する工程と、前記SiN膜上にPoly−Si膜を形成する工程と、前記Poly−Si膜上にAl系ワイヤを接合する工程とを有することを特徴とする接合構造体の製造方法。
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4824801A (en) * | 1986-09-09 | 1989-04-25 | Mitsubishi Denki Kabushiki Kaisha | Method of manufacturing aluminum bonding pad with PSG coating |
JP2757782B2 (ja) * | 1994-06-30 | 1998-05-25 | 日本電気株式会社 | 半導体装置の製造方法 |
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US7535100B2 (en) * | 2002-07-12 | 2009-05-19 | The United States Of America As Represented By The Secretary Of The Navy | Wafer bonding of thinned electronic materials and circuits to high performance substrates |
US7279713B2 (en) * | 2003-05-09 | 2007-10-09 | Au Optronics Corp. | Bonding pad and method for manufacturing the same |
US20080105935A1 (en) * | 2004-08-31 | 2008-05-08 | Hiroshi Ogura | Micromachine Device |
JP2007053130A (ja) * | 2005-08-15 | 2007-03-01 | Matsushita Electric Ind Co Ltd | 接合構造および接合方法 |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20220136150A (ko) | 2021-03-30 | 2022-10-07 | 사카타 인쿠스 가부시키가이샤 | 피막 형성용 조성물, 피막 형성용 조성물을 도공하여 이루어지는 적층체, 이 적층체를 이용한 지문 인증 센서, 및 경화 피막의 형성 방법 |
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