JP2008225064A - 画素クロック生成装置および光走査装置および画像形成装置 - Google Patents
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Abstract
【課題】 走査幅の補正や画素の位置ずれ補正などの画素に対する補正を行った場合に、画素クロックの周波数上昇を抑えることができ、画像データ生成部の誤動作を防ぐことが可能な画素クロック生成装置を提供する。
【解決手段】 本発明の画素クロック生成装置は、画素クロックの遷移タイミングを指示する位相データに基づいて、1クロックごとに周期を制御可能な画素クロックを生成するものであり、前記画素クロックに同期して増減用位相データをあらかじめ挿入しておく挿入手段1と、画素に対する所定の補正を行う場合に、あらかじめ挿入してある増減用位相データを削除するか、または、更に増減用位相データを追加する補正手段2とを備えている。
【選択図】 図1
【解決手段】 本発明の画素クロック生成装置は、画素クロックの遷移タイミングを指示する位相データに基づいて、1クロックごとに周期を制御可能な画素クロックを生成するものであり、前記画素クロックに同期して増減用位相データをあらかじめ挿入しておく挿入手段1と、画素に対する所定の補正を行う場合に、あらかじめ挿入してある増減用位相データを削除するか、または、更に増減用位相データを追加する補正手段2とを備えている。
【選択図】 図1
Description
本発明は、画素クロック生成装置および光走査装置および画像形成装置に関する。
レーザプリンタ,デジタル複写機等の画像形成装置の一般的構成を図6に示す。図6において、半導体レーザユニット1001から出射されたレーザ光は、回転するポリゴンミラー1002によりスキャンされ、走査レンズ1003を介して被走査媒体である感光体1004上に光スポットを形成し、該感光体1004を露光して静電潜像を形成する。このとき、1ライン毎に、フォトディテクタ1005が走査ビームを検出する。位相同期回路1009は、クロック生成回路1008のクロックを入力し、フォトディテクタ1005の出力信号に基づいて、1ライン毎、位相同期のとられた画像クロック(画素クロック)を生成して画像処理ユニット1006とレーザ駆動回路1007へ供給する。このようにして、半導体レーザユニット1001は、画像処理ユニット1006により生成された画像データと位相同期回路1009により1ライン毎に位相が設定された画像クロックに従い、半導体レーザの発光時間をコントロールすることにより、被走査媒体1004上の静電潜像をコントロールする。
このような走査光学系において、ポリゴンスキャナ等の偏向器の偏向反射面の回転軸からの距離のばらつきは、被走査面上を走査する光スポット(走査ビーム)の走査速度ムラを発生させる。この走査速度ムラは画像の揺らぎとなり画像品質の劣化となる。高品位の画質を要求する場合は走査ムラの補正を行う必要がある。
さらに、マルチビーム光学系の場合、各発光源の発振波長に差があると、走査レンズの色収差が補正されていない光学系の場合に露光位置ずれが発生し、各発光源に対応するスポットが被走査媒体上を走査する時の走査幅は、発光源ごとに差が生じてしまい、画像品質の劣化の要因になってしまうため、走査幅の補正を行う必要がある。
従来、走査ムラ等の補正を行う技術としては、例えば、特許文献1や特許文献2に記載のように、基本的に画素クロックの周波数を変化させて、走査線に沿った光スポット位置を制御する方法が知られている。
しかしながら、これら画素クロックの周波数を変化させる従来方式(周波数変調方式)は、一般に画素クロック制御部の構成が複雑であり、かつ、その複雑さは周波数変調幅が微小になるにつれて増大するため、きめ細かな制御ができないという問題がある。
そのため、特許文献3や特許文献4には、より簡単な構成で1クロックごとにその周期を制御可能な画素クロックを生成する方法が示されている。図7には、特許文献3や特許文献4に記載の仕方により生成される画素クロックが示されている。特許文献3や特許文献4に記載の仕方では、図7に示すように、位相データを画素クロックに同期して入力することにより、その位相データに対応して位相をシフトし、クロック幅を長くした画素クロックPCLK、または、クロック幅を短くした画素クロックPCLKを生成することができる。図7の例では、位相データが「01」の場合は、位相データが「00」の場合に比べて1/16PCLK分クロック幅が長くなった画素クロックを生成し、位相データが「11」の場合は、位相データが「00」の場合に比べて1/16PCLK分クロック幅が短くなった画素クロックを生成している。そして、このような画素クロックを用いて走査幅の補正を行っている。すなわち、図7(a)は補正前の画素クロックであり、クロック幅T1で繰り返している。そして、走査幅が短い場合は、図7(b)のように位相データ「01」を与えることにより、クロック幅を長くし、補正を行う。走査幅が長い場合は、図7(c)のように位相データ「11」を与えることによりクロック幅を短くし、補正を行う。
しかしながら、上記画素クロックを用いて、走査幅の補正や画素の位置ずれ補正を行うときに、1/16PCLK分クロック幅を短くすると、その瞬間画素クロックの周波数が上がったことになり、この画素クロックを用いて動作している画像データ生成部がその動作周波数に対応できず誤動作してしまうという問題がある。
本発明は、走査幅の補正や画素の位置ずれ補正などの画素に対する補正を行った場合に、画素クロックの周波数上昇を抑えることができ、画像データ生成部の誤動作を防ぐことが可能な画素クロック生成装置および光走査装置および画像形成装置を提供することを目的としている。
上記目的を達成するために、請求項1記載の発明は、画素クロックの遷移タイミングを指示する位相データに基づいて、1クロックごとに周期を制御可能な画素クロックを生成する画素クロック生成装置において、前記画素クロックに同期して増減用位相データをあらかじめ挿入しておく挿入手段と、画素に対する所定の補正を行う場合に、あらかじめ挿入してある増減用位相データを削除するか、または、更に増減用位相データを追加する補正手段とを備えていることを特徴としている。
また、請求項2記載の発明は、請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が長くなるデータであることを特徴としている。
また、請求項3記載の発明は、請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が短くなるデータであることを特徴としている。
また、請求項4記載の発明は、請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、等間隔に挿入されることを特徴としている。
また、請求項5記載の発明は、請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が長くなるデータであり、等間隔に挿入されることを特徴としている。
また、請求項6記載の発明は、請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が短くなるデータであり、等間隔に挿入されることを特徴としている。
また、請求項7記載の発明は、光源から出力される光束を、偏向器により走査方向に沿って被走査媒体上を走査させる光走査装置において、画素クロックを生成する画素クロック生成装置に請求項1乃至請求項6のいずれか一個に記載の画素クロック生成装置が用いられることを特徴としている。
また、請求項8記載の発明は、請求項7記載の光走査装置を露光手段として用いて画像形成することを特徴とする画像形成装置である。
請求項1乃至請求項6記載の発明によれば、走査幅の補正や画素の位置ずれ補正などの画素に対する補正を行った場合に、画素クロックの周波数上昇を抑えることができ、画像データ生成部の誤動作を防ぐことができ、さらに、周波数上昇を抑えることができるので、省電力を図ることができる。
また、請求項7,請求項8記載の発明によれば、画素クロックを生成する画素クロック生成装置に請求項1乃至請求項6のいずれか一個に記載の画素クロック生成装置を用いるので、高品質の画像を得ることができるとともに、画像データ生成時の誤作動を防止することができる。
以下、本発明を実施するための最良の形態を図面に基づいて説明する。
図1は本発明の画素クロック生成装置の構成例を示す図である。図1を参照すると、本発明の画素クロック生成装置は、画素クロックの遷移タイミングを指示する位相データに基づいて、1クロックごとに周期を制御可能な画素クロックを生成するものであり、前記画素クロックに同期して増減用位相データをあらかじめ挿入しておく挿入手段1と、画素に対する所定の補正を行う場合に、あらかじめ挿入してある増減用位相データを削除するか、または、更に増減用位相データを追加する補正手段2とを備えている。
本発明の画素クロック生成装置による倍率補正,画素の位置ずれ補正を行うための画素クロックの制御方法について図2を用いて説明する。
図2(a)は倍率補正,画素の位置ずれ補正を行う前の画素クロックを示している。図
2の例では、図2(a)に示すように1クロックおきにあらかじめ位相データ「01」を与えておき、クロック幅を1クロックおきに1/16T2分だけ長くしておく。なお、位相データ「00」の時のクロック幅T2は、従来の補正方法による位相データが「00」のときの画素クロックのクロック幅をT1とした場合(図7を参照)、32/33T1となるようにする。
2の例では、図2(a)に示すように1クロックおきにあらかじめ位相データ「01」を与えておき、クロック幅を1クロックおきに1/16T2分だけ長くしておく。なお、位相データ「00」の時のクロック幅T2は、従来の補正方法による位相データが「00」のときの画素クロックのクロック幅をT1とした場合(図7を参照)、32/33T1となるようにする。
次に、倍率補正,画素の位置ずれ補正を行うためにクロック幅を長くする場合について説明する。この場合は、図2(b)に示すように、図2(a)における位相データが「00」のところを位相データ「01」にすることにより(増減用位相データを追加することにより)、そのクロック幅1/16T2分長くして倍率補正、画素の位置ずれ補正を行う。
次に、倍率補正,画素の位置ずれ補正を行うためにクロック幅を短くする場合について説明する。この場合は、図2(c)に示すように、図2(a)における位相データが「01」のところを位相データ「00」にすることにより(増減用位相データを削除することにより)、そのクロック幅を1/16T2分短くして倍率補正,画素の位置ずれ補正を行う。
以上のようにすることにより、本発明での画素クロックのもっとも短いクロック幅はT2(=32/33T1)で、従来の方法の場合のもっとも短いクロック幅15/16T1よりも長いので、走査幅、あるいは画素の位置ずれ補正を行っても、画素クロックの周波数上昇を抑えることができ、画像データ生成部の誤動作を防ぐことができる。
図3は、本発明の画素クロック生成装置による倍率補正,画素の位置ずれ補正を行うための画素クロックの制御方法の他の仕方を説明するための図である。
図3(a)は倍率補正,画素の位置ずれ補正を行う前の画素クロックを示している。図3の例では、図3(a)に示すように1クロックおきにあらかじめ増減用位相データ「11」を与えておき、クロック幅を1クロックおきに1/16T3分だけ短くしておく。なお、位相データ「00」の時のクロック幅T3は、従来の補正方法による位相データが「00」のときの画素クロックのクロック幅をT1とした場合(図7を参照)、32/31T1となるようにする。
次に、倍率補正,画素の位置ずれ補正を行うためにクロック幅を長くする場合について説明する。この場合は、図3(b)に示すように、図3(a)における位相データが「11」のところを位相データ「00」にすることにより(増減用位相データを削除することにより)、そのクロック幅1/16T3分長くして倍率補正,画素の位置ずれ補正を行う。
次に、倍率補正,画素の位置ずれ補正を行うためにクロック幅を短くする場合について説明する。この場合は、図3(c)に示すように、図3(a)における位相データが「00」のところを位相データ「11」にすることにより(増減用位相データを追加することにより)、そのクロック幅を1/16T3分短くして倍率補正,画素の位置ずれ補正を行う。
以上のようにすることにより、本発明での画素クロックのもっとも短いクロック幅は15/16T3(=30/31T1)で、従来の方法の場合のもっとも短いクロック幅15/16T1よりも長いので、走査幅、あるいは画素の位置ずれ補正を行っても、画素クロックの周波数上昇を抑えることができ、画像データ生成部の誤動作を防ぐことができる。
図2,図3の各例では、あらかじめ位相データを1クロックおきに入れているが、2クロックおき、または3クロックおきと挿入間隔を変えてもよい。また、挿入する場合は等間隔に入れるようにすることにより、濃度むらが目立たなくすることができる。
更に本発明は、上述したように周波数上昇を抑えることができるので、省電力を図ることができる。
図4は本発明の画素クロック生成装置を用いた光走査装置を示す図である。
図4において、光源ユニット801の背面には半導体レーザの制御を司る駆動回路及び画素クロック生成装置が形成されたプリント基板802が装着され、光軸と直交する光学ハウジングの壁面にスプリングにより当接され、調節ネジ803により傾きが合わせられ姿勢が保持される。尚、調節ネジ803はハウジング壁面に形成された突起部に螺合される。光学ハウジング内部には、シリンダレンズ805、ポリゴンミラーを回転するポリゴンモータ808、fθレンズ806、トロイダルレンズ、および折り返しミラー807が各々位置決めされ支持され、また、同期検知センサを実装するプリント基板809は、ハウジング壁面に光源ユニットと同様、外側より装着される。光学ハウジングは、カバー811により上部を封止し、壁面から突出した複数の取付部810にて画像形成装置本体のフレーム部材にネジ固定される。
図5は、図4の光走査装置を搭載した画像形成装置の例を示す図である。図5を参照すると、被走査面である感光体ドラム901の周囲には、感光体を高圧に帯電する帯電チャージャ902、光走査装置900により記録された静電潜像に帯電したトナーを付着して顕像化する現像ローラ903、現像ローラ903にトナーを供給するトナーカートリッジ904、ドラム901に残ったトナーを掻き取り備蓄するクリーニングケース905が配置される。感光体ドラム901へは、1面毎に複数ライン同時に潜像記録が行われる。記録紙は給紙トレイ914から給紙コロ907により供給され、レジストローラ対908により副走査方向の記録開始のタイミングに合わせて送りだされ、感光体ドラムを通過する際に転写チャージャ906によってトナーが転写され、定着ローラ909で定着して排紙ローラ912により排紙トレイ910に排出される。
図4,図5の光走査装置,画像形成装置では、本発明の画素クロック生成装置が用いられているので、高品質の画像を得ることができるとともに、画像データ生成時の誤作動を防止することができる。
本発明は、デジタル複写機やレーザプリンタ等に利用可能である。
1 挿入手段
2 補正手段
2 補正手段
Claims (8)
- 画素クロックの遷移タイミングを指示する位相データに基づいて、1クロックごとに周期を制御可能な画素クロックを生成する画素クロック生成装置において、前記画素クロックに同期して増減用位相データをあらかじめ挿入しておく挿入手段と、画素に対する所定の補正を行う場合に、あらかじめ挿入してある増減用位相データを削除するか、または、更に増減用位相データを追加する補正手段とを備えていることを特徴とする画素クロック生成装置。
- 請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が長くなるデータであることを特徴とする画素クロック生成装置。
- 請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が短くなるデータであることを特徴とする画素クロック生成装置。
- 請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、等間隔に挿入されることを特徴とする画素クロック生成装置。
- 請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が長くなるデータであり、等間隔に挿入されることを特徴とする画素クロック生成装置。
- 請求項1記載の画素クロック生成装置において、あらかじめ挿入する増減用位相データは、前記画素クロックの周期が短くなるデータであり、等間隔に挿入されることを特徴とする画素クロック生成装置。
- 光源から出力される光束を、偏向器により走査方向に沿って被走査媒体上を走査させる光走査装置において、画素クロックを生成する画素クロック生成装置に請求項1乃至請求項6のいずれか一個に記載の画素クロック生成装置が用いられることを特徴とする光走査装置。
- 請求項7記載の光走査装置を露光手段として用いて画像形成することを特徴とする画像形成装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007063363A JP2008225064A (ja) | 2007-03-13 | 2007-03-13 | 画素クロック生成装置および光走査装置および画像形成装置 |
Applications Claiming Priority (1)
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JP2007063363A JP2008225064A (ja) | 2007-03-13 | 2007-03-13 | 画素クロック生成装置および光走査装置および画像形成装置 |
Publications (1)
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JP2008225064A true JP2008225064A (ja) | 2008-09-25 |
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Family Applications (1)
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JP2007063363A Pending JP2008225064A (ja) | 2007-03-13 | 2007-03-13 | 画素クロック生成装置および光走査装置および画像形成装置 |
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2007
- 2007-03-13 JP JP2007063363A patent/JP2008225064A/ja active Pending
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