JP2008210842A - バンプ付電子部品の実装方法 - Google Patents

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Abstract

【課題】本発明は、バンプ電極付き電子部品を基板にフリップチップ接続する際に、基板の反りを低減し、精度の高い電子装置を提供することを目的とする。
【解決手段】バンプ電極が形成された電子部品11を、熱硬化性樹脂により基板に固着させるフリップチップ実装方法であって、基板上に熱硬化性樹脂を塗布する工程と、底面の中央部に形成された凹部と、この凹部に連通する吸着孔と、前記凹部を取り囲み前記バンプ電極の裏面に接触する凸部と、さらに加熱装置および吸引装置を備えたアタッチメント30を用いて、バンプ電極の裏面から電子部品を吸引保持しながら、基板の電極にバンプ電極を位置あわせして電子部品を基板に載置する工程と、電子部品の中央部分の熱硬化性樹脂の温度と、アタッチメントの前記凸部との温度差が50℃以上となるように調節しながら、電子部品を基板に対して押し付ける接続工程とを有する実装方法。
【選択図】図3

Description

本発明は、バンプ電極付電子部品を基板にフリップチップ実装する実装方法に関する。
近年、電子機器製造分野の技術の向上にともない、半導体素子等の電子部品の大型化が進む一方、電子機器の小型軽量化の要求に応えるため、電子部品をフェースダウンに配線基板に搭載接合するフリップチップ実装が多く用いられつつある。
フリップチップ実装は、代表的には、半導体素子の電極にバンプと称する突起を設け、これをフェースダウンに配線基板と対向させて、相互の電極を接合するもので、ワイヤボンディング実装などに比べ高密度実装が可能であるという特長を有している。一般にフリップチップ実装では、半導体素子回路面を外的環境から保護するとともに、半導体素子と配線基板とを機械的に接着するため、あるいは、半導体素子と配線基板の熱膨張率の差に起因する熱応力の電極接合部分への集中を緩和するなどの目的で、半導体素子と配線基板の間隙にエポキシ樹脂や異方性導電材などの樹脂組成物を充填している。
従来、フリップチップ実装方法として、次の方法が採用されていた。まず、図5に示すように、電極14が設けられた基板13上に、熱硬化性樹脂15を塗布しておく。一方、バンプ電極12が形成された電子部品(半導体チップ等)11を、裏面からアタッチメント20で保持する。アタッチメント20は、電子部品11に接触する底面を有し、また中央部付近に吸着孔21が設けられており、ここから減圧に吸引することで、電子部品11を保持することができる。次に電子部品11をアタッチメント20で保持した状態で、バンプ電極12と基板13上の電極14との位置合わせをしながら、基板上に載置する。そして、図6に示すように、図示していない加熱装置でアタッチメント20を加熱しながら、電子部品11を基板13に押し付ける。このとき、熱硬化性樹脂の硬化する。図7に示すように、必要により冷却しながら、吸着を解放することで、基板13に対する電子部品11の搭載が完了する。
バンプ電極と基板上の電極の組み合わせは種々の形態が知られているが、例えばバンプ電極は金等の金属で形成され、他方の基板上電極は金メッキや銀メッキが施されていたり、ハンダプレコートが設けられていたりしている。バンプ電極と基板上電極の電気的接続の信頼性を上げるためには、熱硬化性樹脂が硬化して基板と電子部品をしっかりと接着することが必要である。電極を溶融させて接続する形態に比べ、電極同士を接触させて接続する形態では特に、接続直後から基板と電子部品の強固な接着が求められる。しかし、基板13全体が加熱されることにより、基板と電子部品の熱膨張率の差から熱収縮により基板に反りが生じる問題があった。
特開平11−307580号公報(特許文献1)には、吸着孔の周囲を完全に囲み、バンプ電極の配列に相当する形状の突起部を底面に設けたチップ吸着用ツールが記載されている(請求項1および2、図3等)。このチップ吸着用ツールを用いると、チップを変形することなく効果的な加圧ができるとしている(同文献段落0022)。しかし、特許文献1には、基板の反りの問題を解決する方法に関しては全く記載がない。
特開平11−307580号公報
本発明は、このような問題に鑑みてなされたものであり、バンプ電極付き電子部品を基板にフリップチップ接続する際に、基板の反りを低減し、精度の高い電子装置を提供することを目的とする。
本発明は以下の事項に関する。
1. バンプ電極が形成された電子部品を、熱硬化性樹脂により基板に固着させ、前記バンプ電極を基板の電極に導通させる電子部品のフリップチップ実装方法であって、
前記基板上に前記熱硬化性樹脂を塗布する工程と、
前記基板の電極と前記バンプ電極とを位置あわせして前記電子部品を前記基板に載置する工程と、
前記バンプ電極の裏面から前記電子部品を前記基板に押し付けながら、前記バンプ電極の裏面の温度と、前記電子部品内で前記バンプ電極から最も離れた箇所の下部に存在する熱硬化性樹脂の温度との温度差が50℃以上となるように調節しながら加熱し、前記バンプ電極と接する部分の前記熱硬化性樹脂を硬化させる接続工程と
を有する電子部品の実装方法。
2. 前記電子部品は、前記バンプ電極が電子部品の周辺部に形成されている周辺パッド型であり、前記接続工程において、前記バンプ電極の裏面の温度と、電子部品中央部分の下部の熱硬化性樹脂の温度との温度差が50℃以上となるように調節されることを特徴とする上記1記載の実装方法。
3. 前記電子部品は、前記バンプ電極が電子部品の中央付近に形成されているセンターパッド型であり、前記接続工程において、前記バンプ電極の裏面の温度と、電子部品周囲の辺の下部の熱硬化性樹脂の温度との温度差が50℃以上となるように調節されることを特徴とする上記1記載の実装方法。
4. 前記バンプ電極から最も離れた箇所の電子部品の下部に存在する熱硬化性樹脂が、前記接続工程中において、最終強度に達していないことを特徴とする上記1記載の実装方法。
5. 前記バンプ電極が金属バンプであり、前記基板上の電極が、金メッキまたは銀メッキされていることを特徴とする上記1〜4のいずれかに記載の実装方法。
6. 前記基板の電極には、ハンダがプレコートされており、前記接続工程においてハンダが溶融することを特徴とする上記1〜4のいずれかに記載の実装方法。
7. 前記接続工程において、底面に前記バンプ電極の裏面に接触する凸部を有するアタッチメントを用いて、この凸部を前記バンプ電極の裏面に接触させて前記電子部品を加熱および加圧することを特徴とする上記1〜6のいずれかに記載の実装方法。
8. 前記アタッチメントは吸着孔を有しており、この吸着孔から吸引されることで、前記電子部品を吸引保持することができることを特徴とする上記1〜7のいずれかに記載の実装方法。
9. 前記電子部品は、前記アタッチメントにより吸引された部分が吸引方向に反った状態で、前記熱硬化性樹脂に押し付けられることを特徴とする上記8記載の実装方法。
10. 前記アタッチメントの前記凸部の高さが、0.2〜1.0mmであることを特徴とする上記7記載の実装方法。
本発明によれば、バンプ電極付き電子部品を基板にフリップチップ接続する際に、基板の反りを低減し、精度の高い電子装置を提供することができる。
<第1の実施形態>
次に図面を参照しながら本発明の1つの実施形態を説明する。図1に、本発明の実装方法に使用されるアタッチメントの1例を示す。図1(a)は、電子部品との接触面から見た平面図であり、図1(b)は図1(a)のA−A’断面図である。このアタッチメント30は、底面の中央部に凹部33が形成され、この凹部に連通する吸着孔31と、凹部33を取り囲む凸部32を有する。凸部32の底面は、電子部品に接する面であり、吸着孔31から減圧に吸引することで、電子部品を保持することができる。
凹部33と凸部32の高低差tは、0.2〜1.0mmが好ましく、さらに0.3〜0.7mmが好ましい。また、凸部32は、電子部品に設けられたバンプ電極の直上にくるように設定され、その幅Lは、例えば0.5〜2mm、好ましくは0.7〜1.3mmに設定される。
本発明の実装方法では、図2に示すように、電極14が設けられた基板13と、バンプ電極12が形成された電子部品(例えばLSI等の半導体チップ)11を用意する。ここで、バンプ電極は金等の金属で形成され、基板13上の電極14は金メッキ電極として以下の説明を行う。また、基板は、必要により保護箇所がソルダーレジストで覆われていることも好ましい。
まず、図2に示すように、基板13上に、熱硬化性樹脂15を塗布する。実装は、通常ボンディングステージ(図示せず)上で行われるが、熱硬化性樹脂15の塗布は基板をボンディングステージに載せた後または載せる前のどちらでもよい。また、熱硬化性樹脂が、電極14を覆っていても覆っていなくてもどちらでもよい。
一方、図示していないトレイ等に収納されている電子部品11の裏面にアタッチメント30の凸部32を接触させ、吸着孔31から減圧に吸引することで、電子部品11を保持し、移送する。このとき、電子部品の中央が反る程度に吸引することが好ましい。反りの程度は、吸引の強さで制御することができる。また、凹部33と凸部32の高低差tを調節し、電子部品の中央が凹部に接するように吸引することでも、反りの程度を規定できる。
次に電子部品11をアタッチメント30で保持した状態で、バンプ電極12と基板13上の電極14との位置合わせをしながら、基板上に載置する。そして、図3に示すように、図示していない加熱装置でアタッチメント30を加熱しながら、電子部品11を基板13に押し付ける。
ここで、バンプ電極12が電極14に押し付けられて接触することで、電気的接続が生じる。このとき、熱硬化性樹脂15は、バンプ電極に接触している部分が硬化する。
通常、図示していない冷却装置で冷却し、図4に示すように、吸引を解放しアタッチメント30をはずして実装が終了する。
ここで、本発明において、電子部品11と基板13を重ね合わせて、アタッチメント30で、加圧・加熱をする際に、バンプ電極12と電極14の電気的接続の信頼性のために、バンプ電極近傍の熱硬化性樹脂は実用強度が出る程度には硬化することが求められ、同時に、基板の反りを防止するためには、基板がなるべく熱を受けないことが求められる。即ち、バンプ電極の近傍では、熱硬化性樹脂の硬化が起こる以上の温度に加熱され、電子部品の下部にあってバンプ電極から最も離れた箇所の温度(この例では、電子部品11の中央に対向する部分の基板の温度)が、バンプ電極と接している部分より十分に低いこと、例えば温度差が50℃以上となることが好ましい。電子部品と基板の間には熱硬化性樹脂が介在しているため、前記バンプ電極から最も離れた箇所の電子部品の下部に存在する熱硬化性樹脂の温度(この例では、中央部の熱硬化性樹脂の温度)と、バンプ電極の裏面の温度(即ち、アタッチメントの凸部32の温度)との温度差が50℃以上となることが必要である。
温度をこのように制御することで、電気的接続の信頼性を保ちながら、基板13が受ける熱を制限することができる。これは、電子部品の熱伝導度を考慮しながら、アタッチメントの温度制御を適切に行い、同時に、加熱と基板(および熱硬化性樹脂、電極)との接触のタイミングを適切に行うことで調節が可能である。例えば、電子部品を基板に押し付けてからアタッチメントの温度を急速上昇させることが好ましい場合もあるし、加熱を開始しながら電子部品を基板に押し付けた方が好ましい場合もある。この温度差の制御には、アタッチメント30の凸部32の幅Lを適切に調節することも有効である。
本発明では、基板13が受ける熱量が小さいため、実装完了後、基板の反りが小さく、寸法精度の高い電子装置を製造することができる。バンプ電極から最も離れた箇所の電子部品の下部に存在する熱硬化性樹脂(この例では電子部品中央の樹脂)と、バンプ電極の裏面の温度(即ち、アタッチメントの凸部の温度)との温度差は、より好ましくは60℃以上であり、さらに好ましくは70℃以上である。具体的には、アタッチメントの凸部の温度は、最高温度が例えば200℃〜300℃の範囲、特に220〜280の範囲が好ましい。また、バンプ電極から最も離れた箇所の電子部品の下部に存在する熱硬化性樹脂の温度は、最高温度が基板のガラス転移点以下であることが望ましい。
本発明においては、接続工程中に、バンプ電極から離れた箇所で熱硬化性樹脂の硬化が進行しなくてもよい。その代わり、基板の反りの問題が発生しない温度にて、ボンディングステージ上で、または別途、ポスト硬化を行ってもよい。ポスト硬化の具体的な温度としては、例えば100℃〜130℃が好ましい。
さらに、この実施形態のように、吸着の際に電子部品が吸着方向に反った状態で、熱硬化性樹脂に押し付けられると、その吸着方向の反りの部分で(この実施形態では中央部)、硬化前の樹脂厚がバンプ電極近傍より厚くなる。その後、硬化すると樹脂が収縮するため、結果としてフラットな実装状態が得られる。
<その他の実施形態>
本発明は、さらに、次のように種々の変形が可能である。
本発明で「基板」は、電子部品がフリップ接続される電極を有する部品/装置のすべてを含む。一般的基板として、FR−4基板、BT基板、高TgFR−4基板、FR−5基板等の有機樹脂基板が挙げられるが、更にはB2itやALIVHに代表されるビルドアップ基板やフレキシブル基板、セラミック基板なども挙げることができる。また、本発明の「基板」は、半導体チップであってもよい。
電子部品としては、LSI等の半導体チップが挙げられ、第1の実施形態で示したような周辺パッド型、あるいはバンプ電極が半導体チップの中央付近に設けられたセンターパッド型であってもよい。第1の実施形態で示したような周辺パッド型では、「電子部品内で前記バンプ電極から最も離れた箇所」は、電子部品中央部になり、センターパッド型で、「電子部品内で前記バンプ電極から最も離れた箇所」は電子部品の周辺部になる。電子部品は正方形のような方形状が通常であるため、センターパッド型で、「電子部品内で前記バンプ電極から最も離れた箇所」は、好ましくは電子部品の周囲の辺である。また、半導体チップ等の電子部品のサイズとしては、3mm〜30mmのものが挙げられる。
前記の第1の実施形態では、バンプ電極が金等の金属バンプであり、基板上の電極、金メッキ電極としたが、例えば銀メッキでもよいし、接触可能な態様であれば特に限定されない。さらに、バンプ電極と基板上電極が、溶融によって接合する形態でもよい。例えば、基板上の電極にハンダプレコートが施されていてもよいし、バンプ電極がハンダバンプであってもよい。この場合も、基板の反りを生じさせることなく、電気的接続の信頼性を高めることができる。
また、本発明では、アタッチメントが吸着機構を有していなくてもよい。電子部品を基板に載置する際は、通常、吸着機構を有する移送装置を用いるが、接続工程に使用するアタッチメントは、加熱と加圧ができればよい。
尚、本発明の説明で、「アタッチメント」は、電子部品のバンプ電極の裏面に接触して押すことが可能な部材を意味しており、少なくとも電子部品のバンプ電極の裏面に接触できて、電子部品全体の加熱を制限できるような凸部を有しているものであれば特に限定されない。凸部32の位置は、使用する電子部品の形態に合わせることが好ましい。電子部品がセンターパッド型である場合には、凸部の位置は中央によることになる。例えば、図1で、正方形の凸部32が小さな正方形になって中央によった形態が挙げられる。この場合、吸着孔31はあってもなくてもどちらでもよい。
また、アタッチメントの底面のうち、凸部以外の部分(第1の実施形態では凹部)の形状も適宜変更が可能である。例えば第1の実施形態において、凹部33は、底面がフラットでなくてもよく、吸着したときの電子部品の反りをより制御できるように曲面としてもよい。但し、電子部品が接触する部分は、熱が伝わり難い材料で形成したり、より低い温度となるように制御したりすることが好ましい。
本発明で使用可能な熱硬化性樹脂としては、ビスマレイミド樹脂、イミド樹脂、フェノール樹脂、メラミン樹脂、エポキシ樹脂、不飽和ポリエステル樹脂などが挙げられる。
次に、本発明を実施例によりさらに詳細に説明する。
材料
熱硬化性樹脂組成物:FP5000(ヘンケルジャパン(株)製)
組成:
エポキシ系熱硬化性樹脂及び硬化材:45〜50重量%
シリカ等無機充填材:50〜55重量%
<実施例1>
図1でtが0.5mm、Lが1mm、凸部32の外周が10mm×10mm、中央の吸着孔の直径1mmのアタッチメントを用意した。
電極表面にハンダプレコートを施したプリント配線板(0.1mm厚ガラスエポキシ基板FR−4、銅箔厚18μm)上の電子部品実装位置の中心に、上記熱硬化性樹脂組成物を塗布した。
電子部品として、周辺部にAuめっきバンプを形成した10mm×10mm×0.3mmのシリコンチップ(金スタッドバンプサイズ50μm×50μm×25μm、バンプ数200、バンプピッチ120μm〜200μm)を用意し、上記のアタッチメントを用いて吸着保持し、上記の基板上に移送して重ね合わせ、15kg/cmの条件で4秒間加熱した。アタッチメントの凸部の温度は240℃とし、電子部品中央下の熱硬化性樹脂の温度は、150℃であった。
得られたサンプルを、三次元反り測定器を用いて反りを測定し、全体の反りの分布を得た結果、反りが30μmであった。また、サンプルを切断して観察したところ、電子部品と基板との隙間が、周辺と中央でほぼ等しくフラットであることが観察された。
<比較例1>
図1で凹部が存在せず、中央凸部(電子部品との接触部;図5参照)の外周が10mm×100mm、吸着孔の直径1mmのアタッチメントを使用し、アタッチメントの温度を240℃とした以外は、実施例1と同様にして実装を行った。
得られたサンプルを、三次元反り測定器を用いて反りを測定し、全体の反りの分布を得た結果、反りは50μmであり、実施例1に比べて大きかった。また、サンプルを切断して観察したところ、電子部品と基板との隙間は、中央で狭くなっていた。
本発明を使用して、フリップチップなどのバンプ付電子部品を基板に実装することができる。
本発明に使用されるアタッチメントの形状を示す図である。(a)は平面図、(b)は断面図。 本発明の実装方法を示す工程図である。 本発明の実装方法を示す工程図である。 本発明の実装方法を示す工程図である。 従来の実装方法を示す工程図である。 従来の実装方法を示す工程図である。 従来の実装方法を示す工程図である。
符号の説明
11 電子部品
12 バンプ電極
13 基板
14 電極
15 熱硬化性樹脂
20 アタッチメント
21 吸着孔
30 アタッチメント
31 吸着孔
32 凸部
33 凹部

Claims (10)

  1. バンプ電極が形成された電子部品を、熱硬化性樹脂により基板に固着させ、前記バンプ電極を基板の電極に導通させる電子部品のフリップチップ実装方法であって、
    前記基板上に前記熱硬化性樹脂を塗布する工程と、
    前記基板の電極と前記バンプ電極とを位置あわせして前記電子部品を前記基板に載置する工程と、
    前記バンプ電極の裏面から前記電子部品を前記基板に押し付けながら、前記バンプ電極の裏面の温度と、前記電子部品内で前記バンプ電極から最も離れた箇所の下部に存在する熱硬化性樹脂の温度との温度差が50℃以上となるように調節しながら加熱し、前記バンプ電極と接する部分の前記熱硬化性樹脂を硬化させる接続工程と
    を有する電子部品の実装方法。
  2. 前記電子部品は、前記バンプ電極が電子部品の周辺部に形成されている周辺パッド型であり、前記接続工程において、前記バンプ電極の裏面の温度と、電子部品中央部分の下部の熱硬化性樹脂の温度との温度差が50℃以上となるように調節されることを特徴とする請求項1記載の実装方法。
  3. 前記電子部品は、前記バンプ電極が電子部品の中央付近に形成されているセンターパッド型であり、前記接続工程において、前記バンプ電極の裏面の温度と、電子部品周囲の辺の下部の熱硬化性樹脂の温度との温度差が50℃以上となるように調節されることを特徴とする請求項1記載の実装方法。
  4. 前記バンプ電極から最も離れた箇所の電子部品の下部に存在する熱硬化性樹脂が、前記接続工程中において、最終強度に達していないことを特徴とする請求項1記載の実装方法。
  5. 前記バンプ電極が金属バンプであり、前記基板上の電極が、金メッキまたは銀メッキされていることを特徴とする請求項1〜4のいずれかに記載の実装方法。
  6. 前記基板の電極には、ハンダがプレコートされており、前記接続工程においてハンダが溶融することを特徴とする請求項1〜4のいずれかに記載の実装方法。
  7. 前記接続工程において、底面に前記バンプ電極の裏面に接触する凸部を有するアタッチメントを用いて、この凸部を前記バンプ電極の裏面に接触させて前記電子部品を加熱および加圧することを特徴とする請求項1〜6のいずれかに記載の実装方法。
  8. 前記アタッチメントは吸着孔を有しており、この吸着孔から吸引されることで、前記電子部品を吸引保持することができることを特徴とする請求項1〜7のいずれかに記載の実装方法。
  9. 前記電子部品は、前記アタッチメントにより吸引された部分が吸引方向に反った状態で、前記熱硬化性樹脂に押し付けられることを特徴とする請求項8記載の実装方法。
  10. 前記アタッチメントの前記凸部の高さが、0.2〜1.0mmであることを特徴とする請求項7記載の実装方法。
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JP2011135083A (ja) * 2009-12-23 2011-07-07 Commissariat A L'energie Atomique Et Aux Energies Alternatives 少なくとも1つのチップとワイヤ要素をアセンブルする方法、変形する接続要素を有する電子チップ、複数のチップを製造する方法、及び、少なくとも1つのチップとワイヤ要素のアセンブリ
JP2012064853A (ja) * 2010-09-17 2012-03-29 Sekisui Chem Co Ltd 半導体素子接合用接着剤及び半導体素子の接合方法
JP2013098264A (ja) * 2011-10-28 2013-05-20 Sekisui Chem Co Ltd フリップチップボンダー用アタッチメント
CN108962775A (zh) * 2018-06-20 2018-12-07 武汉华星光电半导体显示技术有限公司 一种芯片的绑定模组及装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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