JP2008170978A - 表示装置及びその駆動方法 - Google Patents
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Abstract
【解決手段】本発明による表示装置では、画素列が少なくとも2つずつグループに分けられている。データ駆動部は各グループの画素列に対してデータ電圧を、同じフレームでは水平走査期間ごとに同じ順序で印加する。一方、2つの連続するフレーム間ではその順序を反転させる。その他に、データ駆動部は、各グループの画素列のうち、最初にデータ電圧を印加する画素列をフレームごとに変え、特に1つずつ移しても良い。
【選択図】図5
Description
このように、従来の表示装置では複数のデータ線間でのデジタル−アナログ変換器の共用は更なる高画質化を阻むので好ましくない。
本発明の目的は、表示パネルの画質を十分に高く維持したまま、データ駆動部に内蔵されるデジタル−アナログ変換器の総数をデータ線の総数より少なくできる表示装置を提供することにある。
その実施形態による表示装置は好ましくは液晶表示装置である。その他に、有機発光表示装置であっても良い。
信号制御部600はまず、好ましくは外部のグラフィックコントローラ(図示せず)から入力映像信号R、G、B、及び入力制御信号を受信する。入力映像信号R、G、Bは好ましくは各画素PXの輝度情報を含む。その輝度情報では好ましくは、各画素の輝度が所定数の階調、例えば1024(=210)、256(=28)、又は64(=26)種類の階調で表されている。入力制御信号は好ましくは、垂直同期信号Vsync、水平同期信号Hsync、メインクロック信号MCLK、及びデータイネーブル信号DEを含む。ここで、1水平周期は、水平同期信号Hsync及びデータイネーブル信号DEの各周期に等しい。
まず、信号制御部600が外部のグラフィックコントローラから入力映像信号R、G、B及び入力制御信号を受信する。信号制御部600はそのとき、入力映像信号R、G、Bを適切に処理して映像信号DATに変換し、かつゲート制御信号CONT1及びデータ制御信号CONT2を生成する。信号制御部600はその後、ゲート制御信号CONT1をゲート駆動部400に送信し、データ制御信号CONT2と映像信号DATとをデータ駆動部500に送信する。
図5及び図6に共通に示されているように、信号制御部600は好ましくは、第1選択信号群SEL1と第2選択信号群SEL2とを実質的に同じ波形で、かつ同位相で生成する。具体的には、信号制御部600はまずゲート制御信号CONT1によってゲート駆動部400に、各フレーム1FT、2FTで各ゲート線G1〜Gnに対するゲート信号g1、…、gnのレベルを順番に1水平周期ずつゲートオン電圧Vonに維持させる。信号制御部600は次に、各ゲート線G1〜Gnにおいて各ゲート信号g1、…、gnのレベルがゲートオン電圧Vonに維持されている間、すなわち各水平走査期間1Hに、各選択信号群SEL1、SEL2に含まれるk種類の選択信号SEL11〜SEL1k、SEL21〜SEL2kを所定の順序で所定時間ずつアクティブにする。特にi番目(i=1、2、…、k)の第1選択信号SEL1iとi番目の第2選択信号SEL2iとを同じ期間にアクティブにする。それにより、各データ駆動ICでは第1選択部530のスイッチング素子S1、S2、…、Skが所定の順序でターンオンし、各ラッチ回路521、522、…、52kを所定の順序でデジタル−アナログ変換部540に接続する。一方、第2選択部330ではスイッチング素子SW1、SW2、…、SWkが第1選択部530のスイッチング素子S1、S2、…、Skと同じ順序でターンオンし、出力バッファ550をk本のデータ線Dl+1〜Dl+kに所定の順序で接続する。その結果、データ駆動部500ではいずれのデータ駆動ICでも、i番目のラッチ回路52iから1つの画素PXに対する輝度情報がデジタル−アナログ変換部540に送られるときは、その輝度情報に対応するデータ電圧が出力バッファ550からi番目のデータ線Dl+iに対して出力される。信号制御部600は更に、同じフレーム1FT、2FTの範囲内では全ての水平走査期間1Hにおいて、k種類の選択信号SEL11〜SEL1k、SEL21〜SEL2kを同じ順序でアクティブにする。
191 画素電極
200 上部表示パネル
300 液晶表示パネルアセンブリ
330 第2選択部
400 ゲート駆動部
500 データ駆動部
510 シフトレジスタ
520 ラッチ
530 第1選択部
540 デジタル−アナログ変換部
550 出力バッファ
600 信号制御部
800 階調電圧生成部
Claims (15)
- マトリクス状に配列された複数の画素を含む表示パネル、
各画素行に対してゲートオン電圧を順番に印加するゲート駆動部、及び、
前記ゲート駆動部が1つの画素行に対してゲートオン電圧を印加する間に、同じ行に並ぶ異なる画素に対してデータ電圧を、フレームごとに異なる順序で印加するデータ駆動部、
を有する表示装置。 - 前記データ駆動部は画素列を少なくとも2つずつグループに分け、同じフレームでは、前記ゲート駆動部が各画素行に対してゲートオン電圧を印加する期間ごとに、各グループの画素列に対してデータ電圧を同じ順序で印加する、請求項1に記載の表示装置。
- 前記データ駆動部は、同じ行の画素に対してデータ電圧を印加する順序をフレームごとに反転させる、請求項1に記載の表示装置。
- 前記データ駆動部は、フレームごとに各行の異なる画素から順にデータ電圧を印加する、請求項1に記載の表示装置。
- 前記データ駆動部は、各画素行で最初にデータ電圧を印加する画素をフレームごとに1つずつ移す、請求項4に記載の表示装置。
- 前記データ駆動部は、
同じ行に並ぶ所定数の画素に対する映像信号を記憶するラッチ、
前記ラッチに記憶された各画素に対する映像信号を順番に出力する第1選択部、
前記第1選択部から受信される映像信号をデータ電圧に変換するデジタル−アナログ変換部、及び、
前記第1選択部による映像信号の出力順序に合わせた順序で、前記デジタル−アナログ変換部から前記所定数の画素にデータ電圧を伝達する第2選択部、
を有する、請求項1に記載の表示装置。 - 前記ラッチは、前記所定数の画素のそれぞれに対する映像信号を個別に記憶する複数のラッチ回路を含む、請求項6に記載の表示装置。
- 前記第1選択部は、前記複数のラッチ回路のそれぞれと前記デジタル−アナログ変換部との間に1つずつ接続されている複数の第1スイッチング素子を含み、
前記第2選択部は、前記デジタル−アナログ変換部と前記所定数の画素のそれぞれとの間に1つずつ接続されている複数の第2スイッチング素子を含む、
請求項7に記載の表示装置。 - 前記ゲート駆動部が各画素行に対してゲートオン電圧を印加する期間ごとに、前記第1選択部と前記第2選択部とは前記複数の第1スイッチング素子と前記複数の第2スイッチング素子とを同じ順序でターンオンさせる、請求項8に記載の表示装置。
- 前記第2選択部は前記表示パネルの上に配置されている、請求項6に記載の表示装置。
- 各水平走査期間に少なくとも2つの画素に対する映像信号をラッチに保存する段階、
前記ラッチに保存された前記少なくとも2つの画素のそれぞれに対する映像信号を前記水平走査期間に前記ラッチからデジタル−アナログ変換部へ、フレームごとに異なる順序で出力する段階、
前記ラッチから出力された映像信号を前記デジタル−アナログ変換部でデータ電圧に変換する段階、及び、
前記デジタル−アナログ変換部から前記少なくとも2つの画素に対してデータ電圧を、前記水平走査期間に前記順序に合わせた順序で印加する段階、
を有する表示装置の駆動方法。 - 同じフレームの各水平走査期間では、前記ラッチから前記デジタル−アナログ変換部へ映像信号を同じ順序で出力し、前記デジタル−アナログ変換部から前記少なくとも2つの画素に対してデータ電圧を同じ順序で印加する、請求項11に記載の表示装置の駆動方法。
- 前記ラッチから前記デジタル−アナログ変換部へ映像信号を出力する順序と、前記デジタル−アナログ変換部から前記少なくとも2つの画素に対してデータ電圧を印加する順序とをフレームごとに反転させる、請求項11に記載の表示装置の駆動方法。
- 前記デジタル−アナログ変換部から前記少なくとも2つの画素に対してデータ電圧を印加する段階では、フレームごとに異なる画素からデータ電圧を印加する、請求項11に記載の表示装置の駆動方法。
- 前記デジタル−アナログ変換部から前記少なくとも2つの画素に対してデータ電圧を印加する段階では、前記少なくとも2つの画素のうち、最初にデータ電圧を印加する画素をフレームごとに1つずつ移す、請求項14に記載の表示装置の駆動方法。
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