JP2007535236A - 可変ブロック長を有するブロック低密度パリティ検査符号の符号化/復号化装置及び方法 - Google Patents
可変ブロック長を有するブロック低密度パリティ検査符号の符号化/復号化装置及び方法 Download PDFInfo
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Abstract
Description
111 符号化器
113 変調器
115 無線周波数(RF)処理器
150 受信機
151 RF処理器
153 復調器
155 復号化器
300 変数ノードx1
302 変数ノードx2
304 変数ノードx3
306 変数ノードx4
308 変数ノードx5
310 変数ノードx6
312 変数ノードx7
314 変数ノードx8
316、318、320、322 検査ノード
802 部分ブロックA
804 部分ブロックC
806 部分ブロックB
808 部分ブロックD
810 部分ブロックT
812 部分ブロックE
1611 行列A乗算器
1613 行列C乗算器
1615 行列ET−1乗算器
1617 加算器
1619 行列B乗算器
1621 加算器
1623 行列T−1乗算器
1625、1627、1629 スイッチ
1700 変数ノードパート
1710 ブロック制御器
1711 変数ノード復号化器
1713、1714 スイッチ
1715 加算器
1717 デインタリーバー
1719 インタリーバー
1721 制御器
1723 メモリー
1725 加算器
1727 検査ノード復号化器
1729 硬判定器
1750 検査ノードパート
Claims (101)
- 可変長を有するブロック低密度パリティ検査(LDPC)符号を符号化する方法において、
情報語が入力されるステップと、
前記情報語をブロックLDPC符号として生成するときに適用される長さに応じて、第1のパリティ検査行列と第2のパリティ検査行列のうちのどちらか一方のパリティ検査行列を基に符号化を行い、前記ブロックLDPC符号として生成するステップと、を含むことを特徴とする前記方法。 - 前記ブロックLDPC符号を予め設定されている変調方式により変調して変調シンボルとして生成するステップと、
前記変調シンボルを送信するステップと、をさらに含むことを特徴とする請求項1に記載の前記方法。 - 前記第2のパリティ検査行列は、前記第1のパリティ検査行列のサイズを可変させたパリティ検査行列であることを特徴とする請求項1に記載の前記方法。
- 前記第1のパリティ検査行列は、予め設定されている符号化率を満足するように、且つ、前記ブロックLDPC符号が予め設定された長さを有するように生成されたパリティ検査行列であることを特徴とする請求項3に記載の前記方法。
- 前記第1のパリティ検査行列は、予め設定された数の部分ブロックを含み、前記部分ブロックは、所定のサイズを有することを特徴とする請求項4に記載の前記方法。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の部分ブロックのサイズを可変させたパリティ検査行列であることを特徴とする請求項5に記載の前記方法。
- 前記部分ブロックのそれぞれには、予め設定された順列行列が一対一に対応付けられることを特徴とする請求項6に記載の前記方法。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数と前記第2のパリティ検査行列の部分ブロックのサイズに応じて、前記第2のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数が決められて生成されたパリティ検査行列であることを特徴とする請求項7に記載の前記方法。
- 前記情報語を前記ブロックLDPC符号として生成するステップは、
前記長さに応じて、前記第1のパリティ検査行列及び第2のパリティ検査行列のうちのどちらを用いるかを決めるステップと、
前記情報語を前記決められたパリティ検査行列の第1の部分行列と乗算して第1の信号として生成するステップと、
前記情報語を前記決められたパリティ検査行列の第2の部分行列と乗算して第2の信号として生成するステップと、
前記第1の信号と、前記パリティ検査行列の第3の部分行列及び第4の部分行列の逆行列の行列積とを乗算して、第3の信号として生成するステップと、
前記第2の信号と第3の信号を加算して第4の信号として生成するステップと、
前記第4の信号と前記パリティ検査行列の第5の部分行列を乗算して第5の信号として生成するステップと、
前記第2の信号と前記第5の信号を加算して第6の信号として生成するステップと、
前記第6の信号と、前記パリティ検査行列の第4の部分行列の逆行列の行列積とを乗算して、第7の信号として生成するステップと、
前記情報語と、第1のパリティとしての前記第4の信号と、第2のパリティとしての前記第7の信号を、前記ブロックLDPC符号フォーマットに応じて多重化して出力するステップと、を含むことを特徴とする請求項9に記載の前記方法。 - 前記第1の部分行列及び第2の部分行列は、前記決められたパリティ検査行列における情報語と関連する情報パートに対応する部分行列であることを特徴とする請求項10に記載の前記方法。
- 前記第3の部分行列と第4の部分行列は、パリティと関連する第1のパリティパートに対応する部分行列であり、前記第5の部分行列と第6の部分行列は、前記パリティと関連する第2のパリティパートに対応する部分行列であることを特徴とする請求項11に記載の前記方法。
- 可変長を有するブロック低密度パリティ検査(LDPC)符号を符号化する装置において、
情報語をブロックLDPC符号として生成するときに適用される長さに応じて、第1のパリティ検査行列と第2のパリティ検査行列のうちのどちらか一方のパリティ検査行列を基に符号化を行い、前記ブロックLDPC符号として生成する符号化器と、
前記ブロックLDPC符号を予め設定されている変調方式により変調して変調シンボルとして生成する変調器と、
前記変調シンボルを送信する送信機と、を備えることを特徴とする前記装置。 - 前記第2のパリティ検査行列は、前記第1のパリティ検査行列のサイズを可変させたパリティ検査行列であることを特徴とする請求項28に記載の前記装置。
- 前記第1のパリティ検査行列は、予め設定されている符号化率を満足するように、且つ、前記ブロックLDPC符号が予め設定された長さを有するように生成されたパリティ検査行列であることを特徴とする請求項29に記載の前記装置。
- 前記第1のパリティ検査行列は、予め設定された数の部分ブロックを含み、前記部分ブロックは、所定のサイズを有することを特徴とする請求項30に記載の前記装置。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の部分ブロックのサイズを可変させたパリティ検査行列であることを特徴とする請求項31に記載の前記装置。
- 前記部分ブロックのそれぞれには、予め設定された順列行列が一対一に対応付けられることを特徴とする請求項32に記載の前記装置。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数と前記第2のパリティ検査行列の部分ブロックのサイズに応じて、前記第2のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数が決められて生成されたパリティ検査行列であることを特徴とする請求項33に記載の前記装置。
- 前記符号化器は、
前記長さに応じて、前記第1のパリティ検査行列及び第2のパリティ検査行列のうちのどちらを用いるかを決める制御器と、
前記情報語を前記決められたパリティ検査行列の第1の部分行列と乗算する第1の行列乗算器と、
前記情報語を前記決められたパリティ検査行列の第2の部分行列と乗算する第2の行列乗算器と、
前記第1の行列乗算器から出力された信号と、前記パリティ検査行列の第3の部分行列と第4の部分行列の逆行列の行列積とを乗算する第3の行列乗算器と、
前記第2の行列乗算器から出力された信号と第3の行列乗算器から出力された信号を加算する第1の加算器と、
前記第1の加算器から出力された信号と前記パリティ検査行列の第5の部分行列を乗算する第4の行列乗算器と、
前記第2の行列乗算器から出力された信号と前記第4の行列乗算器から出力された信号を加算する第2の加算器と、
前記第2の加算器から出力された信号と、前記パリティ検査行列の第4の部分行列の逆行列の行列積とを乗算する第5の行列乗算器と、
前記情報語と、第1のパリティとしての前記第1の加算器の出力信号と、第2のパリティとしての前記第5の行列乗算器の出力信号を、前記ブロックLDPC符号フォーマットに応じて多重化して出力するスイッチと、を備えることを特徴とする請求項35に記載の前記装置。 - 前記第1の部分行列及び第2の部分行列は、前記決められたパリティ検査行列における情報語と関連する情報パートに対応する部分行列であることを特徴とする請求項36に記載の前記装置。
- 前記第3の部分行列と第4の部分行列は、パリティと関連する第1のパリティパートに対応する部分行列であり、前記第5の部分行列と第6の部分行列は、前記パリティと関連する第2のパリティパートに対応する部分行列であることを特徴とする請求項37に記載の前記装置。
- 可変長を有するブロック低密度パリティ検査(LDPC)符号を復号化する方法において、
信号を受信するステップと、
復号化するブロックLDPC符号の長さに応じて、第1のパリティ検査行列及び第2のパリティ検査行列のうちのどちらを用いるかを決め、前記決められたパリティ検査行列に応じて前記受信信号を復号化して前記ブロックLDPC符号として検出するステップと、を含むことを特徴とする前記方法。 - 前記第2のパリティ検査行列は、前記第1のパリティ検査行列のサイズを可変させたパリティ検査行列であることを特徴とする請求項54に記載の前記方法。
- 前記第1のパリティ検査行列は、予め設定されている符号化率を満足するように、且つ、前記ブロックLDPC符号が予め設定された長さを有するように生成されたパリティ検査行列であることを特徴とする請求項55に記載の前記方法。
- 前記第1のパリティ検査行列は、予め設定された数の部分ブロックを含み、前記部分ブロックは、所定のサイズを有することを特徴とする請求項56に記載の前記方法。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の部分ブロックのサイズを可変させたパリティ検査行列であることを特徴とする請求項57に記載の前記方法。
- 前記部分ブロックのそれぞれには、予め設定された順列行列が一対一に対応付けられることを特徴とする請求項58に記載の前記方法。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数と前記第2のパリティ検査行列の部分ブロックのサイズに応じて、前記第2のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数が決められて生成されたパリティ検査行列であることを特徴とする請求項59に記載の前記方法。
- 前記決められたパリティ検査行列に応じて前記受信信号を復号化して前記ブロックLDPC符号として検出するステップは、
前記決められたパリティ検査行列に応じて、デインタリーブ方式及びインタリーブ方式を決めるステップと、
前記受信信号の確率値を検出するステップと、
前記受信信号の確率値から以前の復号化時に生成された信号を減算して第1の信号を生成するステップと、
前記第1の信号を入力して前記デインタリーブ方式によりデインタリーブを行うステップと、
前記デインタリーブされた信号を入力して確率値を検出するステップと、
前記デインタリーブされた信号の確率値から前記デインタリーブされた信号を減算して第2の信号を生成するステップと、
前記第2の信号を前記インタリーブ方式によりインタリーブし、前記インタリーブされた信号を繰り返し復号化して前記ブロックLDPC符号を検出するステップと、を含むことを特徴とする請求項61に記載の前記方法。 - 可変長を有するブロック低密度パリティ検査(LDPC)符号を復号化する装置において、
信号を受信する受信機と、
復号化するブロックLDPC符号の長さに応じて、第1のパリティ検査行列及び第2のパリティ検査行列のうちのどちらを用いるかを決め、前記決められたパリティ検査行列に応じて前記受信信号を復号化して前記ブロックLDPC符号として検出する復号化器と、を備えることを特徴とする前記装置。 - 前記第2のパリティ検査行列は、前記第1のパリティ検査行列のサイズを可変させたパリティ検査行列であることを特徴とする請求項78に記載の前記装置。
- 前記第1のパリティ検査行列は、予め設定されている符号化率を満足するように、且つ、前記ブロックLDPC符号が予め設定された長さを有するように生成されたパリティ検査行列であることを特徴とする請求項79に記載の前記装置。
- 前記第1のパリティ検査行列は、予め設定された数の部分ブロックを含み、前記部分ブロックは所定のサイズを有することを特徴とする請求項80に記載の前記装置。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の部分ブロックのサイズを可変させたパリティ検査行列であることを特徴とする請求項81に記載の前記装置。
- 前記部分ブロックのそれぞれには、予め設定された順列行列が一対一に対応付けられることを特徴とする請求項82に記載の前記装置。
- 前記第2のパリティ検査行列は、前記第1のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数と前記第2のパリティ検査行列の部分ブロックのサイズに応じて、前記第2のパリティ検査行列の順列行列のうちの0行列ではない順列行列の指数が決められて生成されたパリティ検査行列であることを特徴とする請求項83に記載の前記装置。
- 前記復号化器は、
前記復号化するブロックLDPC符号の長さに応じて、第1のパリティ検査行列及び第2のパリティ検査行列のうちのどちらを用いるかを決める第1の制御器と、
所定の制御により、前記決められたパリティ検査行列を構成する列のそれぞれのウェイトに応じて、変数ノードを接続して受信信号の確率値を検出して出力する変数ノード復号化器と、
前記変数ノード復号化器から出力された信号から以前の復号化時に生成された信号を減算して出力する第1の加算器と、
前記第1の加算器から出力された信号を入力し、前記決められたパリティ検査行列に応じて設定されたデインタリーブ方式によりデインタリーブして出力するデインタリーバーと、
所定の制御により、前記決められたパリティ検査行列を構成する行のそれぞれのウェイトに応じて、検査ノードを接続して前記デインタリーバーから出力された信号の確率値を検出して出力する検査ノード復号化器と、
前記検査ノード復号化器から出力された信号から前記デインタリーバーから出力された信号を減算する第2の加算器と、
前記第2の加算器から出力された信号を前記決められたパリティ検査行列に応じて設定されたインタリーブ方式によりインタリーブして、前記変数ノード復号化器及び前記第1の加算器に出力するインタリーバーと、
前記デインタリーブ方式及びインタリーブ方式を前記決められたパリティ検査行列に応じて制御する第2の制御器と、を備えることを特徴とする請求項85に記載の前記装置。
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