JP2007066324A - Dma転送方式 - Google Patents
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Abstract
【解決手段】複数のデータ要求源であるDMACのデータ要求を調停するアービタ1084と、外部メモリ等のデータ供給源に対しデータアクセス要求を行い、転送データのやりとりをDMACとデータ供給源との間で管理するデータ制御部とで構成されるDMA転送方式において、DMACは、アクセス要求の際、要求信号と共に所定の内部情報を出力し、データ制御部は、調停によって許可されたDMACのアクセス要求と対の内部情報を一時保存する記憶手段1083を有し、アクセス要求に対するレスポンスデータの受信時、記憶手段1083に保存されている内部情報と、前記出力手段から出力される現在の内部情報1089とを照合し、一致しない場合はレスポンスデータを無効とする照合手段1086とを有する。
【選択図】図3
Description
第2の目的は、複数のDMACが持つデータ加工のための回路を、1箇所で行うようにして、簡単な構成により低コスト化を図ったDMA転送方式を提供することにある。
第3の目的は、第1の目的および第2の目的を共に達成することのできるDMA転送方式を提供することにある。
第1の手段は、複数のデータ要求源であるDMACと、該DMACのデータ要求を調停するアービタと、前記調停結果から外部メモリ等のデータ供給源に対しデータアクセス要求を行い、かつ、転送データのやりとりをDMACとデータ供給源との間で管理するデータ制御部とで構成されるDMA転送方式において、前記DMACは、アクセス要求の際、要求信号と共に所定の内部情報を出力する内部情報出力手段を有し、前記データ制御部は、前記調停によって許可されたDMACのアクセス要求と対の内部情報を一時保存する内部情報一時記憶手段を有し、アクセス要求に対するレスポンスデータの受信時、前記保存された内部情報に基づいて前記レスポンスデータに対して所定の処理を施すことを特徴とする。
第2の手段は、第1の手段において、前記内部情報は、前記DMACがページ単位で一連のデータ転送の起動毎にカウントされるnビットの起動順情報で構成され、前記データ制御部は、前記レスポンスデータ受信時、前記内部情報一時記憶手段に保存されている内部情報と、前記内部情報出力手段から出力される現在の内部情報とを照合し、一致しない場合は、レスポンスデータを無効とするデータ照合手段を有することを特徴とする。
第3の手段は、第1の手段において、前記内部情報は、前記DMACが前記レスポンスデータに施すべきデータ加工情報で構成され、前記データ制御部は、前記レスポンスデータの受信時に、前記内部情報一時記憶手段に保存されている内部情報に基づいて前記レスポンスデータを加工するデータ加工手段を有することを特徴とする。
第4の手段は、第1の手段において、前記内部情報は、前記DMACがページ単位で一連のデータ転送の起動毎にカウントされるnビットの起動順情報と、前記DMACが前記レスポンスデータに施すべきデータ加工情報で構成され、前記データ制御部は、前記レスポンスデータ受信時、前記内部情報一時記憶手段に保存されている内部情報と前記内部情報出力手段から出力される現在の内部情報とを照合し、一致しない場合は、レスポンスデータを無効とするデータ照合手段と、前記内部情報一時記憶手段に保存されている内部情報に基づいて前記レスポンスデータを加工するデータ加工手段とを有することを特徴とする。
請求項2に記載の発明により、メモリ要求時のDMACの内部状態を一時保存し、レスポンスデータ受信時に現在のDMACの内部状態と比較照合することにより、前のDMA起動時のDMA要求に対する無効なデータを誤って転送することを回避した、信頼性の高いDMA転送方式を提供することが可能となる。
請求項3に記載の発明により、複数のDMACが持つデータ加工のための回路を、1箇所で行うことができるので、簡単な構成で低コスト化されたDMA転送方式を提供することが可能となる。
請求項4に記載の発明により、上記請求項2および請求項3に記載の発明の効果を共に奏することのできるDMA転送方式を提供することが可能となる。
図1は、各種の画像処理機器からなる複合画像形成装置の電気的構成の概要を示す図である。
同図において、10は画像形成装置全体を制御するシステムコントローラであり、このシステムコントローラ10には、オペレータに対する表示およびオペレータからの機能設定入力制御、コピー指示を行う操作/表示ボードOPBが接続される。
なお、下記の説明で内部ローカルバス107上のバスマスタの画像メモリ11へのアクセスは全てバス制御部108、汎用高速バス109、バスブリッジ111経由で行われる。
PCI I/F部103は、PCIバス12と内部ローカルバス107とのI/F部であり、スキャナ200やプリンタ400等のPCIバスマスタから指定されたアドレス、データを受けて、画像メモリ11への入出力を行う。
ROM113は、主にCPU110のプログラムが格納されている不揮発性のメモリである。
バス制御部108は、内部ローカルバス107と、汎用高速バス109のインターフェース回路であり、詳細な内部構成については以下に説明する。
バス制御部108は、クロック同期のロジック回路で構成され、大きくは汎用高速バスのマスタ制御に関する回路と、ターゲット制御に関する回路に分けられるが、本発明の趣旨であるマスタ制御に関する回路に関しては詳細に説明し、ターゲット制御に関する回路に関しては簡略して説明する。
Claims (4)
- 複数のデータ要求源であるDMACと、該DMACのデータ要求を調停するアービタと、前記調停結果から外部メモリ等のデータ供給源に対しデータアクセス要求を行い、かつ、転送データのやりとりをDMACとデータ供給源との間で管理するデータ制御部とで構成されるDMA転送方式において、
前記DMACは、アクセス要求の際、要求信号と共に所定の内部情報を出力する内部情報出力手段を有し、前記データ制御部は、前記調停によって許可されたDMACのアクセス要求と対の内部情報を一時保存する内部情報一時記憶手段を有し、アクセス要求に対するレスポンスデータの受信時、前記保存された内部情報に基づいて前記レスポンスデータに対して所定の処理を施すことを特徴とするDMA転送方式。 - 前記内部情報は、前記DMACがページ単位で一連のデータ転送の起動毎にカウントされるnビットの起動順情報で構成され、前記データ制御部は、前記レスポンスデータ受信時、前記内部情報一時記憶手段に保存されている内部情報と、前記内部情報出力手段から出力される現在の内部情報とを照合し、一致しない場合は、レスポンスデータを無効とするデータ照合手段を有することを特徴とする請求項1に記載のDMA転送方式。
- 前記内部情報は、前記DMACが前記レスポンスデータに施すべきデータ加工情報で構成され、前記データ制御部は、前記レスポンスデータの受信時に、前記内部情報一時記憶手段に保存されている内部情報に基づいて前記レスポンスデータを加工するデータ加工手段を有することを特徴とする請求項1に記載のDMA転送方式。
- 前記内部情報は、前記DMACがページ単位で一連のデータ転送の起動毎にカウントされるnビットの起動順情報と、前記DMACが前記レスポンスデータに施すべきデータ加工情報で構成され、前記データ制御部は、前記レスポンスデータ受信時、前記内部情報一時記憶手段に保存されている内部情報と前記内部情報出力手段から出力される現在の内部情報とを照合し、一致しない場合は、レスポンスデータを無効とするデータ照合手段と、前記内部情報一時記憶手段に保存されている内部情報に基づいて前記レスポンスデータを加工するデータ加工手段とを有することを特徴とする請求項1に記載のDMA転送方式。
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