JP2006268204A - 共有メモリ装置、処理システム - Google Patents
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Abstract
【解決手段】本発明においては、共有メモリ装置において、第1の記憶部と、該第1の記憶部に対して記憶容量の小さい第2の記憶部とを備え、前記第2の記憶部に一旦格納したデータを前記第1の記憶部に格納する、ことを特徴とする共有メモリ装置を用いることとする。
【選択図】 図3
Description
(2)本発明においては、前記第2の記憶部は複数の記憶部を含む、ことを特徴とする(1)記載の共有メモリ装置を用いる。
(3)本発明においては、第1処理部と、第2処理部と、該第1処理部により処理されたデータを格納するとともに、該第1処理部から該第2処理部へ処理の引継ぎを行った後に、該第2処理部により格納したデータが利用される共有メモリとを備えた処理システムにおいて、記憶部と、前記第1処理部により処置された前記データを該記憶部に一旦格納してから前記共有メモリに格納する制御を行う制御部とを備え、前記引継ぎに際して、該制御部は、前記記憶部に格納したが前記共有メモリには格納していないデータを検出し、検出したデータのうち所定の単位を満たすものを前記共有メモリに格納する制御を行う、ことを特徴とする処理システムを用いる。
(4)本発明においては、前記記憶部は、前記所定の単位でデータの記憶を行う複数の記憶部を含み、前記制御部は、前記検出を、該各複数の記憶部について行う、ことを特徴とする(3)記載の処理システムを用いる。
・「システム構成」
図1は、無線基地局装置を含む移動通信システムの構成を示す。
・「無線基地局装置3の構成」
さて、次に図2に本発明に係る無線基地局3の構成を示す。
・「共有メモリ部24−3の詳細構成」
次に、図3に共有メモリ部24−3詳細構成を示す。
・「共有メモリ部24−3へのデータ転送制御」
次に、図3に示した共有メモリ部24−3へのデータ転送制御を図4を用いて説明する。
・「共有メモリ部24−3における共有メモリ書き込み処理フロー1/2」
図5は、主として中間バッファへの書き込み制御に関する共有メモリ部24−3(メモリ制御部35以下同様)の動作の詳細を示す。
・「共有メモリ部24−3における共有メモリ書き込み処理フロー2/2」
図6は、主として共有メモリへの書き込み制御に関する共有メモリ部24−3(メモリ制御部35以下同様)の動作の詳細を示す。
・「障害発生時の切替制御」
図7は、呼処理制御部(現用)24−1に障害が発生した場合の動作を示す。
・「面切替制御1」
この面切替制御(図8参照)では、監視タイマ36は、中間バッファへの書き込みを許容している時間を監視し(S41)、これが所定時間を超えたことを検出すると(S42)、中間バッファの面切替を行う(S43)。
・「面切替制御2」
この面切替制御(図9参照)では、メモリ制御部35は、中間バッファへの書き込み量を監視し(S51)、これが所定量を超えたことを検出すると(S52)、中間バッファの面切替を行う(S53)。
2 基地局制御装置
3 無線基地局装置
4 移動局
21 無線送受信部
22 ベースバンド信号処理部
23 ネットワークインタフェース部
24 装置制御部
24−1、−2 呼処理制御部
24−3、24−4 共有メモリ部
31 リード/ライトバス切替制御部
32 中間バッファ
33 中間バッファ切替制御部
34 共有メモリ
35 メモリ制御部
36 監視タイマ
37 中間バッファへの書き込み完了フラグレジスタ
38 共有メモリへの書き込み中フラグレジスタ
Claims (4)
- 共有メモリ装置において、
第1の記憶部と、
該第1の記憶部に対して記憶容量の小さい第2の記憶部とを備え、
前記第2の記憶部に一旦格納したデータを前記第1の記憶部に格納する、
ことを特徴とする共有メモリ装置。 - 前記第2の記憶部は複数の記憶部を含む、ことを特徴とする請求項1記載の共有メモリ装置。
- 第1処理部と、第2処理部と、該第1処理部により処理されたデータを格納するとともに、該第1処理部から該第2処理部へ処理の引継ぎを行った後に、該第2処理部により格納したデータが利用される共有メモリとを備えた処理システムにおいて、
記憶部と、
前記第1処理部により処置された前記データを該記憶部に一旦格納してから前記共有メモリに格納する制御を行う制御部とを備え、
前記引継ぎに際して、該制御部は、前記記憶部に格納したが前記共有メモリには格納していないデータを検出し、検出したデータのうち所定の単位を満たすものを前記共有メモリに格納する制御を行う、
ことを特徴とする処理システム。 - 前記記憶部は、前記所定の単位でデータの記憶を行う複数の記憶部を含み、前記制御部は、前記検出を、該各複数の記憶部について行う、ことを特徴とする請求項3記載の処理システム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005082878A JP2006268204A (ja) | 2005-03-23 | 2005-03-23 | 共有メモリ装置、処理システム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2005082878A JP2006268204A (ja) | 2005-03-23 | 2005-03-23 | 共有メモリ装置、処理システム |
Publications (1)
Publication Number | Publication Date |
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JP2006268204A true JP2006268204A (ja) | 2006-10-05 |
Family
ID=37204142
Family Applications (1)
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JP2005082878A Pending JP2006268204A (ja) | 2005-03-23 | 2005-03-23 | 共有メモリ装置、処理システム |
Country Status (1)
Country | Link |
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JP (1) | JP2006268204A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2079274A2 (en) | 2008-01-10 | 2009-07-15 | NTT DoCoMo, Inc. | Radio base station, radio communication control system, and radio communication control method |
WO2012001788A1 (ja) * | 2010-06-30 | 2012-01-05 | 富士通株式会社 | マルチコアプロセッサシステム、復元プログラム、および復元方法 |
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2005
- 2005-03-23 JP JP2005082878A patent/JP2006268204A/ja active Pending
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US8271041B2 (en) | 2008-01-10 | 2012-09-18 | Ntt Docomo, Inc. | Radio base station, radio communication control system, and radio communication control method |
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