JP2006178430A - 表示装置、電子機器 - Google Patents
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Abstract
【解決手段】本発明は、マトリクス状に配置された複数の画素において、全ての画素が黒の表示を行う行に着目し、当該行に配置された画素に入力する予定のデータのサンプリングは行わないことを特徴とする。そして、当該行のデータのサンプリングを行わない期間では、ソースドライバにおけるシフトレジスタの動作と、第1のラッチ回路における映像信号のサンプリング動作を停止することを特徴とする。上記特徴を有する本発明は、ソースドライバの動作を一時的に停止することができるため、消費電力を低減することができる。特に、表示装置内での電力の消費の割合が高いソースドライバの動作を停止することができる本発明は、消費電力を大幅に低減することができる。
【選択図】図1
Description
また、本発明は、デジタル時間階調方式を用いて多階調の表現を行う際、1水平期間を複数(一例として、2つ)のサブ水平期間に分割し、一方のサブ水平期間において映像信号の書き込みを行い、他方のサブ水平期間において消去を行う駆動方法を用いることを特徴とする。この駆動方法では、ソース信号線には、映像信号と消去信号が、交互に出力されている。言い方を変えると、ある行の画素に映像信号の書き込みを行う直前には、必ず全てのソース信号線に消去信号が出力されている期間が存在する。そして、本発明は、黒の表示を行う行に配置された画素には、直前に入力された消去信号を、黒を表示するための映像信号の代わりに用いることを特徴とする。
上記特徴を有する本発明は、ソースドライバの動作を一時的に停止することができるため、消費電力を低減することができる。特に、表示装置内での電力の消費の割合が高いソースドライバの動作を停止することができる本発明は、消費電力を大幅に低減することができる。
例えば、W/E信号がアクティブとなっている期間においては、ソースドライバ603はソース信号線に映像信号を出力し、書込用ゲートドライバ604がパルスを出力し、消去用ゲートドライバ605の出力は全段で浮遊状態となっている。よって、ゲート信号線の選択は書込用ゲートドライバ604に依存する。
一方、W/Eb信号がアクティブとなっている期間においては、ソースドライバ603は全てのソース信号線に消去信号(先の画素構成によると、黒を書き込む場合と同様なので、ソース信号線をHighレベルに固定)を出力し、消去用ゲートドライバ605がパルスを出力し、書込用ゲートドライバ604の出力は全段で浮遊状態となっている。よって、ゲート信号線の選択は消去用ゲートドライバ605に依存する。
ここで、フレームメモリとは、1フレームを表示するのに必要な映像信号を保持するためのメモリであり、ラインバッファとは、1行を表示するのに必要な映像信号を保持するためのメモリである。ここでは、駆動方法として時間階調方式を用いているので、ラインバッファには1行を表示するのに必要な映像信号のうち、ある特定のビットに関しての1行分の映像信号が保持される。ただし、ラインバッファが一度に保持する映像信号のデータ量としては必ずしも前述の通りでなければならないわけではなく、より多くの映像信号を保持しておき、必要なタイミングで必要なだけ順次読み出す構成となっていても構わない。
102 タイミングコントローラ
103 第1のラインバッファ回路
104 検査回路
105 第2のラインバッファ回路
106 表示部
201 スタートパルス(SSP)
202 サンプリングパルス
203 映像信号
204 ラッチパルス(SLAT)
301 シフトレジスタ
302 第1のラッチ回路
303 第2のラッチ回路
304 書込消去選択回路
305 バッファ回路
401 シフトレジスタ
402 バッファ回路
411 画素部
412 書込用ゲートドライバ
413 消去用ゲートドライバ
Claims (10)
- マトリクス状に配置された複数の画素と、サンプリングパルスを出力するシフトレジスタと、前記サンプリングパルスに従って、映像信号のサンプリングを行うラッチ回路とを有する表示部と、
同じ行に配置された複数の画素の各々に出力する映像信号を保持するラインバッファ回路と、
前記ラインバッファ回路に保持された前記映像信号を検査する検査回路とを有し、
前記検査回路は、前記ラインバッファ回路に保持された前記映像信号が特定の映像信号であることを検出すると、前記シフトレジスタが前記同じ行に配置された前記複数の画素に対応する前記サンプリングパルスの出力を停止するための制御信号を出力することを特徴とする表示装置。 - マトリクス状に配置された複数の画素と、サンプリングパルスを出力するシフトレジスタと、前記サンプリングパルスに従って、映像信号のサンプリングを行うラッチ回路とを有する表示部と、
同じ行に配置された複数の画素の各々に出力する映像信号を保持するラインバッファ回路と、
前記ラインバッファ回路に保持された前記映像信号を検査する検査回路と、
前記シフトレジスタに制御信号を出力するコントローラ回路とを有し、
前記検査回路は、前記ラインバッファ回路に保持された前記映像信号が特定の映像信号であることを検出すると、前記シフトレジスタが前記同じ行に配置された前記複数の画素に対応する前記サンプリングパルスの出力を停止するための制御信号を前記コントローラ回路に出力することを特徴とする表示装置。 - マトリクス状に配置された複数の画素と、サンプリングパルスを出力するシフトレジスタと、前記サンプリングパルスに従って、映像信号のサンプリングを行うラッチ回路とを有する表示部と、
同じ行に配置された複数の画素の各々に出力する映像信号を保持する第1のラインバッファ回路と、
前記第1のラインバッファ回路に保持された映像信号を受け取り、且つ前記第1のラインバッファ回路に保持された映像信号を保持し、なお且つ前記第1のラインバッファ回路に保持された映像信号を前記表示部に出力する第2のラインバッファ回路と、
前記第1のラインバッファ回路に保持された前記映像信号を検査する検査回路と、
前記シフトレジスタに制御信号を出力するコントローラ回路とを有し、
前記検査回路は、前記第1のラインバッファ回路に保持された前記映像信号が特定の映像信号であることを検出すると、前記シフトレジスタが前記同じ行に配置された前記複数の画素に対応する前記サンプリングパルスの出力を停止するための制御信号を前記コントローラ回路に出力し、なお且つ、前記第1のラインバッファ回路から、前記第2のラインバッファ回路への前記映像信号の転送を停止するための制御信号を前記第2のラインバッファ回路に出力することを特徴とする表示装置。 - 請求項1乃至請求項3のいずれか一項において、
前記表示部は、複数行のゲート信号線と、第1のゲートドライバと、第2のゲートドライバとを有し、
前記第1のゲートドライバのn段目(nは自然数)の出力と、前記第2のゲートドライバのn段目の出力はn行目のゲート信号線を制御し、前記第1のゲートドライバ及び前記第2のゲートドライバの各段の出力端は、信号の出力を許可するか許可しないかを決定する選択回路を有することを特徴とする表示装置。 - 請求項4において、前記選択回路は、トライステートバッファであることを特徴とする表示装置。
- 請求項1乃至請求項5のいずれか一項において、前記特定の映像信号は、前記画素が黒を表示する映像信号であることを特徴とする表示装置。
- 請求項1乃至請求項5のいずれか一項において、前記特定の映像信号は、前記画素が白を表示する映像信号であることを特徴とする表示装置。
- 請求項1乃至請求項7のいずれか一項において、前記複数の画素の各々は、発光素子を有することを特徴とする表示装置。
- 請求項1乃至請求項7のいずれか一項において、前記複数の画素の各々は、複数のトランジスタを有することを特徴とする表示装置。
- 請求項1乃至請求項9のいずれか一項に記載の前記表示装置を用いた電子機器。
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