JP2006140926A - 画像読み取り装置及び画像形成装置 - Google Patents
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Abstract
【解決手段】原稿画像を照明し、その光像を光電変換手段へ導く光学系と、光電変換手段を駆動する駆動手段と、この駆動手段へ供給するクロックを発生するタイミング信号発生手段と、前記タイミング信号発生手段の最終段駆動クロック(PH2B)の位相を調整する手段と、A/D変換手段からのデジタル信号に対するシェーディング補正手段を有する画像読み取り装置において、最終段駆動クロック(PH2B)の位相を調整する手段(タイミング回路212)は、前記シェーディング補正手段2223の白補正メモリ2224データから算出した転送効率結果と電荷先送り結果の少なくとも一方によって前記最終段駆動クロック(PH2B)の位相を調整する。
【選択図】図11
Description
第7の手段は、第1ないし第6の手段において、前記光電変換手段がCCDであることを特徴とする。
光電変換手段をCCDとすることにより縮小光学系が可能となり、焦点深度が得られることから原稿浮きやある程度の立体物の読取も焦点ボケない読み取りが可能となる。
まず、タイミング回路212と3ラインCCD211と図10では図示しなかった両者間に入るCCD駆動ドライバ部233について説明する。タイミング回路212では発振器232からのクロックをPLL回路2121の入力としてCPUバスI/F2125を介してレジスタの設定(レジスタ設定部2126)で分周器2122を設定して4逓倍クロックを発生する。このクロックがもとになって各種クロックを発生し、クロック発生回路2127及びCCDクロック発生回路2123にクロックが入力される。また、タイミング回路212のCCDクロック発生回路2123からCCD211を駆動する第1相転送クロックXPH1、第2相転送クロックXPH2、最終段転送クロックXPH2B、リセットクロックXRS、クランプクロックXCP、シフトゲートクロックXSHを発生する。これらのクロックは後段のパルス調整回路2124に入力されてレジスタ設定部のコントロールに従い個々のクロックパルスの位相シフト量とパルス幅増減量を調整して出力する。前記パルス位相シフト量は前記4逓倍クロックの半周期単位でシフト量を調整する機能を持っている。また、パルス幅増減量も前記4逓倍クロックの半周期単位でパルス幅量を増減する機能を持っている。これらの出力がCCD駆動ドライバ部233へ入力される。
図20は最終段転送クロックPH2Bを含むドライバICのパッケージの伝搬遅延時間大きい場合、または、第1相転送クロック及び第2相転送クロックPH1,PH2の複数ドライバICの総和としての伝搬遅延時間が小さい場合についてのタイミングチャートである。この伝搬遅延時間の差によりスキューTdが発生する。このスキューTdの発生によりドライバ出力のPH1↓とPH2B↑(第1相転送クロックの立ち下がりと最終段転送クロックの立ち上がり)のクロスポイントは図20の最下段に示すように規格値2V以上を確保できない2V以下となってしまう。これにより転送効率の低下、PRNUの悪化を招くことが考えられる。図21に示した例においてもクランプクロックXCPに最終段転送クロックXPH2Bと同信号入力した場合で高速動作時においては同様の不具合の発生が考えられる。
図11におけるシェーディング補正回路222は原稿読取時に照明系の光量不均一やCCDの画素出力のバラツキを補正する機能を持っている。シェーディング補正回路222はバスI/F2221、レジスタ設定部コントロール回路2222、シェーディング演算回路2223、白メモリ2224からなっている。本実施形態では白基準板上でシェーディングデータを取り込む白メモリ2224を兼用して、転送効率、電荷先送りのどちらか一方あるいは両方とも算出し、その結果より位相シフト量を算出する。白メモリ2224には白基準板で複数ライン平均した出力値が保存されている。この白メモリ2224に保存した出力値は1画素単位でシェーディング演算回路222を介してレジスタ設定回路2126、バスI/F2125によってCPU201から読み取ることができる構成となっている。
転送効率
=TTE画素の出力値/TTE画素+1画素の出力値+TTE画素の出力値×100%
電荷先送り
=TTE画素の出力値/TTE画素−1画素の出力値+TTE画素の出力値×100%
のようになる。
TTE画素2303の出力値
TTE画素+1画素の出力値
TTE画素−1画素の出力値
をCPU201で読み取る。
TTE画素の出力値=195
TTE画素+1画素の出力値=3
TTE画素−1画素=10
のようになる。このときの実際のCPU201での計算結果を求めると、
転送効率
=TTE画素の出力値/TTE画素+1画素の出力値+TTE画素の出力値×100%
=195/3+195×100%
=98.5%
となり、
電荷先送り
=TTE画素の出力値/TTE画素−1画素の出力値+TTE画素の出力値×100%
=195/20+195×100%
=90.7%
となる。
TTE画素の出力値=195
TTE画素+1画素の出力値=3
TTE画素−1画素=1
となる。このときの実際のCPU201での計算結果を求めると
転送効率
=TTE画素の出力値/TTE画素+1画素の出力値+TTE画素の出力値×100%
=195/3+195×100%
=98.5%
となり、
電荷先送り
=TTE画素の出力値/TTE画素−1画素の出力値+TTE画素の出力値×100%
=195/1+195×100%
=99.5%
となる。CPU201では転送効率、電荷先送りとも95%以上となり位相調整を終了する。
転送効率=最終画素の出力値/最終+1画素の出力値+最終画素の出力値×100%
電荷先送り=最初画素の出力値/最初+1画素の出力値+最初画素の出力値×100%
の画素位置に当てはめて代用する。
このようにして転送効率、電荷先送りを算出して調整することにより転送効率が規格値内に入るようにし、ドライバICのパッケージ間のスキューをキャンセルして信頼の高い安定した画像読取を実現することができる。
7)光電変換手段をCCDとすることで縮小光学系が可能となり、焦点深度が得られることから原稿浮きやある程度の立体物の読取も焦点ボケない読み取りが可能となる。
2 画像読み取りユニット(スキャナ)
3 画像処理ユニット
4 画像書き込みユニット
5 操作部ユニット
6 複写機機構部
7 画像表示ユニット
8 ドラムユニット
9 中間転写部
10 現像部
11 給紙部
12定着部
21 FIFO(ラインバッファ)
22 DRAM(画像データメモリ)
23 CPU
24 VRAM(ビデオメモリ)
25 LCDC(LCDコントローラ)
26 LCD(液晶パネル)
27 ROM
28 SRAM
29 シリアル通信ドライバ
30 画像データ信号バッファ(ドライバ/レシーバ)
31 キーボード
201 CPU
211 3ラインCCD
212 タイミング回路
213,214,215 エミッタホロワ
216,217,218 アナログ回路
219,220,221 A/Dコンバータ
222 シェーディング回路
223,224 ライン間補正メモリ
225 ドット補正部
226 スキャナガンマ補正部
227 ディレーメモリ
228 自動原稿色判定回路
229 自動画像分離回路
230 RGBフィルタ・色変換・変倍処理・クリエイト部
231 プリンタγ補正・書き込み処理部
2221 バスI/F
2222 レジスタ設定部
2223 シェーディング演算回路
2224 色メモリ
Claims (11)
- 原稿画像を照明し、その光像を光電変換手段へ導く光学系と、
光電変換手段をシフト駆動クロック、最終段駆動クロック、リセットクロックで駆動する駆動手段と、
前記駆動手段へ供給するクロックを発生するタイミング信号発生手段と、
前記タイミング信号発生手段の最終段駆動クロックの位相を調整する手段と、
前記光電変換手段からアナログ出力をA/D変換するA/D変換手段と、
前記A/D変換手段からのデジタル信号に対するシェーディング補正手段と、
を有する画像読み取り装置において、
前記最終段駆動クロックの位相を調整する手段は、前記シェーディング補正手段の白補正メモリデータからの算出した転送効率結果と電荷先送り結果の少なくとも一方によって前記最終段駆動クロックの位相を調整することを特徴とする画像読み取り装置。 - 前記最終段駆動クロックの位相を調整する手段は、前記タイミング信号発生手段のクロックの位相をレジスタで設定制御して前記光電変換手段へ供給する前記最終段駆動クロックの位相を調整することを特徴とする請求項1記載の画像読み取り装置。
- 最終段転送クロック、リセットクロックを有し、前記駆動手段が複数パッケージICドライバであり、最終段転送クロック、リセットクロックを同一パッケージICドライバで駆動することを特徴とする請求項1または2記載の画像読み取り装置。
- 最終段転送クロック、リセットクロック、クランプクロックを有し、前記駆動手段が複数パッケージICドライバであり、最終段転送クロック、リセットクロック、クランプクロックを同一パッケージICドライバで駆動することを特徴とする請求項1または2記載の画像読み取り装置。
- 前記タイミング信号発生手段から発生する最終段転送クロックを前記クランプクロックと共通に使用することを特徴とする請求項4記載の画像読み取り装置。
- 前記タイミング信号発生手段のクロックの位相をレジスタで設定制御して前記光電変換手段へ供給する前記リセットクロックの位相を調整することを特徴とする請求項1ないし5のいずれか1項に記載の画像読み取り装置。
- 前記光電変換手段がCCDであることを特徴とする請求項1ないし6のいずれか1項に記載の画像読み取り装置。
- 前記光電変換手段が3ラインカラーCCDを含む複数ラインCCDであることを特徴とする請求項1ないし6のいずれか1項に記載の画像読み取り装置。
- 前記光電変換手段へ供給する2相駆動クロックを1相毎に駆動する複数の駆動手段を有し、2相駆動クロックをセットで同一パッケージICで駆動することを特徴とする請求項1ないし8のいずれか1項に記載の画像読み取り装置。
- 前記最終段駆動クロックの位相を調整量をリセットクロック、クランプクロックの位相調整量と等しくすることを特徴とする請求項4ないし9のいずれか1項に記載の画像読み取り装置。
- 請求項1ないし10のいずれか1項に記載の画像読み取り装置を一体または別体に備えていることを特徴とする画像形成装置。
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JP2007336196A (ja) * | 2006-06-14 | 2007-12-27 | Konica Minolta Business Technologies Inc | 画像読取装置、および画像読取装置の制御方法 |
JP2008054281A (ja) * | 2006-07-26 | 2008-03-06 | Matsushita Electric Ind Co Ltd | 撮像回路の自動調整装置 |
JP2008228037A (ja) * | 2007-03-14 | 2008-09-25 | Matsushita Electric Ind Co Ltd | 位相調整装置、位相調整方法およびデジタルカメラ |
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