JP2005332545A - データ符号化回路、データ符号化方法およびデータ記録装置 - Google Patents
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Abstract
【解決手段】 ホストからのデータを前記メモリ101に書き込む前に、EDC演算回路110とスクランブル演算回路111に入力して処理し、その後、スクランブル演算回路111からメモリ101に書き込まれたデータに対して、PI演算回路104とPO演算回路105にて、誤り訂正符号の付加処理を行う。
ホストからメモリに対してデータを書き込む際のメモリアクセスと、メモリから前記EDC演算回路にデータを読み出す際のメモリアクセスを省略することができる。よって、メモリ101の動作クロックを低下させることができる。
【選択図】 図1
Description
(1) ホストからのデータ書き込み(W)
(2) EDC演算回路102によるデータ読み出し(R)
(3) スクランブル演算回路103によるデータ書き込み(W)
(4) PI演算回路104によるデータ読み出し(R)
(5) PI演算回路104によるPI符号の書き込み(W)
(6) PO演算回路104によるデータ読み出し(R)
(7) PO演算回路104によるPO符号の書き込み(W)
(8) 変調回路200に対するデータ読み出し(R)
がなされる。
CL1=6.5×0.6925=4.5MHz …(1)
CL16=4.5×16=72MHz …(2)
となる。さらに、メモリアクセスのオーバヘッドを1.3〜1.5程度見込むと、クロック周波数は、以下のとおりとなる。
CL16=94〜108MHz …(3)
CL1=4.5×0.6925=3.11MHz
となり、16倍速の場合、
CL16=3.11×16=50MHz
となり、さらに、メモリアクセスのオーバヘッド1.3〜1.5を見込んだ場合、
CL16=65〜75MHz
となる。
101 メモリ
104 PI演算回路
105 PO演算回路
110 EDC演算回路
111 スクランブル演算回路
112 PI演算回路
Claims (3)
- データに誤り検出符号を付加するEDC演算部と、
前記EDC演算部によって誤り検出符号が付加されたデータにスクランブル処理を施すスクランブル演算部と、
前記スクランブル演算部によってスクランブル処理されたデータにPI方向の誤り訂正符号を付加するPI演算部と、
前記スクランブル演算部によってスクランブル処理されたデータにPO方向の誤り訂正符号を付加するPO演算部と、
動作クロックに応じてデータの書き込みと読み出しを行うメモリとを備え、
ホストからのデータを前記メモリに書き込む前に前記EDC演算部と前記スクランブル部に入力して処理し、その後、前記スクランブル部から前記メモリに書き込まれたデータに対して、前記PI演算部とPO演算部によって、誤り訂正符号の付加処理を行う、
ことを特徴とするデータ符号化回路。 - データに誤り検出符号を付加するEDC演算工程と、
前記EDC演算工程によって誤り検出符号が付加されたデータにスクランブル処理を施すスクランブル演算工程と、
前記スクランブル演算工程によってスクランブル処理されたデータにPI方向の誤り訂正符号を付加するPI演算工程と、
前記スクランブル演算部によってスクランブル処理されたデータにPO方向の誤り訂正符号を付加するPO演算工程とを備え、
ホストからのデータを前記EDC演算工程と前記スクランブル工程にて処理してメモリに書き込み、その後、当該メモリに書き込まれたデータに対して、前記PI演算工程とPO演算工程によって誤り訂正符号の付加処理を行う、
ことを特徴とするデータ符号化方法。 - 記録データに誤り訂正符号を付加するデータ符号化回路を備えるデータ記録装置において、
前記データ符号化回路は;
データに誤り検出符号を付加するEDC演算部と、
前記EDC演算部によって誤り検出符号が付加されたデータにスクランブル処理を施すスクランブル演算部と、
前記スクランブル演算部によってスクランブル処理されたデータにPI方向の誤り訂正符号を付加するPI演算部と、
前記スクランブル演算部によってスクランブル処理されたデータにPO方向の誤り訂正符号を付加するPO演算部と、
動作クロックに応じてデータの書き込みと読み出しを行うメモリとを備え、
ホストからのデータを前記メモリに書き込む前に前記EDC演算部と前記スクランブル部に入力して処理し、その後、前記スクランブル部から前記メモリに書き込まれたデータに対して、前記PI演算部とPO演算部によって、誤り訂正符号の付加処理を行う、
ことを特徴とするデータ記録装置。
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