JP2005276153A - テストベンチシステム、プログラム及び記憶媒体 - Google Patents
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Abstract
【解決手段】 CPUインタフェースモデル5、データ入力インタフェースモデル3、データ出力インタフェースモデル4は、それぞれ回路2のCPUインターフェース、データ入力インターフェース、データ出力インターフェースにそれぞれ対応したバスファンクションモデルである。入力データバッファ6は、CPUインタフェースモデル5により回路2に入力するデータをバッファリングする。データ出力インタフェースモデル4は、前記回路2から出力されたデータを期待値データバッファ7にバッファリングされている、その出力データについての期待値と比較する。
【選択図】 図1
Description
このような動的なバッファの追加は、例えば、ランダムな検証でスキャナ入力とプロッタ出力間のタイミング関係のカバレッジを得るために繰り返しデータ転送する際に使用する。このようなケースでは、あらかじめ画像データの面数を決められないからである。このように、PCIバス105経由での画像データの入出力は独立スケジューリングで行なう。
2 回路
3 データ入力インタフェースモデル
4 データ出力インタフェースモデル
5 CPUインタフェースモデル
6 第1のバッファ
7 第2のバッファ
217 記憶媒体
220 プログラム
102 回路
107 バッファ切替手段
111 第1のバッファ
112 第2のバッファ
Claims (16)
- 対象となる回路のCPUインターフェースに対応したバスファンクションモデルであるCPUインタフェースモデルと、
前記CPUインタフェースモデルにより前記回路に入力するデータをバッファリングする第1のバッファと、
前記回路のデータ入力インターフェースに対応したバスファンクションモデルであり、前記第1のバッファがバッファリングしているデータを前記回路に入力するデータ入力インタフェースモデルと、
第2のバッファと、
前記回路のデータ出力インターフェースに対応したバスファンクションモデルであり、前記回路から出力されたデータを前記第2のバッファにバッファリングされている前記データについての期待値と比較するデータ出力インタフェースモデルと、
を備えているテストベンチシステム。 - 前記第2のバッファの記憶しているデータを所定のファイルに読み書きして当該ファイルから前記第2のバッファに前記期待値を記録する手段を、さらに備えている請求項1に記載のテストベンチシステム。
- 前記第1のバッファに記憶されているデータを用いて所定のアルゴリズムの実行により前記期待値を生成する手段と、
前記生成した期待値を前記第2のバッファに出力する手段と、
をさらに備えている請求項1に記載のテストベンチシステム。 - 前記期待値を生成する手段を複数段接続している、請求項3に記載のテストベンチシステム。
- 前記第1及び第2のバッファへのアクセスを条件に応じて切り替えるバッファ切替手段を、さらに備えている請求項1に記載のテストベンチシステム。
- 前記バッファ切替手段は、前記切り替えの条件がアクセスアドレスである、請求項5に記載のテストベンチシステム。
- 前記バッファ切替手段は、前記切り替えの条件が前記第1及び第2のバッファへのリード・ライトアクセス区分である、請求項5に記載のテストベンチシステム。
- 前記バッファ切替手段は、前記第1及び第2のバッファへのアクセスが順次アクセスであり、動的に前記第1及び第2のバッファの接続、取り外しができる、請求項5に記載のテストベンチシステム。
- 対象となる回路のCPUインターフェースに対応したバスファンクションモデルであるCPUインタフェースモデルを実現する手段と、
前記CPUインタフェースモデルにより前記回路に入力するデータをバッファリングする第1のバッファを所定の記憶装置に実現する手段と、
前記回路のデータ入力インターフェースに対応したバスファンクションモデルであり、前記第1のバッファがバッファリングしているデータを前記回路に入力するデータ入力インタフェースモデルを実現する手段と、
第2のバッファを所定の記憶装置に実現する手段と、
前記回路のデータ出力インターフェースに対応したバスファンクションモデルであり、前記回路から出力されたデータを前記第2のバッファにバッファリングされている前記データについての期待値と比較するデータ出力インタフェースモデルを実現する手段と、
をコンピュータに実行させるコンピュータに読み取り可能なプログラム。 - 前記第2のバッファの記憶しているデータを所定のファイルに読み書きして当該ファイルから前記第2のバッファに前記期待値を記録する手段を、さらにコンピュータに実行させる請求項9に記載のプログラム。
- 前記第1のバッファに記憶されているデータを用いて所定のアルゴリズムの実行により前記期待値を生成する手段と、
前記生成した期待値を前記第2のバッファに出力する手段と、
をさらにコンピュータに実行させる請求項9に記載のプログラム。 - 前記第1及び第2のバッファへのアクセスを条件に応じて切り替えるバッファ切替手段を、さらにコンピュータに実行させる請求項9に記載のプログラム。
- 前記バッファ切替手段は、前記切り替えの条件がアクセスアドレスである、請求項12に記載のプログラム。
- 前記バッファ切替手段は、前記切り替えの条件が前記第1及び第2のバッファへのリード・ライトアクセス区分である、請求項12に記載のテストベンチシステム。
- 前記バッファ切替手段は、前記第1及び第2のバッファへのアクセスが順次アクセスであり、動的に前記第1及び第2のバッファの接続、取り外しができる、請求項12に記載のプログラム。
- 請求項9〜15のいずれかの一に記載のプログラムを記憶している、記憶媒体。
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JP2004200654A JP4476053B2 (ja) | 2004-02-25 | 2004-07-07 | プログラム及び記憶媒体 |
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Publication Number | Publication Date |
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009230451A (ja) * | 2008-03-24 | 2009-10-08 | Renesas Technology Corp | 等価性検証方法、等価性検証プログラム及び等価性検証プログラムの生成方法 |
DE102009034242A1 (de) * | 2009-07-22 | 2011-01-27 | Volkswagen Ag | Verfahren und Vorrichtung zum Prüfen eines Steuergeräts eines Fahrzeugs |
CN103020395A (zh) * | 2012-12-31 | 2013-04-03 | 上海高清数字科技产业有限公司 | 解复用接口模块的验证方法及验证系统 |
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- 2004-07-07 JP JP2004200654A patent/JP4476053B2/ja not_active Expired - Fee Related
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