JP2005136910A - インターポレータ、インターポレート方法および信号処理回路 - Google Patents
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Abstract
【課題】インターポレータにDCオフセット成分を除去することができる機能を持たせる。
【解決手段】
インターポレータ100は、タップ120を有するシフトレジスタ140、乗算器160および加算器180で構成される。シフトレジスタ140は非同期サンプリングされたデータサンプルXを逐次取り込み、各乗算器160はシフトレジスタ140の各タップ120からの出力に、係数テーブル200から出力されたタップ係数を掛ける。加算器180は各乗算器160から得られた全ての積を加算し、出力データサンプルYを得る。ここで、インターポレータ100をバンドパスフィルタの特性にするようにタップ係数を設定する。
【選択図】図2
【解決手段】
インターポレータ100は、タップ120を有するシフトレジスタ140、乗算器160および加算器180で構成される。シフトレジスタ140は非同期サンプリングされたデータサンプルXを逐次取り込み、各乗算器160はシフトレジスタ140の各タップ120からの出力に、係数テーブル200から出力されたタップ係数を掛ける。加算器180は各乗算器160から得られた全ての積を加算し、出力データサンプルYを得る。ここで、インターポレータ100をバンドパスフィルタの特性にするようにタップ係数を設定する。
【選択図】図2
Description
本発明は、デジタル信号処理において、サンプリングした入力信号のビット点の補間を行うインターポレータ(補間器)、インターポレート(補間)方法および信号処理回路に関するものである。
デジタルデータ受信システムにおいて、通常、受信信号をそのシンボルと同期したクロックを用いて、アナログ/デジタル(A/D)コンバータでサンプリングを行いデジタルデータの復調を行う。一方、非同期のクロックでサンプリングを行う非同期サンプリングが知られている。非同期サンプリングではインターポレータによって、サンプル点データからサンプル間にあるシンボル点のデータを推定し、計算する。このインターポレータの考え方は、ある周波数でサンプリングした信号をより高い周波数で0補間アップサンプリングを行い、次に、それによって生じる不要なイメージ信号をローパスフィルタ(LPF)により除去し、その後、間引きダウンサンプリングの一連の動作により再サンプリングを行うというものである。
しかし、例えば、デジタルビデオカメラ(DVC)のようなデジタルシステムの再生チャンネルではヘッドで読み取った信号をヘッドアンプにて増幅した後、その出力を再生信号の波形歪みを除くために、PR4(Partial Response Class4)等化等の特性に波形等化する。PR4特性では必要信号成分に直流(DC)成分がないが、実際のシステムではヘッドアンプやA/Dコンバータ等で信号にDCオフセット成分が付加されてしまう。このようなDCオフセット成分を除去するために、A/Dコンバータの前にカップリングコンデンサを接続したり、A/Dコンバータの後にDCオフセットキャンセラ回路を挿入する必要があるが、外付け部品点数が増えたり、回路が複雑になるために、回路規模が増大するという問題点があった。また、上記ローパスフィルタではDCオフセット成分を除去できない。
本発明の目的は、DCオフセット成分を除去することができる機能を有するインターポレータを提供することにある。
本発明は、アナログ信号をデジタルサンプリングしたデジタル信号の補間処理を行うインターポレータであって、複数のタップにより前記デジタル信号を受け取り、前記複数のタップからタップ出力を生成する手段と、前記タップ出力のそれぞれに所定の係数を乗算する乗算手段と、前記乗算手段の出力を加算する加算手段と、を含み、特定の範囲の周波数の信号だけを通すバンドパスフィルタの特性を示すように前記所定の係数を設定する。
また、前記インターポレータにおいて、前記所定の係数が可変であることが好ましい。
また、前記インターポレータにおいて、前記デジタル信号が直流成分を有さないことが好ましい。
また、本発明は、アナログ信号をデジタルサンプリングしたデジタル信号の補間処理を行うインターポレート方法であって、複数のタップにより前記デジタル信号を受け取り、前記複数のタップからタップ出力を生成するステップと、前記タップ出力のそれぞれに所定の係数を乗算するステップと、前記乗算手段の出力を加算するステップと、を含み、特定の範囲の周波数の信号だけを通すバンドパスフィルタの特性を示すように前記所定の係数を設定する。
また、本発明は、信号処理回路であって、前記インターポレータを含む。
また、前記信号処理回路において、前記インターポレータにおいてビット点補間を行う位置を制御する手段をさらに有することが好ましい。
本発明により、カップリングコンデンサ、DCオフセットキャンセラ回路等の回路を設けることなく、インターポレータによりDCオフセット成分を除去することができる。
本発明について以下詳細に説明する。図1に本発明のインターポレータを含む信号処理回路の構成の一例を示す。例えば、DVC等のヘッドにより読み取られたアナログ信号は、ヘッドアンプ220により増幅され、A/Dコンバータ240においてサンプリング周波数fsでデジタルサンプリングされ、データサンプルXが出力される。サンプリング周波数fsのクロックは位相同期ループ(PLL)/電圧制御発信器(VCO)260から発せられる。
インターポレータ100は、デジタル信号処理により、非同期サンプリングされたデータからビット点を推定補間する。インターポレータ100は、例えば、図2に示すようにタップ120を有するシフトレジスタ140、乗算器160および加算器180からなる。シフトレジスタ140はデータサンプルXを逐次取り込み、各乗算器160はシフトレジスタ140の各タップ120からの出力に、係数テーブル200から出力されたタップ係数を掛ける。加算器180は各乗算器160から得られた全ての積を加算し、出力データサンプルYを得る。ここでタップ係数は可変であり、様々な信号の特性に応じて任意に設定してもよい。特にDVCの場合、ヘッドアンプからの出力をPR4等化特性等に波形等化するため、必要信号成分に直流(DC)成分を有さない。したがって、インターポレータ100の特性として、従来のようなローパスフィルタ(LPF)の特性ではなく、直流振幅ゲインをなくす、あるいは小さくして例えば特定の範囲の周波数の信号だけを通すバンドパスフィルタ(BPF)の特性にすることができる。これにより、インターポレータ100によりDC成分を除去することができる。
本実施形態では、インターポレータ100をBPFの特性を示すように、タップ係数を設定する。例えば、タップ数10個、補間32点の場合のタップ係数の設定例を表1、表2および表3に示す。表1、表2および表3において、横の列はタップの番号(この場合、タップ数は10個)、縦の行は補間の位置(この場合、4番のタップと5番のタップの間に補間位置を32点取り、5番のタップに一番近い点を0で、4番のタップに一番近い点を31で示す。)を表す。
また、表1、表2および表3のそれぞれのタップ係数によって処理された信号の周波数特性をそれぞれ図3、図4、および図5に示す。
また、従来のLPFの特性を示すインターポレータのタップ係数の設定例を表4に、表4のタップ係数によって処理された信号の周波数特性を図6に示す。
再び、図1を参照して説明する。インターポレータ100から出力された出力データサンプルYは、固定フィルタ、BPF/ハイパスフィルタ(HPF)、オールパスフィルタ等から選ばれる1つ以上からなるフィルタ282およびFIRフィルタ284等を含むイコライザ280を通してフィルタリング処理され、データZが出力される。
なお、インターポレータ100にて推定補間される位置は、例えば、ビット推定点誤差検出器320、ループフィルタ340、および制御部(NCO)360からなるフィードバックループ300でインターポレータ100を制御することにより決められる。ビット推定点誤差検出器320は出力データZからタイミングエラーを検出し、ループフィルタ340は検出したタイミングエラーからノイズ成分を取り除き、積分処理、微分処理を行う。制御部360はループフィルタ340で処理されたタイミングエラーをフィードバックしてインターポレータ100の動作を制御する。これらビット点同期のPLLに相当するループ動作は全てデジタル処理にて行われることが好ましい。ここで、フィードバックループ300においては、例えば、サンプリングしたデータの絶対値から対称性のずれを検出し誤差が0になるようにフィードバックを行う。
本発明のインターポレータで処理される信号はデジタル信号であれば特に制限はないが、特にデジタルビデオカメラ(DVC)のようなデジタルシステムで使用されるPR4特性信号、PR5特性信号、ダイコード符号、ミラースクエアド(M2)符号、フェイズエンコーディング(PE)符号等、必要信号成分に直流(DC)成分が含まれない信号の処理に特に効果を発揮する。
本発明のインターポレータは、例えば、CMOS−LSI等のデジタル集積回路、デジタル/アナログ集積回路化してデジタル信号処理回路とし、地上波デジタル放送、衛星デジタル放送、デジタルビデオ、デジタル通信、CDシステム、MDシステム、DVDシステム等に使用されるデジタル信号を処理するための装置に好適に使用することができる。
本発明により、カップリングコンデンサ、DCオフセットキャンセラ回路等の回路を設けることなく、DCオフセット成分を除去することができるインターポレータ、インターポレート方法、信号処理回路を提供することができる。
100 インターポレータ、120 タップ、140 シフトレジスタ、160 乗算器、180 加算器、200 係数テーブル。
Claims (6)
- アナログ信号をデジタルサンプリングしたデジタル信号の補間処理を行うインターポレータであって、
複数のタップにより前記デジタル信号を受け取り、前記複数のタップからタップ出力を生成する手段と、
前記タップ出力のそれぞれに所定の係数を乗算する乗算手段と、
前記乗算手段の出力を加算する加算手段と、
を含み、特定の範囲の周波数の信号だけを通すバンドパスフィルタの特性を示すように前記所定の係数を設定することを特徴とするインターポレータ。 - 請求項1に記載のインターポレータであって、
前記所定の係数が可変であることを特徴とするインターポレータ。 - 請求項1または2に記載のインターポレータであって、
前記デジタル信号が直流成分を有さないことを特徴とするインターポレータ。 - アナログ信号をデジタルサンプリングしたデジタル信号の補間処理を行うインターポレート方法であって、
複数のタップにより前記デジタル信号を受け取り、前記複数のタップからタップ出力を生成するステップと、
前記タップ出力のそれぞれに所定の係数を乗算するステップと、
前記乗算手段の出力を加算するステップと、
を含み、特定の範囲の周波数の信号だけを通すバンドパスフィルタの特性を示すように前記所定の係数を設定することを特徴とするインターポレート方法。 - 信号処理回路であって、
請求項1乃至3のいずれか1に記載のインターポレータを含むことを特徴とする信号処理回路。 - 請求項5に記載の信号処理回路であって、
前記インターポレータにおいてビット点補間を行う位置を制御する手段をさらに有することを特徴とする信号処理回路。
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