JP2002118160A - 電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置 - Google Patents
電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置Info
- Publication number
- JP2002118160A JP2002118160A JP2000310968A JP2000310968A JP2002118160A JP 2002118160 A JP2002118160 A JP 2002118160A JP 2000310968 A JP2000310968 A JP 2000310968A JP 2000310968 A JP2000310968 A JP 2000310968A JP 2002118160 A JP2002118160 A JP 2002118160A
- Authority
- JP
- Japan
- Prior art keywords
- film
- forming
- wafer
- light
- semiconductor substrate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000000034 method Methods 0.000 title claims abstract description 100
- 239000004065 semiconductor Substances 0.000 title claims abstract description 58
- 230000005669 field effect Effects 0.000 title claims abstract description 12
- 230000008569 process Effects 0.000 claims abstract description 45
- 238000010438 heat treatment Methods 0.000 claims abstract description 25
- 230000010287 polarization Effects 0.000 claims abstract description 22
- 239000010408 film Substances 0.000 claims description 214
- 230000003287 optical effect Effects 0.000 claims description 71
- 238000005259 measurement Methods 0.000 claims description 60
- 238000004519 manufacturing process Methods 0.000 claims description 53
- 238000012545 processing Methods 0.000 claims description 46
- 239000000758 substrate Substances 0.000 claims description 35
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 25
- 229910052710 silicon Inorganic materials 0.000 claims description 25
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 24
- 239000010703 silicon Substances 0.000 claims description 24
- 239000007789 gas Substances 0.000 claims description 21
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical group [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 19
- 239000001301 oxygen Substances 0.000 claims description 19
- 229910052760 oxygen Inorganic materials 0.000 claims description 19
- 230000008859 change Effects 0.000 claims description 16
- 238000006243 chemical reaction Methods 0.000 claims description 16
- 229910052757 nitrogen Inorganic materials 0.000 claims description 12
- 230000001678 irradiating effect Effects 0.000 claims description 10
- 150000004767 nitrides Chemical class 0.000 claims description 8
- 150000001875 compounds Chemical class 0.000 claims description 6
- -1 nitrogen-containing compound Chemical class 0.000 claims description 6
- 239000010409 thin film Substances 0.000 claims description 6
- 239000000126 substance Substances 0.000 claims description 2
- 230000015572 biosynthetic process Effects 0.000 abstract description 14
- 239000010410 layer Substances 0.000 description 53
- 230000003647 oxidation Effects 0.000 description 31
- 238000007254 oxidation reaction Methods 0.000 description 31
- 238000004458 analytical method Methods 0.000 description 12
- 238000004140 cleaning Methods 0.000 description 12
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 10
- 238000000137 annealing Methods 0.000 description 10
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 9
- 229910052814 silicon oxide Inorganic materials 0.000 description 9
- 229910004298 SiO 2 Inorganic materials 0.000 description 8
- 238000010586 diagram Methods 0.000 description 6
- 238000012544 monitoring process Methods 0.000 description 6
- 239000013078 crystal Substances 0.000 description 5
- 238000001228 spectrum Methods 0.000 description 5
- 229910006501 ZrSiO Inorganic materials 0.000 description 3
- 230000008901 benefit Effects 0.000 description 3
- 230000007423 decrease Effects 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
- 238000011156 evaluation Methods 0.000 description 3
- 238000005121 nitriding Methods 0.000 description 3
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 3
- 229920005591 polysilicon Polymers 0.000 description 3
- 238000002310 reflectometry Methods 0.000 description 3
- 230000001360 synchronised effect Effects 0.000 description 3
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 239000000460 chlorine Substances 0.000 description 2
- 230000005684 electric field Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 230000001747 exhibiting effect Effects 0.000 description 2
- 238000012625 in-situ measurement Methods 0.000 description 2
- 238000000691 measurement method Methods 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000011160 research Methods 0.000 description 2
- 230000004044 response Effects 0.000 description 2
- 239000002356 single layer Substances 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- 238000004611 spectroscopical analysis Methods 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 102100038608 Cathelicidin antimicrobial peptide Human genes 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 101000741320 Homo sapiens Cathelicidin antimicrobial peptide Proteins 0.000 description 1
- CBENFWSGALASAD-UHFFFAOYSA-N Ozone Chemical compound [O-][O+]=O CBENFWSGALASAD-UHFFFAOYSA-N 0.000 description 1
- 235000001630 Pyrus pyrifolia var culta Nutrition 0.000 description 1
- 240000002609 Pyrus pyrifolia var. culta Species 0.000 description 1
- 229910008045 Si-Si Inorganic materials 0.000 description 1
- 229910006411 Si—Si Inorganic materials 0.000 description 1
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 1
- 229910021529 ammonia Inorganic materials 0.000 description 1
- 238000004364 calculation method Methods 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 229910052801 chlorine Inorganic materials 0.000 description 1
- 239000000470 constituent Substances 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 239000010432 diamond Substances 0.000 description 1
- 229910003460 diamond Inorganic materials 0.000 description 1
- 238000000572 ellipsometry Methods 0.000 description 1
- 230000007613 environmental effect Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 229910052736 halogen Inorganic materials 0.000 description 1
- 150000002367 halogens Chemical class 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 238000007689 inspection Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- QPJSUIGXIBEQAC-UHFFFAOYSA-N n-(2,4-dichloro-5-propan-2-yloxyphenyl)acetamide Chemical compound CC(C)OC1=CC(NC(C)=O)=C(Cl)C=C1Cl QPJSUIGXIBEQAC-UHFFFAOYSA-N 0.000 description 1
- 230000002250 progressing effect Effects 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Chemical compound [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 1
- 230000003595 spectral effect Effects 0.000 description 1
- WGPCGCOKHWGKJJ-UHFFFAOYSA-N sulfanylidenezinc Chemical group [Zn]=S WGPCGCOKHWGKJJ-UHFFFAOYSA-N 0.000 description 1
- 238000005211 surface analysis Methods 0.000 description 1
- 125000004213 tert-butoxy group Chemical group [H]C([H])([H])C(O*)(C([H])([H])[H])C([H])([H])[H] 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67155—Apparatus for manufacturing or treating in a plurality of work-stations
- H01L21/67161—Apparatus for manufacturing or treating in a plurality of work-stations characterized by the layout of the process chambers
- H01L21/67167—Apparatus for manufacturing or treating in a plurality of work-stations characterized by the layout of the process chambers surrounding a central transfer chamber
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
- H01L21/28185—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation with a treatment, e.g. annealing, after the formation of the gate insulator and before the formation of the definitive gate conductor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
- H01L21/28211—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation in a gaseous ambient using an oxygen or a water vapour, e.g. RTO, possibly through a layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67242—Apparatus for monitoring, sorting or marking
- H01L21/67253—Process monitoring, e.g. flow or thickness monitoring
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
- H01L22/20—Sequence of activities consisting of a plurality of measurements, corrections, marking or sorting steps
- H01L22/26—Acting in response to an ongoing measurement without interruption of processing, e.g. endpoint detection, in-situ thickness measurement
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/511—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures
- H01L29/513—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures the variation being perpendicular to the channel plane
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/517—Insulating materials associated therewith the insulating material comprising a metallic compound, e.g. metal oxide, metal silicate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/28008—Making conductor-insulator-semiconductor electrodes
- H01L21/28017—Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
- H01L21/28158—Making the insulator
- H01L21/28167—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
- H01L21/28194—Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation by deposition, e.g. evaporation, ALD, CVD, sputtering, laser deposition
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/51—Insulating materials associated therewith
- H01L29/511—Insulating materials associated therewith with a compositional variation, e.g. multilayer structures
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Manufacturing & Machinery (AREA)
- Chemical & Material Sciences (AREA)
- General Chemical & Material Sciences (AREA)
- Crystallography & Structural Chemistry (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Ceramic Engineering (AREA)
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
- Formation Of Insulating Films (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
- Length Measuring Devices By Optical Means (AREA)
Abstract
界効果トランジスタの製造方法、並びに、半導体デバイ
スの製造方法及びその装置を提供する。 【解決手段】 熱処理によるウェハW表面への成膜工程
において、光源206の発生したレーザ光をデポーララ
イザ210により無偏光化してウェハW表面に照射す
る。ウェハW表面から反射された反射光について、ビー
ムスプリッタ211により、所定の直交する2方向の偏
光成分を取り出して光センサ212、213で受光し、
それぞれその強度を検出する。分析処理ユニット205
は検出された2方向成分の反射光強度データの差の変化
からウェハW表面に形成された膜の厚さを判定して、膜
厚データをシステムコントローラ12に送る。システム
コントローラ12は、この膜厚データに基づいて成膜工
程を管理する。
Description
スタの製造方法、並びに、半導体デバイスの製造方法及
びその装置に関する。
に伴い、MOSデバイスにおいても構成要素であるトラ
ンジスタ等の素子の微細化、高性能化が要求されてい
る。ただし、トランジスタ等の素子の微細化によってデ
バイス全体の信頼性が損なわれてはならない。そこで、
トランジスタ等の素子を構成する各要素の微細化と信頼
性の向上とが併せて求められている。
あるゲート絶縁膜については、薄膜化しつつ絶縁耐圧を
確保するため、従来のシリコン酸化膜に代えてより誘電
率の高い高誘電体膜が用いられつつある。ただし、シリ
コン基板上に高誘電体膜を直接形成すると、ゲート絶縁
膜の品質が低下し、リーク電流が増加したり、さらに、
Si/絶縁膜の界面付近のモビリティ低下をきたす。こ
のため、ゲート絶縁膜の形成方法としては、基板上に薄
いシリコン酸化膜を形成し、その上に高誘電体膜を形成
する方法が検討されている。
ると、ゲート絶縁膜全体が厚くなり、微細化の要請に反
する。一方、シリコン酸化膜が薄すぎると、リーク電流
が多くなってしまう。このため、シリコン酸化膜の膜厚
の制御は、非常に重要である。近時では、素子の微細化
により、数Å(数原子層分の厚さ)という非常に薄い酸
化膜が求められるようになっている。ところが、従来、
膜厚の測定に用いられているエリプソメトリ法による薄
膜の測定の信頼性は10数Å程度であり、それよりも薄
い膜の厚さを正確には測定することはできない。
膜の厚さを測定する手法として、反射率差分光法(Refl
ectance Difference Spectroscopy:RDS)が知られ
ており、この技術を用いて、GaAs結晶の表面での結
晶成長の厚さを測定する方法が、米国特許第4,931,132
号に記載されている。この測定方法は、エピタキシャル
成長のように、形成済みの原子層の上に、新たな原子層
が形成されるようなものの膜厚の測定には、新たな原子
層が測定対象面に存在するため、原子層レベルで測定可
能である。
で形成され、シリコン基板の内側に原子層の形成が進
み、その表面には変化が起きない。このため、同様の方
法による測定は困難であると考えられていた。
の鋭意努力の結果、上記したようなシリコン基板の内側
へと原子層が形成される様子が、反射率差分光法により
観測可能であり、かつ、この観測データに基づいて、シ
リコン酸化膜の形成を原子層のオーダで制御可能である
ことが判明した。
光法を用いて、原子層オーダでの膜形成の制御が可能
な、電界効果トランジスタの製造方法、並びに、半導体
デバイスの製造方法及びその装置を提供することにあ
る。
め、本発明の第1の観点に係る電界効果トランジスタの
製造方法は、半導体基板と、該基板上に形成され、絶縁
膜単独或いは絶縁膜と高誘電体膜との2層構造を有する
ゲート絶縁膜と、該ゲート絶縁膜上に形成されたゲート
電極とを備える電界効果トランジスタの製造方法におい
て、半導体基板を所定のガス雰囲気中で加熱することに
より、ガスと半導体との反応を前記半導体基板の表面か
ら内側に進めることにより、半導体基板の表面から内面
側に向かって絶縁膜を成長させる成膜ステップと、前記
成膜ステップを実行しながら、前記半導体基板の表面に
測定光を照射し、前記半導体基板に照射された測定光
の、前記半導体基板と成長した前記絶縁膜との界面から
反射された反射光の直交する2方向の偏光成分の強度を
検出し、検出した強度の変化に基づいて、前記半導体基
板の表面から内側に進む反応により前記半導体基板の表
面領域に形成された前記絶縁膜の原子層単位での厚さを
求める膜厚測定ステップと、前記膜厚測定ステップで求
められた膜厚に基づいて、前記反応のエンドポイントを
検出し、前記成膜ステップを停止させる制御ステップ
と、前記絶縁膜の上に、前記絶縁膜よりも誘電率の大き
い誘電膜を形成するステップと、前記誘電膜の上にゲー
ト電極を形成するステップと、を備えることを特徴とす
る。
半導体基板の表面にゲート絶縁膜を形成する成膜ステッ
プにおいて、基板表面から内側へと成長する絶縁膜の形
成を反射率差分光法を用いて原子層単位でモニタし、所
定の膜厚が形成された時点で加熱処理を終了するよう制
御することができる。その後、加熱処理により形成され
たゲート絶縁膜の上に高誘電体膜を形成し、さらに、そ
の上にゲート電極を形成することにより、高微細化さ
れ、かつ、信頼性の高い電界効果トランジスタを製造す
ることができる。
基板はシリコン基板であり、所定のガス雰囲気は、酸素
又は窒素或いは酸素(系及び含酸素化合物)と窒素(含
窒素化合物)を含む雰囲気であり、成膜ステップは、熱
酸化膜又は熱窒化膜或いは熱酸窒化膜を形成するステッ
プであり、前記膜厚測定ステップは、絶縁膜が2乃至2
0原子層のうちの所定の層だけ形成されたことを検出す
るものであってもよい。
含酸素化合物)と窒素(含窒素化合物)を含むガス中で
の熱酸化処理によりシリコン半導体基板の表面に酸化膜
又は窒化膜或いは熱酸窒化膜のゲート絶縁膜を形成する
成膜ステップにおいて、シリコン基板表面から内側へと
成長する絶縁膜の形成を反射率差分光法を用いて原子層
単位でモニタし、2〜20原子層のうちの、所定の膜厚
が形成された時点で熱処理を終了するよう制御すること
ができる。その後、熱処理により形成されたゲート絶縁
膜の上に高誘電体膜を形成し、さらに、その上にゲート
電極を形成することにより、高微細化され、かつ、信頼
性の高い電界効果トランジスタを製造することができ
る。
観点に係る半導体デバイスの製造方法は、被処理体の内
側に向かって反応を進めることにより、被処理体の表面
領域に膜を形成する成膜ステップと、前記被処理体の表
面に測定光を照射する照射ステップと、前記被処理体に
照射された測定光の反射光の、直交する2方向の偏光成
分の強度を検出する検出ステップと、前記検出ステップ
で検出した反射光の直交する2方向の偏光成分の強度変
化に基づいて前記膜の厚さを求める膜厚測定ステップ
と、前記膜厚測定ステップで求められた膜厚に基づい
て、前記成膜ステップを制御する制御ステップと、を備
えることを特徴とする。
成する成膜ステップにおいて、被処理体の表面から内側
へと成長する膜の形成を反射率差分光法を用いてモニタ
し、処理を制御することができるので、高微細化され、
かつ、信頼性の高い半導体デバイスを製造することがで
きる。
テップは、所定雰囲気下で被処理体を加熱することによ
り、雰囲気中の化学物質と被処理体との反応を進めるこ
とにより、被処理体の表面領域に薄膜を形成するステッ
プであり、前記膜厚測定ステップは、前記被処理体のシ
リコン領域に照射された測定光の2方向の偏光成分の強
度から、直交する2方向の偏光成分の反射率の差を、該
2方向の偏光成分の反射率の相加平均で除した値に対応
する値を求める演算ステップを含み、前記制御ステップ
は、前記演算ステップで求められた値の変化に基づい
て、前記膜の厚さを求めるステップを含んでもよい。
より被処理体の表面領域に薄膜を形成する成膜ステップ
において、被処理体の表面から化学反応により進行する
膜形成中に、反射率差分光法を用いて膜の厚さをその場
計測により求めて、処理を制御することができる。
ップは、前記演算ステップで求められた値の変化に基づ
いて、前記膜の深さ方向への原子層単位での反応の進行
の度合いを求めるステップを含んでもよい。
処理体の表面領域に形成された膜の、深さ方向への膜形
成の進行をモニタすることができる。
テップは、求めた膜厚に基づいて、前記成膜ステップに
よる成膜処理を停止するステップを含んでもよい。
処理体の表面領域に膜を形成する深さ方向への膜形成の
進行を制御することができる。
テップは、所定のガス中で被処理体を加熱することによ
り、該ガスと被処理体との反応膜を表面領域に形成する
工程を含んでもよい。
被処理体の表面に成膜する処理工程に適用することがで
きる。
体はシリコンであり、前記所定の雰囲気は、酸素又は窒
素或いは酸素(系及び含酸素化合物)と窒素(含窒素化
合物)を含む雰囲気であり、前記成膜ステップは、熱酸
化膜又は熱窒化膜或いは熱酸窒化膜を形成する工程であ
り、前記膜厚測定ステップは、絶縁膜が2乃至20原子
層のうちの所定の層だけ形成されたことを検出するよう
してもよい。
含酸素化合物)と窒素(含窒素化合物)を含むガス中で
の処理によりシリコン半導体基板の表面に酸化膜又は窒
化膜或いは熱酸窒化膜を形成する成膜ステップにおい
て、シリコン基板表面から内側へと進行する膜形成反応
を、反射率差分光法を用いて、2〜20層の原子層を形
成させることができる。
の製造装置は、被処理体を所定のガスを含む雰囲気中で
熱処理する処理チャンバと、前記処理チャンバ内の前記
被処理体に測定光を照射し、前記被処理体で反射された
反射光の直行する2方向の偏光成分の強度を測定し、測
定信号を出力する光学手段と、前記処理チャンバと前記
光学手段に接続され、前記処理チャンバに、前記所定の
ガスを含む雰囲気中で熱処理を開始させ、熱処理中に、
前記光学手段からの測定信号に基づいて、形成された膜
の厚さを測定し、膜厚が所定値に達したことを検出する
と、前記熱処理を終了させる制御手段と、を備えること
を特徴とする。
での熱処理により被処理体の表面領域に膜を形成する成
膜ステップにおいて、形成される膜の厚さを反射率差分
光法を用いてモニタし、処理を制御することができるの
で、高微細化され、かつ、信頼性の高い半導体デバイス
を製造することができる。
ャンバと他の処理チャンバとを収容し、これらの前記複
数の処理チャンバを含む空間を大気から遮断した雰囲気
に維持するように取り囲む共通容器と、前記共通容器内
で被処理体を搬送するための搬送手段と、をさらに備
え、クラスタリングされていてもよい。
を行う処理チャンバの他に、成膜処理の前後にこの半導
体デバイスに他の処理を施す処理チャンバを、大気から
遮断した雰囲気でクラスタリングすることにより、処理
される半導体デバイスを大気に曝すことなく、一連の成
膜処理を行うことができ、生産効率を向上させることが
できる。
体デバイスの製造装置について、以下図面を参照して説
明する。図1は、本実施の形態に係る、ウェハW上にゲ
ート絶縁膜、すなわち、シリコン酸化(SiO2)膜を
形成する、半導体デバイスの製造装置の構成を示す。本
実施の形態の製造装置は、酸化膜形成を行う処理チャン
バと、予備洗浄チャンバと、高誘電体膜を形成する処理
チャンバと、アニール処理を行う処理チャンバとがクラ
スタリングされた構成である。
置は、ウェハ処理システム11と、システムコントロー
ラ12と、光学的測定システム13と、から構成され
る。ウェハ処理システム11は、洗浄用チャンバ101
と、高速酸化用(Rapid Thermal Oxidation:RTO)
チャンバ102と、化学的気相成長用(Chemical Vapor
Deposition:CVD)チャンバ103と、アニール用
チャンバ104と、ロードロック室105と、ローダモ
ジュール106と、から構成される。
ベーパ処理、紫外線−塩素処理等により、酸化処理前の
ウェハW上に存在する自然酸化膜を除去するために設け
られる。RTOチャンバ102は、内部にハロゲンラン
プ等の光源を用いた加熱ランプを備え、固定して戴置さ
れたウェハWをこの加熱ランプにより加熱して、ウェハ
W上のシリコン(Si)層の表面を酸化してシリコン酸
化(SiO2)膜を形成する。CVDチャンバ103
は、ウェハWにCVD処理を施し、SiO2膜上に高誘
電率絶縁膜、例えば、ZrSiO2膜を形成する。アニ
ール用チャンバ104は、成膜されたウェハWにアニー
ル処理を施し、膜を安定化、高品質化する。ローダモジ
ュール106及びロードロック室105は、各チャンバ
間及び製造装置内へのウェハWの搬出入を最適化して処
理可能に構成されている。複数のチャンバ及びロードロ
ック室105は、大気から遮断された減圧雰囲気下の空
間を取り囲む共通容器として機能しており、クラスタリ
ングされた製造装置を構成している。
システム11及び光学的測定システム13を制御し、ウ
ェハWの製造装置内への搬入、洗浄用チャンバ101で
の洗浄処理、RTOチャンバ102での酸化処理、CV
Dチャンバ103でのCVD処理、アニール用チャンバ
104での洗浄処理、ウェハWの搬出までの全工程にわ
たる、製造装置全体の制御を行う。
ニット201と、光ドライバ202と、第1のロックイ
ンアンプ203と、第2のロックインアンプ204と、
分析処理ユニット205と、から構成される。光学的測
定システム13は、後述する反射率差分光法に従って、
ウェハW表面に測定光を垂直に照射して、その反射光の
所定の2方向の偏光成分の反射率を測定し、この2つの
反射率の差に基づいてウェハW表面の特性、特に、Si
O2膜の厚さを光学的に評価する。
示す。図に示すように、光学的測定ユニット201は、
RTOチャンバ102の窓214の近傍に設置されてい
る。ここで、窓214は、例えば、石英窓であり、窓2
14を介してRTOチャンバ102内に戴置されたウェ
ハWの表面に垂直に光を照射可能なように、ウェハWに
対面するように設置されている。
と、コリメートレンズ207と、第1及び第2の反射鏡
208、209と、デポーラライザ210と、ビームス
プリッタ211と、第1及び第2の光センサ212、2
13と、から構成される。
ザダイオード、例えば、紫色レーザダイオード(波長3
95nm付近)である。光ドライバ202は、分析処理
ユニット205の指令に従って電流及び温度を制御して
光源206を制御する。コリメートレンズ207は、光
源206から生成されたレーザ光の光路に配設され、生
成されたレーザ光を平行光線に直す。コリメートレンズ
207を通過した照射光は、第1の反射鏡208により
反射され、RTOチャンバ102の窓214を通過し
て、RTOチャンバ102内に戴置されたウェハWの中
心に垂直(〜90±2°)に照射される。デポーラライ
ザ210は、第1の反射鏡208から窓214に至る光
路上に配設され、元々偏光しているレーザ光を無偏光化
する。
プリッタであり、ウェハW表面から略垂直に反射された
反射光のうち、所定方向の偏光成分を反射させて第1の
光センサ212に入射させ、また、所定方向に直交する
方向の偏光成分を第2の光センサ213へと通過させる
ことにより、直交する2方向の偏光成分を取り出す。
は、フォトダイオード等の光センサである。第1の光セ
ンサ212は、ビームスプリッタ211により反射され
た一方の偏光成分を受光可能に設けられ、第1のロック
インアンプ203に接続されている。第2の光センサ2
13は、第2の反射鏡209を介して、ビームスプリッ
タ211を通過したもう一方の偏光成分を受光可能に備
えられ、第2のロックインアンプ204に接続されてい
る。
204は、光ドライバ202に接続され、光センサ21
2、213からの光強度データを信号化する。第1及び
第2のロックインアンプ203、204は、それぞれ、
各偏光成分の反射率を示す信号S1、S2を分析処理ユ
ニット205に送出する。
のロックインアンプ203、204からの信号から、下
記数式1に従って反射率差の変化割合Δr〜/r〜を算
出し、この反射率差の変化割合から膜厚を評価する。分
析処理システムは、得られた膜厚データをシステムコン
トローラ12へと送出する。
の膜厚測定時における処理の流れを説明する。光源20
6で生成された光は、コリメートレンズ207を通り、
第1の反射鏡208で反射され、デポーラライザ210
で無偏光化されてウェハWの被処理面に垂直に照射され
る。ウェハWから反射された光はビームスプリッタ21
1により所定の2方向の成分が取り出される。ビームス
プリッタ211で反射された成分は第1の光センサ21
2で受光し、ビームスプリッタ211を通過した偏光成
分は、第2の反射鏡209で反射されて第2の光センサ
213で受光する。
検出された各偏光成分の強度データは、第1及び第2の
ロックインアンプ203、204へとそれぞれ送られ
る。第1及び第2のロックインアンプ203、204
は、受信した強度データに所定の処理を施し、各偏光成
分の反射率を示す信号S1、S2を、それぞれ、分析処
理ユニット205へと送出する。
ロックインアンプ203、204から受信した信号
S1、S2から上記数式1に従って反射率差の変化割合
を算出し、算出した複素反射率差データからウェハW表
面に形成された酸化膜の厚さを評価する。分析処理ユニ
ット205は、得られた膜厚データをシステムコントロ
ーラ12に送出する。システムコントローラ12は分析
処理ユニット205からの膜厚データをモニタして成膜
工程を制御する。
ctroscopy:RDS)の測定原理について簡単に説明す
る。反射率差分光法は、試料表面に対して垂直に入射し
た偏光の複素反射率について、偏光方向に応じて変化す
る部分を測定する手法である。試料のバルク部分の光学
的応答が等方的な場合の、表面又は界面の構造に極めて
敏感な線形光学測定法である。反射率差分光法について
の詳細は、『固体物理』、第34巻、第2号、19頁〜
29頁(1999年)等に記載されている。また、Ga
As結晶の表面での結晶成長の評価に上記反射率差分光
法を用いたものが、米国特許第4,931,132号に記載され
ている。
的異方性を示す試料Wの表面に、入射光偏光子Pにより
偏光化した直線偏光を照射し、その偏光方向とy軸とが
平行となるようにxy座標系を定義する。このとき、光
照射される試料Wは、この試料Wの表面の持つ異方性の
主軸a及びこれに垂直な主軸bがy軸に対してそれぞれ
45°の角度となるよう配置される。すなわち、入射光
が試料Wに対しa方向成分とb方向成分とで等しい強度
及び位相で照射されるよう配置される。
=re−iθにおいて、振幅rだけに異方性があると
き、例えば、主軸a方向の反射率の振幅raが、もう一
方の主軸b方向の反射率の振幅rbよりも大きく、ra
>rbであるとき、反射光は直線偏光であり、その電界
方向はy軸に対して反時計回りにずれる。一方、位相だ
けに異方性があるとき、例えば、a軸方向の光の電場の
位相がb軸に対して遅れると(θa>θb)、反射光は
y軸からa軸方向に回転する楕円偏光になる。一般に、
振幅と位相の両方が異方性を持つと、図3に示すよう
に、反射光は長軸が入射偏光方向からずれた楕円偏光に
なる。このように、光学的異方性を示す試料Wの表面か
ら反射された光には、異方性軸に平行な成分とこれに垂
直な成分とにおいて反射率に差が観測される。従って、
このような反射率の差を測定することにより異方性を有
する表面の状態についての見知が得られる。
軸a方向の複素反射率r〜 a及び主軸b方向の複素反射
率r〜 bを用いて下記数式2のように定義される。
2回対称以下であれば、複素反射率差Δr〜/r〜が観
察可能であり、すなわち、ゼロでないΔr〜/r〜が許
される。例えば、ダイヤモンド構造或いは閃亜鉛鉱構造
の再構成されていない表面では、(111)面は3回対
称であるので、常にΔr〜/r〜=0であり、一方、
(110)面及び(001)面は2回対称であるので、
Δr〜/r〜≠0を示しうる。従って、結晶成長などに
より表面又は界面の再構成が起き、(110)面、(−
110)面といった2回対称以下の対称性を有する表面
又は界面が形成されれば、これに由来する特徴的な(異
方的な)光学応答を観測することができる。
により、下記数式3のようにも書くことができる。従っ
て、実部の振幅の異方性Δr/r、及び、虚部の位相の
異方性Δθを求めることにより被測定表面の複素反射率
差Δr〜/r〜が求められる。
は、振幅の異方性Δr/r及び位相の異方性Δθから求
めることができ、その手法としては、図3に示すよう
な、光弾性変調器(PEM)を用いた方法が知られてい
る。この方法では、試料Wの異方性表面から反射された
偏光をPEMにより所定の周波数に変調させ、この変調
された偏光について、さらに検光子Aを用いて所定の角
度の成分を取り出し、適当な検出系により変調成分を検
出する。このように検出された、変調された偏光成分の
強度を示す信号からΔr/r及びΔθを求めることがで
きる。しかし、実際には、位相の異方性Δθは、窓や光
学部品等の持つ異方性の影響を受けやすいので、Δr/
rのみを計測するのが好ましい。
た表面分析に関する知見を基に、本発明人らが鋭意努力
した結果、シリコン(Si)表面又は界面の酸化によ
り、シリコン酸化(SiO2)膜がレイヤ・バイ・レイ
ヤ(1原子層毎)で形成される際、1原子層の酸化毎に
SiO2/Si界面の光学的異方性が変化する様子が上
記反射率差分光法を用いて観測可能であることが判明し
た。
面の酸化は、図4に示すように、エピタキシャル成長の
ように1原子層毎に進行する(レイヤ・バイ・レイヤ酸
化)。1層酸化される毎に、フロンティアであるSiO
2/Si界面で終端されているSi−Siボンドの方向
は、(001)面に射影すると、[110]方向(図5
(a))と[−110]方向(図5(b))とで交互に
変化し、これらの射影の方向がシリコン表面又は界面の
異方性の主軸となる。このことは、界面構造の異方性が
酸化された原子層数の偶奇で90°変化することを意味
する。従って、SiO2/Si界面に測定光を照射し、
界面からの反射光について[110]方向及び[−11
0]方向の成分の反射率差を調べることにより、界面の
状態についての知識が得られる。また、光の反射率は、
温度及び光の波長に関して線形に変化するので、酸化工
程において、Si原子層のレイヤ・バイ・レイヤ酸化の
進行の様子をリアルタイムで観測することができ、すな
わち、形成される膜の厚さを原子層オーダでモニタする
ことができる。
2膜の形成時に、単一波長光を被処理表面に照射して、
[110]方向及び[−110]方向の成分の反射率差
を下記数式4に従って算出したときに得られる基本的な
シグナルの時間変化を示す。図に示すように、ピーク一
つ分で膜が一原子層分形成されていることになる。従っ
て、実際の成膜工程において、工程の開始時点から測定
を開始すれば、振幅の周期を数えることによりモニタす
ることができる。例えば、熱酸化工程中、膜をn層成長
させる場合には、ピークがn個観測された時点で加熱、
ガス供給を停止させればよい。
において、測定する原子層の数、すなわち、nの大きさ
は、2〜20程度であることが望ましい。というのは、
酸化膜の成長に従ってSi界面の被処理表面からの深度
は増してゆき、これと共に界面から反射されて観測され
るシグナルの強度は弱くなってゆくからである。このよ
うに、界面が深化するにつれてシグナルの測定から得ら
れる膜厚データの確度は低下していくので、測定する原
子層の範囲としては、2〜20、好ましくは、2〜10
原子層であることが望ましい。
半導体デバイスの製造装置を用いたゲート絶縁膜形成の
一連の工程について説明する。まず、システムコントロ
ーラ12は、ローダモジュール106に戴置されたウェ
ハカセットから、ウェハWをロードロック室105に搬
入する。搬入されたウェハWを洗浄用チャンバ101に
入れる。洗浄用チャンバ101内でウェハW上の自然酸
化膜が希フッ酸により除去される。希フッ酸による洗浄
の終わったウェハWはRTOチャンバ102へと送られ
る。
した後、RTOチャンバ102内を10−6Torr程度の
真空状態とし、O2(100sccm)、Ar(1sl
m)を導入して30Torr程度とする。その後、ランプを
オンとして150℃/秒で急速加熱し、1050℃に達
した後10秒間、ウェハWを加熱する。加熱工程中、シ
ステムコントローラ12は、光学的測定システム13か
ら得られる膜厚データをモニタしており、所望の厚さの
酸化膜が形成されたことを示すデータを受け取ると、7
0℃/秒で降温する。ウェハWが完全に冷えた後、ウェ
ハWをRTOチャンバ102内から搬出してCVDチャ
ンバ103へと送る。
送した後、CVDチャンバ103内を所定の真空度とす
る。CVDチャンバ103内にZr(OtBu)4(2
sccm)、TEOS(4sccm)、H2O(10s
ccm)、N2(1slm)を導入して全圧を1Tor
rに保つ。ウェハWの温度を450℃に保って3分間C
VD処理を行い、ウェハW上にZrSiO2を成膜す
る。CVD処理を施したウェハWは、CVDチャンバ1
03内から搬出し、アニール用チャンバ104へと送
る。
ハWは400〜900℃で加熱してアニール処理が施さ
れた後、ロードロック室105へと送られる。ロードロ
ック室105へ送られたウェハWは、次いでローダモジ
ュール106へと送られて製造装置内から搬出されて、
ゲート酸化膜形成工程は終了する。
を8Å(4原子層分)成膜し、ZrSiO2を24Å成
膜した(実行酸化膜膜厚は13.3Å)。これにMOS
キャパシタを形成してリーク電流を流したところ、10
−6A/cm2であり、これは、従来の方法で同等の膜
厚で形成されたものと比較して6桁以上高い値である。
また、界面準位密度は5x1010cm−2(eV)
−1であり、長期信頼性試験も良好であった。上記結果
からわかるように、本実施の形態の半導体デバイスの製
造装置により、表面に極薄膜が形成されたシリコン半導
体デバイス、特に、極薄のゲート絶縁膜の形成されたM
OSデバイスを製造することができ、従って、高品質の
半導体デバイスを製造することができる。
種々の変形、応用が可能である。以下、本発明に適用可
能な上記の実施の形態の変形態様について説明する。
2内に固定状態で戴置されたウェハWに対し、ウェハW
上の1点に測定光を照射してウェハWの表面状態を評価
する構成である。しかし、ウェハW上の複数の点で計測
してウェハW表面上に均一な膜形成が行われているか検
知可能な構成としてもよい。例えば、RTOチャンバ1
02の窓214を広くして、光学的測定ユニット201
を複数配置する等してもよい。
2内での酸化処理はウェハWを固定して行うものであ
り、ウェハWの表面状態の光学的測定は固定されたウェ
ハWに対するものであった。しかし、本実施の形態の構
成は、ウェハWを回転させて酸化処理を行う場合にも有
効であり、ウェハWを固定させる場合と同様にインライ
ンでの測定が可能である。
場合には、測定光を発振器等で変調し、ウェハWの回転
周波数と同期させて測定を行えばよい。この場合、ウェ
ハWの回転周波数と同期した周波数ωの電流を発生させ
て光ドライバ202に送り、光ドライバ202でレーザ
光を周波数ωで変調させる。変調されたレーザ光をウェ
ハWの回転中心に照射すると、反射光の2つの偏光成分
は第1及び第2の光センサ212、213で検出され、
それぞれの検出信号は第1及び第2のロックインアンプ
203、204に送出される。第1及び第2のロックイ
ンアンプ203、204には参照周波数として2ωを設
定し、受信した信号のうち、この2ωに同期した信号の
み分析処理ユニット205にそれぞれ信号S1、S2を
出力する。分析処理ユニット205は、この周波数2ω
に同期した信号S1、S2から反射率差を算出する。上
述したように、上記実施の形態と同様の構成により、回
転しているウェハWに対するプロセス中のその場計測及
びインラインでの膜厚の測定及びモニタが可能となる。
光をデポーラライザ210により無偏光化してウェハW
表面に照射し、ウェハW表面に存在する異方性軸の方向
の偏光成分を検出している。しかし、測定光は、Si
(001)表面に存在しうる[110]方向及び[−1
10]方向の、直交する2つの異方性軸の方向で強度及
び位相が均等であればよいので、上記2方向に対して4
5°傾けた直線偏光を用いた構成も可能である。この場
合、図2に示す構成において、デポーラライザ210を
45°偏光子に変更すればよい。
光を用いた。しかし、前述のように、測定光としてXe
ランプ等の広波長域光を用いることも可能である。この
場合、『固体物理』、第34巻、第2号、19頁〜29
頁(1999年)に記載されているような光学系を構成
すればよい。
Xeランプを用いて測定した、Si層を1原子層及び2
原子層酸化した時の、それぞれΔr/r及び/又はΔθ
に関する反射率差スペクトル線図である。図よりわかる
ように、1原子層酸化のスペクトルと2原子層酸化のス
ペクトルは、特に、3.3eV(波長で370nm)付
近で、そのピークの向きが反転し、また、その強度は減
少している。このように、予め1層酸化時、2層酸化
時、というように、反射率差の、例えば、2〜4eV付
近のΔr/rのスペクトルパターンを調べておけば、シ
リコン表面に膜がどのくらいの厚さで、すなわち、何原
子層形成されているのかを知ることができる。
の酸化処理は、例えば、所定時間行われるように設定さ
れ、システムコントローラ12は、ウェハWを1枚処理
する毎にウェハWの処理表面を評価する。或いは、十分
に自然酸化膜が除去されているか確認するために酸化処
理の前にウェハW表面を評価する。従って、リアルタイ
ムでなくても、酸化処理により形成された酸化膜の評価
及びそれに基づく工程の管理が可能である。
が395nm、すなわち、3.14eV付近の光を用い
ている。これは、ケイ素原子のE1遷移(3.3eV)
の近傍であり、この付近の波長の光を用いて酸化時のモ
ニタを行った場合に、最も顕著なスペクトルパターンの
変化が観測されるからである。しかし、酸化時の温度に
応じて測定光の波長を変えるなど、ケイ素の表面又は界
面の状態の変化を観測することが可能であれば、いかな
る波長の光も用いることができる。
造装置では、RTOチャンバ102に光学的測定システ
ム13を適用してウェハWに酸化処理を施し、シリコン
半導体ウェハW上に膜厚をモニタしつつ酸化膜を形成す
る構成とした。しかし、上記光学的測定システム13
は、酸化膜だけでなく窒化膜又は熱酸窒化膜を形成する
工程を管理することも可能である。例えば、実施の形態
と同様の構成で、RTOチャンバ102を窒化用チャン
バに変えて窒化処理を行った場合、NH3760Torr
(アンモニア、常圧)、850℃、1分という条件下
で、Si3N4膜15Åを制御よく形成することができ
る。
た製造装置内のRTOチャンバ102に反射率差分光法
を行うための光学的測定ユニット201を取り付けた構
成としたが、本発明は斯かる実施形態に制限されるもの
ではない。
する洗浄チャンバに、光学的測定ユニット201を取り
付け、広波長域光を用いてウェハW表面をスキャンし
て、洗浄後に完全にウェハWの自然酸化膜が除去されて
いるかを確認することができる。このように、RTOチ
ャンバ102での酸化膜形成の前にチェックすることに
より、ゲート酸化膜の不良などのトラブルの発生を確実
に防止することができる。
ていることがわかった場合には、残存している酸化膜の
膜厚を除去するのに必要な時間だけ洗浄を行えばよい。
すなわち、そのまま次工程を進めたのでは不良となるウ
ェハを救済できるので、ウェハを有効に活用できる。
ト201を設置してもよい。この場合、CVD処理前の
ウェハWを光学的測定ユニット201で測定することに
より、ウェハWの表面状態を確認することができる。ま
た、CVD処理により酸化膜上にある程度の層が形成さ
れると、単一波長光を用いた場合、測定光がSi/Si
O2界面に到達できなくなることから異方性シグナル
(反射率差)は測定されなくなるので、異方性シグナル
の消失した時間を指標とする等して、CVD処理におけ
る膜厚管理に用いることも可能である。
た製造装置の構成は、洗浄用チャンバ101、RTOチ
ャンバ102、CVDチャンバ103、アニール用チャ
ンバ104という構成とした。しかし、異なった構成の
処理チャンバをクラスタリングしてもよい。例えば、R
TOの代わりにオゾン酸化、プラズマダウンフロー酸化
等の酸化処理用のチャンバ、また、スパッタリング又は
CVDにより、酸化膜、窒化膜、ポリシリコン膜を形成
するためのチャンバを設けてもよい。特に、ゲート酸化
膜を形成した後に、ポリシリコン膜をこの製造装置内で
形成することができれば、ゲート酸化膜が形成されたウ
ェハW上に自然酸化膜が形成されない内にゲート電極を
構成するポリシリコン膜を形成できるという利点があ
る。
イスの製造装置は、クラスタリングされた製造装置から
構成されるものとした。しかし、本発明の半導体デバイ
スの製造装置は、クラスタリングされた製造装置に限定
されるものではない。単独でCVD、スパッタリング、
熱酸化、窒化又は酸窒化等の成膜処理、或いは、エッチ
ング処理等の膜を除去する処理を行う装置内において
も、反射率差分光法によるスペクトルを利用して形成さ
れる膜の厚さを測定することができる。さらに、単体の
処理装置におけるバッチ処理においても、検査用のウェ
ハWに上述の光学的測定を行って工程の管理を行うこと
ができる。
用いた場合には、特に、一連の工程が終了するまでウェ
ハWを装置外に取り出すことができないので、本実施の
形態のごとく、クラスタリングされた製造装置内で光学
的評価を行うことで、一連の工程の途中で各工程でのト
ラブルの有無を判定できるという利点がある。また、ウ
ェハW表面の状態が装置外部の環境条件(酸素、湿分な
どの存在)に影響されないので、10Å以下の薄い厚さ
を有する酸化膜の厚さを、自然酸化膜の影響等を除去し
ながら把握することができ、より高い測定精度が得られ
るという利点がある。
を利用した光学的測定ユニット201の構成は、別の構
成も可能である。例えば、固定されたウェハWに対して
ウェハW表面の2本の異方性軸にそれぞれ平行な2本の
偏光を照射して反射された偏光をそのまま検出する方法
など、ウェハW表面に対して垂直に入射した光の反射率
について、偏光方向に依存して変化する部分を測定する
ことのできる構成であれば、いかなる構成であってもよ
い。
試料表面に対して垂直に入射した偏光の複素反射率につ
いて、偏光方向に応じて変化する部分を測定する、反射
率差分光法を用いて、原子層オーダでの膜形成の制御が
可能な、電界効果トランジスタの製造方法、並びに、半
導体デバイスの製造方法及びその装置が提供される。さ
らに、上記製造装置を、上記膜形成処理を行うチャンバ
以外の処理を行うチャンバとクラスタリングすることに
より、一連の成膜処理を非大気雰囲気下で行うことがで
き、生産効率の向上が可能となる。
た半導体デバイスの製造装置の構成を示すブロック図で
ある。
の構成を示す断面図である。
子を示す図である。
す図である。
単一波長光を用いてモニタした場合の反射率差の基本的
な強度変化を示す図である。
ンプでスキャンした場合の反射率差((a)Δr/r、
(b)Δθ)のスペクトルを示す図である。
Claims (10)
- 【請求項1】半導体基板と、該基板上に形成され、絶縁
膜単独或いは絶縁膜と誘電膜との2層構造を有するゲー
ト絶縁膜と、該ゲート絶縁膜上に形成されたゲート電極
とを備える電界効果トランジスタの製造方法において、 半導体基板を所定のガス雰囲気中で加熱することによ
り、ガスと半導体との反応を前記半導体基板の表面から
内側に進めることにより、半導体基板の表面から内面側
に向かって絶縁膜を成長させる成膜ステップと、 前記成膜ステップを実行しながら、前記半導体基板の表
面に測定光を照射し、前記半導体基板に照射された測定
光の、前記半導体基板と成長した前記絶縁膜との界面か
ら反射された反射光の直交する2方向の偏光成分の強度
を検出し、検出した強度の変化に基づいて、前記半導体
基板の表面から内側に進む反応により前記半導体基板の
表面領域に形成された前記絶縁膜の原子層単位での厚さ
を求める膜厚測定ステップと、 前記膜厚測定ステップで求められた膜厚に基づいて、前
記反応のエンドポイントを検出し、前記成膜ステップを
停止させる制御ステップと、 前記絶縁膜の上に、前記絶縁膜よりも誘電率の大きい誘
電膜を形成するステップと、 前記誘電膜の上にゲート電極を形成するステップと、 を備えることを特徴とする電界効果トランジスタの製造
方法。 - 【請求項2】前記半導体基板はシリコン基板であり、 所定のガス雰囲気は、酸素又は窒素或いは酸素(系及び
含酸素化合物)と窒素(含窒素化合物)を含む雰囲気で
あり、 前記成膜ステップは、熱酸化膜又は熱窒化膜或いは熱酸
窒化膜を形成するステップであり、 前記膜厚測定ステップは、絶縁膜が2乃至20原子層の
うちの所定の層だけ形成されたことを検出する、 ことを特徴とする請求項1に記載の電界効果トランジス
タの製造方法。 - 【請求項3】被処理体の内側に向かって反応を進めるこ
とにより、被処理体の表面領域に膜を形成する成膜ステ
ップと、 前記被処理体の表面に測定光を照射する照射ステップ
と、 前記被処理体に照射された測定光の反射光の、直交する
2方向の偏光成分の強度を検出する検出ステップと、 前記検出ステップで検出した反射光の直交する2方向の
偏光成分の強度変化に基づいて前記膜の厚さを求める膜
厚測定ステップと、 前記膜厚測定ステップで求められた膜厚に基づいて、前
記成膜ステップを制御する制御ステップと、 を備えることを特徴とする半導体デバイスの製造方法。 - 【請求項4】前記成膜ステップは、所定雰囲気下で被処
理体を加熱することにより、雰囲気中の化学物質と被処
理体との反応を進めることにより、被処理体の表面領域
に薄膜を形成するステップであり、 前記膜厚測定ステップは、前記被処理体のシリコン領域
に照射された測定光の2方向の偏光成分の強度から、直
交する2方向の偏光成分の反射率の差を、該2方向の偏
光成分の反射率の相加平均で除した値に対応する値を求
める演算ステップを含み、 前記制御ステップは、前記演算ステップで求められた値
の変化に基づいて、前記膜の厚さを求めるステップを含
むことを特徴とする請求項3に記載の半導体デバイスの
製造方法。 - 【請求項5】前記制御ステップは、前記演算ステップで
求められた値の変化に基づいて、前記膜の深さ方向への
原子層単位での反応の進行の度合いを求めるステップを
含む、ことを特徴とする請求項3又は4に記載の半導体
デバイスの製造方法。 - 【請求項6】前記制御ステップは、求めた膜厚に基づい
て、前記成膜ステップによる成膜処理を停止するステッ
プを含む、ことを特徴とする請求項3、4又は5に記載
の半導体デバイスの製造方法。 - 【請求項7】前記成膜ステップは、所定のガス中で被処
理体を加熱することにより、該ガスと被処理体との反応
膜を表面領域に形成する工程を含む、ことを特徴とする
請求項3乃至6のいずれか1項に記載の半導体デバイス
の製造方法。 - 【請求項8】前記被処理体はシリコンであり、 前記所定の雰囲気は、酸素又は窒素或いは酸素(系及び
含酸素化合物)と窒素(含窒素化合物)を含む雰囲気で
あり、 前記成膜ステップは、熱酸化膜又は熱窒化膜或いは熱酸
窒化膜を形成する工程であり、 前記膜厚測定ステップは、絶縁膜が2乃至20原子層の
うちの所定の層だけ形成されたことを検出する、 ことを特徴とする請求項3乃至7のいずれか1項に記載
の半導体デバイスの製造方法。 - 【請求項9】被処理体を所定のガスを含む雰囲気中で熱
処理する処理チャンバと、 前記処理チャンバ内の前記被処理体に測定光を照射し、
前記被処理体で反射された反射光の直行する2方向の偏
光成分の強度を測定し、測定信号を出力する光学手段
と、 前記処理チャンバと前記光学手段に接続され、前記処理
チャンバに、前記所定のガスを含む雰囲気中で熱処理を
開始させ、熱処理中に、前記光学手段からの測定信号に
基づいて、形成された膜の厚さを測定し、膜厚が所定値
に達したことを検出すると、前記熱処理を終了させる制
御手段と、 を備えることを特徴とする半導体デバイスの製造装置。 - 【請求項10】前記処理チャンバと他の処理チャンバと
を収容し、これらの前記複数の処理チャンバを含む空間
を大気から遮断した雰囲気に維持するように取り囲む共
通容器と、 前記共通容器内で被処理体を搬送するための搬送手段
と、をさらに備え、クラスタリングされていることを特
徴とする請求項9に記載の半導体デバイスの製造装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000310968A JP3893868B2 (ja) | 2000-10-11 | 2000-10-11 | 電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置 |
US09/974,195 US6747748B2 (en) | 2000-10-11 | 2001-10-10 | Manufacturing method for a field-effect transistor, manufacturing method for a semiconductor device, and apparatus therefor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000310968A JP3893868B2 (ja) | 2000-10-11 | 2000-10-11 | 電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2002118160A true JP2002118160A (ja) | 2002-04-19 |
JP3893868B2 JP3893868B2 (ja) | 2007-03-14 |
Family
ID=18790822
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000310968A Expired - Lifetime JP3893868B2 (ja) | 2000-10-11 | 2000-10-11 | 電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US6747748B2 (ja) |
JP (1) | JP3893868B2 (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006237371A (ja) * | 2005-02-25 | 2006-09-07 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
US7220681B2 (en) | 2004-11-01 | 2007-05-22 | Kabushiki Kaisha Toshiba | Semiconductor device and method of fabricating the same |
JP2009180640A (ja) * | 2008-01-31 | 2009-08-13 | Oki Semiconductor Co Ltd | 膜厚測定方法 |
JP2010093276A (ja) * | 2009-11-26 | 2010-04-22 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
JP2010114450A (ja) * | 2009-11-26 | 2010-05-20 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3793430B2 (ja) * | 2001-07-18 | 2006-07-05 | 株式会社日立製作所 | 近接場光を用いた光学装置 |
JP2004158487A (ja) * | 2002-11-01 | 2004-06-03 | Matsushita Electric Ind Co Ltd | 半導体装置の製造方法 |
EP1619465A1 (en) * | 2004-07-19 | 2006-01-25 | Nederlandse Organisatie Voor Toegepast-Natuurwetenschappelijk Onderzoek Tno | Optical monitoring apparatus and method of monitoring optical coatings |
JP4400406B2 (ja) * | 2004-10-08 | 2010-01-20 | エルピーダメモリ株式会社 | 半導体装置の製造方法 |
US10651017B2 (en) * | 2016-06-30 | 2020-05-12 | Tokyo Electron Limited | Method for operation instability detection in a surface wave plasma source |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4931132A (en) | 1988-10-07 | 1990-06-05 | Bell Communications Research, Inc. | Optical control of deposition of crystal monolayers |
NL8802920A (nl) * | 1988-11-28 | 1990-06-18 | Hoogovens Groep Bv | Laagdiktemeter. |
US5091320A (en) * | 1990-06-15 | 1992-02-25 | Bell Communications Research, Inc. | Ellipsometric control of material growth |
JPH0834198B2 (ja) * | 1990-11-28 | 1996-03-29 | 信越半導体株式会社 | Soi基板における単結晶薄膜層の膜厚制御方法 |
US5665214A (en) * | 1995-05-03 | 1997-09-09 | Sony Corporation | Automatic film deposition control method and system |
US5835221A (en) * | 1995-10-16 | 1998-11-10 | Lucent Technologies Inc. | Process for fabricating a device using polarized light to determine film thickness |
US6449038B1 (en) * | 1999-12-13 | 2002-09-10 | Applied Materials, Inc. | Detecting a process endpoint from a change in reflectivity |
-
2000
- 2000-10-11 JP JP2000310968A patent/JP3893868B2/ja not_active Expired - Lifetime
-
2001
- 2001-10-10 US US09/974,195 patent/US6747748B2/en not_active Expired - Fee Related
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7220681B2 (en) | 2004-11-01 | 2007-05-22 | Kabushiki Kaisha Toshiba | Semiconductor device and method of fabricating the same |
JP2006237371A (ja) * | 2005-02-25 | 2006-09-07 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
US7655549B2 (en) | 2005-02-25 | 2010-02-02 | Canon Anelva Corporation | Method for depositing a metal gate on a high-k dielectric film |
JP2009180640A (ja) * | 2008-01-31 | 2009-08-13 | Oki Semiconductor Co Ltd | 膜厚測定方法 |
JP2010093276A (ja) * | 2009-11-26 | 2010-04-22 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
JP2010114450A (ja) * | 2009-11-26 | 2010-05-20 | Canon Anelva Corp | high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム |
JP4523994B2 (ja) * | 2009-11-26 | 2010-08-11 | キヤノンアネルバ株式会社 | 電界効果トランジスタの製造方法 |
JP4523995B2 (ja) * | 2009-11-26 | 2010-08-11 | キヤノンアネルバ株式会社 | 電界効果トランジスタの製造方法 |
Also Published As
Publication number | Publication date |
---|---|
US6747748B2 (en) | 2004-06-08 |
JP3893868B2 (ja) | 2007-03-14 |
US20020115304A1 (en) | 2002-08-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US6695947B2 (en) | Device for manufacturing semiconductor device and method of manufacturing the same | |
US6642066B1 (en) | Integrated process for depositing layer of high-K dielectric with in-situ control of K value and thickness of high-K dielectric layer | |
US7893703B2 (en) | Systems and methods for controlling deposition of a charge on a wafer for measurement of one or more electrical properties of the wafer | |
US7201174B2 (en) | Processing apparatus and cleaning method | |
Queeney et al. | Infrared spectroscopic analysis of an ordered Si/SiO 2 interface | |
JP3329685B2 (ja) | 計測装置および計測方法 | |
US7102132B2 (en) | Process monitoring using infrared optical diagnostics | |
JPH0816607B2 (ja) | 薄膜処理制御方法 | |
US6849470B1 (en) | Apparatus and method for optical evaluation, apparatus and method for manufacturing semiconductor device, method of controlling apparatus for manufacturing semiconductor device, and semiconductor device | |
JP3893868B2 (ja) | 電界効果トランジスタの製造方法、並びに、半導体デバイスの製造方法及びその装置 | |
US6646752B2 (en) | Method and apparatus for measuring thickness of a thin oxide layer | |
JP3773355B2 (ja) | 半導体装置の製造装置 | |
US20040260420A1 (en) | Processing method and processing system | |
US20040235203A1 (en) | Monitoring of nitrided oxide gate dielectrics by determination of a wet etch | |
US20050019964A1 (en) | Method and system for determining a component concentration of an integrated circuit feature | |
JP4018829B2 (ja) | 半導体装置の製造方法 | |
JPS6250610A (ja) | プラズマモニタ方法 | |
JPH09246341A (ja) | 半導体ウェーハの損傷評価用試料およびこの試料を用いた損傷評価方法 | |
JP3317247B2 (ja) | 結晶成長装置および半導体素子の製造方法 | |
JP3816440B2 (ja) | シリコン酸化膜の評価方法及び半導体装置の製造方法 | |
Lambers et al. | In situ detection of F2 laser-induced oxidation on hydrogen-terminated Si (111) and Si (110) surfaces by Fourier transform infrared transmission spectroscopy | |
WO2024070785A1 (ja) | 基板評価方法及び基板処理装置 | |
JP2009021624A (ja) | 処理装置及び処理装置のクリーニング方法 | |
JP3653622B2 (ja) | GaAs−AlGaAs超格子構造層を含む化合物半導体エピタキシャルウェハの評価方法 | |
JP2001237288A (ja) | 半導体基板表面の評価方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050117 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20060523 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20060530 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20060721 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20060829 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20061030 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20061121 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20061204 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091222 Year of fee payment: 3 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091222 Year of fee payment: 3 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313117 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |