JP2002117396A - 画像処理装置 - Google Patents
画像処理装置Info
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- JP2002117396A JP2002117396A JP2000306371A JP2000306371A JP2002117396A JP 2002117396 A JP2002117396 A JP 2002117396A JP 2000306371 A JP2000306371 A JP 2000306371A JP 2000306371 A JP2000306371 A JP 2000306371A JP 2002117396 A JP2002117396 A JP 2002117396A
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- image signal
- signal
- digital
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Abstract
(57)【要約】
【課題】 本発明は演算処理能力を向上させ、より複雑
な処理を可能とする画像処理装置を提供することを目的
とする。 【解決手段】 本発明に係る画像処理装置は、読み取っ
た画像信号をデジタル変換されたデジタル画像信号に変
換し、もしくはデジタル的に生成された画像情報を画像
信号に変換し、デジタル変換された画像信号を顕像とし
て出力可能な画像信号になるように処理し、前記デジタ
ル画像信号に対し画像処理を行う複数の演算処理手段
（１１〜１４）と、デジタル画像信号とバスとのインタ
フェース及びデジタル信号のメモリ（１６）へのアクセ
スを一括管理する一括管理手段（１５）とを具備する。
な処理を可能とする画像処理装置を提供することを目的
とする。 【解決手段】 本発明に係る画像処理装置は、読み取っ
た画像信号をデジタル変換されたデジタル画像信号に変
換し、もしくはデジタル的に生成された画像情報を画像
信号に変換し、デジタル変換された画像信号を顕像とし
て出力可能な画像信号になるように処理し、前記デジタ
ル画像信号に対し画像処理を行う複数の演算処理手段
（１１〜１４）と、デジタル画像信号とバスとのインタ
フェース及びデジタル信号のメモリ（１６）へのアクセ
スを一括管理する一括管理手段（１５）とを具備する。
Description
【０００１】
【発明の属する技術分野】本発明は画像処理装置に関
し、詳細にはデジタル画像処理装置に係り、スキャナか
ら画像を読み込んで転写紙に画像を再生する装置に適用
されるデジタル信号に対して画像処理を行う画像処理装
置に関する。
し、詳細にはデジタル画像処理装置に係り、スキャナか
ら画像を読み込んで転写紙に画像を再生する装置に適用
されるデジタル信号に対して画像処理を行う画像処理装
置に関する。
【０００２】
【従来の技術】コピー、ファクシミリ、プリンタ、スキ
ャナ等の複合機において、読み取り信号の画像処理、メ
モリへの画像蓄積、複数機能の並行動作及びそれぞれの
画像処理を最適化する技術が特開平８−２７４９８６号
公報（以下従来例と称す）に提案されており、各種の画
像処理を１つの画像処理構成で実行できるようになって
いる。
ャナ等の複合機において、読み取り信号の画像処理、メ
モリへの画像蓄積、複数機能の並行動作及びそれぞれの
画像処理を最適化する技術が特開平８−２７４９８６号
公報（以下従来例と称す）に提案されており、各種の画
像処理を１つの画像処理構成で実行できるようになって
いる。
【０００３】
【発明が解決しようとする課題】しかしながら、上記従
来例によれば、画像パスを変更するためにはシステム構
成も変更しなければならないため、システムの有効活用
という点で最適な制御構成が構築されていない。
来例によれば、画像パスを変更するためにはシステム構
成も変更しなければならないため、システムの有効活用
という点で最適な制御構成が構築されていない。
【０００４】本発明はこの問題点を解決するためのもの
であり、演算処理能力を向上させ、より複雑な処理を可
能とする画像処理装置を提供することを目的とする。
であり、演算処理能力を向上させ、より複雑な処理を可
能とする画像処理装置を提供することを目的とする。
【０００５】
【課題を解決するための手段】前記問題点を解決するた
めに、本発明に係る画像処理装置は、読み取った画像信
号をデジタル変換されたデジタル画像信号に変換し、も
しくはデジタル的に生成された画像情報を画像信号に変
換し、デジタル変換された画像信号を顕像として出力可
能な画像信号になるように処理し、前記デジタル画像信
号に対し画像処理を行う複数の演算処理手段と、デジタ
ル画像信号とバスとのインタフェース及びデジタル信号
のメモリへのアクセスを一括管理する一括管理手段とを
具備する。よって、演算処理能力を向上させ、より複雑
な処理を可能とする。
めに、本発明に係る画像処理装置は、読み取った画像信
号をデジタル変換されたデジタル画像信号に変換し、も
しくはデジタル的に生成された画像情報を画像信号に変
換し、デジタル変換された画像信号を顕像として出力可
能な画像信号になるように処理し、前記デジタル画像信
号に対し画像処理を行う複数の演算処理手段と、デジタ
ル画像信号とバスとのインタフェース及びデジタル信号
のメモリへのアクセスを一括管理する一括管理手段とを
具備する。よって、演算処理能力を向上させ、より複雑
な処理を可能とする。
【０００６】また、各演算処理手段は少なくとも１つの
前記演算処理手段と送信／受信パスにより接続すること
により、演算処理手段間でデータを双方向に送受信可能
となるため、処理回数や処理の負荷に応じた演算処理手
段への処理の振り分けを可能とする。
前記演算処理手段と送信／受信パスにより接続すること
により、演算処理手段間でデータを双方向に送受信可能
となるため、処理回数や処理の負荷に応じた演算処理手
段への処理の振り分けを可能とする。
【０００７】更に、一括管理手段と演算処理手段が少な
くとも２つの送信／受信パスにより接続することによ
り、２つ以上の入力/出力を同時に処理可能とする。
くとも２つの送信／受信パスにより接続することによ
り、２つ以上の入力/出力を同時に処理可能とする。
【０００８】
【発明の実施の形態】本発明に係る画像処理装置は、読
み取った画像信号をデジタル変換されたデジタル画像信
号に変換し、もしくはデジタル的に生成された画像情報
を画像信号に変換し、デジタル変換された画像信号を顕
像として出力可能な画像信号になるように処理し、前記
デジタル画像信号に対し画像処理を行う複数のプログラ
マブルな演算処理手段と、デジタル画像信号とバスとの
インタフェース及びデジタル信号のメモリへのアクセス
を一括管理する一括管理手段とを具備する。
み取った画像信号をデジタル変換されたデジタル画像信
号に変換し、もしくはデジタル的に生成された画像情報
を画像信号に変換し、デジタル変換された画像信号を顕
像として出力可能な画像信号になるように処理し、前記
デジタル画像信号に対し画像処理を行う複数のプログラ
マブルな演算処理手段と、デジタル画像信号とバスとの
インタフェース及びデジタル信号のメモリへのアクセス
を一括管理する一括管理手段とを具備する。
【０００９】
【実施例】図１は本発明の一実施例に係る画像処理装置
の構成を示すブロック図である。同図に示す画像処理装
置は、スキャナ等で読み取ってデジタル変換された画像
信号に対して演算処理を行う複数の演算処理手段（以下
ＩＰＰと略す）と、デジタル信号とバスとのインタフェ
ース及びデジタル信号のメモリへのアクセスを一括に管
理する一括管理手段（以下ＣＤＩＣと略す）との接続構
成の第１の例である。本実施例では、ＩＰＰ１１〜ＩＰ
Ｐ１４の４つのＩＰＰがＣＤＩＣ１５を経由して、各々
が画像データを送受信し、処理が可能である。なお、処
理が不要な場合には、データを転送しないようにするこ
とも可能であり、またデータ転送されても処理をスルー
させることも可能である。
の構成を示すブロック図である。同図に示す画像処理装
置は、スキャナ等で読み取ってデジタル変換された画像
信号に対して演算処理を行う複数の演算処理手段（以下
ＩＰＰと略す）と、デジタル信号とバスとのインタフェ
ース及びデジタル信号のメモリへのアクセスを一括に管
理する一括管理手段（以下ＣＤＩＣと略す）との接続構
成の第１の例である。本実施例では、ＩＰＰ１１〜ＩＰ
Ｐ１４の４つのＩＰＰがＣＤＩＣ１５を経由して、各々
が画像データを送受信し、処理が可能である。なお、処
理が不要な場合には、データを転送しないようにするこ
とも可能であり、またデータ転送されても処理をスルー
させることも可能である。
【００１０】図２は本実施例におけるＩＰＰの内部構成
の概略を示すブロック図である。ＩＰＰ１１〜１４は、
外部とのデータ入出力に関して複数個の入出力ポート２
１を持ち、それぞれ入力又は出力を任意に設定できる。
また、内部にローカルメモリ群２２を持ち、使用するメ
モリ領域、データパスの経路をメモリ制御部２３におい
て制御する。入力されたデータや出力のためのデータは
ローカルメモリ群２２をバッファメモリとして割り当て
それぞれに格納し、外部とのＩ／Ｆを制御される。ロー
カルメモリ群２２に格納された画像データをプロセッサ
アレイ部２４において各種処理を行い、出力結果は再度
ローカルメモリ群２２に格納する。プロセッサの処理順
序、処理のためのパラメータ等はプログラムＲＡＭ２５
及びデータＲＡＭ２６との間でやり取りを行う。プログ
ラムＲＡＭ２５、データＲＡＭ２６の内容はシリアルＩ
／Ｆ２８を通じ、プロセスコントローラからダウンロー
ドされる。あるいはプロセスコントローラがデータＲＡ
Ｍ２６の内容を読み出し、処理の経過を監視する。処理
の内容を変えたり、システムで要求される処理形態が変
更になる場合、プロセッサアレイ部２４が参照するプロ
グラムＲＡＭ２５及びデータＲＡＭ２６の内容を更新し
て対応する。このＩＰＰの設定により定められた長さの
画像データを画像ポートから入力し、プログラムの制御
に基づいて所望の画像処理を行い、処理後のデータを画
像ポートから出力するような動作が可能である。
の概略を示すブロック図である。ＩＰＰ１１〜１４は、
外部とのデータ入出力に関して複数個の入出力ポート２
１を持ち、それぞれ入力又は出力を任意に設定できる。
また、内部にローカルメモリ群２２を持ち、使用するメ
モリ領域、データパスの経路をメモリ制御部２３におい
て制御する。入力されたデータや出力のためのデータは
ローカルメモリ群２２をバッファメモリとして割り当て
それぞれに格納し、外部とのＩ／Ｆを制御される。ロー
カルメモリ群２２に格納された画像データをプロセッサ
アレイ部２４において各種処理を行い、出力結果は再度
ローカルメモリ群２２に格納する。プロセッサの処理順
序、処理のためのパラメータ等はプログラムＲＡＭ２５
及びデータＲＡＭ２６との間でやり取りを行う。プログ
ラムＲＡＭ２５、データＲＡＭ２６の内容はシリアルＩ
／Ｆ２８を通じ、プロセスコントローラからダウンロー
ドされる。あるいはプロセスコントローラがデータＲＡ
Ｍ２６の内容を読み出し、処理の経過を監視する。処理
の内容を変えたり、システムで要求される処理形態が変
更になる場合、プロセッサアレイ部２４が参照するプロ
グラムＲＡＭ２５及びデータＲＡＭ２６の内容を更新し
て対応する。このＩＰＰの設定により定められた長さの
画像データを画像ポートから入力し、プログラムの制御
に基づいて所望の画像処理を行い、処理後のデータを画
像ポートから出力するような動作が可能である。
【００１１】図３は本実施例におけるＣＤＩＣの内部構
成の概略を示すブロック図である。画像データ入力制御
部３３は、ＩＰＰで所望の処理を施され、画像データ入
力部３１を介して入力されたデータを図示していないメ
モリに蓄積するように制御する。また、画像データ入出
力制御部３３では、上位装置からのコマンドに基づいて
コマンド制御部３５の指示に従って、シリアルデータＩ
／Ｆ３６，３７やパラレルデータＩ／Ｆ３８を介してス
キャナから入力された画像データをデータ変換部３４に
よって所望のデータに変換され、ＩＰＰに対して画像デ
ータ出力部３２を介して変換したデータを出力するよう
に制御する。あるいはメモリに蓄積された画像データを
再びＩＰＰへ転送し、ＩＰＰで所望の処理を施されたデ
ータを入力し、後段へ出力する。
成の概略を示すブロック図である。画像データ入力制御
部３３は、ＩＰＰで所望の処理を施され、画像データ入
力部３１を介して入力されたデータを図示していないメ
モリに蓄積するように制御する。また、画像データ入出
力制御部３３では、上位装置からのコマンドに基づいて
コマンド制御部３５の指示に従って、シリアルデータＩ
／Ｆ３６，３７やパラレルデータＩ／Ｆ３８を介してス
キャナから入力された画像データをデータ変換部３４に
よって所望のデータに変換され、ＩＰＰに対して画像デ
ータ出力部３２を介して変換したデータを出力するよう
に制御する。あるいはメモリに蓄積された画像データを
再びＩＰＰへ転送し、ＩＰＰで所望の処理を施されたデ
ータを入力し、後段へ出力する。
【００１２】図４は本実施例における複数のＩＰＰとＣ
ＤＩＣとの接続構成の第２の例であり、各ＩＰＰは１つ
以上のＩＰＰと接続パスが存在する。同図に示すこの例
では、ＩＰＰ１１のみがＣＤＩＣ１５とのデータ転送が
可能であり、ＩＰＰ１１〜ＩＰＰ１４がリング状に接続
されているため、ＩＰＰ１１〜ＩＰＰ１４への処理の振
り分けが可能となる。
ＤＩＣとの接続構成の第２の例であり、各ＩＰＰは１つ
以上のＩＰＰと接続パスが存在する。同図に示すこの例
では、ＩＰＰ１１のみがＣＤＩＣ１５とのデータ転送が
可能であり、ＩＰＰ１１〜ＩＰＰ１４がリング状に接続
されているため、ＩＰＰ１１〜ＩＰＰ１４への処理の振
り分けが可能となる。
【００１３】図５は本実施例における複数のＩＰＰとＣ
ＤＩＣとの接続構成の第３の例であり、ＩＰＰ１１とＩ
ＰＰ１２にはＣＤＩＣ１５との間に接続パスが存在し、
つまりＩＰＰとＣＤＩＣとの間に２つの接続パスが存在
する例である。この場合、ＩＰＰ１１，１２とＣＤＩＣ
１５の間に存在する２つの各接続パスは独立に動作可能
であり、かつ各ＩＰＰには１つ以上のＩＰＰとの接続パ
スが存在するため、ＣＤＩＣ１５とＩＰＰ１１，１２の
間の２つの接続パスに対し、ＩＰＰを割り当て処理の振
り分けを行った並行動作が可能となる。このような接続
構成を有する場合、図６に示すように、スキャナより入
力された入力画像はＣＤＩＣ１５を経由してＩＰＰ１１
→ＩＰＰ１３→ＩＰＰ１４→ＩＰＰ１２と順番に各ＩＰ
Ｐを用い、スキャナ画像処理や階調処理といった一通り
の画像処理を実行した後、再びＣＤＩＣ１５を経由して
画像は出力される。ここで階調処理とは、濃度変換、デ
ィザ処理、誤差拡散処理等の処理であり、階調情報の面
積近似を主な処理とする。
ＤＩＣとの接続構成の第３の例であり、ＩＰＰ１１とＩ
ＰＰ１２にはＣＤＩＣ１５との間に接続パスが存在し、
つまりＩＰＰとＣＤＩＣとの間に２つの接続パスが存在
する例である。この場合、ＩＰＰ１１，１２とＣＤＩＣ
１５の間に存在する２つの各接続パスは独立に動作可能
であり、かつ各ＩＰＰには１つ以上のＩＰＰとの接続パ
スが存在するため、ＣＤＩＣ１５とＩＰＰ１１，１２の
間の２つの接続パスに対し、ＩＰＰを割り当て処理の振
り分けを行った並行動作が可能となる。このような接続
構成を有する場合、図６に示すように、スキャナより入
力された入力画像はＣＤＩＣ１５を経由してＩＰＰ１１
→ＩＰＰ１３→ＩＰＰ１４→ＩＰＰ１２と順番に各ＩＰ
Ｐを用い、スキャナ画像処理や階調処理といった一通り
の画像処理を実行した後、再びＣＤＩＣ１５を経由して
画像は出力される。ここで階調処理とは、濃度変換、デ
ィザ処理、誤差拡散処理等の処理であり、階調情報の面
積近似を主な処理とする。
【００１４】図７は本実施例における複数のＩＰＰとＣ
ＤＩＣとの接続構成の第４の例である。同図に示すＣＤ
ＩＣ１５は、外部とのインターフェースとして１入力/
１出力のポートを有している。入力ポートではスキャナ
より入力される画像データを、出力ポートではＩＰＰで
処理された画像データをそれぞれ転送する。本例では、
各ＩＰＰ１１〜１４がＣＤＩＣ１５と入出力可能なイン
ターフェースを有している。このような接続構成を有す
る場合、スキャナより入力された入力画像は、図８中実
線で示すように、ＣＤＩＣを経由してＩＰＰ１１→ＩＰ
Ｐ１３によりスキャナ画像処理が行われた後、再びＣＤ
ＩＣ１５にデータは転送されてメモリ１６での蓄積が行
われる。メモリ１６に蓄積、読み出された画像は、図８
中破線で示すように、ＣＤＩＣ１５を経由して再びＩＰ
Ｐ１４→ＩＰＰ１２に転送され、一般的な階調処理が行
われた後、画像は出力される。このように、一旦スキャ
ナ画像処理された画像データをメモリに蓄積しておけ
ば、画像処理を変更することによって様々な再生画像を
確認することが可能となる。例えば、再生画像の濃度を
振ってみたり、ディザマトリクスの線数を変更してみた
りすることで、再生画像の雰囲気を変更できる。このと
き処理を変更するたびに画像を読み取りユニットから読
み込み直す必要はなく、メモリから格納画像を読み出せ
ば同一データに対し、何度でも異なる処理を実施でき
る。更に、デジタルコピーの処理はスキャナとプリンタ
に連動したリアルタイム処理であるために、所定の時間
内に全ての処理が終了することが必須である。そこで、
複数のＩＰＰを相互に接続することにより同一の構成で
異なる画像パスを構成でき、一方はＩＰＰ１１,ＩＰＰ
１３の２つのＩＰＰを用いてスキャナ画像処理を施し、
メモリに蓄積する。もう一方はＩＰＰ１２,ＩＰＰ１４
の２つのＩＰＰを用いてメモリよりデータを読み出し、
階調処理を施すというように処理を分割し、２つの処理
を同時に行うことが可能となるため、途中で処理を中断
させることなく所定の時間内で全ての処理が実行可能と
なる。
ＤＩＣとの接続構成の第４の例である。同図に示すＣＤ
ＩＣ１５は、外部とのインターフェースとして１入力/
１出力のポートを有している。入力ポートではスキャナ
より入力される画像データを、出力ポートではＩＰＰで
処理された画像データをそれぞれ転送する。本例では、
各ＩＰＰ１１〜１４がＣＤＩＣ１５と入出力可能なイン
ターフェースを有している。このような接続構成を有す
る場合、スキャナより入力された入力画像は、図８中実
線で示すように、ＣＤＩＣを経由してＩＰＰ１１→ＩＰ
Ｐ１３によりスキャナ画像処理が行われた後、再びＣＤ
ＩＣ１５にデータは転送されてメモリ１６での蓄積が行
われる。メモリ１６に蓄積、読み出された画像は、図８
中破線で示すように、ＣＤＩＣ１５を経由して再びＩＰ
Ｐ１４→ＩＰＰ１２に転送され、一般的な階調処理が行
われた後、画像は出力される。このように、一旦スキャ
ナ画像処理された画像データをメモリに蓄積しておけ
ば、画像処理を変更することによって様々な再生画像を
確認することが可能となる。例えば、再生画像の濃度を
振ってみたり、ディザマトリクスの線数を変更してみた
りすることで、再生画像の雰囲気を変更できる。このと
き処理を変更するたびに画像を読み取りユニットから読
み込み直す必要はなく、メモリから格納画像を読み出せ
ば同一データに対し、何度でも異なる処理を実施でき
る。更に、デジタルコピーの処理はスキャナとプリンタ
に連動したリアルタイム処理であるために、所定の時間
内に全ての処理が終了することが必須である。そこで、
複数のＩＰＰを相互に接続することにより同一の構成で
異なる画像パスを構成でき、一方はＩＰＰ１１,ＩＰＰ
１３の２つのＩＰＰを用いてスキャナ画像処理を施し、
メモリに蓄積する。もう一方はＩＰＰ１２,ＩＰＰ１４
の２つのＩＰＰを用いてメモリよりデータを読み出し、
階調処理を施すというように処理を分割し、２つの処理
を同時に行うことが可能となるため、途中で処理を中断
させることなく所定の時間内で全ての処理が実行可能と
なる。
【００１５】なお、本発明は上記実施例に限定されるも
のではなく、特許請求の範囲内の記載であれば多種の変
形や置換可能であることは言うまでもない。
のではなく、特許請求の範囲内の記載であれば多種の変
形や置換可能であることは言うまでもない。
【００１６】
【発明の効果】以上説明したように、本発明に係る画像
処理装置は、読み取った画像信号をデジタル変換された
デジタル画像信号に変換し、もしくはデジタル的に生成
された画像情報を画像信号に変換し、デジタル変換され
た画像信号を顕像として出力可能な画像信号になるよう
に処理し、前記デジタル画像信号に対し画像処理を行う
複数のプログラマブルな演算処理手段と、デジタル画像
信号とバスとのインタフェース及びデジタル信号のメモ
リへのアクセスを一括管理する一括管理手段とを具備す
る。よって、演算処理能力を向上させ、より複雑な処理
を可能とする。
処理装置は、読み取った画像信号をデジタル変換された
デジタル画像信号に変換し、もしくはデジタル的に生成
された画像情報を画像信号に変換し、デジタル変換され
た画像信号を顕像として出力可能な画像信号になるよう
に処理し、前記デジタル画像信号に対し画像処理を行う
複数のプログラマブルな演算処理手段と、デジタル画像
信号とバスとのインタフェース及びデジタル信号のメモ
リへのアクセスを一括管理する一括管理手段とを具備す
る。よって、演算処理能力を向上させ、より複雑な処理
を可能とする。
【００１７】また、各演算処理手段は少なくとも１つの
前記演算処理手段と送信／受信パスにより接続すること
により、演算処理手段間でデータを双方向に送受信可能
となるため、処理回数や処理の負荷に応じた演算処理手
段への処理の振り分けを可能とする。
前記演算処理手段と送信／受信パスにより接続すること
により、演算処理手段間でデータを双方向に送受信可能
となるため、処理回数や処理の負荷に応じた演算処理手
段への処理の振り分けを可能とする。
【００１８】更に、一括管理手段と演算処理手段が少な
くとも２つの送信／受信パスにより接続することによ
り、２つ以上の入力/出力を同時に処理可能とする。
くとも２つの送信／受信パスにより接続することによ
り、２つ以上の入力/出力を同時に処理可能とする。
【図１】本発明の一実施例に係る画像処理装置の構成を
示すブロック図である。
示すブロック図である。
【図２】本実施例におけるＩＰＰの内部構成の概略を示
すブロック図である。
すブロック図である。
【図３】本実施例におけるＣＤＩＣの内部構成の概略を
示すブロック図である。
示すブロック図である。
【図４】本実施例における複数のＩＰＰとＣＤＩＣとの
接続構成の第２の例である。
接続構成の第２の例である。
【図５】本実施例における複数のＩＰＰとＣＤＩＣとの
接続構成の第３の例である。
接続構成の第３の例である。
【図６】図６の複数のＩＰＰとＣＤＩＣとの接続構成の
第３の例における信号の流れの様子を示す図である。
第３の例における信号の流れの様子を示す図である。
【図７】本実施例における複数のＩＰＰとＣＤＩＣとの
接続構成の第４の例である。
接続構成の第４の例である。
【図８】図７の複数のＩＰＰとＣＤＩＣとの接続構成の
第４の例における信号の流れの様子を示す図である。
第４の例における信号の流れの様子を示す図である。
１１〜１４；ＩＰＰ、１５；ＣＤＩＣ、１６；メモリ。
Claims (3)
- 【請求項１】 読み取った画像信号をデジタル変換され
たデジタル画像信号に変換し、もしくはデジタル的に生
成された画像情報を画像信号に変換し、デジタル変換さ
れた画像信号を顕像として出力可能な画像信号になるよ
うに処理し、前記デジタル画像信号に対し画像処理を行
う複数の演算処理手段と、 デジタル画像信号とバスとのインタフェース及びデジタ
ル信号のメモリへのアクセスを一括管理する一括管理手
段とを具備することを特徴とする画像処理装置。 - 【請求項２】 前記各演算処理手段は、少なくとも１つ
の前記演算処理手段と送信／受信パスにより接続する請
求項１記載の画像処理装置。 - 【請求項３】 前記一括管理手段と前記演算処理手段が
少なくとも２つの送信／受信パスにより接続する請求項
１又は２に記載の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000306371A JP2002117396A (ja) | 2000-10-05 | 2000-10-05 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000306371A JP2002117396A (ja) | 2000-10-05 | 2000-10-05 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002117396A true JP2002117396A (ja) | 2002-04-19 |
Family
ID=18787074
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000306371A Pending JP2002117396A (ja) | 2000-10-05 | 2000-10-05 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2002117396A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN102981592A (zh) * | 2011-06-09 | 2013-03-20 | 索尼公司 | 信息处理装置与信息处理方法 |
-
2000
- 2000-10-05 JP JP2000306371A patent/JP2002117396A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN102981592A (zh) * | 2011-06-09 | 2013-03-20 | 索尼公司 | 信息处理装置与信息处理方法 |
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Legal Events
| Date | Code | Title | Description |
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| A02 | Decision of refusal |
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