JP2002091626A - 車両用電子制御ユニットの電源装置 - Google Patents
車両用電子制御ユニットの電源装置Info
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- JP2002091626A JP2002091626A JP2000281693A JP2000281693A JP2002091626A JP 2002091626 A JP2002091626 A JP 2002091626A JP 2000281693 A JP2000281693 A JP 2000281693A JP 2000281693 A JP2000281693 A JP 2000281693A JP 2002091626 A JP2002091626 A JP 2002091626A
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Abstract
のCPUを備えた車両用電子制御ユニットにおいて、車
両用電子制御ユニットに供給される電圧が低下したと
き、車両用電子制御ユニットの信頼性を保障しつつ、再
起動されなかったCPUが再起動されたCPUの動作を
誤動作であると誤って検知することがないようにする。 【解決手段】 メインCPUおよびサブCPUをリセッ
トするための閾値(Thm,Ths)に関わらず、車両
用電子制御ユニットに供給される動作電圧Vccが、そ
れらの閾値よりも高く設定された閾値Thuより低下し
たとき、メインCPUおよびサブCPUを同時にリセッ
トする。
Description
ブCPUからなる2つのCPUを備えた車両用電子制御
ユニットの電源装置に関し、より詳しくは車両用電子制
御ユニットに供給される電圧が低下した時、2つのCP
Uを同時に再起動することができる車両用電子制御ユニ
ットの電源装置に関する。
Uからなる2つのCPUを備えた車両用電子制御ユニッ
トの電源装置について、図3および図4を参照して説明
する。
ニットの電源装置の構成を説明するための説明ブロック
図である。
電源装置は、メインCPU100およびサブCPU10
2を備え、相互に通信可能に接続され、その動作を互い
に監視している。尚、各CPU100,102には、バ
ッテリ電圧Vb(例えば12〔V〕程度)の電源(図示
しない車両搭載バッテリ)から動作電圧Vcc(例えば
5〔V〕程度)が供給される。
するためのメインCPUリセットスイッチ(図に「MR
ES/SW」と示す)100aを備える。
るためのサブCPUリセットスイッチ(図に「SRES
/SW」と示す)102aを備える。
2は、相互に通信することにより、互いの異常状態(以
下「誤動作」と言う)を監視することができ、いずれか
のCPUあるいは両方のCPUの異常が検知されたと
き、ワーニング・ランプ(図示せず)を点灯させ、制御
を禁止するための出力手段(図示せず)を備え、車両用
電子制御ユニットの信頼性を保障している。
ットは、どちらか一方のCPUが誤動作しても、両CP
Uが同時に再起動されないように構成され、また互いの
誤動作が見逃されないようにされる。これは、前述した
CPUが誤動作したとき、両CPUを同時に再起動する
手法においては、両CPUを再起動した後で、何事もな
かったように正常動作に移行してCPUの故障を見逃す
恐れがあり、そのような場合には、車両用電子制御ユニ
ットの信頼性が欠けるからである。
電源装置は、さらに、メインCPU100およびサブC
PU102に、それぞれメインCPUリセット回路10
4およびサブCPUリセット回路106を備える。
ンCPU100に電源が投入されるとパワー・オン・リ
セット信号の出力を行うと共に、動作電圧Vccが閾値
Thm(後述)を下回った場合、メインCPU100を
再起動するリセット信号を出力する。尚、メインCPU
リセット回路104は、メインCPUリセットスイッチ
100aに接続される。
PU102に電源が投入されるとパワー・オン・リセッ
ト信号の出力を行うと共に、動作電圧Vccが閾値Th
s(後述)を下回った場合、サブCPU102を再起動
するリセット信号を出力する。尚、サブCPUリセット
回路106は、サブCPUリセットスイッチ102aに
接続される。
1つしか用意されない場合、そのリセット回路に例えば
「Hiレベル固定」などの故障が生じたとき、電源投入
時に必要な発振安定を保つための一定時間のLoレベル
(パワー・オン・リセット)が確保されず、全てのCP
Uが暴走する場合がある。
ニットの電源装置にあっては、メインCPU100には
メインCPUリセット回路104が設けられると共に、
サブCPU102にはサブCPUリセット回路106が
設けられる。
車両用電子制御ユニットの電源装置の動作を説明する。
ニットの電源装置の主要構成要素における入出力信号な
どを示すタイム・チャートである。車両のイグニッショ
ン・スイッチ(図示せず)がオンされると、図示しない
アクセサリ(エアコンなど)にバッテリ電圧Vbが供給
されると共に、車両用電子制御ユニットに動作電圧Vc
cが供給され、メインCPU100、サブCPU102
の動作が開始される。
セルモータの駆動が指示されると、その駆動電圧の負荷
に起因してバッテリ電圧Vbが図示の如く低下し、それ
に伴って動作電圧Vccが一時的に低下する(低下する
期間を図に「クランキング」と示す)。
は、それぞれメインCPU100およびサブCPU10
2における動作状態を示すものであり、Hiが動作中を
示し、Loが再起動されて非動作になった状態を示す。
2に供給される動作電圧Vccが低下すると、各CPU
が誤動作を生じる恐れがあるため、動作電圧Vccが閾
値以下に低下したときは、各CPUを再起動する必要が
ある。そのため、メインCPU100およびサブCPU
102を再起動するための閾値Thm(メインCPU1
00)、Ths(サブCPU102)が設定される。
電子制御ユニットの電源装置にあっては、メインおよび
サブCPU100,102を再起動するための閾値Th
m,Thsは同じ値に設定される。
104およびサブCPUリセット回路106の製造時の
誤差等に起因して閾値にバラツキが生じてしまい、図4
に示すように各閾値Thm,Thsが相違することがあ
る。
ユニットの電源装置にあっては、前述のクランキング時
等のような電源電圧が不安定な時に、一方のCPU(例
えばメインCPU100)のみ再起動され、他方のCP
U(例えばサブCPU102)が再起動されずに動作し
続けることがある。この場合、再起動されなかったCP
U(例えばサブCPU102)が、再起動されたCPU
(例えばメインCPU100)の動作を誤動作であると
検知し、ワーニング・ランプを点灯させたり、制御の停
止を指示する恐れがある。
平4−291610号公報に記載されているように、あ
るCPUが誤動作(暴走)するか、電子制御ユニットの
電源装置に供給される電圧が低下した場合は、全てのC
PUを再起動する技術が提案されている。
公報記載の装置においては、前述したような車両用電子
制御ユニットの信頼性は保障されない。
サブCPUからなる2つのCPUを備え、各CPUが相
互に監視可能に構成された車両用電子制御ユニットにお
いて、車両用電子制御ユニットの信頼性を保障しつつ、
再起動されなかったCPUが再起動されたCPUの動作
を誤動作であると検知することがないようにした車両用
電子制御ユニットの電源装置を提供することを目的とす
る。
め、請求項1項においては、相互に通信可能なメインC
PUとサブCPUを有し、前記メインCPUとサブCP
Uの各々にリセット手段を備えた車両用電子制御ユニッ
トの電源装置において、前記メインCPUとサブCPU
に供給される動作電圧が前記メインCPUとサブCPU
の各々のリセット手段の閾値よりも高く設定された閾値
より低下したとき、前記メインCPUとサブCPUを共
に再起動するための電圧低下リセット手段を備える如く
構成した。
るための閾値に関わらず、各CPUに供給される動作電
圧が、それらの閾値よりも高く設定された閾値以下の場
合、メインCPUおよびサブCPUが共に再起動される
ように構成したので、車両用電子制御ユニットの信頼性
を保障しつつ、再起動されなかったCPUが再起動され
たCPUの動作を誤動作であると検知することがない。
明の一つの実施の形態に係る車両用電子制御ユニットの
電源装置を説明する。
る車両用電子制御ユニットの電源装置の構成を説明する
ための説明ブロック図である。
トの電源装置は、その制御対象(図示せず)を制御する
ためのプログラムが記憶されて演算を行うメインCPU
10、およびメインCPU10と相互に通信可能に接続
され、同じ演算を行うサブCPU12を備えると共に、
各CPU10,12は、その動作を相互に監視してい
る。尚、各CPUには、バッテリ電圧Vb(例えば12
〔V〕程度)の電源(図示しない車両搭載バッテリ)か
ら動作電圧Vcc(例えば5〔V〕程度)が供給され
る。
るためのメインCPUリセットスイッチ(図に「MRE
S/SW」と示す)10aを備える。
ためのサブCPUリセットスイッチ(図に「SRES/
SW」と示す)12aを備える。
車両用電子制御ユニットの制御対象(図示せず)を主と
して制御すべく演算を行うと共に、サブCPU12を監
視するように構成される。
両用電子制御ユニットの制御対象(図示せず)を主とし
て制御すべくメインCPU10と同様の演算を行うと共
に、メインCPU10を監視するように構成される。
が出た場合に、制御対象の駆動を禁止し、ワーニング・
ランプ(図示せず)を点灯するための出力段(図示せ
ず)が、両CPUに備えられる。
10,12の演算の相違によって誤動作を監視している
が、それに加えて、メインCPU10にウォッチ・ドッ
グ・タイマ(図示せず)を備え、ウォッチ・ドッグ・タ
イマ出力値をメインリセット回路(後述)に出力するこ
とによって、メインCPU10を監視し、メインCPU
10が誤動作したときはメインリセット回路によって制
御対象の駆動を禁止し、ワーニング・ランプを点灯させ
ても良い。こうすることにより、さらに車両用電子制御
ユニットの信頼性が向上することは言うまでもない。
トの電源装置は、動作電圧が低下したときメインCPU
10およびサブCPU12を共に再起動する信号および
メインCPU10のみを再起動する信号を出力するメイ
ンリセット回路(リセット手段、電圧低下リセット手
段)14を備える。
10のみを再起動する信号を出力するメインCPUリセ
ット信号出力部(図に「MRES」と示す)14a、車
両用電子制御ユニットに供給される動作電圧Vccと閾
値Thu(後述)を比較し、動作電圧Vccが閾値Th
u以下のときにメインCPU10およびサブCPU12
を共に再起動する信号を出力する電圧低下リセット信号
出力部(図に「NMI」と示す)14bを備える。
トの電源装置は、さらにサブCPU12を再起動するた
めにサブCPUリセット回路16を備えると共に、サブ
CPUリセット回路16には、サブCPUリセット信号
出力部(図に「SRES」と示す)16aが設けられ、
そこからサブCPU12を再起動する信号が出力され
る。
よび電圧低下リセット信号出力部14bは、第1のOR
回路18を介し、メインCPUリセットスイッチ10a
に接続される。
aおよび電圧低下リセット信号出力部14bは、第2の
OR回路20を介し、サブCPUリセットスイッチ12
aに接続される。
動作電圧Vccの低下時に両CPU10,12を同時に
再起動するための電源装置は、上述のメインCPUリセ
ットスイッチ10a、サブCPUリセットスイッチ12
a、動作電圧Vccが閾値Thuを下回ったとき、リセ
ット信号を出力(電圧低下リセット信号出力部14b)
するメインリセット回路14、第1および第2のOR回
路18,20から構成される。
係る車両用電子制御ユニットの電源装置の動作を説明す
る。
御ユニットの電源装置の主要構成要素における入出力信
号を示すタイム・チャートである。図2で車両のイグニ
ッション・スイッチ(図示せず)がオンされると、先ず
図示しないアクセサリ(エアコンなど)にバッテリ電圧
Vbが供給されると共に、車両用電子制御ユニットには
動作電圧Vccが供給され、メインCPU10、サブC
PU12の動作が開始される。
セルモータの駆動が指示されると、その駆動電圧の負荷
に起因してバッテリ電圧Vbが一時的に低下し、それに
伴って動作電圧Vccが一時的に低下する(図に「クラ
ンキング」と示す)。
は、それぞれメインCPU10およびサブCPU12の
動作状態を示すものであり、Hiが動作中を示し、Lo
が再起動されて非動作となった状態を示す。「MRE
S」「SRES」に良く示すように、パワー・オン・リ
セットの後、メインCPU10およびサブCPU12の
動作が開始されると共に、それらの相互通信も開始され
る。
で行われる通信は、メインCPU10で進行する演算と
同じ演算をサブCPU12で進行させると共に、これら
の演算を常時比較することにより行われる。
て、メインCPU10およびサブCPU12に供給され
る動作電圧Vccが低下すると、各CPUが誤動作を生
じる恐れがあるため、動作電圧Vccが閾値以下に低下
したとき、各CPUを再起動する必要がある。
トの電源装置にあっては、従来技術と同様、メインCP
U10のみ再起動するメインCPUリセット回路14、
サブCPU12のみ再起動するサブCPUリセット回路
16の閾値が、それぞれThm(メインCPU)、Th
s(サブCPU)となる。
を、動作電圧Vccの低下に伴って同時に再起動するた
めに、それぞれの閾値ThmとThsは同一の値に設定
される。しかしながら、これらの値はメインCPUリセ
ット回路14およびサブCPUリセット回路16の製造
時の誤差等に起因して相違する場合がある。
慮して閾値Thuが設定される。即ち、閾値Thuは、
メインCPU10とサブCPU12を同時に再起動する
必要があるため、メインCPUリセット回路14の閾値
ThmおよびサブCPUリセット回路16の閾値Ths
の誤差範囲を考慮し、それらより高く設定された値であ
る。
供給される動作電圧Vccと常に比較され、図2に「ク
ランキング」と示すようなとき、即ち、閾値Thuが動
作電圧Vcc以下と判断された場合、電圧低下リセット
信号出力部14bからメインCPU10およびサブCP
U12を共に再起動するリセット信号(Lo信号)が出
力される。
が、メインCPUリセットスイッチ10aおよびサブC
PUリセットスイッチ12aに入力されることにより、
図2に示すように、メインCPU10(図2に示す「M
RES」)およびサブCPU12(図2に示す「SRE
S」)が同時に再起動される。
再起動されることによって、再起動されなかったCPU
が、再起動されたCPUの動作を誤動作であると検知す
ることがなくなる。尚、CPU再起動時には制御対象の
駆動が禁止されると共に、ワーニング・ランプが点灯さ
れる。
Uを再起動するための閾値よりも高く設定された閾値を
設け、動作電圧Vccがそれを下回ったとき、両CPU
を同時に再起動するように構成したので、車両用電子制
御ユニットの信頼性を保障しつつ、再起動されなかった
CPUが再起動されたCPUの動作を誤動作であると検
知することがない。
いては、相互に通信可能なメインCPU10とサブCP
U12を有し、前記メインCPUとサブCPUの各々に
リセット手段(メインCPUリセットスイッチ10a,
サブCPUリセットスイッチ12a,メインリセット回
路14,メインCPUリセット信号出力部14a、サブ
CPUリセット回路16、サブCPUリセット信号出力
部16a)を備えた車両用電子制御ユニットの電源装置
において、前記メインCPUとサブCPUに供給される
動作電圧Vccが前記メインCPUとサブCPUの各々
のリセット手段の閾値(Thm,Ths)よりも高く設
定された閾値Thuより低下したとき、前記メインCP
UとサブCPUを共に再起動するための電圧低下リセッ
ト手段(メインCPUリセットスイッチ10a、サブC
PUリセットスイッチ12a、メインリセット回路1
4,メインCPUリセット信号出力部14a、電圧低下
リセット信号出力部14b、サブCPUリセット回路1
6、サブCPUリセット信号出力部16a、第1のOR
回路18、第2のOR回路20)を備える如く構成し
た。
インCPUのみ、またはサブCPUのみを再起動するた
めの閾値に関わらず、各CPUに供給される動作電圧
が、それらの閾値よりも高く設定された閾値以下の場
合、メインおよびサブCPUが共に再起動される。従っ
て、車両用電子制御ユニットの信頼性を保障しつつ、再
起動されなかったCPUが再起動されたCPUの動作を
誤動作であると検知することがない。
制御ユニットの電源装置の構成を説明するための説明ブ
ロック図である。
信号を示すタイム・チャートである。
装置の構成を説明するための説明ブロック図である。
信号を示すタイム・チャートである。
Claims (1)
- 【請求項1】 相互に通信可能なメインCPUとサブC
PUを有し、前記メインCPUとサブCPUの各々にリ
セット手段を備えた車両用電子制御ユニットの電源装置
において、前記メインCPUとサブCPUに供給される
動作電圧が前記メインCPUとサブCPUの各々のリセ
ット手段の閾値よりも高く設定された閾値より低下した
とき、前記メインCPUとサブCPUを共に再起動する
ための電圧低下リセット手段を備えたことを特徴とする
車両用電子制御ユニットの電源装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000281693A JP4008647B2 (ja) | 2000-09-18 | 2000-09-18 | 車両用電子制御ユニットの電源装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000281693A JP4008647B2 (ja) | 2000-09-18 | 2000-09-18 | 車両用電子制御ユニットの電源装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2002091626A true JP2002091626A (ja) | 2002-03-29 |
JP4008647B2 JP4008647B2 (ja) | 2007-11-14 |
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ID=18766311
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000281693A Expired - Fee Related JP4008647B2 (ja) | 2000-09-18 | 2000-09-18 | 車両用電子制御ユニットの電源装置 |
Country Status (1)
Country | Link |
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JP (1) | JP4008647B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2019159702A (ja) * | 2018-03-12 | 2019-09-19 | オムロン株式会社 | 制御装置 |
-
2000
- 2000-09-18 JP JP2000281693A patent/JP4008647B2/ja not_active Expired - Fee Related
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2019159702A (ja) * | 2018-03-12 | 2019-09-19 | オムロン株式会社 | 制御装置 |
JP7143600B2 (ja) | 2018-03-12 | 2022-09-29 | オムロン株式会社 | 制御装置 |
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---|---|
JP4008647B2 (ja) | 2007-11-14 |
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