JP2002062355A - Fm−cwレーダ方式における変調信号発生装置 - Google Patents
Fm−cwレーダ方式における変調信号発生装置Info
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Abstract
号の補正回路の回路規模の低減と距離・速度誤差の低減
とを両立させた変調信号発生装置を提供する。 【解決手段】 変調信号発生装置は、FM−CWレーダ
方式における電圧制御発振器出力をFM変調する変調信
号発生装置であって、変調信号の所定時間経過後毎の周
波数遷移を示す周波数傾きデータをデジタルデータとし
て保持し出力する傾きデータ出力部と、前記傾きデータ
出力部から出力された周波数傾きデータを対応するアナ
ログ傾斜階段信号に変換するデジタル−アナログ変換器
と、前記デジタル−アナログ変換器からの傾斜階段信号
を逐次積分することによって変調信号を生成する積分回
路と、で構成される。
Description
関し、特にFM−CWレーダ装置の回路規模の低減と距
離・速度誤差の低減とを両立させたFM−CWレーダ方
式における変調信号発生装置に関するものである。
度及び距離を同時に計測でき、自動車の車間距離の監視
装置等として広く用いられている。FM−CWレーダに
よる上記計測において、三角波変調の直線性(リニアリ
ティ)が悪いと、送信波と受信波のミキシング波形の周
波数広がりを招き、探知性能の低下及び距離・速度精度
の劣化となることが周知されている。そのため、従来か
らFM−CWレーダには種々の三角波変調信号波形の補
正回路が用いられてきた。
の一構成例を示したものである。図1において、変調信
号発生回路1からの三角波変調信号が波形補正回路2に
入力される。波形補正回路2は、後段の電圧制御発振器
(VCO)3の電圧−周波数特性(V−f特性)の非線
型性を補償するために入力された三角波変調信号に所定
の補正を加える。
変調信号の入力によって線形性が補償されたFM高周波
発振信号を出力する。その信号は送信アンテナ5を介し
て外部の目標物体である自動車等に向けて放射される。
その反射波は受信アンテナ6で受信され、その受信信号
は方向性結合器4を介して前記送信信号の一部が分岐さ
れた信号と混合器7で混合される。その結果、送信信号
と受信信号との位相差によるビート信号から目標物体ま
での距離と相対速度が検出8される。この位相差の測定
精度を向上させるには、電圧制御発振器3の三角変調出
力の線形性が重要な要素となる。
調電圧−変調周波数特性の一例を示したものである。図
2の実線曲線9に示すように、電圧制御発振器3の変調
周波数は変調電圧に対して非線形な特性を有している。
従って、その変調周波数を線形に変化させるには図2の
点線曲線10で示すような入力電圧の補正が必要にな
る。
しており、ここではダイオード折れ線近似回路の回路要
部を示している。図3に示すように、変調信号発生回路
1から入力された三角波変調信号は異なる増幅率A1〜
Anの増幅器21〜22で増幅され、その出力はダイオ
ードスイッチ23〜24で出力レベルの大きい側が選択
される。
ポイントに近似する折れ線出力特性が得られる。なお、
本例では入力信号として三角波変調信号を用いている
が、入力信号に方形パルス等を用い、さらに増幅器21
〜22に代えて積分回路を使用しても同様なダイオード
折れ線近似回路を構成することができる。
をデジタル回路で構成した例を示している。図4では、
メモリ(MEM)25に予め図2の点線曲線で示す補正
後の三角波変調信号の各波形点をデジタルデータとして
記憶しておく。それを所定周期で繰り返し読み出すこと
で次段のデジタル−アナログ変換器(D/A)26から
は補正されたアナログ三角波変調信号が出力される。
ダイオード折れ線近似を用いた補正回路では、補正精度
向上のために補正ポイントを増加させると、部品点数が
増加し、回路が複雑となってコスト上昇につながるとい
う問題があった。また、補正ポイントの調整も回路相互
間のレベル比較によるため、1つの補正ポイントの調整
が他の補正ポイントに影響を与え、調整ポイントの増加
は調整工数の増大につながるという問題もあった。さら
に、ミリ波発振回路3の単調増加特性及び単調減少特性
等のバラツキを考慮すると、それぞれの特性に応じて個
別の回路を設ける必要があり、その結果回路規模が増大
するという問題もあった。
ログ変換器(D/A)26とを用いる構成では、メモリ
25内に図2の点線曲線10のように補正された三角波
変調波形のサンプリングデータを多数格納しておく必要
がある。そのため、所望の精度を実現するには大容量の
メモリ25と高精度なデジタル−アナログ変換器26が
必要となり、コスト的に高価なものになるという問題が
あった。
サンプリングポイント数、及び前記各点の微細な調整ズ
レ等は、変調信号をミキシングした後のビート信号に影
響することが分かっている。すなわち、このビート信号
をFFT処理によって周波数解析すると、上記の制限に
よる信号の不連続性によって本来あるべき周波数ピーク
の前後に隣接する周波数ピーク(ピーク割れ)が発生す
ることになる。
も別の周波数が存在するように見えてしまい、探知性能
の低下や誤検出等が発生することになる。このため、上
記図3及び4のいずれの場合にも所望の探知性能を実現
するにはそれなりの回路規模及びコストが必要となり、
上述した各問題点を根本的に解決することはできなかっ
た。
鑑み、FM−CWレーダの距離及び速度誤差を低減する
直線性の補正を行ないながら、その回路規模の低減化を
達成し、同時にその調整精度や調整工数のコスト及び誤
検出をも低減したFM−CWレーダ方式における変調信
号発生装置を提供することにある。
CWレーダ方式における電圧制御発振器出力をFM変調
する変調信号発生装置であって、変調信号の所定時間経
過後毎の周波数遷移を示す周波数傾きデータをデジタル
データとして保持し出力する傾きデータ出力部と、前記
傾きデータ出力部から出力された周波数傾きデータを対
応するアナログ傾斜階段信号に変換するデジタル−アナ
ログ変換器と、前記デジタル−アナログ変換器からの傾
斜階段信号を逐次積分することによって変調信号を生成
する積分回路と、で構成された変調信号発生装置が提供
される。
定区間で分割した変調周波数幅(Δf)毎の各周波数ポ
イントの電圧を求め、各周波数ポイント電圧間の電圧
(周波数傾き)に対応した周波数傾きデータを求る。そ
の周波数ポイント間の遷移時間を前所定時間経過毎の時
間とする。
で生成された変調信号と同一周期のバイアス補正値を発
生させるバイアス補正回路と、前記積分回路で生成され
た変調信号と前記バイアス補正回路からのバイアス値と
を加算する加算回路と、前記加算回路でバイアスされた
変調信号を積分して2次関数で補正された変調信号を生
成する別の積分回路と、で構成された変調信号発生装置
が提供される。
号を周波数解析し、その際に発生したピーク周波数の割
れについて最大パワーデータに隣接する所定周波数範囲
内のピークデータを除去する信号処理部が設けられる。
レーダ装置の基本構成例を示したものである。図5にお
いて、傾きデータ出力部11は、図2の点線曲線10に
示すような補正された変調信号(三角波や鋸波等)を所
定時間経過毎の周波数遷移量を示す周波数傾きデータと
してデジタル的に保持する。また、図2に一点鎖線で示
すように本発明ではミリ波発振回路(VCO)のV−f
特性を基に、所定区間で分割した変調周波数幅(Δf)
毎の各周波数ポイントの電圧を求め、各周波数ポイント
電圧間の電位差(図2の上側特性の周波数傾きに相当)
に相当する前記周波数傾きデータを求める(図2の上側
特性参照)。また、そのV−t特性(図2の下側特性参
照)からその周波数ポイント間の遷移時間(所定時間経
過毎)が求まる。
f特性に基いて補正された三角変調信号であり、それを
前記電圧制御発振器に供給することによってFM変調の
直線性を補正する。デジタル−アナログ変換器(D/
A)12は、前記傾きデータ出力部11から所定時間経
過後毎に一定周期で繰り返し出力される周波数傾きデジ
タルデータをアナログ変換して対応する傾斜階段信号を
生成する。積分回路は、前記デジタル−アナログ変換器
12からの傾斜階段信号を逐次積分することで前記補正
された変調信号をアナログ的に生成する。
アンテナ6、方向性結合器4、及び混合器7の動作は図
1の従来例と同様である。従って、ここでは更に説明し
ない。次に、信号処理部14では、混合器7からのビー
ト信号に対して後述するような本発明による隣接周波数
ピークの削除処理が行なわれ、本来のピーク周波数から
なるビート信号が受信出力8される。
のである。また、図7は、図6の動作波形の一例を示し
たものである。図6において、図5の各ブロックと対応
するブロックには同一符号を付している。本例では、図
5の傾きデータ出力部をマイクロコンピュータ11で構
成している。マイクロコンピュータ11は、内臓又は外
部のROM等に格納した周波数傾きデータをその入出力
ポートやバス出力等によって次段のデジタル−アナログ
変換器(D/A)12へ出力する。デジタル−アナログ
変換器12は、それをアナログ信号に変換して傾斜階段
信号(a)を生成する。積分回路13は、入力された傾
斜階段信号を積分して補正された三角波変調信号(b)
を出力する。
例を示している。本例では基準点(ref)を始点とし
て一定時間tの経過毎にその時点のレベルを基準に次の
積分波形の傾斜を与える周波数傾きデータがマイクロコ
ンピュータ11から出力される。その結果、図7の
(b)に示すように6×t時間を1周期とするミリ波ユ
ニット3のV−f特性の補正がなされた三角変調信号波
形が得られる。
三角変調波形を忠実にサンプリングする場合(図4参
照)にくらべ各データの絶対レベルが必要とされない。
従って、例えば積分傾斜に相当する差分データのみをメ
モリに格納しておき、マイクロコンピュータ11内のレ
ジスタやアキュームレータ等を使った加減演算によって
その差分データから前記傾斜階段信号(a)を順次作り
出すことができる。また、最終波形は積分回路13によ
ってアナログ的に生成されるためデジタル−アナログ変
換器12の精度も従来例のようには要求されない。
力される簡易な例を示しているが、傾斜が急峻に変化す
る波形領域とそれ以外の領域とで前記時間tを可変にし
(前者を密に、後者を疎にする)、少ないデータ量で忠
実に波形を生成することも可能である。さらに、本発明
の周波数傾きデータは図7の(b)に示すように後段の
積分回路13で積分されることを前提に設定されるた
め、前記積分回路13の時定数を利用した波形補間作用
によってそのデータ出力間隔tをより大きくすることが
でき、図4の従来例に比べて一層のデータ削減が達成さ
れる。
イクロコンピュータ11はFM−CWレーダ装置全体の
制御を行なうマイクロコンピュータがそのまま流用で
き、もしワンチップタイプのマイクロコンピュータなら
デジタル−アナログ変換器(D/A)12も内臓(本発
明では精度を要求しない)されており、また上述したよ
うに周波数傾きデータ量は小さい。従って、1個のワン
チップマイクロコンピュータに簡易なCR積分回路13
を付加するだけで本発明の第1の実施例は実現可能であ
る。これから、本発明は図3に示した従来のアナログ回
路構成と比べて回路規模及びコスト等の面で明らかに優
位であることが分かる。
のである。また、図9は、図8の動作波形の一例を示し
たものである。図8でも、図5の各ブロックと対応する
ブロックには同一符号を付している。本例では、図7の
ブロックにデジタル−アナログ変換器(D/A)15、
加算回路16、及び積分回路17が追加されている。
ル−アナログ変換器12、及び積分回路13の動作は図
6及び7で説明したものと同じである。図9の(a)に
は図7の(b)の波形を再掲載している。本実施例では
第2のデジタル−アナログ変換器15が追加され、マイ
クロコンピュータ11からの出力データによって図7の
(a)の波形の周期と同じ時間周期T(=6t)で所定
レベルの方形パルス信号(b)が出力される。
一般的なアナログ加算演算を行ない、その出力(c)は
図9の(c)に示すような出力波形信号となる。前記出
力波形信号はさらに次段の積分回路17に入力され、二
次積分された波形は図9の(d)に示すような変調信号
となる。このように本実施例によれば、マイクロコンピ
ュータ11に格納される周波数傾きデータ値及びその量
は図6の第1の実施例と同じでありながら、最終的に得
られる変調信号はより連続的な補正が与えられたものと
なる。
角波変調信号を使用すると、ビート信号をFFT処理に
よって周波数解析する際に本来あるべき周波数ピークの
前後に発生する周波数ピーク割れを顕著に低減すること
ができる。このように、本実施例によれば、図4の従来
例における大容量メモリと高精度なデジタル−アナログ
変換器の代わりに、精度の要求されないデジタル−アナ
ログ変換器15、簡易なオペアンプ加算回器16、及び
CR積分器17を使ってより滑らかな補正が与えられた
三角波変調信号を生成することができる。
成における信号処理部14の動作を示している。図10
には、ビート信号のピーク割れ波形の一例を示してい
る。このように本来のビート信号の両側に小さなピーク
信号が発生する。この発生原因については先に説明した
通りである。図11は、本発明による信号処理部14の
ピーク割れ処理動作の原理を示しており、図12にはそ
の処理フロー例を示している。
下の方法をとる。 (1)本来のピークからそれぞれ数KHzはなれた周波
数範囲にあるピークデータは本来のピークの割れである
可能性が高いためそのピークデータを除去する。 (2)上記条件時に合うピークデータが複数ある場合に
は、本来のピークパワーを基準とした所定レベル以下の
ピークパワーも削除する。
ついて説明する。先ず、ステップS10でビート信号を
FFT解析する。それによって最大ピークパワーpとそ
の周波数fとを求める(S11)。次に、図11に示す
ように前記周波数fを中心にその前後周波数幅a以内
(x=f−a又はx=f+a)にピークが存在し(S1
2)、そのピークパワーが前記最大ピークパワーpから
所定レベルb以下(p−b>y)の場合に(S13)、
その信号がピーク割れ信号と判断してそのピーク信号デ
ータを削除する(S14)。
信号が出力される。本信号処理は本発明の第1の実施例
のように、回路規模の削減によって変調信号波形上に補
正ポイント(折れ線ポイント)が存在するような不連続
な三角変調信号を用いた場合に特に有効である。本構成
によりハードウェア削減によって生じた欠点が別の又は
追加のハードウェアではなく既存の信号処理部14のソ
フトウェア処理によって補完されるからである。これに
より、規模の大きなハードウェアを使用した場合と同等
の誤検出低減効果が達成され、また初期精度の調整も疎
調整ですむため調整工数が削減される。
−CWレーダの距離及び速度誤差を低減する直線性の補
正を行ないながら、その回路規模の低減化を達成し、同
時にその調整精度や調整工数のコスト及び誤検出をも低
減したFM−CWレーダ装置を提供することが可能とな
る。
た図である。
一例を示した図である。
図である。
例を示した図である。
例を示した図である。
図である。
ある。
ある。
Claims (7)
- 【請求項1】 FM−CWレーダ方式における電圧制御
発振器出力をFM変調する変調信号発生装置であって、 変調信号の所定時間経過後毎の周波数遷移を示す周波数
傾きデータをデジタルデータとして保持し出力する傾き
データ出力部と、 前記傾きデータ出力部から出力された周波数傾きデータ
を対応するアナログ傾斜階段信号に変換するデジタル−
アナログ変換器と、 前記デジタル−アナログ変換器からの傾斜階段信号を逐
次積分することによって変調信号を生成する積分回路
と、で構成されたことを特徴とする変調信号発生装置。 - 【請求項2】 前記電圧制御発振器のV−f特性を基に
所定区間で分割した変調周波数幅(Δf)毎の各周波数
ポイントとなる電圧を求めることで、各周波数ポイント
電圧間の電位差(周波数傾き)に相当する周波数傾きデ
ータを求める請求項1記載の装置。 - 【請求項3】 前記変調信号は前記電圧制御発振器のV
−f特性に基いて補正された三角変調信号であり、それ
を前記電圧制御発振器に供給することによってFM変調
の直線性を補正する請求項1又は2記載の装置。 - 【請求項4】 FM−CWレーダ方式における電圧制御
発振器出力をFM変調する変調信号発生装置であって、 前記電圧制御発振器のV−f特性に基いて補正された変
調信号の所定時間経過後毎の周波数遷移を示す周波数傾
きデータをデジタルデータとして保持し出力する傾きデ
ータ出力部11と、 前記傾きデータ出力部11から出力された周波数傾きデ
ータをアナログ傾斜階段信号に変換するデジタル−アナ
ログ変換器と、 前記デジタル−アナログ変換器からの傾斜階段信号を一
次積分することで前記補正された変調信号を生成する第
1の積分回路と、 前記第1の積分回路で生成された変調信号と同一周期の
バイアス補正値を発生させるバイアス補正回路と、 前記第1の積分回路で生成された変調信号と前記バイア
ス補正回路からのバイアス値とを加算する加算回路と、 前記加算回路でバイアスされた変調信号をさらに積分
し、2次関数で補正された変調信号を生成する第2の積
分回路と、で構成されたことを特徴とする変調信号発生
装置。 - 【請求項5】 受信したビート信号を周波数解析し、抽
出したピークデータの周波数に隣接する所定周波数範囲
内の他のピークデータを除去する機能を持ったレーダ装
置。 - 【請求項6】 前記所定周波数範囲内に存在する前記他
のピークのうち任意のパワー以下のピークデータを除去
する請求項5記載の装置。 - 【請求項7】 前記任意のパワーレベルを抽出したピー
クデータのレベルにより決定する事を特長とする請求項
6の装置。
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