JP2001333391A - 映像表示装置 - Google Patents
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- JP2001333391A JP2001333391A JP2000147020A JP2000147020A JP2001333391A JP 2001333391 A JP2001333391 A JP 2001333391A JP 2000147020 A JP2000147020 A JP 2000147020A JP 2000147020 A JP2000147020 A JP 2000147020A JP 2001333391 A JP2001333391 A JP 2001333391A
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/01—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level
- H04N7/0112—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level one of the standards corresponding to a cinematograph film standard
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- H04N7/0117—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level involving conversion of the spatial resolution of the incoming video signal
- H04N7/012—Conversion between an interlaced and a progressive signal
-
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/11—Scanning of colour motion picture films, e.g. for telecine
Abstract
(57)【要約】
【課題】 ２−３プルダウン方式によるフィルムソース
の画像画生において、動画再生時のガタつきをなくし、
滑らかな映像を表示出力可能にする。 【解決手段】 外部から入力された映像信号がテレシネ
信号にもとづく信号か否かを判定し、かつ映像信号への
変換前における原画像信号のリフレッシュレートを算出
するテレシネ判別回路１２と、テレシネ信号と判定され
た信号に対して２−３プルダウンを行うＩＰ変換回路１
３とを設けて読み出し用同期処理回路１７に、前記リフ
レッシュレートに同期したタイミングにてメモリ１５か
らＩＰ変換された信号を読み出させて表示させる。
の画像画生において、動画再生時のガタつきをなくし、
滑らかな映像を表示出力可能にする。 【解決手段】 外部から入力された映像信号がテレシネ
信号にもとづく信号か否かを判定し、かつ映像信号への
変換前における原画像信号のリフレッシュレートを算出
するテレシネ判別回路１２と、テレシネ信号と判定され
た信号に対して２−３プルダウンを行うＩＰ変換回路１
３とを設けて読み出し用同期処理回路１７に、前記リフ
レッシュレートに同期したタイミングにてメモリ１５か
らＩＰ変換された信号を読み出させて表示させる。
Description
【０００１】
【発明の属する技術分野】本発明は、フィルムソースの
映像を電気的な映像信号に変換して表示する映像表示装
置に関する。
映像を電気的な映像信号に変換して表示する映像表示装
置に関する。
【０００２】
【従来の技術】従来から、映画フィルムにて２４コマ秒
で記録された映像、音声を電気的なＮＴＳＣの映像、音
声信号に変換する場合にテレシネ方式が採用されてい
る。図２はこのような従来のテレシネ方式を採用した映
像表示装置を示すブロック図である。同図において、１
０は外部から入力された、例えば図３（ａ）に示すよう
な２４コマ／秒の信号にもとづいて得た６０フィールド
／秒のＮＴＳＣ方式による映像信号、１１はこの映像信
号をディジタル信号に変換するアナログ／ディジタル
（Ａ／Ｄ）変換回路、１２はディジタル変換された信号
がテレシネ信号か否かを判定するとともに、テレシネ信
号に変換する前の原画像信号のリフレッシュレートを算
出するテレシネ判定回路である。
で記録された映像、音声を電気的なＮＴＳＣの映像、音
声信号に変換する場合にテレシネ方式が採用されてい
る。図２はこのような従来のテレシネ方式を採用した映
像表示装置を示すブロック図である。同図において、１
０は外部から入力された、例えば図３（ａ）に示すよう
な２４コマ／秒の信号にもとづいて得た６０フィールド
／秒のＮＴＳＣ方式による映像信号、１１はこの映像信
号をディジタル信号に変換するアナログ／ディジタル
（Ａ／Ｄ）変換回路、１２はディジタル変換された信号
がテレシネ信号か否かを判定するとともに、テレシネ信
号に変換する前の原画像信号のリフレッシュレートを算
出するテレシネ判定回路である。
【０００３】また、１３はテレシネ信号と判定された信
号に対してプルダウン処理を行うインタレース／プログ
レッシブ（以下、ＩＰという）変換回路であり、これ
が、所定のシーケンスに従ってフィルムソースの２４コ
マ／秒の信号を、６０フィールド／秒の映像（ビデオ）
信号に変換するように機能する。１４は入力された映像
信号の同期にもとづいて各種のタイミングを発生する同
期処理回路、１５はＩＰ変換で使用する場合に同期処理
回路１４が発生するタイミングでＩＰ変換を行った信号
を記憶したり読み出したりするメモリ、１６はＩＰ変換
を行った映像信号を表示する表示器としてのプラズマモ
ジュールである。
号に対してプルダウン処理を行うインタレース／プログ
レッシブ（以下、ＩＰという）変換回路であり、これ
が、所定のシーケンスに従ってフィルムソースの２４コ
マ／秒の信号を、６０フィールド／秒の映像（ビデオ）
信号に変換するように機能する。１４は入力された映像
信号の同期にもとづいて各種のタイミングを発生する同
期処理回路、１５はＩＰ変換で使用する場合に同期処理
回路１４が発生するタイミングでＩＰ変換を行った信号
を記憶したり読み出したりするメモリ、１６はＩＰ変換
を行った映像信号を表示する表示器としてのプラズマモ
ジュールである。
【０００４】かかる映像表示装置では、外部から入力さ
れた、図３（ａ）に示すようなフィルムソースの信号Ｌ
にもとづいて得た映像信号を、アナログ／ディジタル変
換回路１２で図３（ｂ）に示すような形態のディジタル
信号Ｍに変換し、このディジタル信号Ｍに変換された映
像信号は、テレシネ判定回路１２に入力されてテレシネ
信号であるか否かが判定され、テレシネ信号であると判
定されると、ここで、さらにテレシネ変換前の原画像の
リフレッシュレートを算出する。
れた、図３（ａ）に示すようなフィルムソースの信号Ｌ
にもとづいて得た映像信号を、アナログ／ディジタル変
換回路１２で図３（ｂ）に示すような形態のディジタル
信号Ｍに変換し、このディジタル信号Ｍに変換された映
像信号は、テレシネ判定回路１２に入力されてテレシネ
信号であるか否かが判定され、テレシネ信号であると判
定されると、ここで、さらにテレシネ変換前の原画像の
リフレッシュレートを算出する。
【０００５】さらに、ＩＰ変換回路１３ではそのリフレ
ッシュレートを参照して２−３プルダウン処理を行い、
その処理結果が、同期処理回路１４が発生するタイミン
グに従ってメモリ１５に記憶される。このメモリ１５に
記憶される信号Ｎは、図３（ｃ）に示す通りである。続
いて、前記算出されたリフレッシュレートにもとづいて
前記メモリ１５の読み出しが行われ、読み出された映像
信号Ｐがプラズマモジュール１６に入力されて画像表示
される。
ッシュレートを参照して２−３プルダウン処理を行い、
その処理結果が、同期処理回路１４が発生するタイミン
グに従ってメモリ１５に記憶される。このメモリ１５に
記憶される信号Ｎは、図３（ｃ）に示す通りである。続
いて、前記算出されたリフレッシュレートにもとづいて
前記メモリ１５の読み出しが行われ、読み出された映像
信号Ｐがプラズマモジュール１６に入力されて画像表示
される。
【０００６】ところで、テレシネ方式では、映画などの
フィルムソースである２４コマ／秒で記録された映像信
号を、ＮＴＳ信号に変換している。図３（ａ）は原画像
となる前記のようなフィルムソースの信号Ｌを示し、図
３（ｂ）はこれをＮＴＳＣ信号に変換した信号Ｍを示
す。ＮＴＳＣ信号はインタレース信号であるため、偶数
フィールド、奇数フィールドに分解する必要があり、図
３（ｂ）では、「１」、「２」、「３」…が偶数フィー
ルドであり、「１’」、「２’」、「３’」…が奇数フ
ィールドである。この方式で記録された信号が２−３プ
ルダウン変換によってＮＴＳＣ信号に変換される。
フィルムソースである２４コマ／秒で記録された映像信
号を、ＮＴＳ信号に変換している。図３（ａ）は原画像
となる前記のようなフィルムソースの信号Ｌを示し、図
３（ｂ）はこれをＮＴＳＣ信号に変換した信号Ｍを示
す。ＮＴＳＣ信号はインタレース信号であるため、偶数
フィールド、奇数フィールドに分解する必要があり、図
３（ｂ）では、「１」、「２」、「３」…が偶数フィー
ルドであり、「１’」、「２’」、「３’」…が奇数フ
ィールドである。この方式で記録された信号が２−３プ
ルダウン変換によってＮＴＳＣ信号に変換される。
【０００７】実際は、この２−３プルダウン変換方式お
よびＩＰ変換方式を併用する場合が多く、この二つの方
式を用いてＮＴＳＣ信号を並べ替えた信号Ｎが、図３
（ｃ）である。この図３（ｃ）の信号Ｎが図３（ｂ）の
信号Ｍに対して、ＩＰ変換と２−３プルダウン変換を行
った信号である。図３（ｃ）において、「１”」は例え
ば図３（ｂ）の「１」と「１’」の合成信号であり、
「２”」は図３（ｂ）の「２」と「２’」の合成信号で
あり、以下、「３”」〜「ｎ”」も同様の合成信号であ
る。こうして生成された信号の場合は、図３（ｃ）の
「１”」と図３（ａ）の「１」とは同じ映像となるた
め、原画像の特性を落さない、良質の画像とすることが
できる。
よびＩＰ変換方式を併用する場合が多く、この二つの方
式を用いてＮＴＳＣ信号を並べ替えた信号Ｎが、図３
（ｃ）である。この図３（ｃ）の信号Ｎが図３（ｂ）の
信号Ｍに対して、ＩＰ変換と２−３プルダウン変換を行
った信号である。図３（ｃ）において、「１”」は例え
ば図３（ｂ）の「１」と「１’」の合成信号であり、
「２”」は図３（ｂ）の「２」と「２’」の合成信号で
あり、以下、「３”」〜「ｎ”」も同様の合成信号であ
る。こうして生成された信号の場合は、図３（ｃ）の
「１”」と図３（ａ）の「１」とは同じ映像となるた
め、原画像の特性を落さない、良質の画像とすることが
できる。
【０００８】
【発明が解決しようとする課題】しかしながら、かかる
従来の映像表示装置にあっては、図３（ａ）の信号Ｌの
１乃至５コマについて、一定の間隔で移動する物体に注
目すると、図３（ｃ）の信号Ｎの「１”」である区間と
「２”」である区間の幅が異なるため、各コマの表示時
間が異なる画面になるという問題があった。
従来の映像表示装置にあっては、図３（ａ）の信号Ｌの
１乃至５コマについて、一定の間隔で移動する物体に注
目すると、図３（ｃ）の信号Ｎの「１”」である区間と
「２”」である区間の幅が異なるため、各コマの表示時
間が異なる画面になるという問題があった。
【０００９】すなわち、通常の２−３プルダウン処理で
は、一定の移動量が続く画面、例えば画面全体を横方向
にパスするシーン等においては、移動と停止を細かく繰
り返すこととなり、滑らかさを失うという問題があっ
た。
は、一定の移動量が続く画面、例えば画面全体を横方向
にパスするシーン等においては、移動と停止を細かく繰
り返すこととなり、滑らかさを失うという問題があっ
た。
【００１０】本発明は前記問題を解決するものであり、
２−３プルダウン方式によるフィルムソースの画像画生
を行っても、動画再生時のガタつきがなく、しかも滑ら
かな映像を表示出力できる映像表示装置を提供すること
を目的とする。
２−３プルダウン方式によるフィルムソースの画像画生
を行っても、動画再生時のガタつきがなく、しかも滑ら
かな映像を表示出力できる映像表示装置を提供すること
を目的とする。
【００１１】
【課題を解決するための手段】前記目的達成のために、
本発明にかかる映像表示装置は、外部から入力された映
像信号をディジタル信号に変換するアナログ／ディジタ
ル変換回路と、ディジタル変換された前記映像信号がテ
レシネ信号にもとづく信号であるか否かを判定するとと
もに、前記映像信号への変換前における原画像信号のリ
フレッシュレートを算出するテレシネ判別回路と、前記
テレシネ信号と判定された信号に対して２−３プルダウ
ンを行うインタレース／プログレッシブ変換回路とを有
し、メモリにインタレース／プログレッシブ変換された
信号を記憶させ、読み出し用同期処理回路に、前記原画
像信号のリフレッシュレートに同期したタイミングにて
前記メモリから信号を読み出させて表示器へ出力させる
ようにしたものである。
本発明にかかる映像表示装置は、外部から入力された映
像信号をディジタル信号に変換するアナログ／ディジタ
ル変換回路と、ディジタル変換された前記映像信号がテ
レシネ信号にもとづく信号であるか否かを判定するとと
もに、前記映像信号への変換前における原画像信号のリ
フレッシュレートを算出するテレシネ判別回路と、前記
テレシネ信号と判定された信号に対して２−３プルダウ
ンを行うインタレース／プログレッシブ変換回路とを有
し、メモリにインタレース／プログレッシブ変換された
信号を記憶させ、読み出し用同期処理回路に、前記原画
像信号のリフレッシュレートに同期したタイミングにて
前記メモリから信号を読み出させて表示器へ出力させる
ようにしたものである。
【００１２】また、本発明にかかる映像表示装置は、前
記メモリ読み出し用同期処理回路によるリフレッシュレ
ートを、前記原画像信号のリフレッシュレートの整数倍
に設定するようにしたものである。
記メモリ読み出し用同期処理回路によるリフレッシュレ
ートを、前記原画像信号のリフレッシュレートの整数倍
に設定するようにしたものである。
【００１３】また、本発明にかかる映像表示装置は、前
記インタレース／プログレッシブ変換された信号を、前
記映像信号の入力タイミングに同期して前記メモリに記
憶させるようにしたものである。
記インタレース／プログレッシブ変換された信号を、前
記映像信号の入力タイミングに同期して前記メモリに記
憶させるようにしたものである。
【００１４】また、本発明にかかる映像表示装置は、前
記２−３プルダウンを前記映像信号の入力タイミングに
同期して実施させるようにしたものである。
記２−３プルダウンを前記映像信号の入力タイミングに
同期して実施させるようにしたものである。
【００１５】
【発明の実施の形態】以下、本発明の実施の一形態を図
について説明する。図１は本発明の映像表示装置を示す
ブロック図であり、同図において、１０は外部から入力
された例えば図３（ａ）に示すような２４コマ／秒の信
号にもとづいて得た６０フィールド／秒のＮＴＳＣ方式
の映像信号、１１はこの映像信号をディジタル信号に変
換するアナログ／ディジタル（Ａ／Ｄ）変換回路、１２
はディジタル変換された信号がテレシネ信号か否かを判
定するとともに、テレシネ信号に変換する前の原画像の
リフレッシュレートを算出するテレシネ判定回路であ
る。
について説明する。図１は本発明の映像表示装置を示す
ブロック図であり、同図において、１０は外部から入力
された例えば図３（ａ）に示すような２４コマ／秒の信
号にもとづいて得た６０フィールド／秒のＮＴＳＣ方式
の映像信号、１１はこの映像信号をディジタル信号に変
換するアナログ／ディジタル（Ａ／Ｄ）変換回路、１２
はディジタル変換された信号がテレシネ信号か否かを判
定するとともに、テレシネ信号に変換する前の原画像の
リフレッシュレートを算出するテレシネ判定回路であ
る。
【００１６】また、１３はテレシネ信号と判定された信
号に対してプルダウン処理を行うインタレース／プログ
レッシブ変換回路であり、これが、所定のシーケンスに
従ってフィルムソースの２４コマ／秒の信号を６０フィ
ールド／秒の映像（ビデオ）信号に変換するように機能
する。１４Ａは入力された映像信号の同期にもとづいて
各種のタイミングを発生する同期処理回路、１５はＩＰ
変換で使用する場合に同期処理回路１４Ａが発生するタ
イミングでＩＰ変換を行った信号を記憶するメモリ、１
６はＩＰ変換を行った映像信号を表示するプラズマモジ
ュールなどの表示器である。
号に対してプルダウン処理を行うインタレース／プログ
レッシブ変換回路であり、これが、所定のシーケンスに
従ってフィルムソースの２４コマ／秒の信号を６０フィ
ールド／秒の映像（ビデオ）信号に変換するように機能
する。１４Ａは入力された映像信号の同期にもとづいて
各種のタイミングを発生する同期処理回路、１５はＩＰ
変換で使用する場合に同期処理回路１４Ａが発生するタ
イミングでＩＰ変換を行った信号を記憶するメモリ、１
６はＩＰ変換を行った映像信号を表示するプラズマモジ
ュールなどの表示器である。
【００１７】また、１７は前記同期処理回路１４Ａとは
独立して設けられた読み出し用同期処理回路であり、こ
れが前記原画像信号のリフレッシュレートに同期したタ
イミングにて、前記メモリ１５に記憶されている信号を
読み出し、この信号をプラズマモジュール１６へ出力さ
せるように機能する。つまり、フィルムソースの２−３
プルダウン処理において、入力側では入力された映像信
号に同期した動作を行い、出力側ではその同期タイミン
グとは異なる独立した同期タイミングで映像信号を処理
する。
独立して設けられた読み出し用同期処理回路であり、こ
れが前記原画像信号のリフレッシュレートに同期したタ
イミングにて、前記メモリ１５に記憶されている信号を
読み出し、この信号をプラズマモジュール１６へ出力さ
せるように機能する。つまり、フィルムソースの２−３
プルダウン処理において、入力側では入力された映像信
号に同期した動作を行い、出力側ではその同期タイミン
グとは異なる独立した同期タイミングで映像信号を処理
する。
【００１８】かかる映像表示装置では、外部から入力さ
れた、図３（ａ）に示すようなフィルムソースの信号Ｌ
にもとづいて得た映像信号を、アナログ／ディジタル変
換回路１２で、図３（ｂ）に示すような形態のディジタ
ル信号Ｍに変換し、このディジタル信号Ｍに変換された
映像信号は、テレシネ判定回路１２に入力されてテレシ
ネ信号であるか否かが判定され、テレシネ信号であると
判定されると、ここでさらにテレシネ変換前の原画像の
リフレッシュレートを算出する。
れた、図３（ａ）に示すようなフィルムソースの信号Ｌ
にもとづいて得た映像信号を、アナログ／ディジタル変
換回路１２で、図３（ｂ）に示すような形態のディジタ
ル信号Ｍに変換し、このディジタル信号Ｍに変換された
映像信号は、テレシネ判定回路１２に入力されてテレシ
ネ信号であるか否かが判定され、テレシネ信号であると
判定されると、ここでさらにテレシネ変換前の原画像の
リフレッシュレートを算出する。
【００１９】さらに、ＩＰ変換回路１３では、そのリフ
レッシュレートを参照して２−３プルダウン処理を行
い、その処理結果が、同期処理回路１４Ａが発生するタ
イミングに従ってメモリ１５に記憶される。このメモリ
１５に記憶される信号Ｎは、図３（ｃ）に示す通りであ
る。続いて、前記テレンネ判定回路１２にて算出された
原画像のリフレッシュレートにもとづいて、読み出し用
同期処理回路１７が発生する読み出しタイミングに従っ
て、前記メモリ１５の読み出しが行われ、読み出された
映像信号Ｐがプラズマモジュール１６に入力されて画像
表示される。
レッシュレートを参照して２−３プルダウン処理を行
い、その処理結果が、同期処理回路１４Ａが発生するタ
イミングに従ってメモリ１５に記憶される。このメモリ
１５に記憶される信号Ｎは、図３（ｃ）に示す通りであ
る。続いて、前記テレンネ判定回路１２にて算出された
原画像のリフレッシュレートにもとづいて、読み出し用
同期処理回路１７が発生する読み出しタイミングに従っ
て、前記メモリ１５の読み出しが行われ、読み出された
映像信号Ｐがプラズマモジュール１６に入力されて画像
表示される。
【００２０】ここで、読み出し用同期処理回路１７のリ
フレッシュレートは、図３（ａ）に示す原画像のリフレ
ッシュレート（フィルムソースの原画像における単位時
間当りのコマ数）の整数倍を設定することが可能であ
り、この実施の形態では、例えば図３（ｄ）に示すよう
に、読み出し用同期処理回路１７のリフレッシュレート
を原画像のリフレッシュレートの３倍、すなわち１／７
２秒に設定している。このようにして、読み出されたメ
モリ１５から読み出された映像信号はプラズマモジュー
ル１６に入力されて、画像表示が行われる。
フレッシュレートは、図３（ａ）に示す原画像のリフレ
ッシュレート（フィルムソースの原画像における単位時
間当りのコマ数）の整数倍を設定することが可能であ
り、この実施の形態では、例えば図３（ｄ）に示すよう
に、読み出し用同期処理回路１７のリフレッシュレート
を原画像のリフレッシュレートの３倍、すなわち１／７
２秒に設定している。このようにして、読み出されたメ
モリ１５から読み出された映像信号はプラズマモジュー
ル１６に入力されて、画像表示が行われる。
【００２１】
【発明の効果】以上のように、本発明によれば、ＩＰ変
換された信号を記憶しているメモリから、読み出し用同
期処理回路に、原画像信号のリフレッシュレートの同期
したタイミングにて読み出しを行わせて、その読み出し
た映像信号を表示器に表示させるようにしたので、フィ
ルムソースの動画再生時にも画像のガタつきがなく、滑
らかな映像表示を行えるという効果が得られる。
換された信号を記憶しているメモリから、読み出し用同
期処理回路に、原画像信号のリフレッシュレートの同期
したタイミングにて読み出しを行わせて、その読み出し
た映像信号を表示器に表示させるようにしたので、フィ
ルムソースの動画再生時にも画像のガタつきがなく、滑
らかな映像表示を行えるという効果が得られる。
【図１】 本発明の実施の一形態による映像表示装置を
示すブロック図である。
示すブロック図である。
【図２】 従来の映像表示装置を示すブロック図であ
る。
る。
【図３】 図１および図２のブロック各部の信号波形を
示すタイミングチャートである。
示すタイミングチャートである。
１１ アナログ／ディジタル変換回路（Ａ／Ｄ変換回
路） １２ テレシネ判別回路 １３ ＩＰ変換回路（インタレース／プログレッシブ変
換回路） １５ メモリ １６ プラズマモジュール（表示器） １７ 読み出し用同期処理回路。
路） １２ テレシネ判別回路 １３ ＩＰ変換回路（インタレース／プログレッシブ変
換回路） １５ メモリ １６ プラズマモジュール（表示器） １７ 読み出し用同期処理回路。
Claims (4)
- 【請求項１】 外部から入力された映像信号をディジタ
ル信号に変換するアナログ／ディジタル変換回路と、デ
ィジタル変換された前記映像信号がテレシネ信号にもと
づく信号であるか否かを判定するとともに、前記映像信
号への変換前における原画像信号のリフレッシュレート
を算出するテレシネ判別回路と、前記テレシネ信号と判
定された信号に対して２−３プルダウンを行うインタレ
ース／プログレッシブ変換回路と、インタレース／プロ
グレッシブ変換された信号を記憶するメモリと、前記原
画像信号のリフレッシュレートに同期したタイミングに
て前記メモリから信号を読み出して表示器へ出力させる
読み出し用同期処理回路とを備えたことを特徴とする映
像表示装置。 - 【請求項２】 前記メモリ読み出し用同期処理回路によ
るリフレッシュレートが、前記原画像信号のリフレッシ
ュレートの整数倍に設定されることを特徴とする請求項
１に記載の映像表示装置。 - 【請求項３】 前記インタレース／プログレッシブ変換
された信号が、前記映像信号の入力タイミングに同期し
て前記メモリに記憶されることを特徴とする請求項１に
記載の映像表示装置。 - 【請求項４】 前記２−３プルダウンが前記映像信号の
入力タイミングに同期して実行されることを特徴とする
請求項１に記載の映像表示装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000147020A JP2001333391A (ja) | 2000-05-18 | 2000-05-18 | 映像表示装置 |
| US09/855,618 US20010043207A1 (en) | 2000-05-18 | 2001-05-16 | Image display device |
| EP01112248A EP1156675A3 (en) | 2000-05-18 | 2001-05-18 | Image display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000147020A JP2001333391A (ja) | 2000-05-18 | 2000-05-18 | 映像表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001333391A true JP2001333391A (ja) | 2001-11-30 |
Family
ID=18653266
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000147020A Pending JP2001333391A (ja) | 2000-05-18 | 2000-05-18 | 映像表示装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US20010043207A1 (ja) |
| EP (1) | EP1156675A3 (ja) |
| JP (1) | JP2001333391A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7142245B2 (en) | 2002-11-07 | 2006-11-28 | Seiko Epson Corporation | Conversion of frame rate according to image date |
| JP2009060401A (ja) * | 2007-08-31 | 2009-03-19 | Sony Corp | 画像表示装置および画像処理装置 |
| US8339442B2 (en) | 2009-05-12 | 2012-12-25 | Panasonic Corporation | Image conversion method and image conversion apparatus |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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