JP2001297589A - フラッシュメモリ書換え制御方法 - Google Patents
フラッシュメモリ書換え制御方法Info
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- JP2001297589A JP2001297589A JP2000110285A JP2000110285A JP2001297589A JP 2001297589 A JP2001297589 A JP 2001297589A JP 2000110285 A JP2000110285 A JP 2000110285A JP 2000110285 A JP2000110285 A JP 2000110285A JP 2001297589 A JP2001297589 A JP 2001297589A
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- JP
- Japan
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- sector
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- writing
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Abstract
(57)【要約】
【課題】 フラッシュメモリのセクタ消去、データ書込
みに時間がかかっている。フラッシュメモリを備えた組
込みシステムにおいて、セクタ消去時間及びデータ書込
み時間を短縮できるフラッシュメモリ書換え制御方法を
提供することを目的としている。 【解決手段】 データを書込む前の消去された状態の値
と同じデータを書込む際に、そのまま書込まず、書込み
シーケンスをスキップすることによって、データ書込み
時間を短縮することが出来る。また、フラッシュメモリ
への書込み状態を管理することにより、必要最低限のセ
クタを消去することにより、セクタ消去時間を節約でき
る。
みに時間がかかっている。フラッシュメモリを備えた組
込みシステムにおいて、セクタ消去時間及びデータ書込
み時間を短縮できるフラッシュメモリ書換え制御方法を
提供することを目的としている。 【解決手段】 データを書込む前の消去された状態の値
と同じデータを書込む際に、そのまま書込まず、書込み
シーケンスをスキップすることによって、データ書込み
時間を短縮することが出来る。また、フラッシュメモリ
への書込み状態を管理することにより、必要最低限のセ
クタを消去することにより、セクタ消去時間を節約でき
る。
Description
【０００１】
【発明の属する技術分野】本発明は、フラッシュメモリ
を備えたマイクロプロセッサ組込み装置におけるフラッ
シュメモリ書換え制御方法に関するものである。
を備えたマイクロプロセッサ組込み装置におけるフラッ
シュメモリ書換え制御方法に関するものである。
【０００２】
【従来の技術】フラッシュメモリは、電気的に書換え可
能なＥＥＰＲＯＭの一種で、データを書込む前に、書込
む領域の消去処理が必要である。データを消去するに
は、セクタと呼ばれる複数の論理的な小領域単位で、ひ
とつずつ消去していくセクタ消去処理により、以前書込
まれたデータに対してセクタ消去を行い、その後、全て
のデータを書込んでいく。
能なＥＥＰＲＯＭの一種で、データを書込む前に、書込
む領域の消去処理が必要である。データを消去するに
は、セクタと呼ばれる複数の論理的な小領域単位で、ひ
とつずつ消去していくセクタ消去処理により、以前書込
まれたデータに対してセクタ消去を行い、その後、全て
のデータを書込んでいく。
【０００３】以下、図面を参照して従来方法を説明す
る。図６は従来のフラッシュメモリのメモリイメージを
示した図、図７は従来のフラッシュメモリのセクタイメ
ージを示した図、図８は従来のフラッシュメモリのデー
タ書込みフローチャート、図９は従来のフラッシュメモ
リのセクタ消去フローチャートである。
る。図６は従来のフラッシュメモリのメモリイメージを
示した図、図７は従来のフラッシュメモリのセクタイメ
ージを示した図、図８は従来のフラッシュメモリのデー
タ書込みフローチャート、図９は従来のフラッシュメモ
リのセクタ消去フローチャートである。
【０００４】図６において、従来は、全てのデータを書
込むために、書込みシーケンスを（１〜８）までのデー
タ数分すべて行っていた。図８において、データ書込み
処理では、まず、カウンタを０で初期化する（ステップ
１）。１バイトずつ書込みシーケンスを行う（ステップ
２）。次に、カウンタを１カウントアップする（ステッ
プ３）。カウンタが８になったか判定し、８なら終了、
８より小さければ、ステップ２へ戻る（ステップ４）。
込むために、書込みシーケンスを（１〜８）までのデー
タ数分すべて行っていた。図８において、データ書込み
処理では、まず、カウンタを０で初期化する（ステップ
１）。１バイトずつ書込みシーケンスを行う（ステップ
２）。次に、カウンタを１カウントアップする（ステッ
プ３）。カウンタが８になったか判定し、８なら終了、
８より小さければ、ステップ２へ戻る（ステップ４）。
【０００５】また図７において、従来は、２番目以降の
全セクタ（１８〜２１）を消去してから、データ書込み
を行っていた。図９において、セクタ消去処理では、ま
ず、カウンタを１で初期化する（ステップ１０）。１セ
クタずつ消去シーケンスを行う（ステップ１１）。次
に、カウンタを１カウントアップする（ステップ１
２）。カウンタが５になったか判定し、５なら終了、５
より小さければ、ステップ１１へ戻る（ステップ１
３）。
全セクタ（１８〜２１）を消去してから、データ書込み
を行っていた。図９において、セクタ消去処理では、ま
ず、カウンタを１で初期化する（ステップ１０）。１セ
クタずつ消去シーケンスを行う（ステップ１１）。次
に、カウンタを１カウントアップする（ステップ１
２）。カウンタが５になったか判定し、５なら終了、５
より小さければ、ステップ１１へ戻る（ステップ１
３）。
【０００６】
【発明が解決しようとする課題】しかしながら、従来の
技術では、書込むデータの値にかかわらず、全てのデー
タを書込んでいたので、データ数に比例した書き込み時
間がかかっていた。また、書換えを行う領域（セクタ）
の消去も書き換えるデータにかかわらず、書き換える全
てのセクタを消去して、消去に時間がかかっていた。
技術では、書込むデータの値にかかわらず、全てのデー
タを書込んでいたので、データ数に比例した書き込み時
間がかかっていた。また、書換えを行う領域（セクタ）
の消去も書き換えるデータにかかわらず、書き換える全
てのセクタを消去して、消去に時間がかかっていた。
【０００７】本発明は上記従来の問題点を解決するもの
で，データ書込みのスキップと書込まれたデータの管理
により、必要最低限のセクタ消去を行うことができるよ
うにしたフラッシュメモリ書換え制御方法を提供するこ
とを目的としている。
で，データ書込みのスキップと書込まれたデータの管理
により、必要最低限のセクタ消去を行うことができるよ
うにしたフラッシュメモリ書換え制御方法を提供するこ
とを目的としている。
【０００８】
【課題を解決するための手段】上記課題を解決するため
に本発明は、フラッシュメモリを備えた組込みシステム
において、データを書込む前の消去された状態の値と同
じデータを書込む際に、そのまま書込まず、書込みシー
ケンスをスキップするようにした。
に本発明は、フラッシュメモリを備えた組込みシステム
において、データを書込む前の消去された状態の値と同
じデータを書込む際に、そのまま書込まず、書込みシー
ケンスをスキップするようにした。
【０００９】本発明によれば、データ書込みのスキップ
と書込まれたデータの管理により、必要最低限のセクタ
消去を行うことができるようにしたフラッシュメモリ書
換え制御方法を実現できる。
と書込まれたデータの管理により、必要最低限のセクタ
消去を行うことができるようにしたフラッシュメモリ書
換え制御方法を実現できる。
【００１０】
【発明の実施の形態】請求項１に記載の発明は、フラッ
シュメモリを備えた組込みシステムにおいて、データを
書込む前の消去された状態の値と同じデータを書込む際
に、そのまま書込まず、書込みシーケンスをスキップす
るものであり、これによりフラッシュメモリに書込むデ
ータをフラッシュメモリを消去したときの値と比較し、
同じであれば、書込みシーケンスをスキップし、データ
書込み時間を短縮できる。
シュメモリを備えた組込みシステムにおいて、データを
書込む前の消去された状態の値と同じデータを書込む際
に、そのまま書込まず、書込みシーケンスをスキップす
るものであり、これによりフラッシュメモリに書込むデ
ータをフラッシュメモリを消去したときの値と比較し、
同じであれば、書込みシーケンスをスキップし、データ
書込み時間を短縮できる。
【００１１】請求項２に記載の発明は、請求項１記載の
発明において、フラッシュメモリへの書込み状態を管理
することにより、必要最低限のセクタを消去するもので
あり、これにより書込まれたデータを管理し、必要最低
限のセクタ消去だけを行うことにより、データ消去時間
を短縮できる。
発明において、フラッシュメモリへの書込み状態を管理
することにより、必要最低限のセクタを消去するもので
あり、これにより書込まれたデータを管理し、必要最低
限のセクタ消去だけを行うことにより、データ消去時間
を短縮できる。
【００１２】以下、本発明の実施の形態について説明す
る。図１は本発明の一実施の形態におけるフラッシュメ
モリのメモリイメージを示した図、図２は本発明の一実
施の形態におけるフラッシュメモリのセクタイメージを
示した図、図３は本発明の一実施の形態におけるフラッ
シュメモリのセクタ管理情報のイメージを示した図、図
４は本発明の一実施の形態におけるフラッシュメモリの
データ書込みフローチャート、図５は本発明の一実施の
形態におけるフラッシュメモリのセクタ消去フローチャ
ートである。
る。図１は本発明の一実施の形態におけるフラッシュメ
モリのメモリイメージを示した図、図２は本発明の一実
施の形態におけるフラッシュメモリのセクタイメージを
示した図、図３は本発明の一実施の形態におけるフラッ
シュメモリのセクタ管理情報のイメージを示した図、図
４は本発明の一実施の形態におけるフラッシュメモリの
データ書込みフローチャート、図５は本発明の一実施の
形態におけるフラッシュメモリのセクタ消去フローチャ
ートである。
【００１３】便宜上、メモリを１バイト構成の８つの領
域からなり、１バイトずつデータ書込みを行うこととす
る。図６の従来の方法では、全てのデータを書込むため
に、書込みシーケンスを（１〜８）までのデータ数分す
べて行っていた。一方、図１の本発明では、セクタが消
去された時の値（０ｘＦＦ）と同じ値のデータを書込も
うとしたとき（１０，１５，１６）は、書込みシーケン
スをスキップする。よって、スキップしたデータの分だ
け、書込みシーケンスを行う回数を減らすことができ
る。つまり、書込みシーケンスを減らした分だけ、デー
タ書込み時間を短縮できることになる。
域からなり、１バイトずつデータ書込みを行うこととす
る。図６の従来の方法では、全てのデータを書込むため
に、書込みシーケンスを（１〜８）までのデータ数分す
べて行っていた。一方、図１の本発明では、セクタが消
去された時の値（０ｘＦＦ）と同じ値のデータを書込も
うとしたとき（１０，１５，１６）は、書込みシーケン
スをスキップする。よって、スキップしたデータの分だ
け、書込みシーケンスを行う回数を減らすことができ
る。つまり、書込みシーケンスを減らした分だけ、デー
タ書込み時間を短縮できることになる。
【００１４】図４に本発明のデータ書込み処理のフロー
チャートを示す。本発明のデータ書込み処理では、カウ
ンタを０で初期化する（ステップ５）。次に、書込むデ
ータがセクタが消去された時の値０ｘＦＦかどうか判定
する。データが０ｘＦＦならステップ８へ、それ以外な
らステップ７へ移行する（ステップ６）。１バイトずつ
書込みシーケンスを行う（ステップ７）。次に、カウン
タを１カウントアップする（ステップ８）。カウンタが
８になったか判定し、８なら終了、８より小さければ、
ステップ６へ戻る（ステップ９）。
チャートを示す。本発明のデータ書込み処理では、カウ
ンタを０で初期化する（ステップ５）。次に、書込むデ
ータがセクタが消去された時の値０ｘＦＦかどうか判定
する。データが０ｘＦＦならステップ８へ、それ以外な
らステップ７へ移行する（ステップ６）。１バイトずつ
書込みシーケンスを行う（ステップ７）。次に、カウン
タを１カウントアップする（ステップ８）。カウンタが
８になったか判定し、８なら終了、８より小さければ、
ステップ６へ戻る（ステップ９）。
【００１５】次に、セクタ消去について説明する。フラ
ッシュメモリは、メモリ全領域をセクタと呼ばれる複数
の論理的な領域に分かれており、セクタ毎の消去処理を
行うことができる。よって、データを書き換える際は、
書込み開始アドレス以降のセクタを全て消去してから、
書込みを行っていた。
ッシュメモリは、メモリ全領域をセクタと呼ばれる複数
の論理的な領域に分かれており、セクタ毎の消去処理を
行うことができる。よって、データを書き換える際は、
書込み開始アドレス以降のセクタを全て消去してから、
書込みを行っていた。
【００１６】そこで、データがどのセクタに書込まれる
かという情報を管理することにより、次にデータを書き
換える際に、消去すべきセクタだけを見つけ出し、その
セクタだけを消去することにより、セクタ消去処理シー
ケンスの回数を削減することができる。
かという情報を管理することにより、次にデータを書き
換える際に、消去すべきセクタだけを見つけ出し、その
セクタだけを消去することにより、セクタ消去処理シー
ケンスの回数を削減することができる。
【００１７】図２にセクタ消去を説明するために、セク
タイメージ図を示す。例えば、５個のセクタに分かれた
フラッシュメモリがあり、３番目（１９、２４）、５番
目（２１、２６）のセクタには、何もデータが書かれて
いなかったとする。次に、データを２番目（１８、２
３）のセクタから、書き出すこととする。図７の従来の
方法では、２番目以降の全セクタ（１８〜２１）を消去
してから、データ書込みを行っていた。一方、図２で
は、３番目（２４）、５番目（２６）のセクタにデータ
が書かれていないことを管理しているので、消去するセ
クタは、２番目（２３）以降のセクタで、３番目（２
４）、５番目（２６）を除いたセクタの消去を行うので
ある。そこで、セクタ消去２回分の処理シーケンスを節
約し、処理時間を短縮を行うことができる。
タイメージ図を示す。例えば、５個のセクタに分かれた
フラッシュメモリがあり、３番目（１９、２４）、５番
目（２１、２６）のセクタには、何もデータが書かれて
いなかったとする。次に、データを２番目（１８、２
３）のセクタから、書き出すこととする。図７の従来の
方法では、２番目以降の全セクタ（１８〜２１）を消去
してから、データ書込みを行っていた。一方、図２で
は、３番目（２４）、５番目（２６）のセクタにデータ
が書かれていないことを管理しているので、消去するセ
クタは、２番目（２３）以降のセクタで、３番目（２
４）、５番目（２６）を除いたセクタの消去を行うので
ある。そこで、セクタ消去２回分の処理シーケンスを節
約し、処理時間を短縮を行うことができる。
【００１８】図５に本発明のセクタ消去処理のフローチ
ャートを示す。本発明のセクタ消去処理では、カウンタ
を１で初期化する（ステップ１４）。次に、カウンタ値
の示すセクタにデータが書込まれているかどうか判定す
る。データ書込みなし（ＥＭＰＴＹ）なら、ステップ１
７へ、それ以外なら、ステップ１６へ移行する（ステッ
プ１５）。１セクタずつ消去シーケンスを行う（ステッ
プ１６）。次に、カウンタを１カウントアップする（ス
テップ１７）。カウンタが５になったか判定し、５なら
終了、５より小さければ、ステップ１５へ戻る（ステッ
プ１８）。
ャートを示す。本発明のセクタ消去処理では、カウンタ
を１で初期化する（ステップ１４）。次に、カウンタ値
の示すセクタにデータが書込まれているかどうか判定す
る。データ書込みなし（ＥＭＰＴＹ）なら、ステップ１
７へ、それ以外なら、ステップ１６へ移行する（ステッ
プ１５）。１セクタずつ消去シーケンスを行う（ステッ
プ１６）。次に、カウンタを１カウントアップする（ス
テップ１７）。カウンタが５になったか判定し、５なら
終了、５より小さければ、ステップ１５へ戻る（ステッ
プ１８）。
【００１９】図３にセクタ管理情報のイメージ図を示
す。セクタ管理情報（３２〜３６）は、次にフラッシュ
メモリを書き換える際に、どのセクタがデータとして使
用されていて、どのセクタが空きなのかを示す情報であ
る。すべてのセクタに対して、初期値は、空きである。
フラッシュメモリが書き換えられる際に、データが書込
まれたアドレスから使用されたセクタ番号（２７〜３
１）を判定し、対応したセクタ番号のセクタ情報にデー
タありを示すデータを書込む。
す。セクタ管理情報（３２〜３６）は、次にフラッシュ
メモリを書き換える際に、どのセクタがデータとして使
用されていて、どのセクタが空きなのかを示す情報であ
る。すべてのセクタに対して、初期値は、空きである。
フラッシュメモリが書き換えられる際に、データが書込
まれたアドレスから使用されたセクタ番号（２７〜３
１）を判定し、対応したセクタ番号のセクタ情報にデー
タありを示すデータを書込む。
【００２０】
【発明の効果】以上のように本発明によれば、フラッシ
ュメモリ書込み時間、セクタ消去時間を短縮することが
できる。
ュメモリ書込み時間、セクタ消去時間を短縮することが
できる。
【図１】本発明の一実施の形態におけるフラッシュメモ
リのメモリイメージを示した図
リのメモリイメージを示した図
【図２】本発明の一実施の形態におけるフラッシュメモ
リのセクタイメージを示した図
リのセクタイメージを示した図
【図３】本発明の一実施の形態におけるフラッシュメモ
リのセクタ管理情報のイメージを示した図
リのセクタ管理情報のイメージを示した図
【図４】本発明の一実施の形態におけるフラッシュメモ
リのデータ書込みフローチャート
リのデータ書込みフローチャート
【図５】本発明の一実施の形態におけるフラッシュメモ
リのセクタ消去フローチャート
リのセクタ消去フローチャート
【図６】従来のフラッシュメモリのメモリイメージを示
した図
した図
【図７】従来のフラッシュメモリのセクタイメージを示
した図
した図
【図８】従来のフラッシュメモリのデータ書込みフロー
チャート
チャート
【図９】従来のフラッシュメモリのセクタ消去フローチ
ャート
ャート
１、９ フラッシュメモリ第１番地 ２、１０ フラッシュメモリ第２番地 ３、１１ フラッシュメモリ第３番地 ４、１２ フラッシュメモリ第４番地 ５、１３ フラッシュメモリ第５番地 ６、１４ フラッシュメモリ第６番地 ７、１５ フラッシュメモリ第７番地 ８、１６ フラッシュメモリ第８番地 １７、２２ フラッシュメモリ第１セクタ １８、２３ フラッシュメモリ第２セクタ １９、２４ フラッシュメモリ第３セクタ ２０、２５ フラッシュメモリ第４セクタ ２１、２６ フラッシュメモリ第５セクタ ２７ フラッシュメモリセクタ管理情報セクタ番号１ ２８ フラッシュメモリセクタ管理情報セクタ番号２ ２９ フラッシュメモリセクタ管理情報セクタ番号３ ３０ フラッシュメモリセクタ管理情報セクタ番号４ ３１ フラッシュメモリセクタ管理情報セクタ番号５ ３２ フラッシュメモリセクタ管理情報セクタ番号１セ
クタ情報 ３３ フラッシュメモリセクタ管理情報セクタ番号２セ
クタ情報 ３４ フラッシュメモリセクタ管理情報セクタ番号３セ
クタ情報 ３５ フラッシュメモリセクタ管理情報セクタ番号４セ
クタ情報 ３６ フラッシュメモリセクタ管理情報セクタ番号５セ
クタ情報
クタ情報 ３３ フラッシュメモリセクタ管理情報セクタ番号２セ
クタ情報 ３４ フラッシュメモリセクタ管理情報セクタ番号３セ
クタ情報 ３５ フラッシュメモリセクタ管理情報セクタ番号４セ
クタ情報 ３６ フラッシュメモリセクタ管理情報セクタ番号５セ
クタ情報
Claims (2)
- 【請求項１】フラッシュメモリを備えた組込みシステム
において、データを書込む前の消去された状態の値と同
じデータを書込む際に、そのまま書込まず、書込みシー
ケンスをスキップすることを特徴とするフラッシュメモ
リ書換え制御方法。 - 【請求項２】フラッシュメモリへの書込み状態を管理す
ることにより、必要最低限のセクタを消去することを特
徴とする請求項１記載のフラッシュメモリ書換え制御方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000110285A JP2001297589A (ja) | 2000-04-12 | 2000-04-12 | フラッシュメモリ書換え制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000110285A JP2001297589A (ja) | 2000-04-12 | 2000-04-12 | フラッシュメモリ書換え制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001297589A true JP2001297589A (ja) | 2001-10-26 |
Family
ID=18622823
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000110285A Pending JP2001297589A (ja) | 2000-04-12 | 2000-04-12 | フラッシュメモリ書換え制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2001297589A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003228513A (ja) * | 2001-11-28 | 2003-08-15 | Access:Kk | メモリ制御方法および装置 |
| JP2007294105A (ja) * | 2007-07-09 | 2007-11-08 | Renesas Technology Corp | マイクロコンピュータ |
-
2000
- 2000-04-12 JP JP2000110285A patent/JP2001297589A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003228513A (ja) * | 2001-11-28 | 2003-08-15 | Access:Kk | メモリ制御方法および装置 |
| JP2007294105A (ja) * | 2007-07-09 | 2007-11-08 | Renesas Technology Corp | マイクロコンピュータ |
| JP4666394B2 (ja) * | 2007-07-09 | 2011-04-06 | ルネサスエレクトロニクス株式会社 | データ処理装置 |
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