JP2001155441A5 - - Google Patents

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【請求項１】 パーシャルレスポンスの波形に等化された入力信号を量子化するＡ／Ｄコンバータと、
前記Ａ／Ｄコンバータへの入力信号の波形のパターンを検出するパターン検出器を有し、このパターン検出器の検出結果に基づいて前記Ａ／Ｄコンバータの出力データから位相誤差を抽出する位相誤差検出回路とを備え、
前記位相誤差検出回路から出力される位相誤差を前記Ａ／Ｄコンバータに帰還して位相同期を行うことを特徴とするＰＬＬ回路。
【請求項５】 記録媒体から読み取った信号をパーシャルレスポンスの波形に等化する等化器と、
前記等化器によってパーシャルレスポンスの波形に等化された信号を量子化するＡ／Ｄコンバータと、
前記Ａ／Ｄコンバータへの入力信号の波形のパターンを検出するパターン検出器を有し、このパターン検出器の検出結果に基づいて前記Ａ／Ｄコンバータの出力データから位相誤差を抽出する位相誤差検出回路を有し、前記位相誤差検出回路から出力される位相誤差を前記Ａ／Ｄコンバータに帰還して位相同期を行うＰＬＬ回路と
を具備することを特徴とする記録情報再生装置。
【００１１】
【課題を解決するための手段】
本発明によるＰＬＬ回路は、パーシャルレスポンスの波形に等化された入力信号を量子化するＡ／Ｄコンバータと、このＡ／Ｄコンバータへの入力信号の波形のパターンを検出するパターン検出器を有し、このパターン検出器の検出結果に基づいてＡ／Ｄコンバータの出力データから位相誤差を抽出する位相誤差検出回路とを備え、この位相誤差検出回路から出力される位相誤差をＡ／Ｄコンバータに帰還して位相同期を行う構成となっている。
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