JP2001036920A - 撮像装置及びそれを用いた撮像システム - Google Patents
撮像装置及びそれを用いた撮像システムInfo
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- JP2001036920A JP2001036920A JP11206516A JP20651699A JP2001036920A JP 2001036920 A JP2001036920 A JP 2001036920A JP 11206516 A JP11206516 A JP 11206516A JP 20651699 A JP20651699 A JP 20651699A JP 2001036920 A JP2001036920 A JP 2001036920A
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- Color Television Image Signal Generators (AREA)
Abstract
(57)【要約】
【課題】 動画における高い読み出し速度を必要とせ
ず、なお且つ間引きによる画像劣化を避ける。 【解決手段】 複数色の信号を出力する複数の画素と、
水平方向４画素及び垂直方向４画素の１６画素を１グル
ープとし、該グループから加算走査により複数の色信号
を読み出す読み出し手段とを備え、読み出し手段は、加
算前の各色の空間的色配列と、加算後の各色の空間的色
配列が同じになるように複数の画素の信号を加算する。
ず、なお且つ間引きによる画像劣化を避ける。 【解決手段】 複数色の信号を出力する複数の画素と、
水平方向４画素及び垂直方向４画素の１６画素を１グル
ープとし、該グループから加算走査により複数の色信号
を読み出す読み出し手段とを備え、読み出し手段は、加
算前の各色の空間的色配列と、加算後の各色の空間的色
配列が同じになるように複数の画素の信号を加算する。
Description
【０００１】
【発明の属する技術分野】本発明は撮像装置及びそれを
用いた撮像システムに係り、特に複数の画素に複数色の
色フィルターが対応して配された撮像素子を備えた撮像
装置及びそれを用いた撮像システムに関する。
用いた撮像システムに係り、特に複数の画素に複数色の
色フィルターが対応して配された撮像素子を備えた撮像
装置及びそれを用いた撮像システムに関する。
【０００２】
【従来の技術】カラーフィルターを有した固体撮像素子
は動画を撮影するビデオカメラや静止画を撮影する電子
スチルカメラ等、各種映像機器で利用されている。
は動画を撮影するビデオカメラや静止画を撮影する電子
スチルカメラ等、各種映像機器で利用されている。
【０００３】近年、半導体技術の進歩により数百万画素
の撮像素子が開発され、高解像度が要求される電子スチ
ルカメラ等において実用化されているが、画素数がその
ような数百万画素を越える高解像度のカメラであって
も、動画（必ずしも高解像度である必要はない）を撮影
できることが要求される場合がある。しかしながら、そ
のような高解像度のカメラは静止画用であり、動画を撮
影することは困難である。これは画素数が多くなればそ
れに比例して撮像素子の信号を読み出すのに要する時間
が増大してしまうことによる。
の撮像素子が開発され、高解像度が要求される電子スチ
ルカメラ等において実用化されているが、画素数がその
ような数百万画素を越える高解像度のカメラであって
も、動画（必ずしも高解像度である必要はない）を撮影
できることが要求される場合がある。しかしながら、そ
のような高解像度のカメラは静止画用であり、動画を撮
影することは困難である。これは画素数が多くなればそ
れに比例して撮像素子の信号を読み出すのに要する時間
が増大してしまうことによる。
【０００４】この問題を解決するために従来、動画を撮
影する場合には、撮像素子の信号の読み出し周波数を静
止画の場合より高くしたり、撮像素子の信号を間引く等
により実質的に画素数を少なくして読み出す技術が提案
されていた。
影する場合には、撮像素子の信号の読み出し周波数を静
止画の場合より高くしたり、撮像素子の信号を間引く等
により実質的に画素数を少なくして読み出す技術が提案
されていた。
【０００５】
【発明が解決しようとする課題】しかしながら、上記の
撮像素子の信号の読み出し周波数を切り替えて高い周波
数で読み出す技術では、要求される解像度が高くなり駆
動周波数が高くなると回路の応答性や消費電力等の実用
化の上で多くの課題がある。
撮像素子の信号の読み出し周波数を切り替えて高い周波
数で読み出す技術では、要求される解像度が高くなり駆
動周波数が高くなると回路の応答性や消費電力等の実用
化の上で多くの課題がある。
【０００６】また、動画に必要な画素だけ間引いて読み
出した場合、実際の情報が欠落するので必ずしもきれい
な画像は得られない。
出した場合、実際の情報が欠落するので必ずしもきれい
な画像は得られない。
【０００７】本発明は、上述したような従来技術の問題
点に着目したものであり、高精細の静止画に関しては高
画素のセンサーを全画素で読み出し、動画に関しては画
素を加算して読み出し、動画における高い読み出し速度
を必要とせず、なお且つ間引きによる画像劣化を避ける
ことができる撮像装置及び撮像システムを提供すること
を目的とする。
点に着目したものであり、高精細の静止画に関しては高
画素のセンサーを全画素で読み出し、動画に関しては画
素を加算して読み出し、動画における高い読み出し速度
を必要とせず、なお且つ間引きによる画像劣化を避ける
ことができる撮像装置及び撮像システムを提供すること
を目的とする。
【０００８】
【課題を解決するための手段】本発明の撮像装置は、複
数色の信号を出力する複数の画素と、水平方向４画素及
び垂直方向４画素の１６画素を１グループとし、該グル
ープから加算走査により複数の色信号を読み出す読み出
し手段とを備え、前記読み出し手段は、加算前の各色の
空間的色配列と、加算後の各色の空間的色配列が同じに
なるように複数の画素の信号を加算することを特徴とす
るものである。
数色の信号を出力する複数の画素と、水平方向４画素及
び垂直方向４画素の１６画素を１グループとし、該グル
ープから加算走査により複数の色信号を読み出す読み出
し手段とを備え、前記読み出し手段は、加算前の各色の
空間的色配列と、加算後の各色の空間的色配列が同じに
なるように複数の画素の信号を加算することを特徴とす
るものである。
【０００９】また本発明の撮像装置は、所定の基本色配
列を持つ複数の画素からなる構成要素を複数配列した画
素部と、前記構成要素のそれぞれから複数色の信号を読
み出し、同じ構成要素内又は／及び異なる構成要素間で
同一色毎に加算走査する読み出し手段とを備え、前記読
み出し手段は、加算前の各色の空間的色配列と、加算後
の各色の空間的色配列が同じになるように複数の画素の
信号を加算することを特徴とするものである。
列を持つ複数の画素からなる構成要素を複数配列した画
素部と、前記構成要素のそれぞれから複数色の信号を読
み出し、同じ構成要素内又は／及び異なる構成要素間で
同一色毎に加算走査する読み出し手段とを備え、前記読
み出し手段は、加算前の各色の空間的色配列と、加算後
の各色の空間的色配列が同じになるように複数の画素の
信号を加算することを特徴とするものである。
【００１０】また本発明の撮像装置は、所定の基本色配
列を持つ複数の画素からなる構成要素を複数配列した画
素部と、複数の画素の信号を加算走査して、複数色の信
号を読み出す読み出し手段とを備え、前記読み出し手段
は、加算前の各色の空間的色配列と、加算後の各色の空
間的色配列が同じになるように複数の画素の信号を加算
するとともに、前記複数色の少なくとも１つの色は、斜
め方向に配列された画素のみの信号を加算した色信号で
あることを特徴とするものである。
列を持つ複数の画素からなる構成要素を複数配列した画
素部と、複数の画素の信号を加算走査して、複数色の信
号を読み出す読み出し手段とを備え、前記読み出し手段
は、加算前の各色の空間的色配列と、加算後の各色の空
間的色配列が同じになるように複数の画素の信号を加算
するとともに、前記複数色の少なくとも１つの色は、斜
め方向に配列された画素のみの信号を加算した色信号で
あることを特徴とするものである。
【００１１】本発明の撮像システムは、上記本発明の撮
像装置と、該撮像装置へ光を結像する光学系と、該撮像
装置からの出力信号を処理する信号処理手段とを有する
ことを特徴とするものである。
像装置と、該撮像装置へ光を結像する光学系と、該撮像
装置からの出力信号を処理する信号処理手段とを有する
ことを特徴とするものである。
【００１２】
【実施例】以下、本発明の実施例について図面を用いて
詳細に説明する。
詳細に説明する。
【００１３】図１は、本発明に基づく加算方式の概念図
である。図１（ａ）の１０は加算する前の一般的なベイ
ヤー配列であり、Ｒ，Ｂの間に市松状にＧが配置されて
いるフィルター構成図である。この図１（ａ）を用いて
本発明による加算方式について説明する。ここで、Ｒ，
Ｂの間に市松状にＧが配置されている２×２の４画素
が、基本色配列を持つ１つの構成要素である。そして、
隣接する４つの構成要素を１つのグループとする。ここ
でＧに関してはその構成要素内で斜め２画素を加算す
る。１１は加算するＧ画素を囲ったものである。構成要
素内で、Ｒ，Ｂに関しては基本的にはその構成要素内の
Ｒ，Ｂ画素をそれぞれ選択するだけであるが、近接する
４構成要素間の同色の４画素（１グループ内の同色内の
４画素）を加算する方式を取る。これにより、水平・垂
直の両方向で加算が行われる。１３Ｒは加算するＲ画素
（加算されるＲ画素は○で囲われている）の４画素を点
線で結んだものであり、１３Ｂは加算するＢ画素（加算
されるＢ画素は□で囲われている）の４画素を点線で結
んだものである。図１（ａ）に示されるように、一つの
グループ内で加算されるＧ画素の範囲（１１）、加算さ
れるＲ画素の範囲（１３Ｒ）、加算されるＢ画素の範囲
（１３Ｂ）は空間的に重複している。また、１２は加算
モード上では加算が行われない画素を示しており、この
加算方式では選択されない画素は、点線で示されるＧに
限定されている。このような加算方式を行った結果、図
１（ｂ）に示すように、図１（ａ）と同様の、Ｒ，Ｂの
間に市松状にＧが配置されているベイヤー配列１４とな
り、加算後でもその画素配列は加算する前と同じであ
り、これにより実質の画素数を１／４に落として動画モ
ードとして使用することができる。
である。図１（ａ）の１０は加算する前の一般的なベイ
ヤー配列であり、Ｒ，Ｂの間に市松状にＧが配置されて
いるフィルター構成図である。この図１（ａ）を用いて
本発明による加算方式について説明する。ここで、Ｒ，
Ｂの間に市松状にＧが配置されている２×２の４画素
が、基本色配列を持つ１つの構成要素である。そして、
隣接する４つの構成要素を１つのグループとする。ここ
でＧに関してはその構成要素内で斜め２画素を加算す
る。１１は加算するＧ画素を囲ったものである。構成要
素内で、Ｒ，Ｂに関しては基本的にはその構成要素内の
Ｒ，Ｂ画素をそれぞれ選択するだけであるが、近接する
４構成要素間の同色の４画素（１グループ内の同色内の
４画素）を加算する方式を取る。これにより、水平・垂
直の両方向で加算が行われる。１３Ｒは加算するＲ画素
（加算されるＲ画素は○で囲われている）の４画素を点
線で結んだものであり、１３Ｂは加算するＢ画素（加算
されるＢ画素は□で囲われている）の４画素を点線で結
んだものである。図１（ａ）に示されるように、一つの
グループ内で加算されるＧ画素の範囲（１１）、加算さ
れるＲ画素の範囲（１３Ｒ）、加算されるＢ画素の範囲
（１３Ｂ）は空間的に重複している。また、１２は加算
モード上では加算が行われない画素を示しており、この
加算方式では選択されない画素は、点線で示されるＧに
限定されている。このような加算方式を行った結果、図
１（ｂ）に示すように、図１（ａ）と同様の、Ｒ，Ｂの
間に市松状にＧが配置されているベイヤー配列１４とな
り、加算後でもその画素配列は加算する前と同じであ
り、これにより実質の画素数を１／４に落として動画モ
ードとして使用することができる。
【００１４】図２は本発明に基づく他の加算方式の概念
図である。ここではＧに関しては図１の実施例と同じよ
うに構成要素内での斜め２画素加算である。一方、Ｒ，
Ｂに関してはグループ内の構成要素間で水平方向、垂直
方向の３画素を加算する方式をとる。ここでは、読み出
されない画素には図１のようなＧ（点線で示される）の
画素だけではなく、Ｒ，Ｂの画素も加算されない画素が
できる。図２において、１２Ｇ，１２Ｒ，１２Ｂはよみ
だされないＧ，Ｒ，Ｂ画素を示し、Ｇ，Ｒ，Ｂはそれぞ
れ点線で示されている。この加算方式でも図２（ｂ）に
示すように、図１（ｂ）と同様な、Ｒ，Ｂの間に市松状
にＧが配置されているベイヤー配列１４となる。このよ
うに、Ｇの２画素、Ｒ，Ｂの４画素加算の組み合わせだ
けでなく、Ｇの２画素に対し、Ｒ，Ｂはいくつの画素で
加算してもよい。
図である。ここではＧに関しては図１の実施例と同じよ
うに構成要素内での斜め２画素加算である。一方、Ｒ，
Ｂに関してはグループ内の構成要素間で水平方向、垂直
方向の３画素を加算する方式をとる。ここでは、読み出
されない画素には図１のようなＧ（点線で示される）の
画素だけではなく、Ｒ，Ｂの画素も加算されない画素が
できる。図２において、１２Ｇ，１２Ｒ，１２Ｂはよみ
だされないＧ，Ｒ，Ｂ画素を示し、Ｇ，Ｒ，Ｂはそれぞ
れ点線で示されている。この加算方式でも図２（ｂ）に
示すように、図１（ｂ）と同様な、Ｒ，Ｂの間に市松状
にＧが配置されているベイヤー配列１４となる。このよ
うに、Ｇの２画素、Ｒ，Ｂの４画素加算の組み合わせだ
けでなく、Ｇの２画素に対し、Ｒ，Ｂはいくつの画素で
加算してもよい。
【００１５】図３は図１の加算方式を実現するため概略
的な読み出し回路の回路構成図である。図３において、
１６は図１（ａ）のＲ，Ｇ，Ｂの各画素がベイヤー配列
された画素部である。図３中、上方にＧ画素の信号を読
み出す回路が配され、１７，１８−１は画素部１６のＧ
画素からの信号を読み出すためのトランジスタＴG11〜
ＴG16，ＴG21〜ＴG26、１９−１は画素部１６のＧ画素
から読み出された信号を蓄積するコンデンサＣG1〜ＣG
6、２０−１はコンデンサＣG1〜ＣG6から信号を水平出
力線に出力するためのトランジスタＴG31〜ＴG36、２１
−１，２１−２は出力アンプである。
的な読み出し回路の回路構成図である。図３において、
１６は図１（ａ）のＲ，Ｇ，Ｂの各画素がベイヤー配列
された画素部である。図３中、上方にＧ画素の信号を読
み出す回路が配され、１７，１８−１は画素部１６のＧ
画素からの信号を読み出すためのトランジスタＴG11〜
ＴG16，ＴG21〜ＴG26、１９−１は画素部１６のＧ画素
から読み出された信号を蓄積するコンデンサＣG1〜ＣG
6、２０−１はコンデンサＣG1〜ＣG6から信号を水平出
力線に出力するためのトランジスタＴG31〜ＴG36、２１
−１，２１−２は出力アンプである。
【００１６】また図３中、下方にはＲ，Ｂ画素の信号を
読み出す回路が配され、１８−２は画素部１６のＢ，Ｒ
画素からの信号を読み出すためのトランジスタＴB21，
ＴB22，ＴB25，ＴB26，ＴR23，ＴR24，ＴR27，ＴR28、
１９−２は画素部１６のＲ，Ｂ画素から読み出された信
号を蓄積するコンデンサＣB1，ＣB2，ＣB5，ＣB6，ＣR
3，ＣR4，ＣR7，ＣR8、２０−２はコンデンサＣB1〜ＣR
8から信号を水平出力線に出力するためのトランジスタ
ＴB31，ＴB32，ＴB35，ＴB36，ＴR33，ＴR34，ＴR37，
ＴR38、２２−１，２２−２は出力アンプである。Ｖ１
〜Ｖ４は画素部１６のそれぞれ２水平ラインの画素行を
制御する信号、ＳＷ0〜ＳＷ4はトランジスタ１７を制御
する信号、φTS1，φTS2はトランジスタ１８−１，１８
−２を制御する信号、ｈ11〜ｈ28はトランジスタ２０−
１，２０−２を制御する信号を示す。
読み出す回路が配され、１８−２は画素部１６のＢ，Ｒ
画素からの信号を読み出すためのトランジスタＴB21，
ＴB22，ＴB25，ＴB26，ＴR23，ＴR24，ＴR27，ＴR28、
１９−２は画素部１６のＲ，Ｂ画素から読み出された信
号を蓄積するコンデンサＣB1，ＣB2，ＣB5，ＣB6，ＣR
3，ＣR4，ＣR7，ＣR8、２０−２はコンデンサＣB1〜ＣR
8から信号を水平出力線に出力するためのトランジスタ
ＴB31，ＴB32，ＴB35，ＴB36，ＴR33，ＴR34，ＴR37，
ＴR38、２２−１，２２−２は出力アンプである。Ｖ１
〜Ｖ４は画素部１６のそれぞれ２水平ラインの画素行を
制御する信号、ＳＷ0〜ＳＷ4はトランジスタ１７を制御
する信号、φTS1，φTS2はトランジスタ１８−１，１８
−２を制御する信号、ｈ11〜ｈ28はトランジスタ２０−
１，２０−２を制御する信号を示す。
【００１７】次に上記読み出し回路の動作について説明
する。図４は上記回路構成図に基づく加算モードにおけ
るタイミング図であり、図５は全画素読み出しモード時
のタイミング図である。
する。図４は上記回路構成図に基づく加算モードにおけ
るタイミング図であり、図５は全画素読み出しモード時
のタイミング図である。
【００１８】図４における加算モードの読み出しタイミ
ングでは、まず、信号Ｖ１がＨレベルとなることにより
始めの２Ｈライン（２水平ライン）分が選択される。そ
の中で信号ＳＷ0，ＳＷ4がＨレベルとなり、トランジス
タＴG11，ＴG14がＯＮする。そして、信号φTS1がＨレ
ベルとなることによって、トランジスタＴG21，ＴG24が
ＯＮし、２Ｈライン分で加算に必要な、（第１行，第１
列）目のＧ画素と（第２行，第２列）目のＧ画素からの
画素情報が電荷としてコンデンサＣG1，ＣG4に蓄積され
る。また、信号φTS1がＨレベルとなることによって、
トランジスタＴB21，ＴR23，ＴB25，ＴR27がＯＮし、
（第２行，第１列）目のＢ画素、（第１行，第２列）目
のＲ画素、（第２行，第３列）目のＢ画素、（第１行，
第４列）目のＲ画素からの画素情報が電荷としてコンデ
ンサＣB1，ＣR3，ＣB5，ＣR7に蓄積される。
ングでは、まず、信号Ｖ１がＨレベルとなることにより
始めの２Ｈライン（２水平ライン）分が選択される。そ
の中で信号ＳＷ0，ＳＷ4がＨレベルとなり、トランジス
タＴG11，ＴG14がＯＮする。そして、信号φTS1がＨレ
ベルとなることによって、トランジスタＴG21，ＴG24が
ＯＮし、２Ｈライン分で加算に必要な、（第１行，第１
列）目のＧ画素と（第２行，第２列）目のＧ画素からの
画素情報が電荷としてコンデンサＣG1，ＣG4に蓄積され
る。また、信号φTS1がＨレベルとなることによって、
トランジスタＴB21，ＴR23，ＴB25，ＴR27がＯＮし、
（第２行，第１列）目のＢ画素、（第１行，第２列）目
のＲ画素、（第２行，第３列）目のＢ画素、（第１行，
第４列）目のＲ画素からの画素情報が電荷としてコンデ
ンサＣB1，ＣR3，ＣB5，ＣR7に蓄積される。
【００１９】次に信号Ｖ２がＨレベルとなることによっ
て、次の２Ｈライン分が選択される。その中で信号ＳＷ
1、ＳＷ3がＨレベルとなりトランジスタＴG12，ＴG15が
ＯＮしている時に、信号φTS2がＨレベルとなることに
よって、その２Ｈライン分で加算に必要な、（第４行，
第４列）目のＧ画素と（第３行，第３列）目のＧ画素か
らの画素情報が電荷としてコンデンサＣG2，ＣG5に蓄積
される。また、信号φTS2がＨレベルとなることによっ
て、トランジスタＴB22，ＴR24，ＴB26，ＴR28がＯＮ
し、（第４行，第１列）目のＢ画素、（第３行，第２
列）目のＲ画素、（第４行，第３列）目のＢ画素、（第
３行，第４列）のＲ画素からの画素情報が電荷としてコ
ンデンサＣB2，ＣR4，ＣB6，ＣR8に蓄積される。最終的
に、各コンデンサに蓄積された電荷が信号ｈ11，ｈ12と
信号ｈ14，ｈ15を同時にＨレベルとすることで水平出力
線上で加算が行われ、コンデンサＣG1，ＣG2，ＣG4，Ｃ
G5からの信号の加算信号がアンプ２１−１を通してセン
サーの外にＧ加算信号として伝送される。また、信号ｈ
23，ｈ24，ｈ27，ｈ28を同時にＨレベルとすることで、
コンデンサＣR3，ＣR4，ＣR7，ＣR8からの信号の加算信
号がアンプ２２−１を通してセンサーの外にＲ加算信号
として伝送され、信号ｈ21，ｈ22，ｈ25，ｈ26を同時に
Ｈレベルとすることで、コンデンサＣB1，ＣB2，ＣB5，
ＣB6からの信号の加算信号がアンプ２２−２を通してセ
ンサーの外にＢ加算信号として伝送される。このサイク
ルを１サイクルとして機能し、水平４Ｈライン分を次々
に加算し、最終的に画素部１６の最終ライン分まで読み
出していく。
て、次の２Ｈライン分が選択される。その中で信号ＳＷ
1、ＳＷ3がＨレベルとなりトランジスタＴG12，ＴG15が
ＯＮしている時に、信号φTS2がＨレベルとなることに
よって、その２Ｈライン分で加算に必要な、（第４行，
第４列）目のＧ画素と（第３行，第３列）目のＧ画素か
らの画素情報が電荷としてコンデンサＣG2，ＣG5に蓄積
される。また、信号φTS2がＨレベルとなることによっ
て、トランジスタＴB22，ＴR24，ＴB26，ＴR28がＯＮ
し、（第４行，第１列）目のＢ画素、（第３行，第２
列）目のＲ画素、（第４行，第３列）目のＢ画素、（第
３行，第４列）のＲ画素からの画素情報が電荷としてコ
ンデンサＣB2，ＣR4，ＣB6，ＣR8に蓄積される。最終的
に、各コンデンサに蓄積された電荷が信号ｈ11，ｈ12と
信号ｈ14，ｈ15を同時にＨレベルとすることで水平出力
線上で加算が行われ、コンデンサＣG1，ＣG2，ＣG4，Ｃ
G5からの信号の加算信号がアンプ２１−１を通してセン
サーの外にＧ加算信号として伝送される。また、信号ｈ
23，ｈ24，ｈ27，ｈ28を同時にＨレベルとすることで、
コンデンサＣR3，ＣR4，ＣR7，ＣR8からの信号の加算信
号がアンプ２２−１を通してセンサーの外にＲ加算信号
として伝送され、信号ｈ21，ｈ22，ｈ25，ｈ26を同時に
Ｈレベルとすることで、コンデンサＣB1，ＣB2，ＣB5，
ＣB6からの信号の加算信号がアンプ２２−２を通してセ
ンサーの外にＢ加算信号として伝送される。このサイク
ルを１サイクルとして機能し、水平４Ｈライン分を次々
に加算し、最終的に画素部１６の最終ライン分まで読み
出していく。
【００２０】次に図５におけるタイミング図を使って、
全画素読み出しモードの読み出し方を説明する。まず信
号Ｖ１がＨレベルとなることにより始めの２Ｈライン分
が選択される。その中で信号ＳＷ０、ＳＷ２、ＳＷ３が
Ｈレベルとなることで、それぞれに対応したトランジス
タＴG11，ＴG13，ＴG15，ＴG16がＯＮする。さらに、そ
の中で信号φTS1がＨレベルとなることによって、トラ
ンジスタＴG21，ＴG23，ＴG24，ＴG26がＯＮし、（第１
行，第１列）目のＧ画素、（第２行，第２列）目のＧ画
素、（第１行，第３列）目のＧ画素，（第２行，第４
列）目のＧ画素からの画素情報が電荷としてそれぞれの
コンデンサＣG1，ＣG3，ＣG4，ＣG6に電荷が蓄積され
る。また、信号φTS1がＨレベルとなることによって、
トランジスタＴB21，ＴR23，ＴB25，ＴR27がＯＮし、
（第２行，第１列）目のＢ画素、（第１行，第２列）目
のＲ画素、（第２行，第３列）目のＢ画素、（第１行，
第４列）目のＲ画素からの画素情報が電荷としてコンデ
ンサＣB1，ＣR3，ＣB5，ＣR7に蓄積される。
全画素読み出しモードの読み出し方を説明する。まず信
号Ｖ１がＨレベルとなることにより始めの２Ｈライン分
が選択される。その中で信号ＳＷ０、ＳＷ２、ＳＷ３が
Ｈレベルとなることで、それぞれに対応したトランジス
タＴG11，ＴG13，ＴG15，ＴG16がＯＮする。さらに、そ
の中で信号φTS1がＨレベルとなることによって、トラ
ンジスタＴG21，ＴG23，ＴG24，ＴG26がＯＮし、（第１
行，第１列）目のＧ画素、（第２行，第２列）目のＧ画
素、（第１行，第３列）目のＧ画素，（第２行，第４
列）目のＧ画素からの画素情報が電荷としてそれぞれの
コンデンサＣG1，ＣG3，ＣG4，ＣG6に電荷が蓄積され
る。また、信号φTS1がＨレベルとなることによって、
トランジスタＴB21，ＴR23，ＴB25，ＴR27がＯＮし、
（第２行，第１列）目のＢ画素、（第１行，第２列）目
のＲ画素、（第２行，第３列）目のＢ画素、（第１行，
第４列）目のＲ画素からの画素情報が電荷としてコンデ
ンサＣB1，ＣR3，ＣB5，ＣR7に蓄積される。
【００２１】コンデンサに蓄積されたＧ信号はＸアドレ
ス選択部の信号ｈ11，ｈ13，ｈ14，ｈ16により順次出力
される。同様にＢ信号はｈ21，ｈ25により、Ｒ信号はｈ
23，ｈ27により順次出力される。
ス選択部の信号ｈ11，ｈ13，ｈ14，ｈ16により順次出力
される。同様にＢ信号はｈ21，ｈ25により、Ｒ信号はｈ
23，ｈ27により順次出力される。
【００２２】図６はインターレース表示を考慮した加算
モードによる読み出し方を示す概念図である。図６
（ａ）にはodd（奇数）フィールド、図６（ｂ）にはeve
n（偶数）フィールドにおける加算の仕方を示している
が、どちらもセンサーの中のある同じ領域を示してい
る。なお図１（ａ）では読み出しを行わない画素は点線
で示したが、図６（ａ），（ｂ）では読み出しを行わな
い画素は示されていない。
モードによる読み出し方を示す概念図である。図６
（ａ）にはodd（奇数）フィールド、図６（ｂ）にはeve
n（偶数）フィールドにおける加算の仕方を示している
が、どちらもセンサーの中のある同じ領域を示してい
る。なお図１（ａ）では読み出しを行わない画素は点線
で示したが、図６（ａ），（ｂ）では読み出しを行わな
い画素は示されていない。
【００２３】まず、図６（ａ）に示すoddフィールドで
は４Ｈライン分のＲ，Ｇ，Ｂを用いて表示１Ｈを作成
し、順々に走査を行っていく。その次のevenフィールド
ではoddフィールドの時とは２Ｈライン分ずらした４Ｈ
ラインで表示１Ｈラインを構成する。これらのフィール
ドを交互に走査することによってインターレース表示に
対応する。
は４Ｈライン分のＲ，Ｇ，Ｂを用いて表示１Ｈを作成
し、順々に走査を行っていく。その次のevenフィールド
ではoddフィールドの時とは２Ｈライン分ずらした４Ｈ
ラインで表示１Ｈラインを構成する。これらのフィール
ドを交互に走査することによってインターレース表示に
対応する。
【００２４】次に画素部の構成例について説明する。
【００２５】図７はＣＭＯＳセンサーおよび読み出し回
路を示す回路図である。ＣＭＯＳセンサーは各画素アン
プのバラツキとゲート部のリセットノイズがあるのでそ
のノイズを除去するため出力部に信号用メモリＣＴ１と
ノイズ用メモリＣＴ２を設けて、減算処理によりノイズ
を除去している。ノイズ用メモリＣＴ２とこのノイズ用
メモリＣＴ２に接続されるトランジスタとを追加するこ
とで図３に示す読み出し回路を構成することができる。
路を示す回路図である。ＣＭＯＳセンサーは各画素アン
プのバラツキとゲート部のリセットノイズがあるのでそ
のノイズを除去するため出力部に信号用メモリＣＴ１と
ノイズ用メモリＣＴ２を設けて、減算処理によりノイズ
を除去している。ノイズ用メモリＣＴ２とこのノイズ用
メモリＣＴ２に接続されるトランジスタとを追加するこ
とで図３に示す読み出し回路を構成することができる。
【００２６】図７において、破線領域はＣＭＯＳセンサ
ーの一画素部を示し、ＰＤはフォトダイオード、ＭTXは
転送用トランジスタ、ＭRESはリセット用トランジス
タ、ＭSELは画素アンプとなる増幅用トランジスタ、ＭS
ELは画素を選択する選択用トランジスタである。リセッ
ト用トランジスタＭRES、ＭRVをオンして画素部および
垂直出力線のリセットを行った後に画素アンプ、選択用
トランジスタＭSEL、トランジスタＭCT2を介してノイズ
用メモリＣＴ２にノイズ信号を蓄積する。また、転送用
トランジスタＭTXをオンして、フォトダイオードＰＤか
ら光電変換された信号が画素アンプとなる増幅用トラン
ジスタＭSELのゲートに転送され、画素アンプ、選択用
トランジスタＭSEL、トランジスタＭCT1を介して信号用
メモリＣＴ１ にノイズ信号成分を含む信号を蓄積す
る。そして、信号用メモリＣＴ１に蓄積されたノイズ信
号成分を含む信号と、ノイズ用メモリＣＴ２に蓄積され
たノイズ信号とを水平出力線に出力し、減算処理して画
素アンプのバラツキとゲート部のリセットノイズ等のノ
イズ成分が除去された信号を得る。φSEL、φTX、φRE
S、φRV、φTS、φTNはそれぞれ増幅用トランジスタＭS
EL、転送用トランジスタＭTX、リセット用トランジスタ
ＭRES，ＭRV、トランジスタＭCT1，ＭCT2を制御する制
御信号である。また、トランジスタＭLは画素アンプＭS
Fの負荷である。φLはφSELと共通に駆動するか、常に
Ｈレベルとして抵抗としても良い。
ーの一画素部を示し、ＰＤはフォトダイオード、ＭTXは
転送用トランジスタ、ＭRESはリセット用トランジス
タ、ＭSELは画素アンプとなる増幅用トランジスタ、ＭS
ELは画素を選択する選択用トランジスタである。リセッ
ト用トランジスタＭRES、ＭRVをオンして画素部および
垂直出力線のリセットを行った後に画素アンプ、選択用
トランジスタＭSEL、トランジスタＭCT2を介してノイズ
用メモリＣＴ２にノイズ信号を蓄積する。また、転送用
トランジスタＭTXをオンして、フォトダイオードＰＤか
ら光電変換された信号が画素アンプとなる増幅用トラン
ジスタＭSELのゲートに転送され、画素アンプ、選択用
トランジスタＭSEL、トランジスタＭCT1を介して信号用
メモリＣＴ１ にノイズ信号成分を含む信号を蓄積す
る。そして、信号用メモリＣＴ１に蓄積されたノイズ信
号成分を含む信号と、ノイズ用メモリＣＴ２に蓄積され
たノイズ信号とを水平出力線に出力し、減算処理して画
素アンプのバラツキとゲート部のリセットノイズ等のノ
イズ成分が除去された信号を得る。φSEL、φTX、φRE
S、φRV、φTS、φTNはそれぞれ増幅用トランジスタＭS
EL、転送用トランジスタＭTX、リセット用トランジスタ
ＭRES，ＭRV、トランジスタＭCT1，ＭCT2を制御する制
御信号である。また、トランジスタＭLは画素アンプＭS
Fの負荷である。φLはφSELと共通に駆動するか、常に
Ｈレベルとして抵抗としても良い。
【００２７】なお、画素部は複数の光電変換部に対して
１つの共通アンプを設けるようにしてもよい。図８は共
通アンプ画素の例を示す図である。図８に示すように、
ａ11，ａ12，ａ21，ａ22は各画素の光電変換部となるフ
ォトダイオード、ＭSFは共通アンプとなる増幅用トラン
ジスタ、ＭTX1〜ＭTX4はフォトダイオードに蓄積された
信号電荷を共通アンプの入力部となるフローティングデ
ィフュージョン領域（ＦＤ領域）に転送する転送用トラ
ンジスタ、ＭRESはＦＤ領域をリセットするリセット用
トランジスタ、ＭSELは共通アンプ画素を選択する選択
用トランジスタである。トランジスタＭSF，ＭSELはソ
ースフォロア回路を構成する。かかる共通アンプ画素は
４つのフォトダイオードからの信号が共通アンプを介し
て出力され、４画素で一つの単位セルを構成する。１つ
の画素はフォトダイオード、転送用トランジスタを含
み、共通アンプ，リセット用トランジスタ、選択用トラ
ンジスタからなる共通回路の一部を含んでいる。フォト
ダイオードａ11，ａ22にＧフィルター、フォトダイオー
ドａ21にＢフィルター、フォトダイオードａ12にＲフィ
ルターを配し、転送トランジスタＭTX1，ＭTX4をオンす
ると、フォトダイオードａ１１とフォトダイオードａ２
２からの信号が共通アンプのゲートで加算することも可
能となる。
１つの共通アンプを設けるようにしてもよい。図８は共
通アンプ画素の例を示す図である。図８に示すように、
ａ11，ａ12，ａ21，ａ22は各画素の光電変換部となるフ
ォトダイオード、ＭSFは共通アンプとなる増幅用トラン
ジスタ、ＭTX1〜ＭTX4はフォトダイオードに蓄積された
信号電荷を共通アンプの入力部となるフローティングデ
ィフュージョン領域（ＦＤ領域）に転送する転送用トラ
ンジスタ、ＭRESはＦＤ領域をリセットするリセット用
トランジスタ、ＭSELは共通アンプ画素を選択する選択
用トランジスタである。トランジスタＭSF，ＭSELはソ
ースフォロア回路を構成する。かかる共通アンプ画素は
４つのフォトダイオードからの信号が共通アンプを介し
て出力され、４画素で一つの単位セルを構成する。１つ
の画素はフォトダイオード、転送用トランジスタを含
み、共通アンプ，リセット用トランジスタ、選択用トラ
ンジスタからなる共通回路の一部を含んでいる。フォト
ダイオードａ11，ａ22にＧフィルター、フォトダイオー
ドａ21にＢフィルター、フォトダイオードａ12にＲフィ
ルターを配し、転送トランジスタＭTX1，ＭTX4をオンす
ると、フォトダイオードａ１１とフォトダイオードａ２
２からの信号が共通アンプのゲートで加算することも可
能となる。
【００２８】図９は本発明のシステム構成を示す図であ
る。ここで光電変換は被写体からの光が絞り羽３１を通
り、レンズ３２によりカラーフィルターを有した撮像素
子３４へ結像されることで行われる。なお３３はモアレ
等を防ぐために光の高域をカットする光学ローパスフィ
ルター、色補正フィルター、及び赤外線カット用のフィ
ルター等が組み合わされたフィルター群である。
る。ここで光電変換は被写体からの光が絞り羽３１を通
り、レンズ３２によりカラーフィルターを有した撮像素
子３４へ結像されることで行われる。なお３３はモアレ
等を防ぐために光の高域をカットする光学ローパスフィ
ルター、色補正フィルター、及び赤外線カット用のフィ
ルター等が組み合わされたフィルター群である。
【００２９】撮像素子３４で光電変換された光信号は、
タイミングジェネレータ（ＴＧ）３８からの信号により
Ｘアドレス選択部３６及びＹアドレス選択部３５で２次
元で画素位置選択が行われ、タイミング調整部３７に読
み出される。このタイミング調整部３７では撮像素子３
４からの出力（１〜複数本）のタイミング調整が行われ
る。そして、光電信号はＡＧＣ４０により電圧を制御さ
れ、Ａ／Ｄ変換器４１でデジタル信号に変換される。
タイミングジェネレータ（ＴＧ）３８からの信号により
Ｘアドレス選択部３６及びＹアドレス選択部３５で２次
元で画素位置選択が行われ、タイミング調整部３７に読
み出される。このタイミング調整部３７では撮像素子３
４からの出力（１〜複数本）のタイミング調整が行われ
る。そして、光電信号はＡＧＣ４０により電圧を制御さ
れ、Ａ／Ｄ変換器４１でデジタル信号に変換される。
【００３０】カメラＤＳＰ４２は、動画または静止画の
画像処理を行う。またＭＰＵ４４はこの画像処理の際に
使われるパラメータをカメラＤＳＰ４２に設定したり、
ＡＥ，ＡＦ処理を行ったりする。
画像処理を行う。またＭＰＵ４４はこの画像処理の際に
使われるパラメータをカメラＤＳＰ４２に設定したり、
ＡＥ，ＡＦ処理を行ったりする。
【００３１】画像処理する際の一時的な記憶領域として
ＤＲＡＭ４３が用いられ、不揮発性の記憶領域として画
像記録媒体４８が用いられる。画像記録媒体４８は例え
ば、スマートメディア、磁気テープ、または光ディスク
等である。
ＤＲＡＭ４３が用いられ、不揮発性の記憶領域として画
像記録媒体４８が用いられる。画像記録媒体４８は例え
ば、スマートメディア、磁気テープ、または光ディスク
等である。
【００３２】この画像処理後の表示を行うためにビデオ
エンコーダー４５、及びＣＲＴ４６等が設けられてい
る。またビューファインダー４７は例えぼＬＣＤのよう
なもので画像記録媒体４８に記憶する前に被写体を確認
したりするために用いられる。これらの出力装置はＣＲ
Ｔ４６及びビューファインダー４７に限らずプリンタ等
を用いても良い。
エンコーダー４５、及びＣＲＴ４６等が設けられてい
る。またビューファインダー４７は例えぼＬＣＤのよう
なもので画像記録媒体４８に記憶する前に被写体を確認
したりするために用いられる。これらの出力装置はＣＲ
Ｔ４６及びビューファインダー４７に限らずプリンタ等
を用いても良い。
【００３３】本発明では、撮像素子３４において、加算
読み出しモードと全画素読み出しモードを切り替える場
合には、ＭＰＵ４４がモードを判断し、出力装置（ＣＲ
Ｔ４６、ビューファインダー４７）、力メラＤＳＰ４
２、画像記録媒体４８、ＡＧＣ４０、ＴＧ３８等にそれ
ぞれのモードに対応した信号を送る構成を取る。ここで
ＴＧ３８には動画・静止画により図４、図５に示したよ
うなタイミングを切り替える。またカメラＤＳＰ４２に
は、どちらのモードでも信号出力の順序が、同じ構成を
取れるのでモード別に処理そのものを変える必要がな
い。
読み出しモードと全画素読み出しモードを切り替える場
合には、ＭＰＵ４４がモードを判断し、出力装置（ＣＲ
Ｔ４６、ビューファインダー４７）、力メラＤＳＰ４
２、画像記録媒体４８、ＡＧＣ４０、ＴＧ３８等にそれ
ぞれのモードに対応した信号を送る構成を取る。ここで
ＴＧ３８には動画・静止画により図４、図５に示したよ
うなタイミングを切り替える。またカメラＤＳＰ４２に
は、どちらのモードでも信号出力の順序が、同じ構成を
取れるのでモード別に処理そのものを変える必要がな
い。
【００３４】
【発明の効果】以上説明したように、本発明によれば、
以下のような効果を得ることができる。 ・画像の解像度に支配的にであるＧ（緑）情報を最近接
画素である斜め２画素という加算方式を取ることがで
き、比較的、解像度を落とさずに画像を提供することが
でき、またＲ，Ｂに関しては４画素加算を行うことによ
り水平方向、垂直方向のモアレを低減することができ
る。 ・読み出した信号に対応するカラーフィルターの色の順
序が、加算した場合と加算しない場合とで同じであるた
めに、ＤＳＰにおける信号処理回路を共有化することが
でき簡単な回路構成で本発明の目的を達成できる。 ・従来あるような間引きを行わなわず、センサー内で信
号を加算して動画を作成するため、間引きに見られるよ
うなモアレを低減することができ、鮮明な動画映像を提
供することができる。
以下のような効果を得ることができる。 ・画像の解像度に支配的にであるＧ（緑）情報を最近接
画素である斜め２画素という加算方式を取ることがで
き、比較的、解像度を落とさずに画像を提供することが
でき、またＲ，Ｂに関しては４画素加算を行うことによ
り水平方向、垂直方向のモアレを低減することができ
る。 ・読み出した信号に対応するカラーフィルターの色の順
序が、加算した場合と加算しない場合とで同じであるた
めに、ＤＳＰにおける信号処理回路を共有化することが
でき簡単な回路構成で本発明の目的を達成できる。 ・従来あるような間引きを行わなわず、センサー内で信
号を加算して動画を作成するため、間引きに見られるよ
うなモアレを低減することができ、鮮明な動画映像を提
供することができる。
【図１】本発明に基づく加算方式の概念図である。
【図２】本発明に基づく他の加算方式の概念図である。
【図３】図１の加算方式を実現するため概略的な読み出
し回路の回路構成図である。
し回路の回路構成図である。
【図４】上記読み出し回路に基づく加算モードにおける
タイミング図である。
タイミング図である。
【図５】上記読み出し回路に基づく全画素読み出しモー
ド時のタイミング図である。
ド時のタイミング図である。
【図６】インターレース表示を考慮した加算モードによ
る読み出し方を示す概念図である。
る読み出し方を示す概念図である。
【図７】ＣＭＯＳセンサーおよび読み出し回路を示す回
路図である。
路図である。
【図８】共通アンプ画素の例を示す図である。
【図９】本発明のシステム構成を示す図である。
１０ ベイヤー配列の画素部 １１ 加算するＧ画素 １２ 加算モード上では加算が行われない画素 １２Ｇ，１２Ｒ，１２Ｂ 加算モード上では加算が行わ
れないＧ，Ｒ，Ｂ画素 １３Ｒ，１５Ｒ 加算するＲ画素 １３Ｂ，１５Ｂ 加算するＢ画素 １４ ベイヤー配列
れないＧ，Ｒ，Ｂ画素 １３Ｒ，１５Ｒ 加算するＲ画素 １３Ｂ，１５Ｂ 加算するＢ画素 １４ ベイヤー配列
───────────────────────────────────────────────────── フロントページの続き (72)発明者 光地 哲伸 東京都大田区下丸子３丁目30番２号 キヤ ノン株式会社内 Ｆターム(参考） 5C065 AA01 AA03 BB13 BB30 CC01 CC07 CC08 DD02 DD17 EE05 EE06 GG10 GG11 GG13 GG18 GG21 GG26 GG32
Claims (10)
- 【請求項１】 複数色の信号を出力する複数の画素と、 水平方向４画素及び垂直方向４画素の１６画素を１グル
ープとし、該グループから加算走査により複数の色信号
を読み出す読み出し手段とを備え、 前記読み出し手段は、加算前の各色の空間的色配列と、
加算後の各色の空間的色配列が同じになるように複数の
画素の信号を加算することを特徴とする撮像装置。 - 【請求項２】 所定の基本色配列を持つ複数の画素から
なる構成要素を複数配列した画素部と、 前記構成要素のそれぞれから複数色の信号を読み出し、
同じ構成要素内又は／及び異なる構成要素間で同一色毎
に加算走査する読み出し手段とを備え、 前記読み出し手段は、加算前の各色の空間的色配列と、
加算後の各色の空間的色配列が同じになるように複数の
画素の信号を加算することを特徴とする撮像装置。 - 【請求項３】 所定の基本色配列を持つ複数の画素から
なる構成要素を複数配列した画素部と、 複数の画素の信号を加算走査して、複数色の信号を読み
出す読み出し手段とを備え、 前記読み出し手段は、加算前の各色の空間的色配列と、
加算後の各色の空間的色配列が同じになるように複数の
画素の信号を加算するとともに、前記複数色の少なくと
も１つの色は、斜め方向に配列された画素のみの信号を
加算した色信号であることを特徴とする撮像装置。 - 【請求項４】 請求項１〜３のいずれかに記載の撮像装
置において、前記読み出し手段は、複数の画素の信号の
間引き走査を行うことを特徴とする撮像装置。 - 【請求項５】 請求項１に記載の撮像装置において、加
算される各色の画素の範囲が空間的に重複することを特
徴とする撮像装置。 - 【請求項６】 請求項１〜５のいずれかに記載の撮像装
置において、前記加算走査による信号読み出しを行う第
１の読み出しモードと全画素の信号読み出しを行う第２
の読み出しモードを切り換える切り換え手段を有する撮
像装置。 - 【請求項７】 請求項１〜６のいずれかに記載の撮像装
置において、インタレース駆動を行うことを特徴とする
撮像装置。 - 【請求項８】 請求項１〜７のいずれかに記載の撮像装
置において、前記色フィルターは、Ｇ（緑）色フィルタ
ー、Ｒ（赤）色フィルター、Ｂ（青）色フィルターであ
ることを特徴とする撮像装置。 - 【請求項９】 請求項１〜８のいずれかに記載の撮像装
置において、前記加算は、前記複数色の色フィルターの
うちの第１の色フィルターが配された斜め方向の画素の
信号の加算と、第２及び第３の色フィルターが配された
水平方向及び垂直方向の画素の信号の加算とであること
を特徴とする撮像装置。 - 【請求項１０】 請求項１〜９のいずれかに記載の撮像
装置と、該撮像装置へ光を結像する光学系と、該撮像装
置からの出力信号を処理する信号処理手段とを有するこ
とを特徴とする撮像システム。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20651699A JP3501694B2 (ja) | 1999-07-21 | 1999-07-21 | 撮像装置及びそれを用いた撮像システム |
| US09/584,198 US6992714B1 (en) | 1999-05-31 | 2000-05-31 | Image pickup apparatus having plural pixels arranged two-dimensionally, and selective addition of different pixel color signals to control spatial color arrangement |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20651699A JP3501694B2 (ja) | 1999-07-21 | 1999-07-21 | 撮像装置及びそれを用いた撮像システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001036920A true JP2001036920A (ja) | 2001-02-09 |
| JP3501694B2 JP3501694B2 (ja) | 2004-03-02 |
Family
ID=16524668
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20651699A Expired - Fee Related JP3501694B2 (ja) | 1999-05-31 | 1999-07-21 | 撮像装置及びそれを用いた撮像システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3501694B2 (ja) |
Cited By (28)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2002093939A1 (fr) * | 2001-05-15 | 2002-11-21 | Matsushita Electric Industrial Co., Ltd. | Dispositif d'imagerie et procede de traitement de signaux associe |
| JP2005318544A (ja) * | 2004-04-26 | 2005-11-10 | Magnachip Semiconductor Ltd | 高速アナログ信号処理可能なｃｍｏｓイメージセンサ |
| EP1549050A3 (en) * | 2003-12-25 | 2006-05-17 | Canon Kabushiki Kaisha | Imaging apparatus for processing noise signal and photoelectric conversion signal |
| WO2007004387A1 (ja) * | 2005-07-05 | 2007-01-11 | Tokyo Institute Of Technology | 固体撮像素子の信号読み出し方法及び画像信号処理方法 |
| JP2007189732A (ja) * | 2003-01-28 | 2007-07-26 | Matsushita Electric Ind Co Ltd | 固体撮像装置、その駆動方法及びそれを用いたカメラ |
| JP2007267290A (ja) * | 2006-03-30 | 2007-10-11 | Matsushita Electric Ind Co Ltd | 固体撮像素子およびその駆動方法 |
| JP2007531351A (ja) * | 2003-07-15 | 2007-11-01 | イーストマン コダック カンパニー | 電荷ビニング型イメージセンサ |
| US7349016B2 (en) | 2003-04-03 | 2008-03-25 | Matsushita Electric Industrial Co., Ltd. | Solid-state color imaging apparatus capable of reducing false signals with regard to both luminance and chrominance |
| CN100407775C (zh) * | 2005-03-15 | 2008-07-30 | 佳能株式会社 | 图像捕获装置、图像传感器和图像捕获处理方法 |
| CN100446547C (zh) * | 2005-03-07 | 2008-12-24 | 富士胶片株式会社 | 具有扩大面积的光电管的固态图像传感器 |
| US7471322B2 (en) | 2004-01-21 | 2008-12-30 | Panasonic Corporation | Solid state imaging device and driving method thereof |
| JP2009010923A (ja) * | 2007-02-27 | 2009-01-15 | Phase One As | デジタル画像のカラービニング |
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