JP2000351692A - GaN半導体結晶成長用Siウエーハ、それを用いたGaN発光素子用ウエーハ及びそれらの製造方法 - Google Patents
GaN半導体結晶成長用Siウエーハ、それを用いたGaN発光素子用ウエーハ及びそれらの製造方法Info
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Abstract
し得るGaN半導体結晶成長用Siウエーハを提供す
る。 【解決手段】 CZ法によるSi基板の表面から厚み方
向へ少なくとも3μmの間に亘って低酸素濃度で酸素析
出物が無く、かつ、表面構造が全面に亘ってダブルステ
ップレーヤになっている。
Description
(例えば、発光ダイオード(LED)やレーザ素子)を
作るためのGaN(窒化ガリウム)半導体結晶成長用S
i(シリコン)ウエーハ、それを用いたGaN発光素子
用ウエーハ及びそれらの製造方法に関する。
導体結晶は、サファイア基板上にエピタキシャル成長に
よって育成されているが、GaN半導体結晶とサファイ
ア基板の格子定数の差異による格子不整合を生じたり、
基板としてのサファイアが劈開性、導電性を有しないこ
とによる不具合がある。
に示すように、基板としてSiを用い、Si基板31上
にGa(ガリウム)のバリア層32を介在してGaN半
導体結晶層33を形成するGaN発光素子用ウエーハと
その製造方法が知られている(特開平10−24205
5号公報参照)。
発光素子用ウエーハとその製造方法では、Si基板上へ
のGaのバリア層の形成は、両者の格子定数の大幅な違
いにより不具合があり、Gaのバリア層上への閃亜鉛鉱
型結晶構造のGaN層の形成が困難で、GaN層の結晶
構造がウルツ鉱型の結晶系となり、発光素子としての青
色発光時の輝度があまりあがらない不具合がある。
してウルツ鉱型結晶構造のGaNと格子不整合が僅か
0.6%程度のBP(リン化ホウ素)単結晶を用いるこ
とが考えられる。BP単結晶は、中性子の吸収作用があ
り、原子炉の安全管理や中性子線散乱による物性評価の
ための中性子線センサーとしての用途が期待され研究が
行われている。BPは、閃亜鉛鉱型結晶構造を有し、G
aNとの格子不整合も前述したように僅かである。一
方、Siとの格子不整合が16%と大きいが、B(ホウ
素)とSiとの相性がよく、Si基板上へのBPのエピ
タキシャル成長が報告されているものの、未だ安定的な
結晶成長を行えるまでには至っていない。その理由とし
て、下記の要因が挙げられる。 (1)BPのエピタキシャル成長プロセス中に、Si基
板に含まれるO(酸素)が外方拡散し、Bを酸化するた
め、多結晶化が起こり単結晶成長を阻害する。 (2)Si基板34(図8、図9参照)の表面、すなわ
ち、デバイス製作面にCOP(Crystal Originated Pari
cle :ごく軽いエッチングで形成されるピット(0.5
μmぐらいの小孔))等の欠陥35があると、結晶方位
の違いによりBPの成長速度に差異が生じ、表面の凹凸
が増幅され、表面の均一性(平面度)を欠いてしまう。 (3)Si基板36(図10参照)の表面がシングルス
テップレーヤの場合、BPの結晶成長中に、A−A面で
フェースの異なるアンチフェーズドドメインが生じ多結
晶化する。 一方、上記要因を解消するため、BPエピタキシャル成
長プロセスにおいて、前処理として、Si基板を水素ガ
ス雰囲気において1000〜1200℃の温度でアニー
ル処理することが考えられるが、処理時間が長時間とな
る上、高温度に保持するため、新たな表面荒れが発生す
る等の不具合がある。そこで、本発明は、閃亜鉛鉱型結
晶構造のGaN層を良好に形成し得るGaN半導体結晶
成長用Siウエーハ、それを用いたGaN発光素子用ウ
エーハ及びそれらの製造方法を提供することを目的とす
る。
め、本発明の第1のGaN半導体結晶成長用Siウエー
ハは、CZ法によるSi基板の表面から厚み方向へ少な
くとも3μmの間に亘って低酸度濃度で酸素析出物が無
く、かつ、表面構造が全面に亘ってダブルステップレー
ヤとなっていることを特徴とする。前記Si基板の表面
から厚み方向へ少なくとも5μmの間に亘る酸素濃度は
1.0×1017 atoms/cm3 以下で、残部の酸素濃度
は5.0×1017〜1.0×1018 atoms/cm3 であ
ることが好ましい。又、前記Si基板の表面にはCOP
等のピットが存在しないことが好ましい。第2のGaN
半導体結晶成長用Siウエーハは、第1のものにおい
て、Si基板の表面にBP単結晶層が形成されているこ
とを特徴とする。又、GaN発光素子用ウエーハは、第
2のGaN半導体結晶成長用Siウエーハにおいて、B
P単結晶層の上に閃亜鉛鉱型結晶構造のGaN層が形成
されていることを特徴とする。
ウエーハの製造方法は、CZ法によるSi単結晶からな
るSi基板に水素ガス雰囲気において800〜1300
℃の温度でアニール処理を施した後、1050〜115
0℃の温度でSiのエピタキシャル成長を施すことを特
徴とする。前記Si基板は表面にCOP等のピットの無
いものとすることが好ましい。前記Si単結晶は抵抗値
5/1000〜15/1000ΩcmのBヘビードープ
P+ シリコン単結晶とすることが好ましい。第2のGa
N半導体結晶成長用Siウエーハの製造方法は、第1の
方法において、Si基板の表面にBPのエピタキシャル
成長を施すことを特徴とする。又、GaN発光素子用ウ
エーハの製造方法は、第2のGaN半導体結晶成長用ウ
エーハの製造方法において、BP単結晶層の上に閃亜鉛
鉱型結晶構造のGaNのエピタキシャル成長を施すこと
を特徴とする。
3μmの間に亘って酸素濃度が高くて酸素析出物が有る
と、BP層のエピタキシャル成長プロセスにおいて、S
i基板中の酸素が外方拡散してBを酸化するため、多結
晶化が起こりBPの単結晶成長を阻害する。低酸素濃度
で酸素析出物の無い領域は、表面から厚み方向へ15μ
mの間に亘って形成することが望ましい。表面から厚み
方向へ少なくとも5μmの間に亘る酸素濃度は、8×1
016atoms /cm3 以下であることが望ましい。
ル処理温度が、800℃未満であると、表面変化は少な
くなる、一方、1300℃を超えると、表面が荒れる不
具合がある。好ましいアニール処理温度は、900〜1
250℃である。シリコン単結晶の抵抗値が、5/10
00Ωcm未満であると、エピタキシャル中に不純物が
酸素と反応する、一方、15/1000Ωcmを超える
と、デバイス形成後に抵抗が大きくなりすぎる。好まし
いシリコン単結晶の抵抗値は、6/1000〜14/1
000Ωcmである。
て具体的な実施例を参照して説明する。先ず、CZ(チ
ョクラルスキー)法により、ドーパントであるBを1.
0×1018 atoms/cm3 以上ドーピングし、6インチ
のBヘビードープP+ Si単結晶(100)を引き上
げ、スライスしてCOP等のピットが存在しないSi基
板を得た。次に、Si基板に水素(H2 )ガス雰囲気に
おいて800〜1300℃の温度でアニール処理施した
ところ、図1に示すように、表面から厚さ方向(図1に
おいては上下方向)へ3μmの間に亘って酸素及びその
析出物の全く見られないものとなった。図1において黒
点状のものが酸素析出物である。又、Si基板の表面か
ら厚み方向へ5μmの間に亘る酸素濃度は、1.0×1
017 atoms/cm3 以下で、残部(バルク)の酸素濃度
は、5.0×1017〜1.0×1018 atoms/cm3 で
あり、かつ、Si基板の電気抵抗値は、5/1000〜
15/1000Ωcmであった。
表面に、1050〜1150℃の温度でSiのエピタキ
シャル成長を施してSi単結晶層を形成した。エピタキ
シャル装置は、内径50mm、長さ350mmの石英管
の中央に石英でカバーされたSiCコートを施した黒鉛
サセプターを納置し、その上にSi基板を載置し、外部
より高周波を印加することによりサセプターを発熱させ
る構造のものである。又、エピタキシャル成長は、原料
ガスとしてSiCl4 (四塩化ケイ素)ガス、キャリア
ガスとしてH2 ガスを用い、マスフローコントローラを
介して一定量炉内に導入した。得られたSi基板は、表
面構造が全面に亘ってダブルステップレーヤとなってい
た。
00〜1150℃の温度でBPのエピタキシャル成長を
施してGaN成長の中間層(バッファー層)としてのB
P単結晶層を形成した。エピタキシャル装置は、Siの
エピタキシャル成長に用いたものと同様のものを用い、
BPのエピタキシャル成長は、原料ガスとしてPCl3
(三塩化リン)とBCl3 (三塩化ホウ素)の混合ガ
ス、キャリアガスとしてH2 ガスを用い、マスフローコ
ントローラを介して一定量炉内に導入した。成長温度シ
ーケンスを図2に示す。得られたGaN半導体結晶成長
用Siウエーハは、図3に示すように、テラス状の結晶
成長が行われていると共に、図4、図5に示すように、
ダブルステップレーヤの表面構造のSi基板1の上にB
P単結晶層2が、BP,BPと順番に4.56μmの厚
みに積層され、表面が極めて均一なものとなった。
キシャル成長を施さない通常のミラーウエーハ(Si基
板)を用い、このSi基板の表面に、上述のものと同様
にBPのエピタキシャル成長を施してBP単結晶層を形
成したところ、その表面の結晶構造は、図6に示すよう
に、四角錐の島状のBPの多結晶が成長しており、表面
の均一性(平面度)に欠けたものとなった。
ーハの表面に、700〜1100℃の温度でGaNのエ
ピタキシャル成長を施して閃亜鉛鉱型結晶構造のGaN
半導体結晶層を形成した。エピタキシャル装置は、Si
のエピタキシャル成長に用いたものと同様のものを用
い、GaNのエピタキシャル成長は、原料ガスとしてM
MH(モノメチルヒドラジン)、TMG(トリメチルガ
リウム)ガス、キャリアガスとしてH2 、N 2 (窒素)
ガスを用い、マスフローコントローラを介して一定量炉
内に導入した。得られたGaN発光素子用ウエーハは、
GaN半導体単結晶層の表面が極めて均一で、その厚み
が4μmであり、又、結晶構造が完全な閃亜鉛鉱型とな
っていた。
N発光素子を切り出して発光させたところ、青色発光時
の輝度が極めて高いものであった。
aN半導体結晶成長用Siウエーハとその製造方法によ
れば、デバイス形成用領域側が低酸素濃度で酸素析出物
が無く、かつ、表面構造がダブルステップレーヤとなっ
ているので、GaN半導体単結晶層の中間層となるBP
単結晶層を、表面の均一性に優れたものとして、極めて
安定的に形成することができる。又、第2のGaN半導
体結晶成長用Siウエーハとその製造方法によれば、第
1のSiウエーハとその製造方法による作用効果の他、
GaNに対するBPの格子不整合が僅か0.6%程度で
あるので、GaNの結晶構造を完全な閃亜鉛鉱型とする
ことができる。又、GaN発光素子用ウエーハとその製
造方法によれば、GaN半導体単結晶の結晶構造が完全
な閃亜鉛鉱型となるので、発光素子とした場合、青色発
光時の輝度を極めて高いものとすることができる。
ーハの製造方法の実施の形態の一例を示すアニール処理
工程後のSiウエーハの結晶構造の電子顕微鏡写真であ
る。
ーハの製造方法の実施の形態の一例を示すBPエピタキ
シャル成長工程の成長温度シーケンスの説明図である。
ーハの実施の形態の一例を示すGaN成長中間層として
のBPエピタキシャル成長後の表面の電子顕微鏡写真で
ある。
ーハの実施の形態の一例を示す模式的な部分断面図であ
る。
ーハの実施の形態の一例を示すBPエピタキシャル成長
後の断面の電子顕微鏡写真である。
エピタキシャル成長を施されたBPの結晶構造を示す電
子顕微鏡写真である。
る。
部分断面図である。
N半導体結晶成長用Siウエーハの模式的な部分断面図
である。
Claims (10)
- 【請求項1】 CZ法によるSi基板の表面から厚み方
向へ少なくとも3μmの間に亘って低酸素濃度で酸素析
出物が無く、かつ、表面構造が全面に亘ってダブルステ
ップレーヤとなっていることを特徴とするGaN半導体
結晶成長用Siウエーハ。 - 【請求項2】 前記Si基板の表面から厚み方向へ少な
くとも5μmの間に亘る酸素濃度が1.0×1017 ato
ms/cm3 以下で、残部の酸素濃度が5.0×1017〜
1.0×1018 atoms/cm3 であることを特徴とする
請求項1記載のGaN半導体結晶成長用Siウエーハ。 - 【請求項3】 前記Si基板の表面にCOP等のピット
が存在しないことを特徴とする請求項1又は2記載のG
aN半導体結晶成長用Siウエーハ。 - 【請求項4】 請求項1、2又は3記載のSiウエーハ
において、Si基板の表面にBP単結晶層が形成されて
いることを特徴とするGaN半導体結晶成長用Siウエ
ーハ。 - 【請求項5】 請求項4記載のSiウエーハにおいて、
BP単結晶層の上に閃亜鉛鉱型結晶構造のGaN層が形
成されていることを特徴とするGaN発光素子用ウエー
ハ。 - 【請求項6】 CZ法によるSi単結晶からなるSi基
板に水素ガス雰囲気において800〜1300℃の温度
でアニール処理を施した後、1050〜1150℃の温
度でSiのエピタキシャル成長を施すことを特徴とする
GaN半導体結晶成長用Siウエーハの製造方法。 - 【請求項7】 前記Si基板を表面にCOP等のピット
の無いものとすることを特徴とする請求項6記載のGa
N半導体結晶成長用Siウエーハの製造方法。 - 【請求項8】 前記Si単結晶を抵抗値5/1000〜
15/1000ΩcmのBヘビードープP+ シリコン単
結晶とすることを特徴とする請求項6又は7記載のGa
N半導体結晶成長用Siウエーハの製造方法。 - 【請求項9】 請求項6、7又は8記載のSiウエーハ
の製造方法において、Si基板の表面にBPのエピタキ
シャル成長を施すことを特徴とするGaN半導体結晶成
長用Siウエーハの製造方法。 - 【請求項10】 請求項9記載のSiウエーハの製造方
法において、BP単結晶層の上に閃亜鉛鉱型結晶構造の
GaNのエピタキシャル成長を施すことを特徴とするG
aN発光素子用ウエーハの製造方法。
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Cited By (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003046120A (ja) * | 2001-08-01 | 2003-02-14 | Showa Denko Kk | 発光素子用積層構造体、発光素子、ランプ及び光源 |
WO2003015141A1 (en) * | 2001-08-06 | 2003-02-20 | Motorola, Inc. | Controlling anti-phase domains in semiconductor structures |
JP2003081695A (ja) * | 2001-09-06 | 2003-03-19 | Toshiba Ceramics Co Ltd | SiC半導体とSiCエピタキシャル成長方法 |
WO2003023095A1 (fr) * | 2001-09-06 | 2003-03-20 | Toshiba Ceramics Co., Ltd. | Plaquette de semi-conducteur et production de cette plaquette |
US6638838B1 (en) | 2000-10-02 | 2003-10-28 | Motorola, Inc. | Semiconductor structure including a partially annealed layer and method of forming the same |
US6639249B2 (en) | 2001-08-06 | 2003-10-28 | Motorola, Inc. | Structure and method for fabrication for a solid-state lighting device |
US6646293B2 (en) | 2001-07-18 | 2003-11-11 | Motorola, Inc. | Structure for fabricating high electron mobility transistors utilizing the formation of complaint substrates |
US6667196B2 (en) | 2001-07-25 | 2003-12-23 | Motorola, Inc. | Method for real-time monitoring and controlling perovskite oxide film growth and semiconductor structure formed using the method |
US6673646B2 (en) | 2001-02-28 | 2004-01-06 | Motorola, Inc. | Growth of compound semiconductor structures on patterned oxide films and process for fabricating same |
US6693298B2 (en) | 2001-07-20 | 2004-02-17 | Motorola, Inc. | Structure and method for fabricating epitaxial semiconductor on insulator (SOI) structures and devices utilizing the formation of a compliant substrate for materials used to form same |
US6693033B2 (en) | 2000-02-10 | 2004-02-17 | Motorola, Inc. | Method of removing an amorphous oxide from a monocrystalline surface |
US6709989B2 (en) | 2001-06-21 | 2004-03-23 | Motorola, Inc. | Method for fabricating a semiconductor structure including a metal oxide interface with silicon |
JP2008243948A (ja) * | 2007-03-26 | 2008-10-09 | Sumitomo Electric Ind Ltd | エピタキシャル基板の製造方法 |
JP2011103380A (ja) * | 2009-11-11 | 2011-05-26 | Covalent Materials Corp | 化合物半導体基板 |
JP2012094905A (ja) * | 2007-03-09 | 2012-05-17 | Cree Inc | 中間層構造を有する厚い窒化物半導体構造、及び厚い窒化物半導体構造を製造する方法 |
WO2014034687A1 (ja) * | 2012-08-29 | 2014-03-06 | 日東光器株式会社 | GaN系結晶及び半導体素子の製造方法 |
US9070833B2 (en) | 2011-08-04 | 2015-06-30 | Kabushiki Kaisha Toshiba | Distributed current blocking structures for light emitting diodes |
CN107407008A (zh) * | 2015-03-03 | 2017-11-28 | 国立大学法人大阪大学 | 第iii族氮化物半导体晶体衬底的制造方法 |
Families Citing this family (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2500451B1 (en) * | 2009-11-10 | 2019-01-30 | Stanley Electric Co., Ltd. | Method for producing laminate |
US8395165B2 (en) | 2011-07-08 | 2013-03-12 | Bridelux, Inc. | Laterally contacted blue LED with superlattice current spreading layer |
US20130026480A1 (en) | 2011-07-25 | 2013-01-31 | Bridgelux, Inc. | Nucleation of Aluminum Nitride on a Silicon Substrate Using an Ammonia Preflow |
US8916906B2 (en) | 2011-07-29 | 2014-12-23 | Kabushiki Kaisha Toshiba | Boron-containing buffer layer for growing gallium nitride on silicon |
US8865565B2 (en) | 2011-08-02 | 2014-10-21 | Kabushiki Kaisha Toshiba | LED having a low defect N-type layer that has grown on a silicon substrate |
US9142743B2 (en) | 2011-08-02 | 2015-09-22 | Kabushiki Kaisha Toshiba | High temperature gold-free wafer bonding for light emitting diodes |
US9343641B2 (en) | 2011-08-02 | 2016-05-17 | Manutius Ip, Inc. | Non-reactive barrier metal for eutectic bonding process |
US9012939B2 (en) | 2011-08-02 | 2015-04-21 | Kabushiki Kaisha Toshiba | N-type gallium-nitride layer having multiple conductive intervening layers |
US20130032810A1 (en) | 2011-08-03 | 2013-02-07 | Bridgelux, Inc. | Led on silicon substrate using zinc-sulfide as buffer layer |
US8686430B2 (en) | 2011-09-07 | 2014-04-01 | Toshiba Techno Center Inc. | Buffer layer for GaN-on-Si LED |
US8664679B2 (en) | 2011-09-29 | 2014-03-04 | Toshiba Techno Center Inc. | Light emitting devices having light coupling layers with recessed electrodes |
US20130082274A1 (en) | 2011-09-29 | 2013-04-04 | Bridgelux, Inc. | Light emitting devices having dislocation density maintaining buffer layers |
US8853668B2 (en) | 2011-09-29 | 2014-10-07 | Kabushiki Kaisha Toshiba | Light emitting regions for use with light emitting devices |
US8698163B2 (en) | 2011-09-29 | 2014-04-15 | Toshiba Techno Center Inc. | P-type doping layers for use with light emitting devices |
US9012921B2 (en) | 2011-09-29 | 2015-04-21 | Kabushiki Kaisha Toshiba | Light emitting devices having light coupling layers |
US9178114B2 (en) | 2011-09-29 | 2015-11-03 | Manutius Ip, Inc. | P-type doping layers for use with light emitting devices |
-
1999
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Cited By (26)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6693033B2 (en) | 2000-02-10 | 2004-02-17 | Motorola, Inc. | Method of removing an amorphous oxide from a monocrystalline surface |
US6638838B1 (en) | 2000-10-02 | 2003-10-28 | Motorola, Inc. | Semiconductor structure including a partially annealed layer and method of forming the same |
US6673646B2 (en) | 2001-02-28 | 2004-01-06 | Motorola, Inc. | Growth of compound semiconductor structures on patterned oxide films and process for fabricating same |
US6709989B2 (en) | 2001-06-21 | 2004-03-23 | Motorola, Inc. | Method for fabricating a semiconductor structure including a metal oxide interface with silicon |
US6646293B2 (en) | 2001-07-18 | 2003-11-11 | Motorola, Inc. | Structure for fabricating high electron mobility transistors utilizing the formation of complaint substrates |
US6693298B2 (en) | 2001-07-20 | 2004-02-17 | Motorola, Inc. | Structure and method for fabricating epitaxial semiconductor on insulator (SOI) structures and devices utilizing the formation of a compliant substrate for materials used to form same |
US6667196B2 (en) | 2001-07-25 | 2003-12-23 | Motorola, Inc. | Method for real-time monitoring and controlling perovskite oxide film growth and semiconductor structure formed using the method |
JP2003046120A (ja) * | 2001-08-01 | 2003-02-14 | Showa Denko Kk | 発光素子用積層構造体、発光素子、ランプ及び光源 |
WO2003015141A1 (en) * | 2001-08-06 | 2003-02-20 | Motorola, Inc. | Controlling anti-phase domains in semiconductor structures |
US6639249B2 (en) | 2001-08-06 | 2003-10-28 | Motorola, Inc. | Structure and method for fabrication for a solid-state lighting device |
US6936490B2 (en) | 2001-09-06 | 2005-08-30 | Toshiba Ceramics Co, Ltd. | Semiconductor wafer and its manufacturing method |
JP2003081695A (ja) * | 2001-09-06 | 2003-03-19 | Toshiba Ceramics Co Ltd | SiC半導体とSiCエピタキシャル成長方法 |
WO2003023095A1 (fr) * | 2001-09-06 | 2003-03-20 | Toshiba Ceramics Co., Ltd. | Plaquette de semi-conducteur et production de cette plaquette |
JP2012094905A (ja) * | 2007-03-09 | 2012-05-17 | Cree Inc | 中間層構造を有する厚い窒化物半導体構造、及び厚い窒化物半導体構造を製造する方法 |
US9054017B2 (en) | 2007-03-09 | 2015-06-09 | Cree, Inc. | Thick nitride semiconductor structures with interlayer structures and methods of fabricating thick nitride semiconductor structures |
JP4497170B2 (ja) * | 2007-03-26 | 2010-07-07 | 住友電気工業株式会社 | エピタキシャル基板の製造方法 |
JP2008243948A (ja) * | 2007-03-26 | 2008-10-09 | Sumitomo Electric Ind Ltd | エピタキシャル基板の製造方法 |
JP2011103380A (ja) * | 2009-11-11 | 2011-05-26 | Covalent Materials Corp | 化合物半導体基板 |
US9070833B2 (en) | 2011-08-04 | 2015-06-30 | Kabushiki Kaisha Toshiba | Distributed current blocking structures for light emitting diodes |
WO2014034687A1 (ja) * | 2012-08-29 | 2014-03-06 | 日東光器株式会社 | GaN系結晶及び半導体素子の製造方法 |
JP2014049461A (ja) * | 2012-08-29 | 2014-03-17 | Nitto Koki Kk | GaN系結晶及び半導体素子の製造方法 |
GB2519895A (en) * | 2012-08-29 | 2015-05-06 | Nitto Optical Co Ltd | Gan crystal and method for manufacturing semiconductor element |
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GB2519895B (en) * | 2012-08-29 | 2018-01-17 | Nitto Optical Co Ltd | Method for producing GaN-based crystal and semiconductor device |
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