FR2445556A1 - Systeme terminal a dispositif d'acces direct a une memoire - Google Patents
Systeme terminal a dispositif d'acces direct a une memoireInfo
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- G06F13/20—Handling requests for interconnection or transfer for access to input/output bus
- G06F13/28—Handling requests for interconnection or transfer for access to input/output bus using burst mode transfer, e.g. direct memory access DMA, cycle steal
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Abstract
L'invention concerne un système terminal à dispositif d'accès direct à une mémoire DMA par priorité tournante. Ce système est caractérisé en ce qu'il comprend un bus de système 16, 18, 20 transmettant des signaux de commande synchronisés, définissant des cycles de processur central CPU et un ensemble de cycles de DMA, un sous-système de mémoire 10 connecté au bus, pendant les cycles de CPU et de DMA, un ensemble de sous-systèmes périphériques 4 reliés au bus et au sous-système de mémoire, de manière à échanger des données, le sous-système périphérique étant connecté au sous-système de mémoire pendant un cycle de DMA préaffecté, et étant déconnecté du sous-système de mémoire pendant le cycle qui suit le cycle de DMA préaffecté. Application à l'échange d'informations entre une unité centrale et une mémoire, dans un système de traitement de l'information.
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- 1979-12-25 YU YU316779A patent/YU40587B/xx unknown
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