EP1252554A1 - Correction de deformation d'image non lineaire dans la fabrication de cartes de circuits imprimes - Google Patents
Correction de deformation d'image non lineaire dans la fabrication de cartes de circuits imprimesInfo
- Publication number
- EP1252554A1 EP1252554A1 EP00969787A EP00969787A EP1252554A1 EP 1252554 A1 EP1252554 A1 EP 1252554A1 EP 00969787 A EP00969787 A EP 00969787A EP 00969787 A EP00969787 A EP 00969787A EP 1252554 A1 EP1252554 A1 EP 1252554A1
- Authority
- EP
- European Patent Office
- Prior art keywords
- layer
- pattern
- image data
- conductive material
- layers
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/46—Manufacturing multilayer circuits
Definitions
- Post-etch punching of inner layers offered the following advantages as compared to pre-exposure methods:
- the tooling pattern is punched in the inner layer after etching. All material movement resulting from artwork instability, etching, black oxidizing, etc. is compensated for by offset and global scale.
- linear scaling error may be characterized by a single correction factor per axis for a given type of layer
- non-linear scaling errors require a more complex correction scheme.
- second order non-linearity which requires two correction factors through higher degrees of non-linearity, which require a number of correction factors equal to the degree of non-linearity to the most complex case where the required correction factor is as complex as the image file itself.
- An actual conductor pattern (produced from an initial map or stored image data, and produced by a defined process on defined apparatus) on at least one inner layer (artificially termed "a first inner layer,” even though it does not have to be the first layer) is scanned by an image scanner to produce a scanned map or scanned image data.
- the information from the scanned image of the first inner layer includes either the entire pattern of the conductor pattern, substantially all areas of the conductor pattern which contain conductor sites, or a segmented (discontinuous) pattern identifying the location of all conductor sites in the first inner layer, or a preselected portion of conductor sites.
Landscapes
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Image Processing (AREA)
- Length Measuring Devices By Optical Means (AREA)
Abstract
La présente invention se rapporte à un procédé de fabrication d'éléments multicouches présentant des connexions électriques entre des structures conductrices sur au moins deux couches de cet élément multicouche. Le procédé comprend au moins les étapes suivantes: a) utiliser un ensemble initial de données-image décrivant un premier élément ou une première couche présentant une structure conductrice, formant le premier élément ou la première couche présentant une structure de matériau conducteur; b) prélever des données provenant d'une image de la structure de matériau conducteur du premier élément ou de la première couche; c) déterminer, à partir de l'image de la structure de matériau conducteur du premier élément ou de la première couche, l'emplacement relatif de sites à l'intérieur de la structure de matériau conducteur dudit premier élément ou de ladite première couche devant être connectés aux sites d'une structure de matériau conducteur sur au moins une seconde couche présentant des structures conductrices; et ensuite effectuer les étapes sélectionnées dans le groupe consistant à: I) modifier l'ensemble initial de données-image pour le premier élément ou la première couche pour effectuer des corrections pour chaque site conducteur à l'intérieur de la structure de matériau conducteur et produire un ensemble corrigé de données-image; II) modifier un ensemble initial de données pour au moins une seconde couche présentant des sites à l'intérieur d'une structure de matériau conducteur devant être connectés aux sites du premier élément ou de la première couche, ladite modification étant basée sur une comparaison de l'ensemble initial de données-image pour la seconde couche et des données-image provenant de l'étape (b) dudit premier élément ou de ladite première couche, et produire un ensemble corrigé de données-image pour la seconde couche; III) modifier un ensemble initial de données pour une seconde couche présentant des sites à l'intérieur d'une structure de matériau conducteur devant être connectés aux sites d'une autre couche, la modification étant basée sur une comparaison de l'ensemble initial de données-image pour la seconde couche et des données-image provenant d'une seconde couche manufacturée, et modifier l'ensemble initial de données-image du premier élément ou de la première couche pour effectuer des corrections pour chaque site conducteur à l'intérieur de la structure de matériau conducteur, produisant ainsi un ensemble corrigé de données pour au moins le premier élément ou la première couche et la seconde couche; et IV) modifier un ensemble initial de données pour un certain nombre de couches, chaque couche présentant des sites à l'intérieur d'une structure de matériau conducteur devant être connectés aux sites d'une autre couche, la modification étant basée sur une comparaison des ensembles initiaux de données-image pour chacune des couches et des données-image provenant d'une couche manufacturée pour chacune des couches, et modifier l'ensemble initial de données-image pour chacune des couches pour effectuer des corrections pour chaque site conducteur à l'intérieur d'une structure de matériau conducteur à l'intérieur de chacune des couches, produisant ainsi un ensemble corrigé de données-image pour chacune des couches; et fabriquant ainsi au moins une couche présentant des sites conducteurs utilisant un ensemble corrigé de données pour fabriquer au moins ladite couche.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/IL2000/000667 WO2002033492A1 (fr) | 1999-07-06 | 2000-10-19 | Correction de deformation d'image non lineaire dans la fabrication de cartes de circuits imprimes |
Publications (1)
Publication Number | Publication Date |
---|---|
EP1252554A1 true EP1252554A1 (fr) | 2002-10-30 |
Family
ID=11043004
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
EP00969787A Withdrawn EP1252554A1 (fr) | 2000-10-19 | 2000-10-19 | Correction de deformation d'image non lineaire dans la fabrication de cartes de circuits imprimes |
Country Status (5)
Country | Link |
---|---|
EP (1) | EP1252554A1 (fr) |
JP (1) | JP4791681B2 (fr) |
KR (1) | KR20020074163A (fr) |
CN (1) | CN1434932A (fr) |
AU (1) | AU2000279433A1 (fr) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN108901119A (zh) * | 2018-06-22 | 2018-11-27 | 广州兴森快捷电路科技有限公司 | 用于测量激光钻机孔位精度的治具及方法 |
CN116362957A (zh) * | 2021-12-27 | 2023-06-30 | 广州镭晨智能装备科技有限公司 | Pcb板卡图像对齐的方法、装置、介质和电子设备 |
CN117141037A (zh) * | 2023-10-30 | 2023-12-01 | 山西昌鸿电力器材有限公司 | 一种电力金具加工工艺 |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100526035B1 (ko) * | 2003-05-07 | 2005-11-08 | 홍성국 | 메탈 마스크 검사 장치 및 그의 검사 방법 |
EP1804278A4 (fr) * | 2004-09-14 | 2011-03-02 | Nikon Corp | Procédé de correction et dispositif d exposition |
US7368207B2 (en) * | 2006-03-31 | 2008-05-06 | Eastman Kodak Company | Dynamic compensation system for maskless lithography |
KR101798678B1 (ko) | 2010-02-26 | 2017-11-16 | 마이크로닉 아베 | 패턴 정렬을 수행하기 위한 방법 및 장치 |
CN111694226B (zh) * | 2020-05-25 | 2022-05-17 | 合肥芯碁微电子装备股份有限公司 | 水平度测量方法和直接式成像设备 |
KR102385554B1 (ko) * | 2020-06-16 | 2022-04-13 | 재단법인 아산사회복지재단 | 나노구조체 기반의 표면증강라만 기판 및 그 제조 방법 |
CN114485409A (zh) * | 2022-04-18 | 2022-05-13 | 深圳市元硕自动化科技有限公司 | 原料板质量检测方法、装置、设备及可读存储介质 |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3291176B2 (ja) * | 1995-05-15 | 2002-06-10 | 松下電工株式会社 | 回路パターンの検査方法および検査装置 |
-
2000
- 2000-10-19 EP EP00969787A patent/EP1252554A1/fr not_active Withdrawn
- 2000-10-19 JP JP2002536614A patent/JP4791681B2/ja not_active Expired - Fee Related
- 2000-10-19 KR KR1020027007439A patent/KR20020074163A/ko not_active Application Discontinuation
- 2000-10-19 AU AU2000279433A patent/AU2000279433A1/en not_active Abandoned
- 2000-10-19 CN CN00819083A patent/CN1434932A/zh active Pending
Non-Patent Citations (1)
Title |
---|
See references of WO0233492A1 * |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN108901119A (zh) * | 2018-06-22 | 2018-11-27 | 广州兴森快捷电路科技有限公司 | 用于测量激光钻机孔位精度的治具及方法 |
CN116362957A (zh) * | 2021-12-27 | 2023-06-30 | 广州镭晨智能装备科技有限公司 | Pcb板卡图像对齐的方法、装置、介质和电子设备 |
CN116362957B (zh) * | 2021-12-27 | 2024-05-14 | 广州镭晨智能装备科技有限公司 | Pcb板卡图像对齐的方法、装置、介质和电子设备 |
CN117141037A (zh) * | 2023-10-30 | 2023-12-01 | 山西昌鸿电力器材有限公司 | 一种电力金具加工工艺 |
CN117141037B (zh) * | 2023-10-30 | 2024-02-02 | 山西昌鸿电力器材有限公司 | 一种电力金具加工工艺 |
Also Published As
Publication number | Publication date |
---|---|
JP4791681B2 (ja) | 2011-10-12 |
CN1434932A (zh) | 2003-08-06 |
JP2004512678A (ja) | 2004-04-22 |
KR20020074163A (ko) | 2002-09-28 |
AU2000279433A1 (en) | 2002-04-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US6165658A (en) | Nonlinear image distortion correction in printed circuit board manufacturing | |
EP2539773B1 (fr) | Procédé et appareil pour effectuer un alignement de motifs | |
CA2078930C (fr) | Marque de repere | |
US4536239A (en) | Multi-layer circuit board inspection system | |
WO2002039793A2 (fr) | Systeme et procede de fabrication de plaquettes de circuit imprime multicouche | |
JPH0445043B2 (fr) | ||
KR100890133B1 (ko) | 노광장치 | |
KR101480589B1 (ko) | 묘화 데이터의 보정 장치 및 묘화 장치 | |
IL142354A (en) | Multi-layer printed circuit board fabrication system and method | |
JP2008016758A (ja) | 多層回路基板製造におけるマーキング装置 | |
EP1252554A1 (fr) | Correction de deformation d'image non lineaire dans la fabrication de cartes de circuits imprimes | |
JP2012079739A (ja) | 変位算出方法、描画データの補正方法、描画方法および描画装置 | |
CN106793583A (zh) | 一种pcb板局部电厚金与非局部电金接线的制作方法 | |
JP4348474B2 (ja) | 基板方向検出方法および描画システム | |
KR20150027929A (ko) | 인쇄회로기판(pcb)의 역설계 장치 및 방법 | |
JP3711804B2 (ja) | 回路板の製造方法及びマスクフィルム用取付孔穿設装置 | |
JP2004252313A (ja) | 露光装置 | |
FI81690C (fi) | Foerfarande av en jaemn foerdelningstaethet. | |
JPS61172003A (ja) | プリント基板パタ−ン検査装置 | |
KR19980021238A (ko) | 반도체장치의 마스크 정렬 방법 | |
JPH1117292A (ja) | プリント基板とこの基板に部品を実装する部品実装機 | |
TW202319841A (zh) | 直接描繪裝置及其控制方法 | |
JPH08261720A (ja) | 印刷パターンの位置検査方法 | |
JPS6080298A (ja) | 混成集積回路の製造方法 | |
JPH05243716A (ja) | 配線板の製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PUAI | Public reference made under article 153(3) epc to a published international application that has entered the european phase |
Free format text: ORIGINAL CODE: 0009012 |
|
AK | Designated contracting states |
Kind code of ref document: A1 Designated state(s): AT BE CH CY DE DK ES FI FR GB GR IE IT LI LU MC NL PT SE |
|
AX | Request for extension of the european patent |
Free format text: AL;LT;LV;MK;RO;SI |
|
17P | Request for examination filed |
Effective date: 20030513 |
|
RBV | Designated contracting states (corrected) |
Designated state(s): AT BE CH DE FR GB LI |
|
STAA | Information on the status of an ep patent application or granted ep patent |
Free format text: STATUS: THE APPLICATION IS DEEMED TO BE WITHDRAWN |
|
18D | Application deemed to be withdrawn |
Effective date: 20060501 |