DE4402124A1 - Schaltungsanordnung zur Überwachung von digitalen periodischen Signalen - Google Patents
Schaltungsanordnung zur Überwachung von digitalen periodischen SignalenInfo
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- DE4402124A1 DE4402124A1 DE19944402124 DE4402124A DE4402124A1 DE 4402124 A1 DE4402124 A1 DE 4402124A1 DE 19944402124 DE19944402124 DE 19944402124 DE 4402124 A DE4402124 A DE 4402124A DE 4402124 A1 DE4402124 A1 DE 4402124A1
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Classifications
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/19—Monitoring patterns of pulse trains
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
Description
Die Erfindung betrifft eine Schaltungsanordnung zur
Überwachung von digitalen periodischen Signalen.
Der Einsatz von digitalen periodischen Signalen zur
Nachrichtenübermittlung bringt auch die Notwendigkeit mit
sich, derartige Signale auf Fehler zu überwachen. Diese
Überwachung ist aufgrund der üblichen hohen Datenraten
derartiger Signale (z. B. 150 MBit pro Sekunde) schwierig.
Der Erfindung liegt die Aufgabe zugrunde, eine Schaltung
anzugeben, mittels der eine Fehlerüberwachung erfolgen
kann.
Dies geschieht erfindungsgemäß mit einer Schaltungs
anordnung zur Überwachung von digitalen periodischen
Signalen, die einen Sollsignalgenerator, eine Vergleichs
schaltung, eine Fehlerzählschaltung und einen Marken
generator enthält, wobei an zwei Eingänge der Vergleichs
schaltung das zu überwachende digitale periodische Signal
und ein Ausgangssignal des Sollsignalgenerators heran
geführt sind, wobei ein Eingang der Fehlerzählschaltung an
den Ausgang der Vergleichsschaltung angeschlossen ist und
wobei der Markengenerator zur Steuerung der Fehlerzähl
zeiträume an einen Steuereingang der Fehlerzählschaltung
angeschlossen ist.
Die erfindungsgemäße Schaltungsanordnung bietet die
Möglichkeit, mit geringem Aufwand auch digitale Signale
sehr hoher Datenrate zu überwachen.
Die Erfindung wird anhand einer Figur näher erläutert.
Diese zeigt eine beispielhafte Schaltungsanordnung, die
einen Sollsignalgenerator 1, eine Vergleichsschaltung 2,
eine Fehlerzählschaltung 3 und einen Markengenerator 4
umfaßt.
Der Ausgang des Sollsignalgenerators 1 ist mit einem
Eingang der Vergleichsschaltung 2 verbunden. An den
zweiten Eingang der Vergleichsschaltung 2 ist das zu
überwachende Istsignal 1 herangeführt. Der Ausgang der
Vergleichsschaltung 2 ist mit dem Eingang einer
Fehlerzählschaltung 3 verbunden. Deren Steuereingang
EN ist an den Ausgang des Markengenerators 4
angeschlossen. Am Ausgang der Fehlerzählschaltung liegt
das Überwachungsergebnis vor.
Bei der Übertragung digitaler Zeichen wird üblicherweise
eine größere Anzahl der Zeichen zu einem Datenblock
zusammengefaßt, dem eine Synchronisierinformation
vorangestellt ist. Diese Synchronisierinformation wird vom
Sender generiert und auf der Empfangsseite ausgewertet.
Mit dieser Vorgangsweise ist gewährleistet, daß Sender und
Empfänger in dem für eine fehlerfreie Datenübertragung
notwendigen, völligen Gleichlauf oder Synchronismus
arbeiten.
Die im Empfänger vorhandene Information über den Aufbau
der Synchronisierinformation wird nun erfindungsgemäß zur
Fehlerüberwachung eines digitalen Datensignales verwendet.
Dabei ist ein Sollsignalgenerator 1 vorgesehen, der ein
digitales Referenzsignal generiert, dessen Periodendauer
mit dem zu überwachenden Signal übereinstimmt. Das
Referenzsignal enthält die Synchronisierungsinformation
des digitalen Empfangssignales. Die Teile des zu
überwachenden Signales, welche Synchronisierungs
information enthalten, werden nun mit dem Referenzsignal
verglichen. Tritt ein Unterschied auf, so ist dies als
Fehler zu werten, der von der Fehlerzählschaltung 3
registriert wird. Nach Ablauf einer vorgegebenen Zeit kann
die Fehlerzählschaltung ausgelesen werden, und so eine
Aussage über die Fehlerhäufung während des Vergleichs
zeitraumes getroffen werden. Es ist nun dabei
notwendig, Teile des zu überwachenden Signales zu
maskieren, da ja nur die Synchronisierungsinformation
verglichen und ausgewertet werden soll. Dies geschieht
erfindungsgemäß derart, daß ein Markengenerator 4
vorgesehen ist, der ein Markensignal startet, welche die
Fehlerzählschaltung 3 über einen Steuereingang aktiviert
bzw. deaktiviert. Durch dieses Markensignal ist also
gewährleistet, daß die Fehlerzählschaltung nur während der
Zeiträume aktiv ist, während der Synchronisierungsin
formation des zu überwachenden Signales mit dem Referenz
signal des Sollsignalgenerators verglichen wird. Während
der übrigen Zeiträume ist die Fehlerzählschaltung 3
inaktiv und das Ergebnis der Vergleichsschaltung 2 wird
nicht berücksichtigt.
Die angegebene Schaltung bietet die einfache Möglichkeit
der Fehlerüberwachung bei digitalen, periodischen Signalen
mit geringem Aufwand. Dieser geringe Aufwand ermöglicht
die Überwachung auch digitaler Signale sehr hoher
Datenraten.
Claims (1)
- Schaltungsanordnung zur Überwachung von digitalen periodischen Signalen, dadurch gekennzeichnet, daß ein Sollsignalgenerator (1), eine Vergleichsschaltung (2), eine Fehlerzählschaltung (3) und ein Markengenerator (4) vorgesehen sind, daß an zwei Eingänge der Vergleichs schaltung (2) das zu überwachende digitale periodische Signal und ein Ausgangssignal des Sollsignalgenerators (1) zugeführt sind, daß ein Eingang der Fehlerzählschaltung (3) an den Ausgang der Vergleichsschaltung (2) ange schlossen ist und daß der Markengenerator (4) zur Steuerung der Fehlerzählzeiträume an einen Steuereingang (EN) der Fehlerzählschaltung (3) angeschlossen ist.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19944402124 DE4402124A1 (de) | 1994-01-21 | 1994-01-21 | Schaltungsanordnung zur Überwachung von digitalen periodischen Signalen |
PCT/DE1995/000097 WO1995020267A1 (de) | 1994-01-21 | 1995-01-18 | Schaltungsanordnung zur überwachung von digitalen periodischen signalen |
AU14537/95A AU1453795A (en) | 1994-01-21 | 1995-01-18 | Circuit for monitoring digital periodic signals |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19944402124 DE4402124A1 (de) | 1994-01-21 | 1994-01-21 | Schaltungsanordnung zur Überwachung von digitalen periodischen Signalen |
Publications (1)
Publication Number | Publication Date |
---|---|
DE4402124A1 true DE4402124A1 (de) | 1995-07-27 |
Family
ID=6508652
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19944402124 Withdrawn DE4402124A1 (de) | 1994-01-21 | 1994-01-21 | Schaltungsanordnung zur Überwachung von digitalen periodischen Signalen |
Country Status (3)
Country | Link |
---|---|
AU (1) | AU1453795A (de) |
DE (1) | DE4402124A1 (de) |
WO (1) | WO1995020267A1 (de) |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4080589A (en) * | 1975-06-02 | 1978-03-21 | Gte Automatic Electric Laboratories Incorporated | Error density detector |
US4446437A (en) * | 1981-12-21 | 1984-05-01 | Gte Automatic Electric Labs Inc. | Pulse monitor circuit |
US5161175A (en) * | 1991-05-28 | 1992-11-03 | Motorola, Inc. | Circuit and method of detecting an invalid clock signal |
US5159615A (en) * | 1991-12-20 | 1992-10-27 | Vlsi Technology, Inc. | Digital frequency detection circuit |
-
1994
- 1994-01-21 DE DE19944402124 patent/DE4402124A1/de not_active Withdrawn
-
1995
- 1995-01-18 WO PCT/DE1995/000097 patent/WO1995020267A1/de active Application Filing
- 1995-01-18 AU AU14537/95A patent/AU1453795A/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
AU1453795A (en) | 1995-08-08 |
WO1995020267A1 (de) | 1995-07-27 |
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