DE3038522C2 - Schaltungsanordnung mit einem bipolaren Schalttransistor - Google Patents
Schaltungsanordnung mit einem bipolaren SchalttransistorInfo
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- DE3038522C2 DE3038522C2 DE19803038522 DE3038522A DE3038522C2 DE 3038522 C2 DE3038522 C2 DE 3038522C2 DE 19803038522 DE19803038522 DE 19803038522 DE 3038522 A DE3038522 A DE 3038522A DE 3038522 C2 DE3038522 C2 DE 3038522C2
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/04—Modifications for accelerating switching
- H03K17/041—Modifications for accelerating switching without feedback from the output circuit to the control circuit
- H03K17/0412—Modifications for accelerating switching without feedback from the output circuit to the control circuit by measures taken in the control circuit
- H03K17/04126—Modifications for accelerating switching without feedback from the output circuit to the control circuit by measures taken in the control circuit in bipolar transistor switches
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- Electronic Switches (AREA)
Description
— Die Basis des im Sättigungsbereich betriebenen Schalttransistors (1, 1') ist mit dem Eingang (5,
5*) für das Steuersginal über einen Widerstand
(3,3') verbunden,
— der Transistor ist ein Feldeffekttransistor (8,8'),
dessen Source an die Basis des Transistors, dessen Drain an das emitterseitige Potential
und dessen Gate an den Eingang (5, 5') angeschlossen ist; und
— der .Feldeffekttransistor (8, 8') ist selbstleitend
und von solchem Leitfähigkeitstyp, daß sein Kanal durch den vom Basisstrom des Transistors
(1,1') verursachten Spannungsabfall über dem Widerstand (3,3") gesperrt wird
Die Erfindung bezieht sich auf eine Schaltungsanordnung mit einem bipolaren Schalttransistor gemäß
Oberbegriff des Patentanspruchs.
Bei im Sättigungsbereich betriebenen bipolaren Schalttransistoren ist uezüglioi des Zeitverhaltens
bekanntlich die sogenannte Speicherzeit zu beachten,
die auftritt, wenn der Transisto. aus dem leitenden (gesättigten) in den gesperrten Zustand geschaltet wird,
und durch die in der Basiszone befindlichen Ladungsträger verursacht wird. Es sind bereits verschiedene
Möglichkeiten bekannt, um diese Ladungsträger schneiler
wegzuführen und damit den Entladeverzug zu verkleinern. Beispielsweise kann zwischen Basis- und
Emitteranschluß ein ausreichend niederohmiger Widerstand geschaltet werden, der in weiterer Ausgestaltung
mit einer in Sperrichtung wirkenden Spannungsquelle verbunden sein kann.
Hierbei ist jedoch ein entsprechend höherer Steuerstrom und im zweiten Fall zusätzlich eine weitere
Spannungsquelle erforderlich. Andere bekannte Eingangsschaltungen erfordern beispielsweise ein zusätzliches
gegenphasiges Steuersignal oder sind jeweils nur innerhalb eines durch die Dimensionierung der Bauelemente
bedingten Frequenzbereichs verwendbar.
Durch die US-PS 30 50 636 ist eine Schaltungsanordnung
mit einem bipolaren Schalttransistor bekannt, an dessen Basis ein Transistor angeschlossen ist, der durch
eine Diode, drei Widerstände und eine Stromquelle von — 12 V gesperrt ist, solange aufgrund des Eingangssignals
Strom in die Basis des Schalttransistors fließt, und bei fehlendem Eingangssignal in den leitenden Zustand
gelangt, so daß er dann dem bipolaren Schalttransistor den Basisstrom wegnimmt.
Der bipolare Schalttransistor wird jedoch im nicht-gesättigten Zustand betrieben, und der an seiner
Basis angeschlossene Transistor überbrückt nicht die Basis-ZEmitter-Strecke des bipolaren Schalttransistors,
sondern ist mil seinem Kollektor an eine weitere Spiinnungsquelle angeschlossen.
Der Erfindung liegt die Aufgabe zugrunde, eine Schaltungsanordnung der eingangs genannten Gattung
zu schaffen, bei der ein schnelles Abschalten des Schalttransistors ohne zusätzliche Steuerleistung und
mit einem Minimum an zusätzlichem Bauelementeaufwand erreicht wird.
Die Lösung dieser Aufgabe ist durch die im Patentanspruch genannten Merkmale gekennzeichnet
Sie erfordert somit nur ein einziges zusätzliches Bauelement, nämüch einen Feldeffekttransistor.
Die Erfindung wird nachstehend anhand der in der
Zeichnung dargestellten Ausführungsbeispiele näher erläutert Es zeigt
F i g. 1 eine Schaltungsanordnung mit einem NPN-Schalttransistor und
Fig.2 eine Schaltungsanordnung mit einem PNP-Schalttransistor
und einer Transistor-Vorstufe.
Die Schaltungsanordnung der F i g. I enthält einen NPN-Schalttransistor 1, dessen Emitter mit dem
Bezugspotential, dessen Basisanschluß über einen Widerstand 3 mit dem das Steuersignal 4 aufnehmenden
Eingang (Eingangsklemme) 5 und dessen Kollektor an den Ausgang 6 und über einen Widerstand 7 mit dem
positiven Anschluß der Speisespannung U verbunden ist Im Eingangskreis der Schaltung ist ein selbstleitender,
vorzugsweise niederohmiger P-Kanal-Feldeffekttransistor
8 angeordnet, und zwar so, daß die als Source wirkende Elektro-·; mit der Basis des Transistors 1, das
Drain mit dem emitterseitigen Potential und das Gate mit dem Eingang 5 der Schaltung verbunden ist
Wird das am Eingang 5 liegende Steuersignal 4 positiv, dann fließt über den Widerstand 3 Strom in die
Basis des Transistors 1, so daß dieser leitend wird. Der
durch den Basisstrom verursachte Spannungsabfall über dem Widerstand 3 wirkt als positive Gate-Source-Spannung,
die den Feldeffekttransistor 8 sperrt. Wenn das Steuersignal 4 auf Null geht oder am Eingang 5 kein
Signal anliegt, gehen der Basisstrom des Transistors 1 und damit der Spannungsabfall üb^r dem Widerstand 3
auf Null und der Kanal des Feldeffekttransisotrs 8 wird
leitend. Die in der Basiszone des Transistors 1 befindlichen Ladungsträger können dadurch in sehr
kurzer Zeit abfließen, so daß die eingangs genannte Speicherzeit und auch die Anstiegszeit der entsprechenden
Flanke des Signals am Ausgang 6 wesentlich verkleinert werden. Zusätzlich ergibt sich der Vorteil,
daß der Transistor 1 über den Kanal des Feldeffekttransistors 8 sicher im gesperrten Zustand gehalten wird,
ohne daß es hierfür eines besonderen Basis-Ableitwiderstandes bedarf.
Die Schaltungsanordnung der F i g. 2 unterscheidet sich von der oben beschriebenen zunächst dadurch, daß
hier ein PNP-Schalttransistor Γ und in Anpassung an
diesen ein N-Kanal-Feldeffekttransistor 8' verwendet
sind. Dementsprechend ist der Emitter des Transistors 1' mit dem positiven Anschluß der Speisespannung
verbunden. In vorteilhafter weiterer Ausgestaltung erfolgt die Ansteuerung des Schalttransistors Γ über
einen vorgeschalteten NPN-Transistor 9, dessen Kollektor unmittelbar an den Eingang 5' angeschlossen ist.
Die Basis des Transistors 9 ist über einen Ableitwiderstand 10 mit dem Bezugspotential und über einen
Widerstand 11 mit einem das Steuersignal liefernden Generator 12 verbunden.
Wird der Transistor 9 durch das Steuersignal in den leitenden Zustand gebracht, so zieht er über dtn
Widerstand 3' Strom aus der Basis des Schalttransistors
daß auch dieser in den leitenden Zustand gerät der Transistor 9 durch das Steuersignal gesperrt,
tfällt mit dem Basisstrom des Transistors 1' auch Spannungsabfall am Widerstand 3', so daß der
I des Feldeffekttransistors 8' selbstleitend wird und den Schalttransistor 1' rasch in den gesperrten
jid bringt.
In den beschriebenen Ausführungsbeispielen wird der Schalttransistor t bzw, 1' in Emitterschaltung betrieben.
Die erfinciungsgem&ße Anordnung eines Feldeffekttransistors
zum schnellen Ableiten der Ladungsträger aus der Basiszone ist jedoch in sinngemäßer Abwandlung
ebenso bei einer Kollektorschaltung (Emitterfolger) möglich.
Hierzu 1 Blatt Zeichnungen
Claims (1)
- Patentanspruch:Schaltungsanordnung mit einem bipolaren Schalttransistor, an dessen Basis ein Transistor angeschlossen Ist, der durch geeignete Schaltungsmittel 5 gesperrt wird, solang aufgrund des Eingangssignals Strom in die Basis des Schalttransistors fließt, und bei fehlendem Eingangssignal in den leitenden Zustand gelangt, gekennzeichnet durch die folgenden Merkmale:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19803038522 DE3038522C2 (de) | 1980-10-11 | 1980-10-11 | Schaltungsanordnung mit einem bipolaren Schalttransistor |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19803038522 DE3038522C2 (de) | 1980-10-11 | 1980-10-11 | Schaltungsanordnung mit einem bipolaren Schalttransistor |
Publications (2)
Publication Number | Publication Date |
---|---|
DE3038522A1 DE3038522A1 (de) | 1982-04-29 |
DE3038522C2 true DE3038522C2 (de) | 1983-02-10 |
Family
ID=6114208
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19803038522 Expired DE3038522C2 (de) | 1980-10-11 | 1980-10-11 | Schaltungsanordnung mit einem bipolaren Schalttransistor |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE3038522C2 (de) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3538552C1 (de) * | 1985-10-30 | 1987-01-08 | Philips Patentverwaltung | Schaltungsanordnung zur Ansteuerung einer kapazitiven Last |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3050636A (en) * | 1960-08-24 | 1962-08-21 | Ibm | High speed transistor switch |
-
1980
- 1980-10-11 DE DE19803038522 patent/DE3038522C2/de not_active Expired
Also Published As
Publication number | Publication date |
---|---|
DE3038522A1 (de) | 1982-04-29 |
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