DE3013523C2 - Prüfschaltungsanordnung für Speicher - Google Patents
Prüfschaltungsanordnung für SpeicherInfo
- Publication number
- DE3013523C2 DE3013523C2 DE3013523A DE3013523A DE3013523C2 DE 3013523 C2 DE3013523 C2 DE 3013523C2 DE 3013523 A DE3013523 A DE 3013523A DE 3013523 A DE3013523 A DE 3013523A DE 3013523 C2 DE3013523 C2 DE 3013523C2
- Authority
- DE
- Germany
- Prior art keywords
- memory
- digital
- circuit arrangement
- test circuit
- digital number
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
- G06F11/1666—Error detection or correction of the data by redundancy in hardware where the redundant component is memory or memory area
- G06F11/167—Error detection by comparing the memory output
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0763—Error or fault detection not based on redundancy by bit configuration check, e.g. of formats or tags
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/14—Error detection or correction of the data by redundancy in operation
- G06F11/1402—Saving, restoring, recovering or retrying
- G06F11/1415—Saving, restoring, recovering or retrying at system level
- G06F11/1441—Resetting or repowering
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
- G06F11/20—Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
- G06F11/2015—Redundant power supplies
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Power Sources (AREA)
- For Increasing The Reliability Of Semiconductor Memories (AREA)
- Tests Of Electronic Circuits (AREA)
Description
Normalbetriebs des Gerätes in diesen Speicherstellen gehalten. Der Speicherstatus kann zu jeder Zeit durch
Auslesung der Digitalzahlen M und N2 sowie durch
Prüfung des Zusammenhangs zwischen diesen beiden Zahlen geprüft werden. Es ist speziell wichtig, diesen
Zusammenhang nach einer Unterbrechung oder einem Verlust der Hauptspannungsversorgung zu prüfen,
wobei eine Reserve-Spannungsversorgung, wie beispielsweise eine Batterie verwendet wird, um die in den
Systemspeicherw gespeicherten Daten zu erhalten. Ein
richtiger Zusammenhang zwischen den Digitalzahlen M und N2 ist eine Verifikation dafür, daß der Status der
Daten im Speicher erhalten geblieben ist
Ausgestaltungen des Erfindungsgedankens sind in den Unteransprüchen gekennzeichnet
Die Erfindung wird im folgenden anhand eines in der einzigen Figur der Zeichnung dargestellten Ausführungsbeispiels
näher erläutert. Die Figur zeigt ein Blockschaltbild einer bevorzugten Ausführungsform
einer erfindungsgemäßen Prüfschaltungsanordnung.
Die erfindungsgemäße Prüfschaltungsanordnung kann in einem elektronischen Gerät, beispielsweise hei
Rechnern, in Meßinstrumenten oder in Datenübertragungsanlagen verwendet werden, in denen eine digitale
Prozessorschaltung 10 und ein Speicher 12 vorhanden sind. Die digitale Prozessorschaltung 10 kann irgendeine
Kombination von logischen Gattern, Schieberegistern, Flip-Flops und so weiter sein, mittels denen die jeweils
erforderliche digitale Signalverarbeitung durchgeführt wird. Eingangsdaten werden über Eingangsleitungen 14
in die digitale Prozessorschaltung 10 eingespeist, während verarbeitete Daten über Ausgangsleitungen 16
ausgegeben werden. Die Eingangs- und Ausgangsleitungen 14 und 16 können durch denselben Daten-Bus
gebildet werden. Die digitale Verarbeitungsschaltung 10 kann auch Verarbci lungs- und Steuerlogikschaltungen
enthalten. In der dargestellten Ausführungsform ist jedoch eine getrennte Verarbeitungs- und Steuerlogikschaltung
18 vorgesehen, welche beispielsweise durch eine getrennte Mikroprozessor- oder Mikrocomputer-Hardware
geoildet wird. Schaltungen dieser Art sind konventionell und an sich bekannt Sie werden daher
hier nicht detaillierter beschrieben.
Der Speicher 12 kann in seiner einfachen Form durch ein oder mehrere Flip-Flops gebildet werden. Es ist
jedoch zweckmäßiger, daß für diesen Speicher ein Speicher mit wahlfreiem Zugriff (RAM) mit Tausenden
von adressierbaren Speicherstellen vorgesehen wird-Der Speicher 12 ist wie dargestellt zu seiner
Energieversorgung zwischen eine Spannungsversor- ίο
gungsschaltung und Masse geschaltet. Die Spannungsversorgung kann entweder durch eine Haupt-Spannungsversorgungsstufe
20 oder eine Reserve-Spannungsversorgungsstufe 22 erfolgen, welche über einen Schalter 24 an den Speicher 12 angekoppelt sind. Die
Haupt-Spannungsversorgungsstufe 20 ist zweckmäßigerweise die Spannungsversorgung für das gesamte
System, während die Reserve-Spannungsversorgungsstufe 22 entweder durch die im Gerät vorgesehene
Batterie oder durch eine externe Spannungsversorgungsschaltung gebildet werden kann. Der Schalter 24
ist vorzugsweise ein elektronischer Schalter, wie beispielsweise ein Paar von als Komparator geschalteten
Transistoren mit zugehörigen Vorspannungs- und Sensorkreisen, wodurch er auf die richtige Spannungs-Versorgungsstufe
geschaltet werden kann. Im Normalbetrieb
ist die Haupt-Spannungsversorgungsstufe 20 über den Schalter 24 au den Speicher 12 gekoppelt.
Wird die Haupt-Spannungsversorgungsstufe unterbrochen
oder abgeschaltet, so wird die Reserve-Spannungsversorgungsstufe 22 in die Schaltung eingeschaltet, uir<
die im Speicher 12 gespeicherten Daten zu erhalten. Da die Schaltfunktion des Schalters 24 nicht augenblicklich
eintreten kann, ist ein Kondensator 26 vorgesehen, um die Betriebsspannung während des Umschaltern zu
erhalten und damit eine Zerstörung der gespeicherten Daten zu vermeiden.
Zur Erzeugung von Digitalzahlen in einer pseudowillkürlichen Art ist ein Zahlengenerator 30 vorgesehen.
Ein derartiger Zahlengenerator kann beispielsweise ein cyclisch kontinuierlich arbeitender Zähler sein.
Die Verarbeitungs- und Steuerlogikschaltung 18 empfängt also eine Folge von Digitalzahlen Ni vom
Zahlengenerator 30 und bearbeitet diese Zahl in einer speziellen Weise, um eine Folge von zweiten Digitalzahlen
N2 zu erzeugen, welche jeweils eindeutig auf Ni
bezogen sind. Die Dsgitalzahlen M und N2 werden in
einer ersten bzw. zweiten vorgegebenen Speicherstelle im Speicher 12 gespeichert und wäh' nd des Normalbetriebs
des Gerätes, in dem die Haupi-Sp-innungsversorgungsstufe
20 die Betriebsspannung für den Speicher liefert in diesen Speicherstellen gehalten. Durch die
digitale Verarbeitungsschaltung 10 verarbeitete Daten können in konventioneller Weise im Speicher gespeichert
werden. Der Speicherstatus kann in jedem Zeitpunkt durch Auslesen der Digitalzahlen N, und N2
sowie durch Prüfung des Zusammenhangs zwischen diesen beiden Zahlen geprüft werden. Dies kann
dadurch erfolgen, daß zuerst die Digitalzahl N\ ausgelesen wird, diese Zahl Nt in der gleichen Weise wie
ursprünglich zur Erzeugung einer neuen Digitalzahl N2
verarbeitet wird und sodann die neue Digitalzahl N2 mit
der ursprünglich gespeicherten Digitalzah! N2 verglichen
wird. Stimmen die Zahlen überein, so ist dies eine Anzeige dafür, daß die im Speicher 12 gespeicherten
Daten richtig erhalten geblieben sind Es ist speziell wichtig, diesen Zusammenhang nach einei Unterbrechung
oder einem Verlust der Hauptbetriebsspannung während der Zeit zu prüfen, in welcher die Reserve-Spa.inungsversorgungsstufe
zur Erhaltung der im Systemspeicher gespeicherten Daten verwendet wird. An die Verarbeitungs- und Steuerlogikschaltung 18 ist
eine Benutzerschaltung 34 angekoppelt, welche entweder eine Anzeige der Gültigkeit oder der Nichtgültigkeit
der Erhaltung des Speicherstatus liefert. Beispielsweise kann die Benutzerschaltung 34 durch eine Anzeigelampe,
durch einen Alarmgeber, einen Rücksetzschalter oder ein Gerät wie beispielsweise eine Kathodenstrahlröhren-Anzeige
oder einen Drucker gebildet werden, welche eine visuelle Anzeige für eine Bedienungsperson
liefern.
Die bevorzugte Ausführungsform der vorstehend beschriebenen Datenerhaltungs- und Prüfschaltungsanordnung
für Speie« er ist universell verwendbar. Die beschriebene Anordnung kann in einem Oszillographen
mit digitalen Rechnermöglichkeiten verwendet werden. Die digitale V?rarbeitungsschaltung 10 sowie die
Verarbeitungs- unu Steuerlogikschaltung 18 werden dabei durch einen Mikroprozessor mit seinen zugeordneten
Schaltungen gebildet. Der Speicher 12 ist eine Bank für Speichern mit wahlfreiem Zugriff. Die
Haupt-Spannungsversorgungsstufe 20 dient als Spannungsversorgung für den gesamten Oszillographen. Der
Zahlengenerator 30 wird durch die Zähierschaltungen gebildet, welche das zugehörige Einstellwerk ansteuern.
Die Benutzerschaltung 34 wird durch die Kathoden-
strahlröhre des Oszillographen gebildet. Da lediglich ein Teil des Speichers im PrüfprozeD geprüft wird, basiert
die Annahme, daß gültige Daten im Rest des Speichers gespeichert sind, auf der Wahrscheinlichkeit. Es werden
verschiedene Maßnahmen ergriffen, um einen hohen Wahrscheinlichkeitsgrad für gültige Daten sicherzustellen.
Zunächst sind die Digitalzahlen N\ und N2
8-Bit-Digitalzahlen. Die Verarbeitungs- und Steuerlogikschaltung
18 analysiert die Zahl /Vi und verwirft eine Zahl mit jeweils nur Nullen oder Einsen. Daher |()
enthalten gespeicherte Zahlen sowohl Nullen als auch Einsen, wobei die Wahrscheinlichkeit eliminiert wird,
daß ein Speicher, welcher nur Nullen oder Einsen bei einer nachfolgenden Spannungseinschaitung enthält, für
den Prüfzweck verwendet wird. Die bei der Erzeugung t5
der zweiten Digitalzahl N2 stattfindende Operation
besteht in der Erzeugung des Komplements der ersten Digitalzahl Ni. d. h., alle Nullen in der Zahl N\ und alle
Einsen der ersten Zahl N\ werden für die Zahl N2 in
Einsen bzw. Nullen überführt. Die beiden Zahlen Ni und
N2 werden in einer ersten und zweiten vorgegebenen
Speicherstelle gespeichert, welche benachbart zueinander liegen. Es ist davon auszugehen, daß eine solche
Situation tatsächlich die Chancen für eine Speicherzerstörung während einer Spannungsunterbrechung erhöht,
so daß infolgedessen eine positive Prüfung bei einer nachfolgenden Spannungseinschaltung die Wahrscheinlichkeit
erhöht, daß die im Rest des Speichers gespeicherten Daten gültig sind. Die Verwendung von
komplementären Digitalzahlen /Vi und AZ2 vereinfacht
auch den Prüfprozeß, da die Digitalzahlen N1 und N2
direkt verglichen werden können, ohne daß eine neue Digitalzahl N2 erzeugt wird.
Hie
Zeichnungen
Claims (9)
1. Prüfschaltungsanordnung für Speicher mit einer
an den Speicher (12) angekoppelten Spannungsversorgung in Form einer Haupt-Spannungsversorgungsstufe
und einer Reserve-Spannungsversorgungsstufe, gekennzeichnet durch einen
Generator (30) zur Erzeugung einer ersten Folge von ersten pseudo-willkürlichen Digitalzahlen (Nl),
durch eine Verarbeitung^- und Steuerlogik (10, 18) zur Erzeugung einer zweiten Folge von eindeutig auf
die ersten Digitalzahlen (JVl) bezogenen zweiten Digitalzahlen (N2\ zur Einspeisung je einer ersten
Digitalzahl (JVl) und je einer zugeordneten zweiten
Digitalzahl (N2) in den Speicher (12) sowie zur Auslesung der ersten Digitalzahl (JVl) und zweiten
Digitalzahl (JV2) und Prüfung des Zusammenhangs zwischen diesen zwecks Realisierung einer Prüfung
der Gültigkeit des Speicherinhaltes und durch eine Benutzei?cfca!tung (34) zur Realisierung einer
Anzeige der Prüfung.
2. Prüfschaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, daß als Generator (30) ein
zyklisch arbeitender Zähler vorgesehen ist
3. Prüfschaltungsanordnung nach Anspruch 1, gekennzeichnet durch eine derartige Ausbildung der
Verarbeitungs- und Steuerlogik (10, 18), daß die Prüfung der Gültigkeit des Speicherinhaltes nach
einer Unterbrechung oder einem Verlust der Haupt-Betriebsspannung erfolgt
4. PrüfscLaltungsanordnung nach Anspruch 1,
gekennzeichnet durch eine d?~artige Ausbildung der Verarbeitungs- und S»euerlogik (10, 18), daß die
erste Digitalzahl (Ni) und d« zweite Digitalzahl
(JV 2) in benachbarten Speicherzellen gespeichert sind.
5. Prüfschaltungsanordnung nach Anspruch 1, gekennzeichnet durch eine derartige Ausbildung der
Verarbeitungs- und Steuerlogik (10, 18), daß die erste Digitalzahl (JVl) vor Erzeugung der zweiten
Digitalzahl (N 2) analysiert und verworfen wird, falls eine Zahl mit jeweils nur Nullen oder Einsen
festgestellt wird.
6. Prüfschaltungsanordnung nach Anspruch 1, gekennzeichnet durch eine derartige Ausbildung der
Verarbeitungs- und Steuerlogik (10, 18), daß die zweite Digitalzahl (JV 2) das Komplement der ersten
Digitalzahl (JVl) ist.
7. Prüfschaltungsanordnung nach Anspruch 6, gekennzeichnet durch eine derartige Ausbildung der
Verarbeitungs- und Steuerlogik (10,18), daß bei der Prüfung der Gültigkeit des Speicherinhaltes die
erste Digitalzahl und die zweite Digitalzahl direkt verglichen werden.
8. Prüfschaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, daß als Speicher (12) ein
Speicher mit wahlfreiem Zugriff (RAM) vorgesehen ist.
9. Prüfschaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, daß als Benutzerschaltung
(34) eine Anzeigelampe, oder ein Alarmgeber, oder ein Rücksetzschalter, oder eine Kathodenstrahlröhrenanzeigevorrichtung
oder ein Drucker vorgesehen ist.
Die vorliegende Erfindung betrifft eine Prüfschaltungsanordnung für Speicher nach dem Oberbegriff des
Patentanspruchs 1.
Aufgrund der Fortschritte des Standes der Halbleitertechnologie hinsichtlich Größe, Kosten und Leistungsverbrauchreduzierung
ist es zweckmäßig, digitale Verarbeitungs- und Rechnersysteme in elektrische Geräte aller Arten einzubauen. Ein Problem derartiger
Systeme besteht jedoch darin, daß bei Unterbrechung ίο oder Abschaltung der Spannungsversorgung im Betrieb
in Systemspeichern enthaltene Daten verloren gehen. Dieses Problem wurde bis zu einem gewissen Grade
dadurch gelöst, daß für die Speicherbausteine eine Reserve-Batteriespannungsversorgung vorgesehen
wurde, um die gespeicherten Daten zu erhalten. Ein weiteres Problem besteht jedoch in der Sicherstellung,
daß die gespeicherten Daten bei der erneuten Einschaltung der Betriebsspannung richtig bzw. gültig
sind. Es ist vorgeschlagen worden, ein bekanntes Datenwort zu speichern und dieses Wort vor einem
erneuten Beginn von Datenverarbeitungsvorgängen als gültig zu prüfen. Ein derartiges bekanntes Datenwort
kann jedoch immer dasselbe sein und immer in der gleichen Speicherstelle gespeichert werden, wobei
durch eine unbestimmte physikalische Eigenschaft des Speicherbausteins dessen Speicherstelle das bekannte
Wort fest annehmen kann, was einem gespeicherten latenten Bild in einer Anzeigeeinrichtung analog ist.
Dies führt zu der Gefahr, daß das bekannte Datenwort bei erneuter Einschaltung der Betriebsspannung durch
den Speicher zur Prüfung erzeugt werden kann, auch wenn der Inhalt des Speichers während des Verlustes
der Betriebsspannung zerstört wurde.
Der vorliegenden Erfindung liegt die Aufgabe zugrunde, eine Prüfschaltungsanordnung anzugeben, bei
der die vorstehend genannte Gefahr nicht auftritt
Die Lösung dieser Aufgabe gelingt durch eine Prüfschaltungsanordnung der eingangs genannten Art,
die durch die im Patentanspruch 1 genannten Merkmale gekennzeichnet ist
Bei der vorstehend definierten erfindungsgemäßen Schaltungsanordnung wird ein Speicherinhalt nach
einer Unterbrechung und einer nachfolgenden Einschaltung der Betriebsspannung als gültig geprüft
Durch die Schaltungsanordnung können dabei zwei pseudo-willkürlich erzeugte Digitalzahlen in vorgegebenen Speicherstellen für eine spätere Prüfung gespeichert werden.
Durch die Schaltungsanordnung können dabei zwei pseudo-willkürlich erzeugte Digitalzahlen in vorgegebenen Speicherstellen für eine spätere Prüfung gespeichert werden.
Der Speicherinhalt wird dabei nach einer Unterbrechung und einer nachfolgenden erneuten Einschaltung
der Hauptbetriebsspannung durch Speicherung einer willkürlichen Digitalzahl und einer speziellen aus dieser
abgeleiteten Codezahl in benachbarten Speicherstellen, sowie durch nachfolgende Prüfung des Zusammenhangs
zwischen der Digitalzahl und der Codezahl als gültig geprüft.
In einem elektrischen Gerät, das digitale Verarbeitungsschaltungen
enthält, wird die Reserve-Spannungsversorgung dazu verwendet, um den Status des Speicherinhaltes während einer Unterbrechung oder
eines Verlustes der Haupt=Spannungsversorgung aufrecht zu erhalten. Es wird eine erste Folge pseudo-willkürlicher
Digitalzahlen JVi erzeugt und in einer speziellen Weise verarbeitet, um daraus eine zweite
Folge von Digitalzahlen /Vi zu erzeugen, welche jeweils
eindeutig auf M bezogen sind. Die Digitalzahlen /Vi und
/V2 werden in vorgegebenen benachbarten ersten und
zweiten Speicherstellen gespeichert und während des
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US06/030,509 US4232377A (en) | 1979-04-16 | 1979-04-16 | Memory preservation and verification system |
Publications (2)
Publication Number | Publication Date |
---|---|
DE3013523A1 DE3013523A1 (de) | 1980-10-23 |
DE3013523C2 true DE3013523C2 (de) | 1983-09-15 |
Family
ID=21854527
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE3013523A Expired DE3013523C2 (de) | 1979-04-16 | 1980-04-08 | Prüfschaltungsanordnung für Speicher |
Country Status (7)
Country | Link |
---|---|
US (1) | US4232377A (de) |
JP (1) | JPS55142499A (de) |
CA (1) | CA1135869A (de) |
DE (1) | DE3013523C2 (de) |
FR (1) | FR2454674A1 (de) |
GB (1) | GB2047927B (de) |
NL (1) | NL181154C (de) |
Families Citing this family (31)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1981002362A1 (en) * | 1980-02-08 | 1981-08-20 | Mostek Corp | Multiplexed operation of write enable terminal of a memory circuit for control and backup power functions |
US4315162A (en) * | 1980-05-09 | 1982-02-09 | Control Technology, Incorporated | Reserve power supply for computers |
US5276354A (en) * | 1981-05-27 | 1994-01-04 | Sgs-Thomson Microelectronics, Inc. | Integrated circuit package with battery housing |
US5055704A (en) * | 1984-07-23 | 1991-10-08 | Sgs-Thomson Microelectronics, Inc. | Integrated circuit package with battery housing |
US4998888A (en) * | 1984-07-23 | 1991-03-12 | Sgs-Thomson Microelectronics, Inc. | Integrated circuit package with battery housing |
JPS5840674A (ja) * | 1981-09-03 | 1983-03-09 | Fujitsu Ten Ltd | マイクロコンピュ−タの異常判定方法 |
JPS58171537U (ja) * | 1982-05-07 | 1983-11-16 | ブラザー工業株式会社 | 電子機器 |
JPS5948899A (ja) * | 1982-09-09 | 1984-03-21 | Ishida Scales Mfg Co Ltd | Ramのエラ−チエツク方法 |
JPS59127299A (ja) * | 1983-01-08 | 1984-07-23 | Sony Tektronix Corp | 記憶回路のバツクアツプ確認方法 |
GB2145253A (en) * | 1983-08-17 | 1985-03-20 | Philips Electronic Associated | Method of controlling a domestic appliance |
JPS60247766A (ja) * | 1984-05-22 | 1985-12-07 | Sharp Corp | プログラム計算機 |
GB2166893B (en) * | 1984-10-05 | 1988-03-23 | Sharp Kk | Checking memory at system power-up |
FR2571870B1 (fr) * | 1984-10-15 | 1987-02-20 | Sagem | Dispositif de sauvegarde de memoire de microprocesseur. |
JPS61141056A (ja) * | 1984-12-14 | 1986-06-28 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 揮発性メモリの間欠エラ−検出方法 |
US4650957A (en) * | 1985-04-29 | 1987-03-17 | Cyclomatic Industries, Inc. | Voltage control system |
US4800378A (en) * | 1985-08-23 | 1989-01-24 | Snap-On Tools Corporation | Digital engine analyzer |
US4779091A (en) * | 1986-01-31 | 1988-10-18 | Nec Corporation | Radio pager receiver capable of informing whether or not memory backup is correct |
JPH0624335B2 (ja) * | 1987-02-27 | 1994-03-30 | 日本電気株式会社 | 表示付選択呼出受信機 |
JPH086799B2 (ja) * | 1987-06-20 | 1996-01-29 | 富士通株式会社 | 自動車変速機用電子制御装置、及び方法 |
US4874960A (en) * | 1988-03-04 | 1989-10-17 | Square D Company | Programmable controller capacitor and battery backed ram memory board |
US5028806A (en) * | 1989-04-14 | 1991-07-02 | Dell Corporate Services Corporation | Battery replacement system for battery-powered digital data handling devices |
US5410713A (en) * | 1992-01-02 | 1995-04-25 | Smith Corona/Acer | Power-management system for a computer |
ES2107492T3 (es) * | 1992-12-15 | 1997-12-01 | Siemens Ag | Procedimiento y disposicion para la supervision del funcionamiento de un sistema de circuito digital. |
ATE202224T1 (de) * | 1993-10-04 | 2001-06-15 | Elonex Technologies Inc | Verfahren und vorrichtung für eine optimierte leistungsversorgung für eine rechnereinrichtung |
JP3474665B2 (ja) * | 1995-03-02 | 2003-12-08 | 富士通株式会社 | 計算機システムの電源制御装置及び方法 |
JP2802744B2 (ja) * | 1996-01-26 | 1998-09-24 | 株式会社アイエスエイ | タイマー付無停電電源制御装置 |
US5857074A (en) * | 1996-08-16 | 1999-01-05 | Compaq Computer Corp. | Server controller responsive to various communication protocols for allowing remote communication to a host computer connected thereto |
US5796566A (en) * | 1996-08-16 | 1998-08-18 | Compaq Computer Corporation | Printed circuit board having conductors which can be decoupled for isolating inactive integrated circuits connected thereto |
US5852720A (en) | 1996-08-16 | 1998-12-22 | Compaq Computer Corp. | System for storing display data during first time period prior to failure of computer and during second time period after reset of the computer |
US6233634B1 (en) | 1996-08-17 | 2001-05-15 | Compaq Computer Corporation | Server controller configured to snoop and receive a duplicative copy of display data presented to a video controller |
DE102004022792A1 (de) * | 2004-05-08 | 2005-08-11 | Infineon Technologies Ag | Speicherschaltung, Speichersteuereinheit zum Betreiben der Speicherschaltung sowie Verfahren zum Ansteuern der Speicherschaltung und ein Verfahren zum Betreiben der Speicherschaltung |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3980935A (en) | 1974-12-16 | 1976-09-14 | Worst Bernard I | Volatile memory support system |
US4122359A (en) * | 1977-04-27 | 1978-10-24 | Honeywell Inc. | Memory protection arrangement |
-
1979
- 1979-04-16 US US06/030,509 patent/US4232377A/en not_active Expired - Lifetime
-
1980
- 1980-03-18 NL NLAANVRAGE8001608,A patent/NL181154C/xx not_active IP Right Cessation
- 1980-03-25 CA CA000348342A patent/CA1135869A/en not_active Expired
- 1980-04-08 DE DE3013523A patent/DE3013523C2/de not_active Expired
- 1980-04-15 FR FR8008662A patent/FR2454674A1/fr active Granted
- 1980-04-15 JP JP5024780A patent/JPS55142499A/ja active Granted
- 1980-04-15 GB GB8012307A patent/GB2047927B/en not_active Expired
Also Published As
Publication number | Publication date |
---|---|
FR2454674A1 (fr) | 1980-11-14 |
JPS6245572B2 (de) | 1987-09-28 |
NL181154B (nl) | 1987-01-16 |
DE3013523A1 (de) | 1980-10-23 |
GB2047927B (en) | 1983-05-25 |
NL8001608A (nl) | 1980-10-20 |
GB2047927A (en) | 1980-12-03 |
NL181154C (nl) | 1987-06-16 |
FR2454674B1 (de) | 1983-06-17 |
CA1135869A (en) | 1982-11-16 |
US4232377A (en) | 1980-11-04 |
JPS55142499A (en) | 1980-11-07 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE3013523C2 (de) | Prüfschaltungsanordnung für Speicher | |
DE4328605C2 (de) | Halbleiterspeichereinrichtung | |
DE3689128T2 (de) | Halbleiterspeichergerät mit einer Korrekturfunktion. | |
DE69500346T2 (de) | Verbesserte Speicherselbstprüfung | |
EP0207320B1 (de) | Integrierte Schaltung und Verfahren zum Sichern von geheimen Codedaten | |
DE3128740C2 (de) | ||
DE2721319A1 (de) | Einrichtung zur selbsttaetigen aenderung der prozessor/speicher-konfiguration | |
DE4430387C2 (de) | Fehlererkennungsvorrichtung | |
DE3607015A1 (de) | Verfahren und vorrichtung zur funktionspruefung von direktzugriffsspeichern | |
DE2556822A1 (de) | Monolithische hochintegrierte halbleiterschaltung | |
DE2946081A1 (de) | Anordnung zur ueberwachung der funktion eines programmierbaren elektronischen schaltkreises | |
DE2556556A1 (de) | Verfahren und anordnung zur speicherung von informationen ueber den ort eines oder mehrerer fehlerhafter bits in einem einzelne fehler korrigierenden halbleiter-hauptspeicher | |
DE10355116B4 (de) | Ein- und Ausgangsschaltung eines integrierten Schaltkreises, Verfahren zum Testen eines integrierten Schaltkreises sowie integrierter Schaltkreis mit einer solchen Ein- und Ausgangsschaltung | |
DE2536625C2 (de) | Paritätsprüfschaltung für ein binär zählendes Register | |
DE2418650C2 (de) | Einrichtung zur Prüfung und Überwachung von Stromversorgungseinrichtungen | |
DE2719291A1 (de) | Datenspeichersystem | |
DE19823930A1 (de) | Integrierte Halbleiterschaltung mit an einem Halbleiterchip angeordnetem DRAM | |
DE2349607A1 (de) | Verfahren zur wechselstrom-guetepruefung von integrierten schaltungen | |
DE102008013099A1 (de) | Speichertestschaltung | |
DE69216172T2 (de) | Schaltung und Verfahren zur Fehlerdetektion und -korrektur von Datenwörtern mit Prüfbits | |
DE3318083A1 (de) | Schaltungsanordnung mit einem speicher und einer zugriffskontrolleinheit | |
DE69012382T2 (de) | Referenzzelle für das Lesen von EEPROM-Speicheranordnungen. | |
DE2733921A1 (de) | Schaltungsanordnung fuer eine indirekt gesteuerte vermittlungsanlage, insbesondere fernsprechvermittlungsanlage | |
DE2106731A1 (de) | Diagnoseeinrichtung fur elektronische Datenverarbeitungsanlagen | |
EP0037965B1 (de) | Einrichtung zum Prüfen einer digitalen Schaltung mittels in diese Schaltung eingebauter Prüfschaltungen |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
OAP | Request for examination filed | ||
OD | Request for examination | ||
8172 | Supplementary division/partition in: |
Ref country code: DE Ref document number: 3050396 Format of ref document f/p: P |
|
Q171 | Divided out to: |
Ref country code: DE Ref document number: 3050396 |
|
8125 | Change of the main classification |
Ipc: G11C 29/00 |
|
8126 | Change of the secondary classification |
Ipc: ENTFAELLT |
|
8181 | Inventor (new situation) |
Free format text: TALLMAN, JAMES LARRY, HILLSBORO, OREG., US |
|
D2 | Grant after examination | ||
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |