DE2920940C2 - - Google Patents

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Description

Die Erfindung betrifft ein Verfahren zur Herstellung von gedruckten Schaltungen unter Verwendung von kupferkaschiertem Basismaterial, das in üblicher Weise gebohrt, gereinigt, aktiviert, gegebenenfalls reduziert und in üblicher Weise nachbehandelt wird, wobei die Aufbringung der Leiterstrukturen durch Aufbringen eines Resists in Sieb- oder Fotodruck-Technik erfolgt.
Verfahren zur Herstellung von gedruckten Schaltungen sind bereits bekannt, doch sind diese mit gewissen Nachteilen behaftet.
Ein Nachteil der sogenannten Subtraktivtechnik besteht zum Beispiel darin, daß große Mengen der Kaschierung des Basismaterials nach dem Aufbau des Leiterbildes entfernt werden müssen. Gleichzeitig erfolgt die Unterätzung der Leiterzüge mit all den bekannten Schädigungen, die um so gravierender sind und prozentual um so rascher anwachsen, je schmaler die Bahnen ausgelegt beziehungsweise aneinander gerückt werden. Diese Erscheinungen stehen daher einer weiteren Miniaturisierung im Rahmen der Substraktivtechnik entgegen.
Ein Nachteil der sogenannten Additivtechnik besteht andererseits darin, daß haftvermittlerbeschichtetes Basismaterial verwendet werden muß. Der Haftvermittler ist nach dem chemischen Aufschluß und der Aktivierung die Grundlage für das selektiv aufgebrachte, chemisch abgeschiedene Kupfer und weist nach der Naßbehandlung gegenüber Epoxidharz deutlich schlechtere, elektrische Kenndaten auf, wodurch der Auslegung miniaturisierter Schaltungen ebenfalls enge Grenzen gezogen werden.
Aus der DE-PS 21 09 576 ist weiterhin ein Verfahren zur Herstellung von gedruckten Schaltungen aus metallkaschierten Isolierstoffplatten bekannt, bei dem das Leiterbild mit einem ätzfesten Lack positiv gedruckt wird, so daß die gewünschten Leiterbahnen abgedeckt sind. Eine vollständige Abdeckung der aktivierten Bohrlochwandungen ist mit der gehaltenen Zuverlässigkeit nicht möglich. Das hat den Nachteil, daß sich der Ätzvorgang des Kupfers auch auf die frei liegenden Keime der Aktivierung auf der Bohrlochoberfläche erstreckt, was wiederum bei der späteren chemischen Verkupferung zu Fehlstellen oder gar Ausbleiben einer Durchkontaktierung führen muß.
Bekannt ist es außerdem, metallische Ätzresiste, zum Beispiel Nickel oder Zinn- Nickel, bei der Bildung der leitfähigen Bereiche der Platte einzusetzen (DE-OS 26 52 428; WO 79/00083).
Aufgabe der vorliegenden Erfindung ist daher die Schaffung eines zuverlässigen Verfahrens, das ausgehend von kupferkaschiertem Basismaterial die Herstellung von gedruckten Schaltungen mit feinsten Leitern auf engstem Raum mit optimalen elektrischen Kenndaten ermöglicht.
Diese Aufgabe wird erfindungsgemäß durch ein Verfahren gemäß dem kennzeichnenden Teil des Patentanspruchs gelöst.
Weitere Ausgestaltungen der Erfindung sind dem Kennzeichnungsteil des Unteranspruchs zu entnehmen.
Das erfindungsgemäße Verfahren ermöglicht in bisher nicht erreichter Weise die Herstellung qualitativ hochwertiger miniaturisierter Schaltungen. Das Verfahren hat außerdem den großen Vorteil, ausgehend von kupferkaschiertem Basismaterial, die Herstellung von Feinstleiterbahnen in einer Breite von unter 100 µm mit besten Isolations- und Oberflächenwiderstandswerten zu ermöglichen.
Ein weiterer wesentlicher Vorteil ist die Einsparung von Kupfer, einem wertvollen Rohstoff.
Als geeignetes Basismaterial ist beispielsweise Phenolharzhartpapier, Epoxidharzpapier und insbesondere glasfaserverstärktes Epoxidharz zu nennen.
Dieses wird in üblicher Weise gebohrt, gereinigt und in einem der üblichen Aktivatorsysteme aktiviert, gegebenenfalls reduziert und nachbehandelt. Anschließend wird in an sich bekannter Weise gespült und getrocknet.
Das Schaltbild wird im Sieb- oder Fotodruck negativ aufgetragen.
Möglich ist auch die Auftragung des Lötbildes (Lötaugen und Bohrlöcher) durch einen negativen Sieb- oder Fotodruck. Die Metallisierung erfolgt in einem chemischen Bad, wobei 0,1 bis 1,5 µm einer Nickel-, Kobalt- oder Nickel-Kobalt-Schicht, die entweder das ganze Schaltbild oder nur die Lötaugen und Bohrlöcher bedeckt, abgeschieden werden. Diese Schichten können chemisch und/oder galvanisch in einem üblichen Bad vorverkupfert werden. Nach dem Ablösen des zuvor aufgetragenen Resists, dessen Entfernung in an sich bekannter Weise durch Einwirkung eines organischen Lösungsmittels, wie zum Beispiel Methylenchlorid, erfolgt, wird das freigelegte Kupfer in üblicher Weise abgeätzt, während das unter der Nickel-, Kobalt- oder Nickel-Kobalt-Schicht befindliche Kupfer ebenso wie die Metallschicht selbst überraschenderweise insbesondere bei der Anwendung alkalischer Ätzmedien unangegriffen bleiben. Als Resist dient zweckmäßigerweise ein üblicher Fotolack oder Fotofilm. In vielen Fällen wird das entwickelte Schaltbild negativ durch Lötstoplackdruck abgedeckt und die freigebliebenen Lötaugen und Bohrlöcher chemisch verkupfert.
Als Kupferbad läßt sich vorzugsweise ein stabilisiertes chemisches Kupferbad verwenden, und zwar enthaltend als wesentliche Bestandteile ein Kupfersalz, einen Komplexbildner, Formaldehyd, ein Alkalicyanid und gegebenenfalls eine Selenverbindung als Stabilisatoren.
Als Alkalicyanid eignet sich hierfür insbesondere Natriumcyanid in Konzentrationen von 15 bis 30 mg/Liter.
Geeignete Selenverbindungen sind die organischen, anorganischen und organisch-anorganischen Mono- und Diselenide und hiervon insbesondere die Alkaliselenocyanate, wie Kaliumselenocyanat, die in geringen Konzentrationen von insbesondere 0,1 bis 0,3 mg/ Liter verwendet werden.
Das folgende Beispiel dient zur Erläuterung der Erfindung.
Beispiel
Eine übliche doppelseitig kupferkaschierte Basisplatte aus glasfaserverstärktem Epoxidharz wird in üblicher Weise gebohrt, gebürstet und unter Verwendung einer stabilisierten schwefelsauren Lösung von Wasserstoffperoxid geätzt und gereinigt. Anschließend wird die derart vorbehandelte Platte mit einem Aktivator auf Basis von zum Beispiel Palladiumchlorid, Zinnchlorid und Salzsäure aktiviert und darauf mit 30%iger Fluoroborsäure haftfixiert. Sodann werden alle nicht zum Leiterbild gehörenden Gebiete mittels eines Resists abgedeckt, das heißt negativ bedruckt und die entstehenden Verunreinigungen entfernt.
Erfindungsgemäß läßt man nun ein chemisches Nickelbad folgender Zusammensetzung einwirken.
28 g/l NickelsulfatNiSO₄ · 7 H₂O 20 g/l NatriumhypophosphitNaH₂PO₂ · H₂O 20 g/l NatriumboratNa₂B₄O₇ · 10 H₂O 75 g/l TrinatriumcitratNa₃C₄H₃O₆ · 2 H₂O
Die Behandlung erfolgt bei einem pH-Wert von 9,0 bei 50°C und einer Dauer von 30 Minuten. Die Schichtdicke beträgt etwa 1,5 µm.
Anschließend wird der Resist zum Beispiel unter Verwendung eines organischen Lösungsmittels, wie Methylenchlorid, entfernt und das freigelegte Kupfer mittels einer sauren Ätzlösung, zum Beispiel einer sauren Ammoniumpersulfat-Lösung, oder einer alkalischen Ätzlösung, zum Beispiel einer ammoniakalischen Lösung von Natriumchlorit, abgeätzt.
Hierauf erfolgt die Auftragung einer Lötmaske unter Verwendung eines Lötstoplackes, zum Beispiel auf Basis von Epoxidharz wie Polyisocyanaten und Aminen als Härter, welche das Schaltbild wiederum negativ bedeckt jedoch die Lötaugen und Bohrungen freiläßt.
Die Lötaugen und Bohrungen werden dann durch Behandlung mit einem chemischen Kupferbad der folgenden Zusammensetzung verkupfert:
10 g/lKupfersulfat, CuSO₄ · 5 H₂O 30 g/lÄthylendiamintetraessigsäure 20 g/lNatriumhydroxid, NaOH 0,025 g/lNatriumcyanid, NaCN 0,001 g/lKaliumselenocyanat, KSeCN 4 mlFormaldehyd, 37%ig.
Die Verkupferung erfolgt bei einer Temperatur von 65°C und einer Behandlungsdauer von 20 Stunden mit einer durchschnittlichen Abscheidungsgeschwindigkeit von 1,5 µm/Stunde.
Es entsteht ein Leiterbild mit Leiterzügen in einer Schichtdicke von etwa 30 µm.
Gewünschtenfalls kann die Kupferschicht auf Lötaugen und Bohrlochwandungen durch Heißluftverzinnung, das heißt Auftragung einer flüssigen Blei-Zinn-Legierung, geschützt werden.
Die gedruckte Schaltung ist damit zur anschließenden Bestückung und Verlötung fertig.

Claims (2)

1. Verfahren zur Herstellung von gedruckten Schaltungen unter Verwendung von kupferkaschiertem Basismaterial, das in üblicher Weise gebohrt, gereinigt, aktiviert, gegebenenfalls reduziert und in üblicher Weise nachbehandelt wird, wobei die Ausbildung der Leiterstrukturen durch Aufbringen eines Resists in Sieb- oder Fotodruck-Technik erfolgt, gekennzeichnet durch folgende Verfahrensschritte:
  • - Negativdruck des Resists zur Bildung der Leiterstrukturen,
  • - Abscheiden einer chemischen Nickel-, Kobalt- oder Nickel-Kobalt-Schicht in den Bohrungen sowie den resistfreien Flächen,
  • - Entfernen des Resists,
  • - Ätzen des Kupfers,
  • - Aufbringen eines Lötstoplackes,
  • - chemisches Aufkupfern der Lötaugen und Bohrungen,
  • - gegebenenfalls Aufbringen einer Blei-Zinn-Legierungsschicht auf den Lötaugen und Bohrungen (Heißluftverzinnen).
2. Verfahren gemäß Anspruch 1, dadurch gekennzeichnet, daß die Nickel-, Kobalt- oder Nickel-Kobalt-Schicht in einer Stärke von 0,1 bis 1,5 µm, vorzugsweise 0,3 bis 0,8 µm, aufgetragen wird.
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Priority Applications (11)

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DE19792920940 DE2920940A1 (de) 1979-05-21 1979-05-21 Verfahren zur herstellung von gedruckten schaltungen
NL8002375A NL8002375A (nl) 1979-05-21 1980-04-23 Werkwijze voor de vervaardiging van gedrukte bedra- dingen.
CH3804/80A CH658563A5 (de) 1979-05-21 1980-05-14 Verfahren zur herstellung von gedruckten schaltungen.
US06/150,174 US4285991A (en) 1979-05-21 1980-05-15 Method for producing printed circuits
SE8003710A SE457593B (sv) 1979-05-21 1980-05-19 Saett foer framstaellning av tryckta kretsar
IT22186/80A IT1130622B (it) 1979-05-21 1980-05-20 Processo per la fabbricazione di circuiti stampati
JP6606880A JPS55156396A (en) 1979-05-21 1980-05-20 Method of manufacturing printed board
CA000352367A CA1152225A (en) 1979-05-21 1980-05-21 Process for the manufacture of printed circuits
FR8011341A FR2457621A1 (fr) 1979-05-21 1980-05-21 Procede de fabrication de circuits imprimes
GB8016840A GB2051489B (en) 1979-05-21 1980-05-21 Process for the manufacture of printed circuits
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SE (1) SE457593B (de)

Families Citing this family (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3008434A1 (de) * 1980-03-03 1981-09-17 Schering Ag Berlin Und Bergkamen, 1000 Berlin Verfahren zur selektiven chemischen und/oder galvanischen abscheidung von metallueberzuegen, insbesondere zur herstellung von gedruckten schaltungen
DE3021896A1 (de) * 1980-06-06 1982-03-25 Schering Ag, 1000 Berlin Und 4619 Bergkamen Verfahren zur herstellung von gedruckten schaltungen
EP0092971B1 (de) * 1982-04-27 1989-08-16 Richardson Chemical Company Verfahren zum selektiven Abscheiden einer Nickel-Bor Schicht über einem metallurgischen Muster auf einem dielektrischen Substrat und auf diese Weise hergestellte Produkte
DE3242162A1 (de) * 1982-11-13 1984-05-17 Bayer Ag, 5090 Leverkusen Verfahren zur herstellung von verbundwerkstoffen
GB2137421A (en) * 1983-03-15 1984-10-03 Standard Telephones Cables Ltd Printed circuits
US4512829A (en) * 1983-04-07 1985-04-23 Satosen Co., Ltd. Process for producing printed circuit boards
GB2141879B (en) * 1983-06-01 1988-03-09 Ferranti Plc Manufacture of printed circuit boards
DE3407114A1 (de) * 1984-02-28 1985-09-05 Bayer Ag, 5090 Leverkusen Verfahren zur herstellung von leiterplatten
DE3417563C2 (de) * 1984-05-11 1986-12-04 Dr.-Ing. Max Schlötter GmbH & Co KG, 7340 Geislingen Verfahren zur Herstellung von Metallmustern auf isolierenden Trägern, insbesondere gedruckte Schaltungen
ATA200888A (de) * 1987-08-11 1993-07-15 Schering Ag Konditionierungsmittel für gedruckte schaltungen
DE3800682A1 (de) * 1988-01-13 1989-07-27 Bayer Ag Verfahren zur herstellung von elektrischen leiterplatten
GB2284509B (en) * 1993-12-03 1997-11-26 John Frederick David Knopp Method of making a printed circuit board
EP0762813A1 (de) * 1995-08-25 1997-03-12 Macdermid Incorporated Verfahren zur Herstellung von Leiterplatten
US7537799B2 (en) 2003-07-11 2009-05-26 Hewlett-Packard Development Company, L.P. Methods of forming electrically conductive pathways using palladium aliphatic amine complexes
US20050199587A1 (en) * 2004-03-12 2005-09-15 Jon Bengston Non-chrome plating on plastic
US8591636B2 (en) * 2010-12-14 2013-11-26 Rohm And Haas Electronics Materials Llc Plating catalyst and method

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB829263A (en) * 1957-02-08 1960-03-02 Sperry Rand Corp Method of making printed circuits
GB964557A (en) * 1962-07-02 1964-07-22 Marconi Co Ltd Improvements in or relating to printed circuits and methods of manufacturing the same
DE1621103A1 (de) * 1967-11-24 1971-06-24 Guenter Dr Laubmeyer Verfahren zur Herstellung metallisierter Loecher in gedruckten Schaltungen
DE1924775B2 (de) * 1969-05-14 1971-06-09 Verfahren zur herstellung einer leiterplatte
US3640765A (en) * 1969-08-06 1972-02-08 Rca Corp Selective deposition of metal
US3672986A (en) * 1969-12-19 1972-06-27 Day Co Nv Metallization of insulating substrates
US3930963A (en) * 1971-07-29 1976-01-06 Photocircuits Division Of Kollmorgen Corporation Method for the production of radiant energy imaged printed circuit boards
US4024631A (en) * 1975-11-24 1977-05-24 Xerox Corporation Printed circuit board plating process
AT349110B (de) * 1975-12-09 1979-03-26 Ney Fa Gerhard Vorrichtung zum doublieren von gemaelden
US4104111A (en) * 1977-08-03 1978-08-01 Mack Robert L Process for manufacturing printed circuit boards

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