DE2629498C2 - - Google Patents

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DE2629498C2
DE2629498C2 DE19762629498 DE2629498A DE2629498C2 DE 2629498 C2 DE2629498 C2 DE 2629498C2 DE 19762629498 DE19762629498 DE 19762629498 DE 2629498 A DE2629498 A DE 2629498A DE 2629498 C2 DE2629498 C2 DE 2629498C2
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clock
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Rudolf Dipl.-Ing. 8034 Unterpfaffenhofen Froeschl
Gerhard 8000 Muenchen Prey
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    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F5/00—Methods or arrangements for data conversion without changing the order or content of the data handled
    • G06F5/06—Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor
    • G06F5/08—Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor having a sequence of storage locations, the intermediate ones not being accessible for either enqueue or dequeue operations, e.g. using a shift register

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US4949301A (en) * 1986-03-06 1990-08-14 Advanced Micro Devices, Inc. Improved pointer FIFO controller for converting a standard RAM into a simulated dual FIFO by controlling the RAM's address inputs

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