DE112012003409B4 - Verfahren zum Ablösen einer Halbleitereinheit-Schicht von einem Grundsubstrat - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 231
- 239000000758 substrate Substances 0.000 title claims abstract description 130
- 238000000034 method Methods 0.000 title claims abstract description 89
- 238000005530 etching Methods 0.000 claims abstract description 38
- 239000010410 layer Substances 0.000 claims description 254
- 239000000463 material Substances 0.000 claims description 60
- 150000001875 compounds Chemical class 0.000 claims description 36
- 239000011241 protective layer Substances 0.000 claims description 27
- 239000002253 acid Substances 0.000 claims description 13
- 230000003746 surface roughness Effects 0.000 claims description 10
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 claims description 7
- 229910052698 phosphorus Inorganic materials 0.000 claims description 7
- 239000011574 phosphorus Substances 0.000 claims description 7
- 229910045601 alloy Inorganic materials 0.000 claims description 5
- 239000000956 alloy Substances 0.000 claims description 5
- 239000000203 mixture Substances 0.000 claims description 5
- 229910000577 Silicon-germanium Inorganic materials 0.000 claims description 4
- 238000009835 boiling Methods 0.000 claims description 3
- 239000010409 thin film Substances 0.000 description 13
- 239000007795 chemical reaction product Substances 0.000 description 10
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 8
- 210000004027 cell Anatomy 0.000 description 6
- 239000013078 crystal Substances 0.000 description 6
- 229910016569 AlF 3 Inorganic materials 0.000 description 5
- 238000004519 manufacturing process Methods 0.000 description 5
- 229910052732 germanium Inorganic materials 0.000 description 4
- 239000012212 insulator Substances 0.000 description 4
- 229910005542 GaSb Inorganic materials 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 3
- 238000005137 deposition process Methods 0.000 description 3
- 230000000737 periodic effect Effects 0.000 description 3
- 239000002243 precursor Substances 0.000 description 3
- 239000000126 substance Substances 0.000 description 3
- 238000012546 transfer Methods 0.000 description 3
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 3
- 229910005540 GaP Inorganic materials 0.000 description 2
- 229910000530 Gallium indium arsenide Inorganic materials 0.000 description 2
- 229910000927 Ge alloy Inorganic materials 0.000 description 2
- 229910000673 Indium arsenide Inorganic materials 0.000 description 2
- 229910021617 Indium monochloride Inorganic materials 0.000 description 2
- 229910003811 SiGeC Inorganic materials 0.000 description 2
- 229910004298 SiO 2 Inorganic materials 0.000 description 2
- 230000008021 deposition Effects 0.000 description 2
- 238000007598 dipping method Methods 0.000 description 2
- 239000011888 foil Substances 0.000 description 2
- RPQDHPTXJYYUPQ-UHFFFAOYSA-N indium arsenide Chemical compound [In]#[As] RPQDHPTXJYYUPQ-UHFFFAOYSA-N 0.000 description 2
- APHGZSBLRQFRCA-UHFFFAOYSA-M indium(1+);chloride Chemical compound [In]Cl APHGZSBLRQFRCA-UHFFFAOYSA-M 0.000 description 2
- 239000002184 metal Substances 0.000 description 2
- 229910003465 moissanite Inorganic materials 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- 238000012545 processing Methods 0.000 description 2
- 239000000047 product Substances 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 229910010271 silicon carbide Inorganic materials 0.000 description 2
- 238000011282 treatment Methods 0.000 description 2
- 229910002601 GaN Inorganic materials 0.000 description 1
- 150000007513 acids Chemical class 0.000 description 1
- 239000002390 adhesive tape Substances 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- -1 area Substances 0.000 description 1
- 230000001680 brushing effect Effects 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 239000003518 caustics Substances 0.000 description 1
- 210000003850 cellular structure Anatomy 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000000383 hazardous chemical Substances 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 238000002161 passivation Methods 0.000 description 1
- 229920000307 polymer substrate Polymers 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 238000005507 spraying Methods 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
- 238000003631 wet chemical etching Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/30604—Chemical etching
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- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
- H01L21/7806—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices involving the separation of the active layers from a substrate
- H01L21/7813—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices involving the separation of the active layers from a substrate leaving a reusable substrate, e.g. epitaxial lift off
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/30604—Chemical etching
- H01L21/30612—Etching of AIIIBV compounds
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- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02373—Group 14 semiconducting materials
- H01L21/02381—Silicon, silicon germanium, germanium
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02387—Group 13/15 materials
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02436—Intermediate layers between substrates and deposited layers
- H01L21/02439—Materials
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- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02436—Intermediate layers between substrates and deposited layers
- H01L21/02439—Materials
- H01L21/02455—Group 13/15 materials
- H01L21/02461—Phosphides
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- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02436—Intermediate layers between substrates and deposited layers
- H01L21/02494—Structure
- H01L21/02496—Layer structure
- H01L21/02502—Layer structure consisting of two layers
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- H01L21/02365—Forming inorganic semiconducting materials on a substrate
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Abstract
Description
- HINTERGRUND
- Die vorliegende Offenbarung betrifft die Herstellung von Halbleitereinheiten und insbesondere ein Verfahren zum Entfernen einer Halbleitereinheit-Schicht von einem darunterliegenden Grundsubstrat.
- Einheiten, die in Dünnschichtform hergestellt werden können, weisen ihren massiven Gegenstücken gegenüber drei klare Vorteile auf: Erstens verbessern Dünnschichteinheiten die mit der Produktion von Einheiten einhergehenden Materialkosten, da weniger Material verbraucht wird. Zweitens ist das niedrige Gewicht der Einheiten ein eindeutiger Vorteil, der auf industrieller Ebene die Bemühung um ein breites Spektrum an Dünnschichtanwendungen motiviert. Drittens können Einheiten in ihrer Dünnschichtform mechanische Flexibilität aufweisen, wenn die Abmessungen klein genug sind. Wenn eine Einheit-Schicht von einem wiederverwendbaren Substrat entfernt wird, kann zudem eine zusätzliche Senkung der Fertigungskosten erreicht werden.
- Es gibt laufende Bemühungen, (i) aus massiven Materialien (d.h., Halbleitern) Dünnschichtsubstrate herzustellen und (ii) Dünnschichteinheit-Schichten zu bilden, indem Einheit-Schichten von einem darunterliegenden massiven Substrat, auf welchem sie gebildet wurden, entfernt werden.
- Die
US 2011 / 0 186 910 A1 US 2011 / 0 186 910 A1 - Die
US 2009 / 0 044 860 A1 - KURZDARSTELLUNG
- Es wird ein Verfahren zum Entfernen einer Halbleitereinheit-Schicht von einem darunterliegenden Grundsubstrat bereitgestellt, wobei zwischen einer Halbleitereinheit-Schicht und einem Grundsubstrat eine phosphidhaltige Opferschicht gebildet wird. In einigen Ausführungsformen kann auf einer Oberseite des Grundsubstrats eine Halbleiterpufferschicht gebildet werden, bevor die phosphidhaltige Opferschicht gebildet wird. Die resultierende Struktur wird dann mit einem Nicht-HF-Ätzmittel geätzt, um die Halbleitereinheit-Schicht vom Grundsubstrat abzulösen. Nach dem Ablösen der Halbleitereinheit-Schicht vom Grundsubstrat kann das Grundsubstrat wiederverwendet werden.
- Der ELO-Prozess der vorliegenden Offenbarung ist mit geringeren Kosten verbunden. Darüber hinaus, und wie oben erwähnt, kann das Grundsubstrat nach Durchführung des ELO-Prozesses der vorliegenden Offenbarung wiederverwendet werden.
- In einer Ausführungsform schließt das Verfahren der vorliegenden Offenbarung das Bilden einer phosphidhaltigen Opferschicht auf einer Oberseite eines Grundsubstrats ein. Dann wird auf einer Oberseite der phosphidhaltigen Opferschicht eine Halbleitereinheit-Schicht gebildet. Die phosphidhaltige Opferschicht zwischen der Halbleitereinheit-Schicht und dem Grundsubstrat wird dann durch Ätzen mit einem nicht HF-haltigen Ätzmittel entfernt.
- In einer anderen Ausführungsform schließt das Verfahren der vorliegenden Offenbarung das Bilden einer Halbleiterpufferschicht auf einer Oberseite eines Grundsubstrats ein. Eine phosphidhaltige Opferschicht wird dann auf einer Oberseite der Halbleiterpufferschicht gebildet. Dann wird auf einer Oberseite der phosphidhaltigen Opferschicht eine Halbleitereinheit-Schicht gebildet. Die phosphidhaltige Opferschicht, die zwischen der Halbleitereinheit-Schicht und dem Grundsubstrat liegt, wird dann durch Ätzen mit einem nicht HF-haltigen Ätzmittel entfernt. Dann kann die Halbleiterpufferschicht von der Oberseite des Grundsubstrats entfernt werden.
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1 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die eine Anfangsstruktur mit einem Grundsubstrat zeigt, das einer Ausführungsform der vorliegenden Offenbarung gemäß verwendet werden kann. -
2 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die die Struktur von1 zeigt, nachdem auf einer Oberseite des Grundsubstrats eine optionale Halbleiterpufferschicht gebildet wurde. -
3A und3B sind bildliche Darstellungen (durch Querschnittsansichten), die jeweils die Strukturen von1 und2 zeigen, nachdem eine phosphidhaltige Opferschicht darauf gebildet wurde. -
4A und4B sind bildliche Darstellungen (durch Querschnittsansichten), die jeweils die Strukturen von3A und3B zeigen nachdem eine Halbleitereinheit-Schicht darauf gebildet wurde. -
5A und5B sind bildliche Darstellungen (durch Querschnittsansichten), die jeweils die Strukturen von4A und4B während eines Anfangsstadiums eines Ätzprozesses gemäß der vorliegenden Offenbarung zeigen. -
6A und6B sind bildliche Darstellungen (durch Querschnittsansichten), die jeweils die Strukturen von5A und5B zeigen, nachdem der Ätzprozess gemäß der vorliegenden Offenbarung durchgeführt wurde. -
7 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die die Struktur von6B zeigt, nachdem die optionale Halbleiterpufferschicht von der Oberseite des Grundsubstrats entfernt wurde. -
8 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die eine Struktur mit einer ersten Schutzschicht zeigt, die zwischen einer Halbleitereinheit-Schicht und einer phosphidhaltigen Opferschicht liegt und in einer Ausführungsform der vorliegenden Offenbarung verwendet werden kann. -
9 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die die Struktur von8 zeigt, nachdem die Halbleitereinheit-Schicht strukturiert und eine zweite Schutzschicht darauf gebildet wurde. -
10 ist eine bildliche Darstellung (durch eine Querschnittsansicht), die die Struktur von9 während eines Anfangsstadiums eines Ätzprozesses gemäß der vorliegenden Offenbarung zeigt. - AUSFÜHRLICHE BESCHREIBUNG
- Die vorliegende Erfindung, die ein Verfahren zum Entfernen einer Halbleitereinheit-Schicht von einem darunterliegenden Grundsubstrat bereitstellt, wird nun Bezug nehmend auf die folgende Beschreibung und die der vorliegenden Anmeldung beiliegenden Zeichnungen ausführlicher beschrieben. Es ist anzumerken, dass die Zeichnungen der vorliegenden Anmeldung nur zur Veranschaulichung dienen und daher nicht maßstabsgerecht gezeichnet sind.
- In der folgenden Beschreibung werden zahlreiche spezifische Details wie z.B. bestimmte Strukturen, Komponenten, Materialien, Abmessungen, Verarbeitungsschritte und Techniken dargelegt, um ein Verständnis einiger Aspekte der vorliegenden Offenbarung zu ermöglichen. Doch für den Fachmann versteht es sich, dass die verschiedenen Ausführungsformen der Offenbarung ohne diese spezifischen Details ausgeführt werden können. In anderen Fällen wurden wohlbekannte Strukturen oder Verarbeitungsschritte nicht im Detail beschrieben, um eine Verdunkelung der verschiedenen Ausführungsformen der vorliegenden Erfindung zu vermeiden.
- Es versteht sich, dass, wenn ein Element wie eine Schicht, ein Bereich oder ein Substrat als „auf“ oder „über“ einem anderen Element liegend bezeichnet wird, es direkt auf dem anderen Element liegen kann oder auch dazwischenliegenden Elemente vorhanden sein können. Demgegenüber sind keine dazwischenliegenden Elemente vorhanden, wenn ein Element als „direkt auf“ oder „direkt über“ einem anderen Element liegend bezeichnet wird. Es versteht sich auch, dass, wenn ein Element als „unterhalb“ oder „unter“ einem anderen Element liegend bezeichnet wird, es direkt unterhalb oder unter dem anderen Element liegen kann oder dazwischenliegenden Elemente vorhanden sein können. Demgegenüber sind keine dazwischenliegenden Elemente vorhanden, wenn ein Element als „direkt unterhalb“ oder „direkt unter“ einem anderen Element liegend bezeichnet wird.
- Ein Weg zur Bildung einer Dünnschichteinheit besteht darin, eine Halbleitereinheit-Schicht mithilfe eines epitaktischen Lift-Off-Prozesses (ELO-Prozess) von einem Grundsubstrat abzulösen. In einem herkömmlichen ELO-Prozess für III-V-Verbindungshalbleitermaterialien wird zwischen dem III-V-Verbindungshalbleitermaterial und einer darüberliegenden Halbleitereinheit-Schicht eine AlAs-Schicht eingefügt. Die resultierende Struktur wird dann einer Ätzung in HF ausgesetzt. Nach dem Ätzen ist die Halbleitereinheit-Schicht vom III-V-Verbindungshalbleitermaterial gelöst.
- Der obige herkömmliche ELO-Prozess erfordert, dass vor der HF-Ätzung auf einer freiliegenden Fläche der Halbleitereinheit-Schicht ein Klebeband und eine Metallfolie gebildet werden. Diese Struktur wird dann umgedreht, und ein äußerer Randabschnitt der Metallfolie wird mit einem Gewicht belastet. Diese spezielle Anordnung trägt während des HF-Ätzens dazu bei, die Ätzrate zu beschleunigen und einen Abbruch des Ätzvorgangs zu verhindern.
- Der obige herkömmliche ELO-Prozess wird nur für ein III-V-Verbindungshalbleitermaterial auf einmal benutzt, und während der Ätzung ist Aufmerksamkeit geboten. Daher ist die Ausbeute mit dem herkömmlichen ELO-Prozess gering. Zusätzlich zu den obigen Nachteilen beim herkömmlichen ELO-Prozess verwendet der herkömmliche ELO-Prozess als Ätzmittel HF, was ein gefährlicher chemischer Stoff ist, zu dessen Entsorgung Spezialbehälter erforderlich sind. Zudem ist das III-V-Verbindungshalbleitermaterial, das nach dem herkömmlichen ELO-Prozess wiedergewonnen wird, aufgrund der auf der Oberfläche zurückbleibenden AlF3-Komplexverbindungen und des Angriffs des Ätzmittels HF auf die GaAs-Oberfläche glänzend und rau (mit einer RMS-Oberflächenrauheit von 2 nm bis 4 nm). Ein chemisch-mechanisches Polieren und weitere Behandlungen sind typischerweise notwendig, um die Oberfläche des III-V-Verbindungshalbleiters, der aus dem herkömmlichen ELO-Prozess wiedergewonnen wird, zu glätten. Das ursprüngliche III-V-Verbindungshalbleitermaterial, das im herkömmlichen ELO-Prozess verwendet wurde, ist daher nicht wiederverwendbar, wenn keine weiteren Behandlungen durchgeführt werden.
- Die vorliegende Offenbarung stellt ein Verfahren zum Entfernen einer Halbleitereinheit-Schicht von einem darunterliegenden Grundsubstrat (d.h., III-V-Verbindungshalbleiter oder Ge-haltigen Halbleiter) bereit, in welchem zwischen einer Halbleitereinheit-Schicht und einem Grundsubstrat eine phosphidhaltige Opferschicht gebildet wird. In einigen Ausführungsformen, in welchen insbesondere ein Grundsubstrat mit einem Ge-haltigen Halbleiter verwendet wird, kann auf einer Oberseite des Grundsubstrats eine Halbleiterpufferschicht gebildet werden, bevor die phosphidhaltige Opferschicht gebildet wird. Die resultierende Struktur wird dann mit einem Nicht-HF-Ätzmittel geätzt, um die Halbleitereinheit-Schicht vom Halbleitergrundsubstrat abzulösen. Nach dem Ablösen der Halbleitereinheit-Schicht vom Grundsubstrat kann das Grundsubstrat wiederverwendet werden.
- Das Verfahren der vorliegenden Offenbarung stellt eine hohe Ausbeute und hohen Durchsatz bereit, sowie die Möglichkeit, das Grundsubstrat wiederzuverwenden, nachdem die Halbleitereinheit-Schicht davon entfernt wurde. Typischerweise ist auch keine spezielle Anordnung erforderlich.
- Diese und andere Vorteile des Verfahrens der vorliegenden Offenbarung werden in Tabelle 1 veranschaulicht. Das heißt, Tabelle 1 zeigt einen Vergleich eines herkömmlichen ELO-Prozesses (AlAs-Schicht und HF-Ätzung) mit dem ELO-Prozess der vorliegenden Offenbarung (phosphidhaltige Opferschicht und Nicht-HF-Ätzung). Tabelle 1:
Herkömmliches ELO ELO-Prozess der vorliegenden Offenbarung Ätzmittel HF (gefährlich) Nicht-HF Spezielle Anordnung Erforderlich Typischerweise nicht erforderlich Aufmerksamkeit geboten Ja Nein Ausbeute Mäßig Hoch (etwa 100 %) Durchsatz Ein Prüfling je Anordnung Unbegrenzt Wiederverwendung des Substrats Nein (raue Oberfläche von 2 bis 4 nm nach der Ätzung) Ja (glatte Oberfläche von 0,1 bis 0,5 nm oder im Bereich von ± 0,5 nm der RMS-Anfangsrauheit) Kosten Hoch Gering - Nun wird auf
1 Bezug genommen, die ein Grundsubstrat10 zeigt, das im Verfahren der vorliegenden Offenbarung verwendet werden kann. In einer Ausführungsform der vorliegenden Offenbarung weist das Grundsubstrat10 , das verwendet werden kann, ein III-V-Verbindungshalbleitermaterial auf. Der Begriff „III-IV-Verbindungshalbleiter“, wie er in der vorliegenden Offenbarung verwendet wird, bezeichnet eine Halbleiterverbindung, die aus mindestens einem Element aus der Gruppe III des Periodensystems und mindestens einem Element aus der Gruppe V des Periodensystems zusammengesetzt ist. Das III-V-Verbindungshalbleitermaterial, das als Grundsubstrat10 verwendet werden kann, kann einen binären III-V-Verbindungshalbleiter, d.h. mit zwei Elementen, einen ternären III-V-Verbindungshalbleiter, d.h. mit drei Elementen, oder einen quaternären III-V-Verbindungshalbleiter, d.h. mit vier Elementen, aufweisen. Auch III-V-Verbindungshalbleitermaterialien, die mehr als 4 Elemente enthalten, können als Grundsubstrat10 verwendet werden. - Beispiele für III-V-Verbindungshalbleitermaterialien, die als Grundsubstrat
10 verwendet werden können, schließen, ohne darauf beschränkt zu sein, GaAs, InP, AlAs, GaSb, GaN, InGaAs, InGaN, InGaP, AlInGaP und AlInGaSb ein. In einigen Ausführungsformen besteht das Grundsubstrat10 aus einem III-V-Verbindungshalbleiter, der kein P enthält. In einer Ausführungsform der vorliegenden Offenbarung besteht das Grundsubstrat10 aus GaAs. - In einer anderen Ausführungsform besteht das Grundsubstrat
10 aus einem Ge-haltigen Halbleitermaterial. Der Begriff „Ge-haltiges Halbleitermaterial“ wird in der vorliegenden Offenbarung verwendet, um einen Halbleiter zu bezeichnen, der Ge enthält. Das Ge-haltige Material kann reines Ge oder Ge enthalten, das mit einem anderen Halbleitermaterial wie zum Beispiel Si legiert ist. Der Ge-haltige Halbleiter, der in der vorliegenden Offenbarung verwendet werden kann, enthält Ge typischerweise in einem Bereich, der von 1 Atom-% Ge bis einschließlich 100 Atom-% Ge liegt. In einer anderen Ausführungsform ist das Ge-haltige Material, das als Grundsubstrat10 verwendet werden kann, eine SiGe-Legierung, die 1 Atom-% Ge bis 99 Atom-% Ge enthält. - Die Anfangsdicke des Grundsubstrats
10 kann abhängig von der Größe des verwendeten Wafers variieren. In einer Ausführungsform, und für einen 2-Zoll-Wafer, hat das Grundsubstrat10 typischerweise eine Anfangsdicke von 200 µm bis 800 µm, wobei eine Anfangsdicke von 300 µm bis 400 µm für einen 2-Zoll-Wafer typischer ist. Der Begriff „Anfangsdicke“, wenn er in Verbindung mit dem Grundsubstrat10 verwendet wird, bezeichnet die Dicke des Grundsubstrats10 , bevor das Grundsubstrat10 dem weiter unten beschriebenen Ätzprozess ausgesetzt wird. - Das Grundsubstrat
10 , das in der vorliegenden Offenbarung verwendet wird, hat typischerweise eine RMS-Anfangsoberflächenrauheit von 0,1 nm bis 1 nm, wobei eine RMS-Anfangsoberflächenrauheit von 0,2 nm bis 0,5 nm typischer ist. Die RMS-Anfangsoberflächenrauheit ist eine Messung der Textur des Grundsubstrats10 vor dem Ätzen. - Nun auf
2 Bezug nehmend, wird die Struktur von1 gezeigt, nachdem auf einer Oberseite des Grundsubstrats10 eine optionale Halbleiterpufferschicht12 gebildet wurde. Wie erwähnt, ist die Halbleiterpufferschicht12 optional. Daher kann die optionale Halbleiterpufferschicht12 in einigen Ausführungsformen entfallen. In anderen Ausführungsformen wird die optionale Halbleiterpufferschicht12 verwendet. In einer Ausführungsform der vorliegenden Offenbarung wird die optionale Halbleiterpufferschicht12 , die verwendet werden kann, zum Beispiel auf einem Ge-haltigen Halbleitermaterial gebildet. - Die optionale Halbleiterpufferschicht
12 , die verwendet werden kann, schließt ein Halbleitermaterial ein, das sich hinsichtlich seiner Zusammensetzung vom darunterliegenden Grundsubstrat10 unterscheidet. Obwohl die optionale Halbleiterpufferschicht12 aus einem anderen Halbleitermaterial als das darunterliegende Grundsubstrat10 zusammengesetzt ist, kann die optionale Halbleiterpufferschicht12 die gleiche oder eine andere Gitterkonstante haben wie oder als das darunterliegende Grundsubstrat10 . Der Begriff „Puffer“, wenn er in Verbindung mit dem Begriff „optionale Halbleiterpufferschicht 12“ verwendet wird, bezeichnet eine Zwischenschicht, die zwischen dem Grundsubstrat10 und der (danach zu bildenden) Halbleitereinheit-Schicht16 liegt. - Die optionale Halbleiterpufferschicht
12 kann ein Halbleitermaterial einschließlich, ohne aber darauf beschränkt zu sein, Si, Ge, SiGe, SiGeC, SiC, Ge-Legierungen, GaSb, GaP, GaAs, InAs, InP und aller anderen III-V oder II-VI-Verbindungshalbleiter aufweisen. In einer Ausführungsform, in welcher ein Ge-haltiges Material als Grundsubstrat10 verwendet wird, kann die optionale Halbleiterpufferschicht12 aus einem III-V-Verbindungshalbleiter wie zum Beispiel GaAs oder InGaAs bestehen. In einigen Ausführungsformen besteht die Halbleiterpufferschicht12 aus einem III-V-Verbindungshalbleiter, der kein P enthält. - In einer Ausführungsform kann das Halbleitermaterial, das als optionale Halbleiterpufferschicht
12 verwendet werden kann, einkristallin sein. In einer anderen Ausführungsform kann das Halbleitermaterial, das als optionale Halbleiterpufferschicht12 verwendet werden kann, polykristallin sein. In einer weiteren Ausführungsform der vorliegenden Offenbarung kann das Halbleitermaterial, das als optionale Halbleiterpufferschicht12 verwendet werden kann, amorph sein. Das Halbleitermaterial, das als optionale Halbleiterpufferschicht12 verwendet werden kann, ist typischerweise einkristallin. - Die optionale Halbleiterpufferschicht
12 kann mit Techniken, die dem Fachmann wohlbekannt sind, auf einer Oberseite des Grundsubstrats10 gebildet werden. In einer Ausführungsform kann die optionale Halbleiterpufferschicht12 durch einen physikalischen Prozess oder Wachstumsabscheidungsprozess, in welchem ein Halbleitervorläufer verwendet wird, auf dem Grundsubstrat10 gebildet werden. In einer anderen Ausführungsform kann die optionale Halbleiterpufferschicht12 durch einen epitaktischen Wachstumsprozess gebildet werden. Wenn ein epitaktischer Wachstumsprozess verwendet wird, wird die optionale Halbleiterpufferschicht12 mit der darunterliegenden Oberfläche des Grundsubstrats10 epitaktisch ausgerichtet. In einer anderen Ausführungsform kann die optionale Halbleiterpufferschicht12 mithilfe eines Schichttransferprozesses auf dem Grundsubstrat10 gebildet werden. - Die Dicke der optionalen Halbleiterpufferschicht
12 , die in der vorliegenden Offenbarung verwendet wird, kann abhängig von der zu ihrer Bildung verwendeten Technik variieren. In einer Ausführungsform hat die optionale Halbleiterpufferschicht12 eine Dicke von 1 nm bis 100 nm. In einer anderen Ausführungsform hat die optionale Halbleiterpufferschicht12 eine Dicke von 1 nm bis 2.000 nm. Auch andere Dicken, die über und/oder unter den genannten Bereichen liegen, können für die optionale Halbleiterpufferschicht12 verwendet werden. - Bezug nehmend auf
3A und3B , werden jeweils die Strukturen von1 und2 gezeigt, nachdem eine phosphidhaltige Opferschicht14 darauf gebildet wurde. In der Ausführungsform, die in3A veranschaulicht wird, wird die phosphidhaltige Opferschicht14 direkt auf einer Oberseite des Grundsubstrats10 gebildet. In der Ausführungsform, die in3B veranschaulicht wird, wird die phosphidhaltige Opferschicht14 direkt auf einer Oberseite der optionalen Halbleiterpufferschicht12 gebildet. - Der Begriff „phosphidhaltige Opferschicht“ wird in der vorliegenden Offenbarung verwendet, um eine Verbindung aus Phosphor mit einem oder mehreren weniger elektronegativen Element(en) zu bezeichnen. In einigen Ausführungsformen ist die phosphidhaltige Opferschicht
14 aus einem anderen Halbleitermaterial als das Grundsubstrat10 , die optionale Halbleiterpufferschicht12 und die (danach zu bildende) Halbleitereinheit-Schicht16 . In solch einer Ausführungsform weist die phosphidhaltige Opferschicht14 einen höheren Phosphorgehalt auf als das Grundsubstrat10 , die optionale Halbleiterpufferschicht12 und die (danach zu bildende) Halbleitereinheit-Schicht16 . In dieser Ausführungsform weist die phosphidhaltige Opferschicht14 in nicht HF-haltigen Ätzmitteln eine höhere Ätzrate auf als das Grundsubstrat10 , die optionale Halbleiterpufferschicht12 und die (danach zu bildende) Halbleitereinheit-Schicht16 . - In einigen Ausführungsformen kann die phosphidhaltige Opferschicht
14 aus dem gleichen Halbleitermaterial wie mindestens eines vom Grundsubstrat10 , von der optionalen Halbleiterpufferschicht12 und von der (danach zu bildenden) Halbleitereinheit-Schicht16 sein. Zum Beispiel kann auch die Halbleitereinheit-Schicht16 ein phosphidhaltiges Material enthalten und weist somit die gleiche Ätzrate wie die phosphidhaltige Opferschicht14 auf. In solch einer Ausführungsform wird durch herkömmliche Verfahren, einschließlich thermischen Wachstums oder Abscheidung, zwischen der phosphidhaltigen Opferschicht14 und der Halbleitereinheit-Schicht16 eine erste Schutzschicht gebildet, um zu verhindern, dass die Halbleitereinheit-Schicht16 durch das Nicht-HF-Ätzmittel geätzt wird. Die erste Schutzschicht kann aus GaAs oder anderen nicht phosphidhaltigen Materialien sein, die durch das Nicht-HF-Ätzmittel nicht geätzt werden. Auch eine zweite Schutzschicht wird auf freiliegenden Oberflächen (Oberseite und Seitenwände) der Halbleitereinheit-Schicht16 gebildet, um zu verhindern, dass die Halbleitereinheit-Schicht16 durch das Nicht-HF-Ätzmittel geätzt wird. Die zweite Schutzschicht kann aus SiO2, Si3N4 oder anderen Materialien sein, die durch das Nicht-HF-Ätzmittel nicht geätzt werden. Diese Ausführungsform wird hierin weiter unten ausführlicher beschrieben. - In Bezug auf die phosphidhaltige Opferschicht
14 , und in einer Ausführungsform, schließen das oder die Element(e), die weniger elektronegativ als Phosphor sind, ein Element aus der Gruppe III und/oder der Gruppe V des Periodensystems ein. Veranschaulichende Materialien, die als phosphidhaltige Opferschicht14 verwendet werden können, schließen, ohne darauf beschränkt zu sein, InAIP, InGaP, InAsP, GaAsP, InGaAIP, InGaAsP, GaP, InP und phosphidhaltige Legierungen ein. - In einer Ausführungsform kann die phosphidhaltige Opferschicht
14 einkristallin sein. In einer anderen Ausführungsform kann die phosphidhaltige Opferschicht14 polykristallin sein. In einer weiteren Ausführungsform der vorliegenden Offenbarung kann die phosphidhaltige Opferschicht14 amorph sein. Typischerweise ist die phosphidhaltige Opferschicht14 ein einkristallines Material. - Die phosphidhaltige Opferschicht
14 kann mit Techniken gebildet werden, die dem Fachmann wohlbekannt sind. In einer Ausführungsform kann die phosphidhaltige Opferschicht14 durch einen physikalischen Prozess oder Wachstumsabscheidungsprozess, in welchem ein Halbleitervorläufer verwendet wird, auf dem Grundsubstrat10 oder auf der optionalen Halbleiterpufferschicht12 gebildet werden. In einer anderen Ausführungsform kann die phosphidhaltige Opferschicht14 durch einen epitaktischen Wachstumsprozess gebildet werden. Wenn ein epitaktischer Wachstumsprozess verwendet wird, wird die phosphidhaltige Opferschicht14 mit der darunterliegenden Oberfläche des Grundsubstrats10 oder der darunterliegenden Oberfläche der optionalen Halbleiterpufferschicht12 epitaktisch ausgerichtet. In einer weiteren Ausführungsform kann die phosphidhaltige Opferschicht14 mithilfe eines Schichttransferprozesses auf dem Grundsubstrat10 oder auf der optionalen Halbleiterpufferschicht12 gebildet werden. - Die Dicke der phosphidhaltigen Opferschicht
14 , die in der vorliegenden Offenbarung verwendet wird, kann abhängig von der zu ihrer Bildung verwendeten Technik variieren. In einer Ausführungsform hat die phosphidhaltige Opferschicht14 eine Dicke von 1 nm bis 1.000 nm. In einer anderen Ausführungsform hat die phosphidhaltige Opferschicht14 eine Dicke von 10 nm bis 100 nm. Auch andere Dicken, die über und/oder unter den genannten Bereichen liegen, können für die phosphidhaltige Opferschicht14 verwendet werden. - Nun auf
4A und4B Bezug nehmend, werden jeweils die Strukturen von3A und3B gezeigt, nachdem eine Halbleitereinheit-Schicht16 darauf gebildet wurde. In einer Ausführungsform, und wie zuvor erwähnt, weist die verwendete Halbleitereinheit-Schicht16 ein Halbleitermaterial auf, das in einem nicht HF-haltigen Ätzmittel eine niedrigere Ätzrate als die darunterliegende phosphidhaltige Opferschicht14 aufweist. In anderen Ausführungsformen, und wie zuvor erwähnt, kann die Halbleitereinheit-Schicht16 ein phosphidhaltiges Material verwenden, das dieselbe Ätzrate wie die phosphidhaltige Opferschicht14 aufweisen kann. In dieser Ausführungsform, und wie oben erwähnt, sind die zusätzlichen Schutzschichten erforderlich, um die Halbleitereinheit-Schicht16 vor Ätzung zu schützen. - Beispiele für Halbleitermaterialien, die als Halbleitereinheit-Schicht
16 verwendet werden können, schließen, ohne darauf beschränkt zu sein, Si, Ge, SiGe, SiGeC, SiC, Ge-Legierungen, GaSb, GaP, GaAs, InAs, InP und alle anderen III-V- oder II-VI-Verbindungshalbleiter ein. In einigen Ausführungsformen besteht die Halbleitereinheit-Schicht16 aus einem III-V-Verbindungshalbleiter, der kein P enthält. - In einigen Ausführungsformen ist die Halbleitereinheit-Schicht
16 ein massives Halbleitermaterial. In anderen Ausführungsformen kann die Halbleitereinheit-Schicht16 ein geschichtetes Halbleitermaterial wie zum Beispiel ein Halbleiter-auf-Isolator-Substrat oder einen Halbleiter auf einem Polymersubstrat aufweisen. Beispiele für Halbleiter-auf-Isolator-Substrate, die als Halbleitereinheit-Schicht16 verwendet werden können, schließen Silicium-auf-Isolatoren und Silicium-Germanium-auf-Isolatoren ein. - In einigen Ausführungsformen weist die Halbleitereinheit-Schicht
16 das gleiche Halbleitermaterial wie das Grundsubstrat10 auf. In einer anderen Ausführungsform weisen die Halbleitereinheit-Schicht16 und das Grundsubstrat10 verschiedene Halbleitermaterialien auf. Das Halbleitermaterial der Halbleitereinheit-Schicht16 kann dotiert oder undotiert sein oder dotierte Bereiche und undotierte Bereiche enthalten. - In einer Ausführungsform kann das Halbleitermaterial, das als Halbleitereinheit-Schicht
16 verwendet werden kann, einkristallin sein. In einer anderen Ausführungsform kann das Halbleitermaterial, das als Halbleitereinheit-Schicht16 verwendet werden kann, polykristallin sein. In einer weiteren Ausführungsform der vorliegenden Offenbarung kann das Halbleitermaterial, das als Halbleitereinheit-Schicht16 verwendet werden kann, amorph sein. Das Halbleitermaterial, das als Halbleitereinheit-Schicht16 verwendet werden kann, ist typischerweise ein einkristallines Material. - Die Halbleitereinheit-Schicht
16 kann mit Techniken, die dem Fachmann wohlbekannt sind, auf einer Oberseite der phosphidhaltigen Opferschicht14 gebildet werden. In einer Ausführungsform kann die Halbleitereinheit-Schicht16 durch einen physikalischen Prozess oder Wachstumsabscheidungsprozess, in welchem ein Halbleitervorläufer verwendet wird, auf der phosphidhaltigen Opferschicht14 gebildet werden. In einer anderen Ausführungsform kann die Halbleitereinheit-Schicht16 durch einen epitaktischen Wachstumsprozess gebildet werden. Wenn ein epitaktischer Wachstumsprozess verwendet wird, wird die Halbleitereinheit-Schicht16 mit der darunterliegenden Oberfläche der phosphidhaltigen Opferschicht14 epitaktisch ausgerichtet. In einer weiteren Ausführungsform kann die Halbleitereinheit-Schicht16 mithilfe eines Schichttransferprozesses auf der phosphidhaltigen Opferschicht14 gebildet werden. - Die Halbleitereinheit-Schicht
16 kann bearbeitet werden, um mindestens eine Halbleitereinheit, einschließlich, ohne darauf beschränkt zu sein, eines Transistors, eines Kondensators, einer Diode, eines BiCMOS, eines Widerstands, einer Fotozellen-Komponente, einer Komponente einer Solarzelle usw. aufzuweisen. In einer Ausführungsform kann die mindestens eine Halbleitereinheit auf der Halbleitereinheit-Schicht16 gebildet werden, nachdem die Halbleitereinheit-Schicht16 auf der phosphidhaltigen Opferschicht14 gebildet wurde. In einer anderen Ausführungsform kann die mindestens eine Halbleitereinheit gebildet werden, bevor die Halbleitereinheit-Schicht16 auf der phosphidhaltigen Opferschicht14 gebildet wird. - Die Dicke der Halbleitereinheit-Schicht
16 , die in der vorliegenden Offenbarung verwendet wird, kann abhängig vom Typ der Einheit, die darauf vorliegen soll, variieren. In einer Ausführungsform hat die Halbleitereinheit-Schicht16 eine Dicke von 3 nm bis 1.000 nm. In einer anderen Ausführungsform hat die Halbleitereinheit-Schicht16 eine Dicke von 5 nm bis 100 nm. Auch andere Dicken, die über und/oder unter den genannten Bereichen liegen, können für die Halbleitereinheit-Schicht16 verwendet werden. - Nun auf
5A und5B Bezug nehmend, werden jeweils die Strukturen von4A und4B während eines Anfangsstadiums eines Ätzprozesses gezeigt, in welchem ein nicht HF-haltiges Ätzmittel verwendet wird. In diesen Zeichnungen bezeichnet das Bezugszeichen18 einen Spalt, der in mindestens einem Rand der phosphidhaltigen Opferschicht14 , der dem nicht HF-haltigen Ätzmittel ausgesetzt ist, gebildet wird.6A und6B veranschaulichen jeweils die Strukturen von5A und5B , nachdem der Ätzprozess gemäß der vorliegenden Offenbarung durchgeführt wurde. - Wie oben erwähnt, wird das Ätzen, das in
5A ,5B ,6A und6B veranschaulicht wird, mit einem Nicht-HF-Ätzmittel durchgeführt. Insbesondere schließt die Ätzung, die in der vorliegenden Offenbarung verwendet wird, ein Nicht-HF-Ätzmittel ein, das die phosphidhaltige Opferschicht14 selektiv zu den anderen Halbleiterschichten (d.h., die Schichten10 ,12 ,16 ) und den optionalen Schutzschichten ätzt, die in den Strukturen vorhanden sind. In einigen Ausführungsformen, und wie zuvor erwähnt, weist die phosphidhaltige Opferschicht14 im nicht HF-haltigen Ätzmittel eine höhere Ätzrate auf als das Grundsubstrat10 , die optionale Halbleiterpufferschicht12 und die Halbleitereinheit-Schicht16 . In anderen Ausführungsformen, und wie ebenfalls zuvor erwähnt, kann die Ätzrate der phosphidhaltigen Opferschicht14 die gleiche sein wie die der Halbleitereinheit-Schicht16 und die zusätzlichen Schutzschichten müssen während der Ätzung vorhanden sein. - Zudem schließt die Ätzung, die in der vorliegende Offenbarung verwendet wird, jedes Nicht-HF-Ätzmittel ein, das in der Lage ist, das geätzte Reaktionsprodukt so zu lösen, dass während der Ätzung kein geätztes Reaktionsprodukt auf der Oberfläche des Grundsubstrats
10 gebildet wird. Anders ausgedrückt, das Nicht-HF-Ätzmittel, das in der vorliegenden Offenbarung verwendet wird, reagiert mit der phosphidhaltigen Opferschicht14 und bildet „hoch“ lösliche Reaktionsprodukte, die nicht auf dem Grundsubstrat10 bleiben. Zum Beispiel, und in der vorliegenden Offenbarung, reagiert eine phosphidhaltige InAIP-Opferschicht mit HCl, um als Reaktionsprodukte InCl3, AlCl3 und PH3 zu bilden. PH3 ist ein gasförmiges Produkt und kann direkt aus der Reaktionsfront diffundieren, und InCl3 und AICI3 sind hoch löslich im Ätzmittel, das in der vorliegenden Offenbarung verwendet wird. Im Falle eines herkömmlichen ELO (d.h., AlAs + HF) sind die Reaktionsprodukte AlF3 und AsH3. AsH3 ist ein gasförmiges Produkt und kann direkt aus der Reaktionsfront diffundieren. AlF3 kann mit dem HF oder H2O reagieren, um sich im Wasser zu lösen. Die Menge an AlF3, das in Wasser gelöst werden kann, ist jedoch gering, und ein Teil des Reaktionsprodukts AlF3 kann auf der Oberfläche des Grundsubstrats10 bleiben. - Das Nicht-HF-Ätzmittel, das in der vorliegenden Offenbarung verwendet werden kann, um die phosphidhaltige Opferschicht
14 von der Struktur zu entfernen, schließt jede nicht HF-haltige Säure ein, die (i) die phosphidhaltige Opferschicht14 selektiv zu den anderen Halbleiterschichten (d.h., die Schichten10 ,12 ,16 ) und den optionalen Schutzschichten ätzt, die in den Strukturen vorhanden sind, und (ii) die das geätzte Reaktionsprodukt so löst, dass auf der Oberfläche des Grundsubstrats10 kein geätztes Reaktionsprodukt gebildet wird. Beispiele für nicht HF-haltige Säuren, die in der vorliegenden Offenbarung verwendet werden können, schließen, ohne darauf beschränkt zu sein, HCl, HBr, HI und Mischungen daraus ein. Die nicht HF-haltige(n) Säure(n) können unverdünnt verwendet werden, oder sie können mit Wasser verdünnt werden, um eine verdünnte nicht HF-haltige Säure oder eine verdünnte nicht HF-haltige Säuremischung zu ergeben. Die Konzentration der nicht HF-haltigen Säure, die in der vorliegenden Offenbarung verwendet werden kann, um die phosphidhaltige Opferschicht14 von den Strukturen zu entfernen, kann im Bereich von 1 % bis 99 % liegen. Andere Konzentrationen können verwendet werden, solange die Konzentration der nicht HF-haltigen Säure (i) die Selektivität der nicht HF-haltigen Säure beim Ätzen der phosphidhaltigen Opferschicht14 und (ii) die Fähigkeit der nicht HF-haltigen Säure, das geätzte Reaktionsprodukt so zu lösen, dass auf der Oberfläche des Grundsubstrats10 kein geätztes Reaktionsprodukt gebildet wird, nicht nachteilig beeinflusst. Eine höhere Konzentration an Nicht-HF-Ätzmittel wird bevorzugt, um die Oberfläche nach der Ätzung aufgrund des Passivierungseffekts atomar glatt zu halten. - In einer Ausführungsform kann die Ätzung, die verwendet wird, um die phosphidhaltige Opferschicht
14 von den Strukturen zu entfernen, bei Raumtemperatur (d.h., von 20 °C bis 40 °C) durchgeführt werden. In einer anderen Ausführungsform kann die Ätzung, die verwendet wird, um die phosphidhaltige Opferschicht14 von den Strukturen zu entfernen, bei einer erhöhten Temperatur durchgeführt werden, die höher ist als die Raumtemperatur, den Siedepunkt des nicht HF-haltigen Ätzmittels aber nicht übersteigt. In einem Beispiel kann die erhöhte Temperatur mehr als 40°C bis 100°C betragen. - Der Ätzprozess kann mit Techniken durchgeführt werden, die dem Fachmann wohlbekannt sind, einschließlich zum Beispiel des Tauchens eines Randabschnitts der Struktur in ein Bad, das ein Nicht-HF-Ätzmittel enthält, des Eintauchens der gesamten Struktur in ein Bad, das ein Nicht-HF-Ätzmittel enthält, des Sprühens des Nicht-HF-Ätzmittels auf einen Randabschnitt der Struktur, oder des Bürstenstreichens des nicht HF-haltigen Ätzmittels auf einen Randabschnitt. Auch eine Kombination dieser Techniken kann verwendet werden, um die phosphidhaltige Opferschicht
14 von der Struktur zu ätzen. - Die Dauer des Ätzschritts kann abhängig vom Typ des verwendeten Nicht-HF-Ätzmittels, von den Bedingungen, bei welchen die Ätzung durchgeführt wird, und von der Länge des verwendeten Anfangsgrundsubstrats
10 variieren. In einer Ausführungsform ist die Dauer der Ätzung typischerweise 1 Stunde bis 7 Tage, wobei eine Dauer von 1 Stunde bis 1 Tag typischer ist. Die Ätzung kann abhängig von der Größe des Wafers und von der Technik, die bei der Ätzung angewandt wird, eine längere oder kürzere Zeit lang als die oben genannten Bereiche durchgeführt werden. - In der Ausführungsform, die in
6A gezeigt wird, ist die Halbleitereinheit-Schicht16 vom Grundsubstrat10 ‚abgelöst‘. Die abgelöste Halbleitereinheit-Schicht16 kann in diesem Zustand verwendet werden oder auf ein flexibles oder starres Substrat angeordnet werden. Was das ‚abgelöste‘ Grundsubstrat10 anbetrifft, kann das ‚abgelöste‘ Grundsubstrat10 wiederverwendet werden. Zudem ist die Oberflächenrauheit des ‚abgelösten‘ Grundsubstrats10 im Wesentlichen die gleiche, im Bereich von ± 0,5 nm, wie die Anfangsoberflächenrauheit des Grundsubstrats10 . Auch die Dicke des ‚abgelösten‘ Grundsubstrats ist im Wesentlichen die gleiche, im Bereich von ± 100 nm, wie die Anfangsdicke des Grundsubstrats10 vor dem Durchführen der Ätzung. - In der Ausführungsform, die in
6B gezeigt wird, ist die Halbleitereinheit-Schicht16 vom Grundsubstrat10 ‚abgelöst‘. Die abgelöste Halbleitereinheit-Schicht16 kann in diesem Zustand verwendet werden oder auf ein anderes Substrat wie zum Beispiel ein flexibles Substrat angeordnet werden. Was das ‚abgelöste‘ Grundsubstrat10 anbetrifft, weist das in6B gezeigte Grundsubstrat10 noch die optionale Halbleiterpufferschicht12 darauf auf. In einigen Ausführungsformen kann die optionale Halbleiterpufferschicht12 auf dem Grundsubstrat bleiben, und diese Struktur kann wiederverwendet werden. - In anderen Ausführungsformen, und wie in
7 gezeigt, kann die optionale Halbleiterpufferschicht12 von der Oberseite des Grundsubstrats10 entfernt werden. In einer Ausführungsform kann die optionale Halbleiterpufferschicht12 durch chemisch-mechanisches Polieren von der Oberseite des Grundsubstrats10 entfernt werden. In einer anderen Ausführungsform kann die optionale Halbleiterpufferschicht12 durch einen chemischen Nassätzprozess von der Oberseite des Grundsubstrats10 entfernt werden, wobei der chemische Nassätzprozess zur Kostensenkung bevorzugt wird. Das in7 gezeigte Grundsubstrat10 kann wiederverwendet werden. Zudem ist die Oberflächenrauheit des in7 gezeigten ‚abgelösten‘ Grundsubstrats10 im Wesentlichen die gleiche, im Bereich von ± 0,5 nm, wie die Anfangsoberflächenrauheit des Grundsubstrats10 . Auch die Dicke des ‚abgelösten‘ Grundsubstrats ist im Wesentlichen die gleiche, im Bereich von ± 100 nm, wie die Anfangsdicke des Grundsubstrats10 vor dem Durchführen der Ätzung. - Nun wird auf
8 bis10 Bezug genommen, die die obige Ausführungsform veranschaulichen, in welcher die Halbleitereinheit-Schicht16 auch ein phosphidhaltiges Material aufweisen kann und daher dieselbe Ätzrate wie die phosphidhaltige Opferschicht14 aufweist. In solch einer Ausführungsform, und wie in8 gezeigt, wird zwischen der phosphidhaltigen Opferschicht14 und der Halbleitereinheit-Schicht16 eine erste Schutzschicht20 gebildet, um zu verhindern, dass die Halbleitereinheit-Schicht16 durch das Nicht-HF-Ätzmittel geätzt wird. Obwohl dies nicht gezeigt wird, kann auch zwischen dem Grundsubstrat10 und der phosphidhaltigen Opferschicht14 eine optionale Halbleiterpufferschicht gebildet werden. Wie oben erwähnt, kann die erste Schutzschicht20 aus GaAs oder anderen nicht phosphidhaltigen Materialien sein, die durch das Nicht-HF-Ätzmittel nicht geätzt werden. Die erste Schutzschicht20 kann durch herkömmliche Techniken gebildet werden, wie ebenfalls oben erwähnt. - Nach dem Bereitstellen der in
8 gezeigten Struktur kann die Halbleitereinheit-Schicht16 durch Lithografie und Ätzen strukturiert werden, um eine strukturierte Halbleitereinheit-Schicht16' zu ergeben. In einigen Ausführungsformen kann der Strukturierungsschritt entfallen, und die zweite Schutzschicht wird auf einer Oberseite und Seitenwandrändern der in8 gezeigten Halbleitereinheit-Schicht16 gebildet. Als Nächstes wird auf freiliegenden Oberflächen (Oberseite und Seitenwände) der strukturierten Halbleitereinheit-Schicht16' eine zweite Schutzschicht22 gebildet, um zu verhindern, dass die strukturierte Halbleitereinheit-Schicht16' durch das Nicht-HF-Ätzmittel geätzt wird. Wie oben erwähnt, kann die zweite Schutzschicht22 aus SiO2, Si3N4 oder anderen Materialien bestehen, die durch das Nicht-HF-Ätzmittel nicht geätzt werden. Die zweite Schutzschicht22 kann mit herkömmlichen Techniken gebildet werden, die dem Fachmann wohlbekannt sind, einschließlich thermischen Wachstums oder Abscheidung. Die resultierende Struktur mit der strukturierten Halbleitereinheit-Schicht16' und der zweiten Schutzschicht22 wird zum Beispiel in9 gezeigt. -
10 zeigt die Struktur während eines frühen Stadiums des Ätzprozesses, in welchem die Ätzung die phosphidhaltige Opferschicht14 selektiv entfernt. Nach dem Entfernen der strukturierten Halbleitereinheit-Schicht16' und der darunterliegenden ersten Schutzschicht20 kann eine Ätzung verwendet werden, um mindestens die zweite Schutzschicht22 von der Struktur zu entfernen. Dieselbe Ätzung oder eine andere Ätzung kann verwendet werden, um die darunterliegende erste Schutzschicht20 zu entfernen. In einigen Ausführungsformen kann die erste Schutzschicht20 unter der abgelösten, strukturierten Halbleitereinheit-Schicht16' bleiben.
Claims (26)
- Verfahren zum Ablösen einer Halbleitereinheit-Schicht (16) von einem Grundsubstrat (10), wobei das Verfahren aufweist: Bilden einer phosphidhaltigen Opferschicht (14) auf einer Oberseite eines Grundsubstrats (10); Bilden einer Halbleitereinheit-Schicht (16) auf einer Oberseite der phosphidhaltigen Opferschicht (14); und Entfernen der phosphidhaltigen Opferschicht (14) zwischen der Halbleitereinheit-Schicht (16) und dem Grundsubstrat (10), wobei das Entfernen ein Ätzen mit einem nicht HF-haltigen Ätzmittel aufweist, und wobei während des Entfernens der phosphidhaltigen Opferschicht (14) eine obere Oberfläche der Halbleitereinheit-Schicht (16), welche in Kontakt ist mit der gegenüberliegenden Bodenfläche der Halbleitereinheit-Schicht (16), unbedeckt ist.
- Verfahren nach
Anspruch 1 , wobei das Grundsubstrat (10) ein III-V-Verbindungshalbleitermaterial ist. - Verfahren nach
Anspruch 1 oder2 , wobei das Grundsubstrat (10) ein Ge-haltiges Halbleitermaterial ist. - Verfahren nach einem der
Ansprüche 1 bis3 , außerdem aufweisend ein Bilden einer Halbleiterpufferschicht (12) zwischen dem Ge-haltigen Halbleitersubstrat (10) und der phosphidhaltigen Opferschicht (14). - Verfahren nach
Anspruch 4 , wobei die Halbleiterpufferschicht (12) ein III-V-Verbindungshalbleitermaterial ist. - Verfahren nach einem der
Ansprüche 1 bis5 , wobei das Nicht-HF-Ätzmittel eine nicht HF-haltige Säure ist. - Verfahren nach
Anspruch 6 , wobei die nicht HF-haltige Säure aus der Gruppe gewählt ist, die aus HCl, HBr, HI und Mischungen daraus besteht. - Verfahren nach einem der
Ansprüche 1 bis7 , wobei das Entfernen der phosphidhaltigen Opferschicht (14) mit dem nicht HF-haltigen Ätzmittel bei einer Temperatur von Raumtemperatur bis zu einem Siedepunkt des nicht HF-haltigen Ätzmittels, jedoch nicht darüber hinaus durchgeführt wird. - Verfahren nach einem der
Ansprüche 1 bis8 , wobei das Grundsubstrat (10) nach dem Entfernen der phosphidhaltigen Opferschicht (14) zwischen dem Grundsubstrat (10) und der Halbleitereinheit-Schicht (16) eine RMS-Oberflächenrauheit von 0,1 nm bis 0,5 nm oder im Bereich von ± 0,5 nm einer RMS-Anfangsrauheit aufweist. - Verfahren nach einem der
Ansprüche 1 bis9 , wobei die phosphidhaltige Opferschicht (14) aus einer Verbindung aus Phosphor und mindestens einem Element zusammengesetzt ist, das weniger elektronegativ als der Phosphor ist. - Verfahren nach
Anspruch 10 , wobei die phosphidhaltige Opferschicht (14) InAIP, InGaP, InAsP, GaAsP, InGaAIP, InGaAsP, GaP, InP und phosphidhaltige Legierungen aufweist. - Verfahren nach einem der
Ansprüche 1 bis11 , wobei die phosphidhaltige Opferschicht (14) aus einem anderen Halbleitermaterial als das Grundsubstrat (10) und die Halbleitereinheit-Schicht (16) besteht. - Verfahren nach einem der
Ansprüche 1 bis12 , wobei die phosphidhaltige Opferschicht (14) aus einem gleichen Halbleitermaterial wie die Halbleitereinheit-Schicht (16) ist und wobei zwischen der Halbleitereinheit-Schicht (16) und der phosphidhaltigen Opferschicht (14) eine erste Schutzschicht (20) gebildet wird, und wobei auf freiliegenden Flächen der Halbleitereinheit-Schicht (16') eine zweite Schutzschicht (22) gebildet wird. - Verfahren zum Ablösen einer Halbleitereinheit-Schicht (16) von einem Grundsubstrat (10), wobei das Verfahren aufweist: Bilden einer Halbleiterpufferschicht (12) auf einer Oberseite eines Grundsubstrats (10); Bilden einer phosphidhaltigen Opferschicht (14) auf einer Oberseite der Halbleiterpufferschicht (12); Bilden einer Halbleitereinheit-Schicht (16) auf einer Oberseite der phosphidhaltigen Opferschicht (14); und Entfernen der phosphidhaltigen Opferschicht (14), die zwischen der Halbleitereinheit-Schicht (16) und dem Grundsubstrat (10) liegt, wobei das Entfernen ein Ätzen mit einem nicht HF-haltigen Ätzmittel aufweist, und wobei während des Entfernens der phosphidhaltigen Opferschicht (14) eine obere Oberfläche der Halbleitereinheit-Schicht (16), welche in Kontakt ist mit der gegenüberliegenden Bodenfläche der Halbleitereinheit-Schicht (16), unbedeckt ist.
- Verfahren nach
Anspruch 14 , außerdem aufweisend ein Entfernen der Halbleiterpufferschicht (12) von der Oberseite des Grundsubstrats (10). - Verfahren nach
Anspruch 14 oder15 , wobei das Grundsubstrat (10) ein III-V-Verbindungshalbleitermaterial ist. - Verfahren nach einem der
Ansprüche 14 bis16 , wobei das Grundsubstrat (10) ein Ge-haltiges Halbleitersubstrat ist. - Verfahren nach
Anspruch 17 , wobei das Ge-haltige Halbleitermaterial eine SiGe-Legierung aufweist. - Verfahren nach einem der
Ansprüche 14 bis18 , wobei das Nicht-HF-Ätzmittel eine nicht HF-haltige Säure ist. - Verfahren nach
Anspruch 19 , wobei die nicht HF-haltige Säure aus der Gruppe gewählt ist, die aus HCl, HBr, HI und Mischungen daraus besteht. - Verfahren nach einem der
Ansprüche 14 bis20 , wobei das Entfernen der phosphidhaltigen Opferschicht (14) mit dem nicht HF-haltigen Ätzmittel bei einer Temperatur von Raumtemperatur bis zu einem Siedepunkt des nicht HF-haltigen Ätzmittels, jedoch nicht darüber hinaus durchgeführt wird. - Verfahren nach einem der
Ansprüche 14 bis21 , wobei das Grundsubstrat (10) nach dem Entfernen der phosphidhaltigen Opferschicht (14) und der Halbleiterpufferschicht (12) zwischen dem Grundsubstrat (10) und der Halbleitereinheit-Schicht (16) eine RMS-Oberflächenrauheit von 0,1 nm bis 0,5 nm oder im Bereich von ± 0,5 nm einer RMS-Anfangsrauheit aufweist. - Verfahren nach einem der
Ansprüche 14 bis22 , wobei die phosphidhaltige Opferschicht (14) aus einer Verbindung aus Phosphor und mindestens einem Element zusammengesetzt ist, das weniger elektronegativ als der Phosphor ist. - Verfahren nach
Anspruch 23 , wobei die phosphidhaltige Opferschicht (14) InAIP, InGaP, InAsP, GaAsP, InGaAIP, InGaAsP, GaP, InP und phosphidhaltige Legierungen aufweist. - Verfahren nach einem der
Ansprüche 14 bis24 , wobei die phosphidhaltige Opferschicht (14) aus einem anderen Halbleitermaterial als das Grundsubstrat (10) und die Halbleitereinheit-Schicht (16) besteht. - Verfahren nach einem der
Ansprüche 14 bis25 , wobei die phosphidhaltige Opferschicht (14) aus einem gleichen Halbleitermaterial wie die Halbleitereinheit-Schicht (16) besteht und wobei zwischen der Halbleitereinheit-Schicht (16) und der phosphidhaltigen Opferschicht (14) eine erste Schutzschicht (20) gebildet wird, und wobei auf freiliegenden Flächen der Halbleitereinheit-Schicht (16') eine zweite Schutzschicht (22) gebildet wird.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US13/236,119 | 2011-09-19 | ||
US13/236,119 US8541315B2 (en) | 2011-09-19 | 2011-09-19 | High throughput epitaxial lift off for flexible electronics |
PCT/US2012/054400 WO2013043402A1 (en) | 2011-09-19 | 2012-09-10 | High throughput epitaxial lift off for flexible electronics |
Publications (2)
Publication Number | Publication Date |
---|---|
DE112012003409T5 DE112012003409T5 (de) | 2014-05-08 |
DE112012003409B4 true DE112012003409B4 (de) | 2020-09-03 |
Family
ID=47881045
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112012003409.0T Active DE112012003409B4 (de) | 2011-09-19 | 2012-09-10 | Verfahren zum Ablösen einer Halbleitereinheit-Schicht von einem Grundsubstrat |
Country Status (5)
Country | Link |
---|---|
US (2) | US8541315B2 (de) |
CN (1) | CN103797568B (de) |
DE (1) | DE112012003409B4 (de) |
GB (1) | GB2508572B (de) |
WO (1) | WO2013043402A1 (de) |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR102009727B1 (ko) * | 2012-11-26 | 2019-10-22 | 삼성디스플레이 주식회사 | 표시 장치, 표시 장치의 제조 방법 및 표시 장치를 제조하기 위한 캐리어 기판 |
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US9653308B2 (en) | 2015-08-28 | 2017-05-16 | International Business Machines Corporation | Epitaxial lift-off process with guided etching |
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Publication number | Priority date | Publication date | Assignee | Title |
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US7678601B2 (en) | 2006-01-20 | 2010-03-16 | Texas Instruments Incorporated | Method of forming an acceleration sensor |
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-
2011
- 2011-09-19 US US13/236,119 patent/US8541315B2/en active Active
-
2012
- 2012-09-10 WO PCT/US2012/054400 patent/WO2013043402A1/en active Application Filing
- 2012-09-10 GB GB1406069.3A patent/GB2508572B/en not_active Expired - Fee Related
- 2012-09-10 CN CN201280045159.4A patent/CN103797568B/zh active Active
- 2012-09-10 DE DE112012003409.0T patent/DE112012003409B4/de active Active
-
2013
- 2013-09-23 US US14/033,942 patent/US8796120B2/en not_active Expired - Fee Related
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Also Published As
Publication number | Publication date |
---|---|
US8796120B2 (en) | 2014-08-05 |
GB2508572B (en) | 2016-04-27 |
US20140024222A1 (en) | 2014-01-23 |
GB201406069D0 (en) | 2014-05-21 |
WO2013043402A1 (en) | 2013-03-28 |
CN103797568B (zh) | 2016-04-20 |
US8541315B2 (en) | 2013-09-24 |
GB2508572A (en) | 2014-06-04 |
DE112012003409T5 (de) | 2014-05-08 |
CN103797568A (zh) | 2014-05-14 |
US20130071999A1 (en) | 2013-03-21 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES INC., KY Free format text: FORMER OWNER: INTERNATIONAL BUSINESS MACHINES CORPORATION, ARMONK, N.Y., US |
|
R082 | Change of representative |
Representative=s name: RICHARDT PATENTANWAELTE PARTG MBB, DE Representative=s name: RICHARDT PATENTANWAELTE PART GMBB, DE |
|
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0021311000 Ipc: H01L0021306000 Effective date: 20140411 |
|
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES U.S. INC., SANTA CLARA, US Free format text: FORMER OWNER: INTERNATIONAL BUSINESS CORPORATION, ARMONK, N.Y., US Owner name: GLOBALFOUNDRIES INC., KY Free format text: FORMER OWNER: INTERNATIONAL BUSINESS CORPORATION, ARMONK, N.Y., US |
|
R082 | Change of representative |
Representative=s name: RICHARDT PATENTANWAELTE PARTG MBB, DE |
|
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES U.S. INC., SANTA CLARA, US Free format text: FORMER OWNER: GLOBALFOUNDRIES US 2 LLC (N.D.GES.DES STAATES DELAWARE), HOPEWELL JUNCTION, N.Y., US Owner name: GLOBALFOUNDRIES INC., KY Free format text: FORMER OWNER: GLOBALFOUNDRIES US 2 LLC (N.D.GES.DES STAATES DELAWARE), HOPEWELL JUNCTION, N.Y., US |
|
R082 | Change of representative |
Representative=s name: RICHARDT PATENTANWAELTE PARTG MBB, DE |
|
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES U.S. INC., SANTA CLARA, US Free format text: FORMER OWNER: GLOBALFOUNDRIES INC., GRAND CAYMAN, KY |
|
R082 | Change of representative |
Representative=s name: RICHARDT PATENTANWAELTE PARTG MBB, DE |
|
R020 | Patent grant now final |