DE102005024943B4 - Soi-igbt - Google Patents
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- 239000004065 semiconductor Substances 0.000 claims abstract description 88
- 210000000746 body region Anatomy 0.000 claims abstract description 79
- 238000009413 insulation Methods 0.000 claims abstract description 14
- 238000002955 isolation Methods 0.000 claims description 19
- 239000000758 substrate Substances 0.000 description 10
- 238000000034 method Methods 0.000 description 7
- 230000006798 recombination Effects 0.000 description 7
- 238000005215 recombination Methods 0.000 description 7
- 229910052710 silicon Inorganic materials 0.000 description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 6
- 230000008569 process Effects 0.000 description 6
- 238000002513 implantation Methods 0.000 description 5
- 239000010703 silicon Substances 0.000 description 5
- 235000012431 wafers Nutrition 0.000 description 5
- 239000002131 composite material Substances 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 4
- 238000005530 etching Methods 0.000 description 3
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 3
- 238000000137 annealing Methods 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 238000000407 epitaxy Methods 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- 229920005591 polysilicon Polymers 0.000 description 2
- 230000009467 reduction Effects 0.000 description 2
- MYMOFIZGZYHOMD-UHFFFAOYSA-N Dioxygen Chemical compound O=O MYMOFIZGZYHOMD-UHFFFAOYSA-N 0.000 description 1
- 240000003517 Elaeocarpus dentatus Species 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 230000000903 blocking effect Effects 0.000 description 1
- 239000002800 charge carrier Substances 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000007781 pre-processing Methods 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/70—Bipolar devices
- H01L29/72—Transistor-type devices, i.e. able to continuously respond to applied control signals
- H01L29/739—Transistor-type devices, i.e. able to continuously respond to applied control signals controlled by field-effect, e.g. bipolar static induction transistors [BSIT]
- H01L29/7393—Insulated gate bipolar mode transistors, i.e. IGBT; IGT; COMFET
- H01L29/7395—Vertical transistors, e.g. vertical IGBT
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0603—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
- H01L29/0642—Isolation within the component, i.e. internal isolation
- H01L29/0649—Dielectric regions, e.g. SiO2 regions, air gaps
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0603—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
- H01L29/0642—Isolation within the component, i.e. internal isolation
- H01L29/0649—Dielectric regions, e.g. SiO2 regions, air gaps
- H01L29/0653—Dielectric regions, e.g. SiO2 regions, air gaps adjoining the input or output region of a field-effect device, e.g. the source or drain region
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66234—Bipolar junction transistors [BJT]
- H01L29/66325—Bipolar junction transistors [BJT] controlled by field-effect, e.g. insulated gate bipolar transistors [IGBT]
- H01L29/66333—Vertical insulated gate bipolar transistors
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
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- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/70—Bipolar devices
- H01L29/72—Transistor-type devices, i.e. able to continuously respond to applied control signals
- H01L29/739—Transistor-type devices, i.e. able to continuously respond to applied control signals controlled by field-effect, e.g. bipolar static induction transistors [BSIT]
- H01L29/7393—Insulated gate bipolar mode transistors, i.e. IGBT; IGT; COMFET
- H01L29/7394—Insulated gate bipolar mode transistors, i.e. IGBT; IGT; COMFET on an insulating layer or substrate, e.g. thin film device or device isolated from the bulk substrate
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Abstract
SOI-IGBT (1', 1''), mit:
– einem ersten Halbleiterkörperbereich (2),
– einem oberhalb des ersten Halbleiterkörperbereichs (2) ausgebildeten zweiten Halbleiterkörperbereich (3) mit mehreren lateral nebeneinander angeordneten Bodyzonen (9) des ersten Leitungstyps, in die Sourcezonen (6) des zweiten Leitungstyps eingebettet sind, sowie
– einer Isolationsstruktur (4), die zwischen dem ersten Halbleiterkörperbereich (2) und dem zweiten Halbleiterkörperbereich (3) ausgebildet ist und die beiden Halbleiterkörperbereiche gegeneinander elektrisch isoliert, jedoch Aussparungen (5) aufweist, über die die beiden Halbleiterkörperbereiche elektrisch miteinander verbunden sind, wobei im Betriebszustand des SOI-IGBT elektrische Ströme ausbildbar sind, die von den Sourcezonen (6) durch die Aussparungen (5) hindurch zu wenigstens einer in dem ersten Halbleiterkörperbereich (2) ausgebildeten Drainzone (7) hin und umgekehrt verlaufen, wobei:
– die Bodyzonen (9) lateral durch im zweiten Halbleiterkörperbereich ausgebildete Zonen (10) des zweiten Leitungstyps voneinander getrennt sind, die zumindest teilweise oberhalb der in der Isolationsstruktur (4) vorgesehenen Aussparungen (5) angeordnet und mit dem...
– einem ersten Halbleiterkörperbereich (2),
– einem oberhalb des ersten Halbleiterkörperbereichs (2) ausgebildeten zweiten Halbleiterkörperbereich (3) mit mehreren lateral nebeneinander angeordneten Bodyzonen (9) des ersten Leitungstyps, in die Sourcezonen (6) des zweiten Leitungstyps eingebettet sind, sowie
– einer Isolationsstruktur (4), die zwischen dem ersten Halbleiterkörperbereich (2) und dem zweiten Halbleiterkörperbereich (3) ausgebildet ist und die beiden Halbleiterkörperbereiche gegeneinander elektrisch isoliert, jedoch Aussparungen (5) aufweist, über die die beiden Halbleiterkörperbereiche elektrisch miteinander verbunden sind, wobei im Betriebszustand des SOI-IGBT elektrische Ströme ausbildbar sind, die von den Sourcezonen (6) durch die Aussparungen (5) hindurch zu wenigstens einer in dem ersten Halbleiterkörperbereich (2) ausgebildeten Drainzone (7) hin und umgekehrt verlaufen, wobei:
– die Bodyzonen (9) lateral durch im zweiten Halbleiterkörperbereich ausgebildete Zonen (10) des zweiten Leitungstyps voneinander getrennt sind, die zumindest teilweise oberhalb der in der Isolationsstruktur (4) vorgesehenen Aussparungen (5) angeordnet und mit dem...
Description
- Die Erfindung betrifft einen SOI-IGBT nach dem Oberbegriff des Patentanspruches
1 . - SOI-IGBTs (SOI = Silicon-On-Insulator bzw. Silizium auf Isolator; IGBT = Insulated Gate Bipolar Transistor bzw. Bipolartransistor mit isoliertem Gate) sind häufig eingesetzte Bauteile. In
1 ist ein bekannter SOI-IGBT in Querschnittsdarstellung gezeigt. - Ein SOI-IGBT
1 weist einen ersten Halbleiterkörperbereich2 , einen oberhalb des ersten Halbleiterkörperbereichs ausgebildeten zweiten Halbleiterkörperbereich3 sowie eine Isolationsstruktur4 , die zwischen dem ersten Halbleiterkörperbereich2 und dem zweiten Halbleiterkörperbereich3 ausgebildet ist und die beiden Halbleiterkörperbereiche2 ,3 gegeneinander elektrisch isoliert, auf. In der Isolationsstruktur4 sind Aussparungen5 vorgesehen, über die die beiden Halbleiterkörperbereiche2 ,3 elektrisch miteinander verbunden sind. Der erste Halbleiterkörperbereich2 weist eine Drainzone7 sowie eine auf der Drainzone7 ausgebildete Driftzone8 auf. Der zweite Halbleiterkörperbereich3 weist mehrere lateral nebeneinander angeordnete Bodyzonen9 auf, die durch Kanalzonen10 lateral voneinander getrennt sind. In den Bodyzonen9 sind Sourcezonen6 vorgesehen. Oberhalb des zweiten Halbleiterkörperbereichs3 ist ein (aus n+-dotiertem Polysilizium bestehendes) Gate11 vorgesehen, das gegenüber dem zweiten Halbleiterkörperbereich3 durch eine Isolierung12 elektrisch isoliert ist. Die Bodyzonen9 weisen einen ersten und zweiten p+-dotierten Bereich13 ,14 sowie einen p-dotierten Bereich15 auf. Ferner sind in dieser Ausführungsform die Drainzone7 p+-dotiert, die Driftzone8 n–-dotiert, die Kanalzonen10 n–-dotiert und die Sourcezonen6 n+-dotiert. Die Sourcezonen6 werden über Sourceanschlüsse S kontaktiert, die gleichzeitig auch die p+-dotierten Bereiche14 (Bodykontaktgebiete) kontaktieren. - Im Betriebszustand des SOI-IGBTs werden elektrische Ströme ausgebildet, die von den in dem zweiten Halbleiterkörperbereich
3 ausgebildeten Sourcezonen6 durch die Aussparungen5 hindurch zu der Drainzone7 hin verlaufen (Elektronen) und umgekehrt (Löcher). - Nachteilig an dem in
1 gezeigten SOI-IGBT1 ist, dass die Isolationsstruktur4 mit verhältnismäßig hohem Aufwand hergestellt werden muss:
Eine Möglichkeit besteht darin, in einen Schichtverbund, bestehend aus dem ersten Halbleiterkörperbereich2 , der darauf angeordneten (durchgehenden) Isolationsstruktur4 sowie dem auf der Isolationsstruktur4 angeordneten zweiten Halbleiterkörperbereich3 Aussparungen einzubringen (beispielsweise mittels eines Ätzverfahrens), die, ausgehend von der Oberseite des Schichtverbunds, durch den zweiten Halbleiterkörperbereich3 sowie die Isolationsstruktur4 hindurch in den ersten Halbleiterkörperbereich2 hinein reichen. Anschließend werden die so erzeugten Aussparungen mit Halbleitermaterial aufgefüllt. Erfolgt die Auffüllung der Aussparungen mittels eines Epitaxieprozesses, so bilden sich an den Teilen der Isolationsstruktur4 , die an die Aussparungen angrenzen, polykristalline Zonen16 aus, die eine hohe Rekombination von Elektronen und Löchern bewirken und daher unerwünscht sind. - Eine weitere Möglichkeit ist, in einen durchgehenden Halbleiterkörper (d. h. in einen lediglich aus erstem und zweitem Halbleiterkörperbereich
2 ,3 bestehenden Halbleiterkörper) eine strukturierte Isolationsstruktur4 mittels eines Implantationsprozesses und eines anschließenden Temperprozesses einzubringen. Auch hier bilden sich jedoch an dem Übergang zwischen den Halbleiterkörperbereichen2 ,3 und der Isolati onsstruktur4 sowie dem Halbleiterkörper Zonen erhöhter Rekombination aus, die unerwünscht sind. - Im einzelnen ist ein IGBT der eingangs genannten Art aus der
DE 198 01 093 A1 bekannt. Dieser IGBT hat einen ersten Halbleiterkörperbereich, einen oberhalb des ersten Halbleiterkörperbereichs ausgebildeten zweiten Halbleiterkörperbereich mit mehreren lateral nebeneinander angeordneten Bodyzonen des ersten Leitungstyps, die in die Sourcezonen des zweiten Leitungstyps eingebettet sind, und eine Isolationsstruktur, zwischen dem ersten Halbleiterkörperbereich und dem zweiten Halbleiterkörperbereich, die die beiden Halbleiterkörperbereiche gegeneinander elektrisch isoliert, die jedoch Aussparungen aufweist, über die die beiden Halbleiterkörperbereiche elektrisch miteinander verbunden sind, wobei im Betriebszustand des SOI-IGBT elektrische Ströme ausbildbar sind, die von den Sourcezonen durch die Aussparungen hindurch zu wenigstens einer in dem ersten Halbleiterkörperbereich ausgebildeten Drainzone hin und umgekehrt verlaufen. Die Bodyzonen sind lateral durch im zweiten Halbleiterkörperbereich ausgebildete Zonen des zweiten Leitungstyps voneinander getrennt. Diese Zonen sind zumindest teilweise oberhalb der in der Isolationsstruktur vorgesehenen Aussparungen angeordnet und mit dem ersten Halbleiterkörperbereich elektrisch verbunden. - Weiterhin ist es aus der
DE 695 19 210 T2 bekannt, dass die Ausbildung von Hohlräumen im Halbleiterkörper eines Halbleiterbauelements zu einer verbesserten Kristallinität führt. - Schließlich ist noch ein aus zwei Substraten aufgebautes Halbleiterbauelement mit einem Hohlraum und einer ähnlichen Struktur wie der IGBT der
DE 198 01 093 A1 aus derUS 5,841,155 A bekannt. - Die der Erfindung zugrunde liegende Aufgabe ist es, einen SOI-IGBT anzugeben, der (möglichst) keine Zonen erhöhter Rekombination in der Nähe der Isolationsstruktur aufweist.
- Diese Aufgabe wird erfindungsgemäß durch einen SOI-IGBT gemäß Patentanspruch 1 gelöst. Vorteilhafte Ausgestaltungen bzw. Weiterbildungen des Erfindungsgedankens finden sich in den Unteransprüchen.
- Der erfindungsgemäße SOI-IGBT weist einen ersten Halbleiterkörperbereich, einen oberhalb des ersten Halbleiterkörperbereichs ausgebildeten zweiten Halbleiterkörperbereich sowie eine Isolationsstruktur, die zwischen dem ersten Halbleiterkörperbereich und dem zweiten Halbleiterkörperbereich ausgebildet ist und die beiden Halbleiterkörperbereiche gegeneinander elektrisch isoliert, auf. In der Isolationsstruktur (beispielsweise eine Oxidschicht) sind Aussparungen vorgesehen, über die die beiden Halbleiterkörperbereiche elektrisch miteinander verbunden sind. Im Betriebszustand des SOI-IGBT sind elektrische Ströme ausbildbar, die von in dem zweiten Halbleiterkörperbereich ausgebildeten Sourcezonen durch die Aussparungen hindurch zu wenigstens einer in dem ersten Halbleiterkörperbereich ausgebildeten Drainzone hin und umgekehrt verlaufen. Die Isolationsstruktur weist wenigstens einen Hohlraum auf; Teile der Isolationsstruktur bzw. die gesamte Isolationsstruktur sind also in Form eines Hohlraums oder in Form mehrerer Hohlräume, die den ersten Halbleiterkörperbereich gegenüber dem zweiten Halbleiterkörperbereich trennen, realisiert; die Funktion der Isolationsstruktur wird ersetzt durch entsprechende Hohlräume.
- Vorteilhaft hierbei ist, dass bei der Herstellung der Hohlräume keine Zonen erhöhter Rekombination in der Umgebung der Hohlräume (d. h. in der Umgebung der durch die Hohlräume gebildeten Isolationsstruktur) ausgebildet werden, da die Hohlräume, wie später noch ausführlich beschrieben werden wird, mittels entsprechender Ätzprozesse, bei denen keine Zonen erhöhte Rekombination ausgebildet werden, erzeugt werden können.
- Der zweite Halbleiterkörperbereich weist mehrere lateral nebeneinander angeordnete Bodyzonen des ersten Leitungstyps auf, in die Sourcezonen des zweiten Leitungstyps eingebettet sind. Die Bodyzonen werden dabei lateral durch im zweiten Halbleiterkörperbereich ausgebildete Zonen des zweiten Leitungstyps voneinander getrennt, die zumindest teilweise oberhalb der in der Isolationsstruktur vorgesehenen Aussparungen angeordnet und mit dem ersten Halbleiterkörperbereich elektrisch verbunden sind.
- In den Zonen des zweiten Leitungstyps, die die Bodyzonen lateral voneinander trennen, sind Kompensationsstrukturen des ersten Leitungstyps vorgesehen. Unterhalb der Kompensationsstrukturen können Hohlräume vorgesehen sein, die als Teil der Isolationsstruktur interpretierbar sind.
- Die unterhalb der Bodyzonen und/oder Kompensationsstrukturen ausgebildeten Hohlräume können von den Bodyzonen bzw. Kompensationsstrukturen durch eine in dem zweiten Halbleiterkörperbereich ausgebildete Zone des zweiten Leitungstyps beabstandet sein.
- Ein Verfahren zur Herstellung des vorangehend beschriebenen SOI-IGBTs hat die folgenden Schritte:
- – Ausbilden des ersten Halbleiterkörperbereichs in einem ersten Substrat,
- – Ausbilden des zweiten Halbleiterkörperbereichs in einem zweiten Substrat,
- – Ausbilden von Aussparungen im ersten und/oder und zweiten Halbleiterkörperbereich, und
- – Ausbilden eines Schichtverbunds aus erstem Substrat und zweitem Substrat, derart, dass die Aussparungen zwischen dem ersten Substrat und dem zweiten Substrat die Hohlräume darstellen.
- Bei diesem Herstellungsverfahren werden also zur Ausbildung der Isolationsstruktur lediglich Aussparungen in einem oder beiden Substraten ausgebildet, und die beiden Substrate dann mittels eines Fügeprozesses zu einem Schichtverbund miteinander verbunden.
- Die Erfindung wird im Folgenden unter Bezugnahme auf die Figuren in beispielsweiser Ausführungsform näher erläutert.
- Es zeigen:
-
1 einen Ausschnitt eines bekannten SOI-IGBTs in Querschnittsdarstellung, -
2 eine Detailaufnahme eines Ausschnitts des in1 gezeigten SOI-IGBTs in Querschnittsdarstellung, -
3 einen Ausschnitt einer ersten Ausführungsform des erfindungsgemäßen SOI-IGBTs in Querschnittsdarstellung, -
4 einen Ausschnitt einer zweiten Ausführungsform des erfindungsgemäßen SOI-IGBTs in Querschnittsdarstellung. - In den Figuren sind identische bzw. einander entsprechende Bereiche, Bauteile oder Bauteilgruppen mit denselben Bezugsziffern gekennzeichnet. Weiterhin können die Dotiertypen sämtlicher Ausführungsformen invertiert sein, d. h. n-Bereiche können durch p-Bereiche ersetzt werden und umgekehrt.
- Der in
3 gezeigte SOI-IGBT1' weist einen ersten Halbleiterkörperbereich2 , einen oberhalb des ersten Halbleiterkörperbereichs ausgebildeten zweiten Halbleiterkörperbereich3 sowie eine Isolationsstruktur4 , die zwischen dem ersten Halbleiterkörperbereich2 und dem zweiten Halbleiterkörperbereich3 ausgebildet ist und die beiden Halbleiterkörperbereiche2 ,3 gegeneinander elektrisch isoliert, auf. In der Isolationsstruktur4 sind Aussparungen5 vorgesehen, über die die beiden Halbleiterkörperbereiche2 ,3 elektrisch miteinan der verbunden sind. Der erste Halbleiterkörperbereich2 weist eine Drainzone7 sowie eine auf der Drainzone7 ausgebildete Driftzone8 auf. Der zweite Halbleiterkörperbereich3 weist mehrere lateral nebeneinander angeordnete Bodyzonen9 auf, die durch Kanalzonen10 lateral voneinander getrennt sind. In den Bodyzonen9 sind Sourcezonen6 vorgesehen. Oberhalb des zweiten Halbleiterkörperbereichs3 ist ein Gate11 vorgesehen, das gegenüber dem zweiten Halbleiterkörperbereich3 durch eine Isolierung12 elektrisch isoliert ist. Die Bodyzonen9 weisen einen ersten und zweiten p+-dotierten Bereich13 ,14 sowie einen p-dotierten Bereich15 auf. Ferner sind in dieser Ausführungsform die Drainzone7 p+-dotiert, die Driftzone n–-dotiert, die Kanalzonen10 n–-dotiert, die Sourcezonen6 n+-dotiert; das Gate11 besteht aus n+-dotiertem Polysilizium. Die Sourcezonen6 werden über Sourceanschlüsse S kontaktiert, die gleichzeitig auch den p+-dotiertem Bereich14 kontaktieren. - Im Betriebszustand des SOI-IGBTs werden elektrische Ströme ausgebildet, die von den in dem zweiten Halbleiterkörperbereich
3 ausgebildeten Sourcezonen6 durch die Aussparungen5 hindurch zu der Drainzone7 hin verlaufen (Elektronen) und umgekehrt (Löcher). - Im Gegensatz zu der in
1 gezeigten Ausführungsform ist hier die Isolationsstruktur4 vollständig in Form von Hohlräumen17 realisiert, d. h. die Isolationsschicht wird durch eine ”Hohlraumschicht” ersetzt. Die lateralen Ausdehnungen der Hohlräume17 entspricht der lateralen Ausdehnung der Bodyzonen9 , d. h. die lateralen Enden der Hohlräume17 schließen bündig mit den lateralen Enden der Bodyzonen9 ab. Die Erfindung ist jedoch nicht hierauf beschränkt, d. h. die laterale Ausdehnung der Hohlräume17 kann größer sein als entsprechende laterale Ausdehnungen der Bodyzonen9 . Auch ist es möglich, die lateralen Ausdehnungen der Hohlräume17 kürzer auszugestalten als die lateralen Ausdehnungen der entsprechenden Bodyzonen9 . Weiterhin ist es möglich, die Dicke der Hohlräume17 in horizontaler Richtung zu variieren oder die vertikalen Positionen der Hohlräume17 in horizontaler Richtung zu variieren. - Ein weiterer Unterschied gegenüber dem in
1 gezeigten IGBT ist, dass innerhalb der Kanalzonen10 Kompensationsstrukturen18 vorgesehen sind, die p-dotiert sind. Die Kompensationsstrukturen18 bewirken, dass im Sperrfall des SOI-IGBTs eine bessere Ausräumung von in den Kanalzonen10 vorhandenen Ladungsträgern erfolgen kann. - Die in
4 gezeigte Ausführungsform1'' unterscheidet sich von der in3 gezeigten Ausführungsform1' dadurch, dass die Ausgestaltung des Gates11 anderes ausfällt: das Gate11 weist einen stufenförmigen Verlauf auf, wodurch die Millerkapazität des Bauteils reduziert werden kann. Weiterhin sind in dieser Ausführungsform auch unterhalb der Kompensationsstrukturen18 Hohlräume17 vorgesehen. Ferner sind die Hohlräume17 gegenüber den Bodyzonen9 vertikal beabstandet und die vertikalen Positionen der Hohlräume17 variieren in horizontaler Richtung. - In beiden erfindungsgemäßen Ausführungsformen kann das p+-Gebiet
7 durch eine Schottky-Barriere ersetzt werden. In der folgenden Beschreibung sollen weitere Aspekte der Erfindung erläutert werden. - Zur Herstellung der im Halbleiterkörper der SOI-IGBTs vergrabenen und strukturierten Isolationsstruktur (die im allgemeinen eine Oxidschicht ist), gibt es nach heutigem Stand der Technik zwei Möglichkeiten:
- a) Ausgehend von einer SOI-Scheibe (hergestellt durch
Waferbonden) wird an den Stellen, an denen sich kein Oxid befinden
soll, ein Loch durch die aktive Silizium-Schicht und durch die Oxidschicht
geätzt.
Anschließend
wird das Loch mit passend dotiertem Silizium mittels Epitaxie auf gefüllt (siehe
4 ). Dabei bildet sich an den Oxidoberflächen ein polykristallines Gebiet aus. Polykristallines Silizium hat jedoch eine extrem hohe Rekombinationsrate, d. h. das durch die Oxidschicht angestrebte Ziel einer Anhebung der Minoritätsträgerdichte unter der Oxidschicht wird nicht erreicht. Darüber hinaus sind wafergebondete Scheiben extrem teuer (2–3 mal so teuer wie eine Substratscheibe). - b) Bei der Verwendung von SIMOX-Scheiben (die Oxidschicht wird durch die Implantation einer extrem hohen Dosis Sauerstoff in die Silizium-Scheibe und anschließendes Tempern bei ca. 1000°C erzeugt) muss die Implantation maskiert erfolgen, um oxidfreie Zonen zu erzeugen. Die Nachteile dieses Verfahrens sind: die Herstellung der maskierten Oxidschicht muss beim Scheibenhersteller erfolgen; die Oxid-Silizium-Grenzfläche weist aufgrund der hohen Implantationsdosis ebenfalls eine erhöhte Rekombinationsrate auf. Weiterhin sind die Kosten für die Herstellung der vergrabenen Oxidschicht ähnlich hoch wie wafergebondete Scheiben.
- Es wird deshalb anstelle des Oxids ein Hohlraum verwendet. Dieser lässt sich in jeder Chipfabrik mit dem vorhandenen Equipment leicht und preiswert herstellen. Ein weiterer Vorteil ist, dass Hohlräume eine Dielektrizitätskonstante Epsilon von 1 aufweisen (im Gegensatz hierzu beträgt diese Konstante bei einer Oxidschicht 4). Hierdurch kann eine Reduktion der Rückwirkungskapazitäten erzielt werden.
- Der Löcherstrom wird durch die Hohlräume (ähnlich wie bei einer Isolationsschicht) in der Oberflächennähe so verengt, dass ein gegebener Strom nur bei sehr hohem Konzentrationsquotienten der Löcher fließen kann. Damit wird die Plasmadichte im oberen Teil des Bauteils wesentlich erhöht, womit eine Reduktion des Spannungsabfalls (Durchlasswiderstand) erzielt werden kann.
- Ähnlich arbeitet dieser IGBT auch nach dem Trench-Prinzip in den Zellen der ”IGBT”-Bauelemente.
- Die Hohlräume unter den Bodyzonen in den IGBT-Zellen können durch Trench-Ätzen mit nachfolgender H2-Temperierung nach heutigem Stand der Technik einfach hergestellt werden. Dies bedeutet, dass lediglich die Vorprozessierung entsprechender Halbleiterscheiben mit einem nicht zu feinen Maskenschritt notwendig ist. Die hierzu alternative SOI-Scheibe wäre wesentlich teurer.
- Auch die planare Gateanordnung ist ein Vorteil: es sollen keine Trench-Gates erstellt werden, wie es bei IGBT3 Z6 der Fall ist.
Claims (3)
- SOI-IGBT (
1' ,1'' ), mit: – einem ersten Halbleiterkörperbereich (2 ), – einem oberhalb des ersten Halbleiterkörperbereichs (2 ) ausgebildeten zweiten Halbleiterkörperbereich (3 ) mit mehreren lateral nebeneinander angeordneten Bodyzonen (9 ) des ersten Leitungstyps, in die Sourcezonen (6 ) des zweiten Leitungstyps eingebettet sind, sowie – einer Isolationsstruktur (4 ), die zwischen dem ersten Halbleiterkörperbereich (2 ) und dem zweiten Halbleiterkörperbereich (3 ) ausgebildet ist und die beiden Halbleiterkörperbereiche gegeneinander elektrisch isoliert, jedoch Aussparungen (5 ) aufweist, über die die beiden Halbleiterkörperbereiche elektrisch miteinander verbunden sind, wobei im Betriebszustand des SOI-IGBT elektrische Ströme ausbildbar sind, die von den Sourcezonen (6 ) durch die Aussparungen (5 ) hindurch zu wenigstens einer in dem ersten Halbleiterkörperbereich (2 ) ausgebildeten Drainzone (7 ) hin und umgekehrt verlaufen, wobei: – die Bodyzonen (9 ) lateral durch im zweiten Halbleiterkörperbereich ausgebildete Zonen (10 ) des zweiten Leitungstyps voneinander getrennt sind, die zumindest teilweise oberhalb der in der Isolationsstruktur (4 ) vorgesehenen Aussparungen (5 ) angeordnet und mit dem ersten Halbleiterkörperbereich elektrisch verbunden sind, dadurch gekennzeichnet, dass – die Isolationsstruktur (4 ) wenigstens einen Hohlraum (17 ) aufweist, und – in den Zonen (10 ) des zweiten Leitungstyps, die die Bodyzonen (9 ) lateral voneinander trennen, Kompensationsstrukturen (18 ) des ersten Leitungstyps vorgesehen sind. - SOI-IGBT (
1'' ) nach Anspruch 1, dadurch gekennzeichnet, dass die Hohlräume (17 ) auch unterhalb der Kompensationsstrukturen (18 ) ausgebildet sind. - SOI-IGBT (
1' ) nach Anspruch 1 oder 2, dadurch gekennzeichnet, dass die unterhalb der Bodyzonen (9 ) und/oder Kompensationsstrukturen (18 ) ausgebildeten Hohlräume (17 ) von den Bodyzonen (9 ) und/oder Kompensationsstrukturen (18 ) durch eine in dem zweiten Halbleiterkörperbereich (3 ) ausgebildete Zone (13 ) des zweiten Leitungstyps beabstandet sind.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE200510024943 DE102005024943B4 (de) | 2005-05-31 | 2005-05-31 | Soi-igbt |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE200510024943 DE102005024943B4 (de) | 2005-05-31 | 2005-05-31 | Soi-igbt |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102005024943A1 DE102005024943A1 (de) | 2006-12-14 |
DE102005024943B4 true DE102005024943B4 (de) | 2009-11-05 |
Family
ID=37439853
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE200510024943 Expired - Fee Related DE102005024943B4 (de) | 2005-05-31 | 2005-05-31 | Soi-igbt |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE102005024943B4 (de) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8120074B2 (en) * | 2009-10-29 | 2012-02-21 | Infineon Technologies Austria Ag | Bipolar semiconductor device and manufacturing method |
CN102064191A (zh) * | 2010-11-02 | 2011-05-18 | 浙江大学 | 绝缘栅双极晶体管 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5841155A (en) * | 1995-02-08 | 1998-11-24 | Ngk Insulators, Ltd. | Semiconductor device containing two joined substrates |
DE19801093A1 (de) * | 1998-01-14 | 1999-07-22 | Siemens Ag | Soi-igbt |
DE69519210T2 (de) * | 1994-08-26 | 2001-05-17 | Ngk Insulators Ltd | Im Normalzustand abgeschalteter statischer Induktionsthyristor |
-
2005
- 2005-05-31 DE DE200510024943 patent/DE102005024943B4/de not_active Expired - Fee Related
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE69519210T2 (de) * | 1994-08-26 | 2001-05-17 | Ngk Insulators Ltd | Im Normalzustand abgeschalteter statischer Induktionsthyristor |
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DE19801093A1 (de) * | 1998-01-14 | 1999-07-22 | Siemens Ag | Soi-igbt |
Also Published As
Publication number | Publication date |
---|---|
DE102005024943A1 (de) | 2006-12-14 |
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