CS266687B1

CS266687B1 - Zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A

Info

Publication number: CS266687B1
Application number: CS876508A
Authority: CS
Inventors: Vladislav Rndr Csc Malat; Petr Ing Kubik; Martin Ing Csc Zaruba
Original assignee: Vladislav Rndr Csc Malat; Petr Ing Kubik; Martin Ing Csc Zaruba
Priority date: 1987-09-09
Filing date: 1987-09-09
Publication date: 1990-01-12
Also published as: CS650887A1

Abstract

Zapojení slouží jako styková jednotka zapojení mezi řadič rámu systému^CAMAC a mikropočítač. Jako mikropočítač, tak řadič a také zapojení jsou vyrobeny s tuzemských součástek. Zapojení lze využít pro měření školních úloh;, nenáročných na pamět a rychlost řídicího počítače, nebo při použití zapojení jako záložního systému.L

Description

Vynález se týká zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A za pomoci řadiče NL 2106.

V zemích RVHP se často k řízení systému CAMAC (Computer Aided Measurement and Control) užívá některý ze systému malých elektronických počítačů. Jako řadič je při tom užíván typ Tesla NL 2106. Pro některá školní měření, pro měření nenáročná na rychlost a pamět počítače, nebo při použití jako záložní je tento způsob ekonomicky náročný, dostatečně nevyužitý a při prudkém technickém rozvoji navíc rychle zaostává.

Výše uvedené nedostatky odstraňuje zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A, jehož podstata spočívá v tom, že první výstup dekodéru adres je připojen jednak na první vstupy prvního, druhého, třetího a pátého strádače informace, jednak na první vstupy jednosměrných budičů a jednak na první vstup generátoru signálu. Druhý až pátý výstup STB dekodéru adres je připojen na jednotlivé druhé vstupy stradačů informace. Vstup adres, vstup I/OR a vstup I/OW dekodéru adres je připojen na první, druhý a třetí výstup mikropočítače. První výstup prvního stradače informace je připojen na vstup CO,Cl řadiče a druhý výstup prvního stradače informace a první výstup druhého stradače informace jsou připojeny na vstup adresy řadiče. První výstup třetího střadače informace je připojen jednak na druhý vstup jednosměrného prvního budiče a jednak na druhou svorku data řadiče. První výstup čtvrtého střadače je připojen jednak na druhý vstup jednosměrného budiče a jednak na první

266 687 svorku data řadiče. První výstupy prvého a druhého jednosměrného budiče jsou připojeny jednak na třetí vstupy prvého až čtvrtého střadače informace a jednak na druhou svorku data mikropočítače. První vstup mikropočítače je připojen na výstup INT obvodu logického součtu, jehož první vstup je připojen na první výstup generátoru signálu, druhý až čtvrtý výstup generátoru signálu je připojen jednotlivě na vstup MSYN, svorku SSYN a svorku BBSY řadiče. Dále je čtvrtý výstup generátoru signálu připojen na první vstup arbitru, jehož druhý a třetí vstup je jednotlivě připojen na výstup BR a výstup INTR řadiče, při čemž vstup BG řadiče je připojen na druhý výstup arbitru.

Výhody zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A spočívají v jeho jednoduchosti, ekonomické nenáročnosti a komplexním využití pro případ jednoduchých školních měření, či použití systému jako záložního. Také nelze pominout, že zapojení podle vynálezu je z tuzemských součástek.

Vynález bude blíže popsán na příkladu provedení, znázorněného na připojených výkresech. Na obr.l je znázorněno blokové schema systému řízení za použití zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A podle vynálezu a na obr.2 je znázorněno vlastní blokové schema zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A.

První výstup dekodéru 2 adres je připojen jednak na první vstupy střadačů informace, jednak na první vstupy jednosměrných budičů ^a jednak na první vstup generátoru 8 signálu. Druhý až pátý výstup STB dekodéru 2 adres je připojen na jednotlivé druhé vstupy prvého až čtvrtého střadače informace, přitom vstup adres, vstup I/OR a vstup I/OW dekodéru 2 adres je připojen na první, druhý a třetí výstup mikropočítače. První výstup prvního střadače 2 informace je připojen na vstup C 0, Cl řadiče, druhý výstup prvního střadače 2 informace a první výstup druhého střadače 2 informace jsou připojeny na vstup adresy řadiče . První výstup třetího střadače 2 informace je připojen jednak na druhý vstup prvního jednosměrného budiče 4 ^a jednak na druhou svorku data řadiče. První výstup čtvrtého střadače 2 informace je připojen jednak na druhý vstup druhého jednosměrného budiče 6

266 687 a jednak na první svorku data řadiče. První výstupy prvého a druhého jednosměrného budiče £,£ jsou připojeny jednak na třetí vstupy prvého a čtvrtého střadače £,£,£,£ informace a jednak na druhou svorku data mikropočítače, přičemž první vstup mikropočítače je přpojen na výstup INT obvodu 10 logického součtu, jehož první vstup je připojen na první výstup generátoru £ signálu. Druhý, třetí a čtvrtý výstup generátoru £ signálu je připojen jednotlivě na vstup MSYN, svorku SSYN a svorku BBSY řadiče a dále je čtvrtý výstup generátoru £ signálu připojen na první vstup arbitru £, jehož druhý a třetí vstup je připojen jednotlivě na výstup BR a výstup INTR řadiče, přičemž vstup BG řadiče je připojen na druhý výstup arbitru £.

Na obr.l jsou jednotlivé jednotky 11 systému CAMAC připojeny na vstupy řadiče 12, jehož výstup je přes blok 14 řízení, který je předmětem vynálezu, připojen k mikropočítači 15 na bázi mikroprocesoru 8080A.

V konkrétním případě zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A bylo použito mikropočítače tuzemské výroby typu PMD 85 a připojení na jeho aplikační konektor. Jako řadič byl použit tuzemský typ Tesla NL . 2106. Adresové a datové signály řadiče jsou po osmibitové datové sběrnici mikropočítače přivedeny do zapojení podle vynálezu, přičemž rozlišení, zda se jedná o adresy či data, vstup nebo výstup, se provádí dekódováním signálů adresové sběrnice mikropočítače v dekodéru £ adres. Protože adresová a datová sběrnice řadiče NL 2106 jsou více než osmibitové, je nutno adresy i data řadiče skládat ze dvou osmibitových polovin, což je také řízeno dekodérem £ adres. Místo dvou bitů nižší poloviny adres jsou přenášeny kontrolní signály CO,Cl, udávající o jaký typ přenosu půjde. Z dekodéru £ jsou také odvozeny signály BB5Y (bus busy) a MSYN (mas.ter synchronization), pomocí kterých je řízen řadič. Signál SSYN (slave synchronization) je na vstup zapojení podle vynálezu přiváděn a pak slouží ke generaci výstupního signáli INT obvodu 10 logického součtu, nebo je na výstupu zapojení podle vynálezu, a to když přenáší přerušovací

266 687

- 4 vektor. Ke zpracování žádosti o přerušení řízení slouží vstup INTR (interrupt request) arbitru 2, který zpracovává žádosti od až čtyř rámů o různé prioritě, po jejichž vyhodnocení vysílá příslušný signál BG (bus granted) vybranému rámu. Žádost o přerušení z určitého rámu je prováděna vstupem BR (bus request) arbitru 2· Osmibitové stradače 2,2,2,2 informace jsou připojeny prvními vstupy k řadiči NL 2106 signálem OE (output enable) z výstupu dekodéru 7 adres. Obvod 10 logického součtu ovládá přerušovací systém mikropočítače. Osmibitové jednosměrné budiče 2,2 mají prvé vstupy připojeny k řadiči NL 2106 signálem OE z dekodéru 2 adres.

Zapojení podle vynálezu je možno použít v počítačové technice při nahrazování větších počítačů mikropočítačem na bázi, mikroprocesoru 8080A pro řízení systémů CAMAC, obzvláště pro školní úlohy nebo jako záložní prostředek.

Claims

PŘEDMĚT . VYNÁLEZU 266 687

Zapojení pro řízení systému CAMAC mikropočítačem na bázi mikroprocesoru 8080A;vyznačující se tím, že první výstup dekodéru (7) adres je připojen jednak na první vstupy prvého, druhého,třetího a čtvrtého střadače (1,2,3,5) informace, jednak na první vstupy prvého a druhého jednosměrného budiče (4,6) a jednak na první vstup generátoru (8) signálu, přičemž druhý až pátý výstup (STB) dekodéru (7) adres je připojen na jednotlivé druhé vstupy prvého, druhého, třetího a čtvrtého střadače (1,2,3,5) informace, vstup adres, vstup (I/OR) a vstup (I/OW) dekodéru (7) adres je připojen na první, druhý a třetí výstup mikropočítače, dále první výstup prvního střadače (1) informace je připojen na vstup (CO,Cl) řadiče, druhý výstup prvního střadače (1) informace a první výstup druhého střadače (2) informace jsou připojeny na vstup adresy řadiče, první výstup třetího střadače (3) informace je připojen jednak na druhý vstup prvního jednosměrného budiče (4) a jednak na druhou svorku data řadiče, první výstup čtvrtého střadače (5) informace je připojen jednak na druhý vstup druhého jednosměrného budiče (6) a jednak na první svorku data řadiče, dále první výstupy prvého a druhého jednosměrného budiče (4,6) jsou připojeny jednak na třetí vstupy prvého, druhého, třetího a čtvrtého střadače (1,2,3,5) informace a jednak na druhou svorku data mikropočítače, přičemž první vstup mikropočítače je připojen na výstup (INT) obvodu (10) logického součtu, jehož první vstup je připojen na první výstup generátoru (8) signálu, druhý, třetí a čtvrtý výstup generátoru (8) signálu je připojen jednotlivě na vstup (MSYN), svorku (SSYN) a svorku (BBSY) řadiče a dále je čtvrtý výstup nerátoru (8) signálu připojen na vstup arbitru (9), jehož druhý a třetí vstup je připojen jednotlivě na výstup (BR) a výstup (INTR) řadiče, přičemž vstup (BG) řadiče je připojen na druhý výstup arbitru (9).