CS212194B1 - Zapojení vyrovnávací paměti - Google Patents

Abstract

Vynález se týká regulační a řídicí techniky a řeší zapojení vyrovnávací paměti signálů přicházejících z telemechanizačního zařízení do počítače. Signály přicházejí z telemechanizačního zařízení bit po bitu, přicházejí do zápisového a čtecího logického bloku, který rozhodne, do které ze dvou dílčích pamětí še budou ukládat. Na žádost z počítače vydá zápisový a čtecí logický blok pokyn k převední obsahu jedné z dílcích pamětí do počítače jediným stykem. Informace ze čtené dílci paměti jdou přes zápisový a čtecí blok do linkového vysílače-přijímače, kde se přetransformují z TTL úrovně na proudový signál a předávají se do počítače.

Description

Vynález se týká zapojení vyrovnávací paměti signálů, přenášených z telemechanizačního zařízení do počítače.

Při zpracování velkého množství signálů, které se přenášejí ze vzdálených ®íst z telemechanizaěního zařízení do počítače, například při řízení dopravy, ovládání vodáren, plynáren, elektrických měníren, produktovodů a podobně, se tento přenos provádí buá na výzvu minipočítače, nebo v automatickém cyklu.

Při přenosů signálů na výzvu počítače hrozí nebezpečí, že o některých změnách přenášených signálů nebude počítač informován, protože se sledovaný signál změnil mezi dvěma po sobě následujícími výzvami počítače zpět k původní hodnotě. Pokud k této situaci dojde, může počítač dodat chybné rozhodnutí, které je nežádoucí. Tento nedostatek odstraňuje přenos informací v automatickém cyklu. Při tomto přenosu se informace trvale snímají a v sériovém kódu se přenášejí do počítače.

Nedostatkem tohoto přenosu je, že probíhá relativně pomalu, řádově v jednotkách až desítkách bitů za sekundu a v některých případech neumožňuje řízení v reálném čase, protože počítač musí čekat,až dojdou všechny požadované informace, což je několik set bitů a teprve potom je může zpracovat. Dalším nedostatkem při tomto přenosu je, že je počítač při zpracování informace rušen neustálým nabízením dalších došlých bitů, které musí odebrat což zabírá velké množství drahého strojového času. Toto uspořádání proto také neumožňuje řídit z časových důvodů větší počet telemechanizačníoh zařízeni.

Proto se hledají cesty, které by zvýšily kapacitu zpracování. Jednu z možností předsta vuje zapojení vyrovnávací paměti signálů, přenášených z telemechanizačního zařízení do počítače, u něhož je druhý skupinový výstup linkového vysílače-přijímače spojen se skupinovým výstupem zapojení, jehož třetí skupinový vstup je spojen se druhým skupinovým vstupem linkového vysílače-přijímače, jehož druhý obousměrný skupinový vývod je spojen s druhým skupinovým obousměrným vývodem zapojení, podle vynálezu, jehož podstata spočívó v tom, že první skupinový vstup zapojení je spojen s prvním skupinovým vstupem zápisového a čtecího logického bloku, jehož druhý skupinový vstup je spojen se druhým skupinovým vstupem •zapojení.

První obousměrný skupinový vývod zapojení je spojen s prvním obousměrným skupinovým vývodem zápisového a čtecího logického bloku, jehož druhý obousměrný skupinový vývod je spojen s obousměrným skupinovým vývodem první dílčí paměti. Její skupinový vstup je spojen s prvním skupinovým výstupem zápisového a čtecího logického bloku, jehož druhý skupinový výstup je spojen se skupinovým vstupem druhé dílčí paměti.

Její obousměrný skupinový vývod je spojen se třetím obousměrným skupinovým vývodem zápisového a čtecího logického bloku, jehož čtvrtý obousměrný skupinový vývod je spojen s prvním obousměrným skupinovým vývodem linkového vysílače-přijímače. Jeho první skupinový výstup je spojen se třetím skupinovým vstupem zápisového a čtecího logického bloku,, jehož třetí skupinový výstup je spojen s.prvním skupinovým vstupem linkového vysílače-přijímače .

Výhodou uspořádání podle vynálezu je, že pomalu přenášené informace z telemechanizačního zařízení bit po bitu ukládá do vyrovnávací paměti a po shromáždění všech potřebných informací přenáší tyto vysokou rychlostí do minipočítače jedním stykem. Tím se značně sníží nároky na drahý strojní čas počítače a zároveň nemůže dojít ke ztrátě žádného bitu z pře nášené informace. Ušetřený strojový Čas počítače umožní připojení většího množství telemechanizačního zařízení a tím i zpracování většího množství informací.

Příklad zapojení vyrovnávací paměti signálů předávaných z telemechanizačních zařízení do počítače je znázorněn v blokovém schématu na připojeném výkrese.

Jednotlivá bloky zapojení možno charakterizovat takto. První dílčí vyrovnávací paměť X i druhé dílčí vyrovnávací paměť 2 je polovodičová paměť, sestavená z polovodičových integΓον/ζΜ¹ obvodů,typu RAM, kapacitně organizované do r-slov po s-biteoh, kde r může nabývat hodnoty až 32 el?^{v a} £ může nabývat nóůiiCt; SŽ 22 bitů. Obě dílčí psměti umožňují určení adresy bu5 z počítače, nebo ze zápisového a čtecího logického bloku 3. Pracují atřídsvě v režimu zápis” a čtení a slouží k uchování informaci přicházejících z telemechanizačního zařízení. V dílčích pamětích X, 2 se postupně shromažduji informace přicházející z telemechanizačního zařízení, které se potom jedním stykem přenéěejí do počítače.

Zápisový a čtecí logický blok 3 j® sestaven z polovodičových integrovaných obvodů a slouží jako řídicí jednotka zapojení. Obstarává střídání režimů zápis a čtení, uvolňuje obě dílčí pamětí X, 2 k žepisa nebo čtení, určuje adresu dílčí paměti, do níž se má zapsat informace, uvolňuje čtení přijímaného slova a generuje všechny signály potřebné pro styk s telemechanizačním zařízením a s počítačem.

Linkový vysílač-přijímač £ je sestaven z polovodičových integrovaných obvodů a v návaznosti na obvody styku spolupracujícího počítače zajišťuje přenos ve formě slov mezi počítačem a zápisovým a čtecím logickým blokem £. Přijímané proudové signály z počítače přetrensformuje na signály napěťové úrovně TTL a informace, které se vysílají k počítači přetransformuje z úrovně TTL na proudové signály.

Jednotlivé bloky jsou zapojeny tak, že první skupinový vstup 51 zapojení, sloužící pro vstup dat, je spojen s prvním skupinovým vstupem 31 zápisového a čtecího logického bloku 3· Druhý skupinový vstup 52 zapojení, který je určen pro vstup stavového slova, je spojen s druhým skupinovým vstupem 32 zápisového a čtecího logického bloku 3· První obousměrný skupinový vývod 71 zapojení je spojen s prvním obousměrným skupinovým vývodem 33 zápisového a čtecího logického bloku 3·

Druhý obousměrný skupinový vývod 35 zápisového a čtecího logického bloku 3> který je určen pro obousměrný průchod dat, je spojen s obusměrným skupinovým vývodem 12 první dílčí paměti χ. První skupinový výstup 30 zápisového a čtecího logického bloku 3> P° kterém se uskutečňuje adresování, je spojen se skupinovým vstupem 11 první dílčí paměti χ. Druhý skupinový výstup 38 zápisového a čtecího logického bloku 3i P° kterém se rovněž uskutečňuje adresování, je spojen se skupinovým vstupem 21 druhé dílčí paměti 2.

Třetí obousměrný skupinový vývod 36 zápisového a čtecího logického bloku 3> který je určen pro přenos v obou směrech, je spojen s obousměrným skupinovým vývodem 22 druhé dílčí paměti 2. Čtvrtý obousměrný skupinový vývod 37 zápisového a čtecího logického bloku 3 3® spojen s prvním obousměrným skupinovým vývodem 44 linkového vysílače-přijímače £. Třetí skupinový výstup 39 zápisového a čtecího logického bloku 3, sloužící pro přenos dat k počítači, je spojen s prvním skupinovým vstupem 41 linkového vysílače-přijímače £.

První skupinový výstup 45 linkového vysílače-přijímače £, který slouží pro adresování z počítače, je spojen se třetím skupinovým vstupem 34 linkového a čtecího logického bloku 3· Druhý skupinový výstup 46 linkového vysílače-přijímače £, který slouží pro přenos dat do počítače, je spojen se skupinovým výstupem 61 zapojení. Druhý skupinový vstup 42 linkového vysílače-přijímače £, po kterém jsou adresy z počítače, je spojen se třetím skupinovým vstupem 53 zapojení. Druhý obousměrný skupinový vývod 43 linkového vysílače-přijímače £ je spojen se druhým obousměrným skupinovým vývodem 72 zapojení.

Zapojení praouje takto. Signál nesoucí stavovou informaci přichází z telemechanizačního zařízení, které není na výkresech znázorněno, na první skupinový vstup 51 zapojení a odtud na první skupinový vstup 31 zápisového a čtecího logického bloku 3· Podle toho, které dílčí paměť je volné, rozhodne zápisový a Čtecí logický blok 3 ⁰ tom, do které dílčí paměti se bude zápis provádět. Při zápisu do první dílčí paměti X se zápis uskuteční přes první skupinový výstup 30 zápisového a čtecího logického bloku 3 ^ns skupinový vstup XX první dílčí paměti χ.

V případě, že se zapisuje do druhé dílěí paměti 2, potom se zépis uskuteční přes druhý skupinový-výstup 38 zápisového a čtecího logického bloku £ na skupinový vstup 2 i druhé dílčí paměti 2. Na žádost z počítače, který není na výkresech znázorněn, se do počítače přenášejí informace uložené v první dílčí paměti J a ve druhé dílčí paměti 2. Žádost z počítače přichází jednak na třetí skupinový vstup 53 zapojeni a odtud na druhý skupinový vstup 42 linkového vysílače-přijímače £, kde je adresa žádané informace. Řídicí signál přichází z počítače na druhý obousměrný skupinový vývod 72 zapojení a odtud na druhý obousměrný skupinový vývod 43 linkového vysílače-přijímače £. V linkovém vysílači-přijímači £ se signály transformují do úrovní TTL a předávají se přes první skupinový výstup 45 linkového vysílače-přijímače £ na třetí skupinový vstup 34 zápisového a čtecího logického bloku £ a zároveň z prvního obousměrného skupinového vývodu 44 linkového vysílače-přijímače £ na čtvrtý obousměrný vývod 37 zápisového a čtecího logického bloku £.

Zápisový a čtecí logický blok £ rozhodne, ze které ze dvou dílčích pamětí J, 2 se bude žádaná informace vybírat. Podle toho, ze které dílčí paměti J, 2 se bude žádané informace vybírat, vyšle zápisový a čtecí logický blok £ příslušné řídicí a adresové signály buS přes svůj druhý obousměrný skupinový vývod 35 a na obousměrný skupinový vývod 12 dílčí paměti J, nebo přes svůj třetí obousměrný skupinový vývod 36 zápisového a čtecího logického bloku £ na obousměrný skupinový vývod 22 druhé dílčí paměti 2.

Zvolené dílčí paměl J, 2 požadovanou informaci vybaví. Ze druhé dílčí paměti 2jde potom žádané informace přes jeji obousměrný skupinový vývod 22 na třetí obousměrný skupinový vývod 36 zápisového a čtecího logického bloku £. Z první dílčí paměti J jde žádaná informace přes její obousměrný skupinový vývod 12 na druhý obousměrný skupinový vývod 35 zápisového a čtecího logického bloku £.

Zápisový a čtecí logický blok £ žádanou informaci předá přes svůj třetí skupinový výstup 39 na první skupinový vstup 41 linkového vysílače-přijímače £. V linkovém vysílači-přijímači £ se žádané informace přetransformuje z TTL úrovně na proudový signál a předá se přes jeho druhý skupinový výstup 46 na skupinový výstup 61 zapojení. Současně s převedením požadované informace oznámí zápisový a čtecí logický blok £ počítači, že je informace připravena.

Oznámení předává zápisový a čtecí logický blok £ přes svůj čtvrtý obousměrný skupinový vývod 37 na první obousměrný skupinový vývod 44 linkového vysílače-přijímače £ a odtud přes jeho druhý obousměrný skupinový vývod 43 na druhý obousměrný skupinový vývod 72 zapojení. První obousměrný skupinový vývod 33 zápisového a čtecího logického bloku £ řídl přes první obousměrný skupinový vývod 71 zapojení přenos informací z telemechanizačního zařízení, které není na výkrese znázorněno, do zápisového a čtecího logického bloku £.

Vynálezu se využije při přenosu dat z telemechanizačního zařízení do počítače při řízení dopravy, vodáren, plynáren, elektrických měníren.

Claims (1)

1. PŘEDMĚT VYNÁLEZU

   Zapojení vyrovnávací paměti signálů z telemechanizačního zařízeni, u něhož je druhý skupinový výstup linkového vysílače-přijímače spojen se skupinovým výstupem zapojení, třetí skupinový vstup je spojen se druhým skupinovým vstupem linkového vysílače-přijímače, jehož druhý obousměrný skupinový vývod je spojen s druhým skupinovým obousměrným vývodem zapojení, vyznačující se tím, že první skupinový vstup (51) zapojení je spojen s prvním skupinovým vstupem (31) zápisového a čtecího logického bloku (3), jehož druhý skupinový vstup (32) je spojen se druhým skupinovým vstupem (52) zapojeni, jehož první obousměrný skupinový vývod (71) je spojen s prvním obousměrným skupinovým vývodem (33) zápisového a čtecího logického bloku (3), jehož druhý obousměrný skupinový vývod (35) je spojen s obousměrným skupinovým vývodem (12) první dílčí paměti (1), jejíž skupinový vstup (11) je spojen s prvním skupinovým výstupem (30) zápisového a čtecího logického bloku (3), jehož druhý skupinový výstup (38) je spojen se skupinovým vstupem (21) druhé dílčí paměti (2), jejíž obousměrný skupinový vývod (22) je spojen s třetím obousmérným skupinovým vývodem (36) zápisového a čtecího logického bloku (3), jehož čtvrtý skupinový obousměrný vývod (37) je spojen s prvním obousmérným skupinovým vývodem (44) linkového vysílače-přljlmače (4), jehož první skupinový výstup (45) je spojen s třetím skupinovým vstupem (34) zápisového a čtecího logického bloku (3), jehož třetí skupinový výstup (39) je spojen s prvním skupinovým vstupem (41) linkového vysíláče-přijímače (4).