CS210197B1 - Zapojení obvodů pro inversní zobrazování znaků - Google Patents

Abstract

Vynález se týká oboru výpočetní techniky, zejména zobrazování znaků na výstupních zařízeních počítače, zejména obrazovkového displeje a řádkově bodové tiskárny. Vynález řeší vytváření normálního a inversního zobrazování znaků, kdy kod znaku je před zápisem do pamšti dekódován, přičemž je podle výsledků rozhodnulo, zda se kod znaku zaznamená do pamšti kódu znaků, nebo se užije k nastavení paměti inversního bitu. Podstatou vynálezu je vzájemné propojení paměti kódu znaku, rozšířené o další bit pamětí inversního zobrazení znaku s časovým zdrojem, pamětí dat, dekodérem dat, pamětí zápisu inversního bitu, pevnou paměti znaku, registrem zobrazeni, modulačním obvodem, vyrovnávací pamětí inversního bitu a paměti zobrazení inversního bitu. Vynálezu může být užito v oboru kancelářské techniky, zejména u sériových bodových tiskáren s řádkováním tiskací hlavice. Vynález charakterizuje předmět vynálezu a připojený výkres.

Description

Vynález se týká zapojení obvodů pro inversní zobrazování znaků, tvořených bodovou maticí, zejména pro obrazovkové displeje a řádkové tiskárny s bodovým tiskem.

Vizuální styk operátora a počítačem se děje nejčastěji prostřednictvím obrazovkového displeje nebo řádkové tiskárny. Pro zobrazování znaků se nejčastěji užívá zobrazení v takovém tvaru, že znak je složen z bodů, uspořádaných v bodové mozaice, přičemž množství bodů, tvořících mozaiku, přímo ovlivňuje čitelnost znaku. V oblasti obrazovkových displejů pro zobrazování abecedně číslicových znaků se užívá jasové modulace obrazovky, kdy body tvořící znak jsou zobrazovány jako svítící, ostatní body mozaikového pole jsou nesvítící, to znamená, že nejsou zobrazovány, Pro obrazovkové displeje s větším počtem zobrazovaných znaků se zpravidla zlepšuje orientace operátora zavedením tak zvaného inversního způsobu zobra zování znaků, kdy určitá část textu je, podle volby operátora, zobrazena v inversním tvaru, to znamená, že původně svítící body mozaiky, tvořící znak, jsou zobrazeny jako nesvítící, to je černé, zatímco zbývající body mozaikového pole znaku jsou zobrazeny jako svítící.

Znak je pak zobrazen ve tvaru tmavých bodů ve svítícím poli, což zlepšuje přehlednost zobra zených údajů na stínítku obrazovky.

Tento způsob zobrazování a vzájemná kombinace normálního a inversního tvaru klade zvýšené nároky na obvodovou techniku modulačních obvodů. Dosud užívané obvody pro inversní zobrazování znaků jsou značně složité, speciální, a tím i nákladné.

Zlepšení v obvodové technice modulačních obvodů, zjednodušení zapojení a zmenšení nákladů přináší zapojení obvodů pro inversní zobrazování znaků podle vynálezu, jehož podstata spočívá v tom, že vícenásobný vstup vstupních dat je připojen na první až osmý vstup paměti dat, přičemž na devátý vstup paměti je zapojena svorka zápisového signálu, zatímco první až osmý výstup paměti dat je připojen na první až osmý vstup dekodéru dat a současně na první až osmý vstup paměti kódu znaku, přičemž první a druhý výstup dekodéru je připojen na první a druhý vstup paměti zápisu inversního bitu, zatímco na třetí vstup této paměti zápisu je připojena svorka nulovacího signálu a na čtvrtý vstup paměti zápisu inversního bitu je připojen první výstup časového zdroje, přičemž první výstup paměti zápisu inversního bitu je připojen na první vstup paměti inversního zobrazení znaku, zatímco druhý výstup paměti, zápisu inversního bitu je připojen na první vstup časového zdroje, přičemž druhý a třetí vstup paměti inversního zobrazení znaku je připojen na druhý a třetí výstup časového zdroje, který je současně připojen na dvacátý první a dvacátý druhý vstup paměti kódu znaku, zatímco na čtvrtý až devátý vstup paměti inversního zobrazení znaku a současně na patnáctý až dvacátý vstup paměti kódu znaku je připojena první část sběrnice adresy, zatímco druhá, část sběrnice adresy je připojena na desátý až patnáctý vstup paměti inversního zobra zení znaku a současně na devátý až čtrnáctý vstup paměti kódu znaku, přičemž výstup paměti inversního zobrazení znaku je připojen na první vstup vyrovnávací paměti inversního bitu, přičemž na druhý vstup této paměti je připojen čtvrtý výstup časového zdroje, přičemž výstup vyrovnávací paměti inversního bitu je spojen s prvním vstupem paměti zobrazení inversního bitu, zatímco na druhý a třetí vstup paměti zobrazení inversního bitu je připojen pátý a šestý výstup časového zdroje, první a druhý výstup této paměti je spojen s prvním a druhým vstupem modulačního obvodu, přičemž třetí, čtvrtý, pátý, šestý a sedmý vstup modulačního obvodu je propojen se sedmým, osmým, devátým, desátým a jedenáctým výstupem časového zdroje, zatímco dvanáctý výstup^časového zdroje je spojen se šestým vstupem registru zobrazení, přičemž třináctý až patnáctý výstup časového zdroje je spojen s devátým až jedenáctým vstupem pevné paměti znaků, přičemž na první až osmý vstup této paměti je připojen první až osmý výstup paměti kódu znaku, zatímco první až pátý výstup pevné paměti znaků je připojen na první až pátý vstup registru zobrazení, přičemž výstup tohoto registru je připojen na devátý vstup modulačního obvodu, zatímco na osmý vstup tohoto obvodu je připojena svorka ovládacího signálu zobrazení, přičemž výstup modulačního obvodu je výstupem modulačního signálu.

Výhodou zapojení obvodů pro inversní zobrazování znaků podle vynálezu je především to, že pomocí několika obvodů lze rozšířit normální způsob zobrazeni znaků o další modifikaci způsobu zobrazení. Velkou výhodou je malý počet běžných logických integrovaných obvodů a jednotná organizace paměti displeje.

Příklad zapojení obvodů pro inversní zobrazování znaků je znázorněn na připojeném výkrese.

V uvedeném příkladě je znázorněna podstatná část obvodů pro inversní zobrazování znaků, obsahující paměť 01 dat, dekodér 02 dat, paměť 03 zápisu inversního bitu, paměť 04 inversního zobrazení znaků, paměť 05 kódu znaků, pevnou paměť 06 znaků, časový zdroj 07. registr 08 zobrazení, vyrovnávací paměť 09 inversního bitu, paměť 10 zobrazení inversního bitu a modulační obvod 13.

Vícenásobný vstup 20 vstupních dat je přiveden na první 111 až osmý 118 vstup paměti 01 dat, přičemž na devátý vstup 119 paměti 01 dat je svorka 21 «zápisového signálu, zatímco první 121 až osmý 128 výstup paměti 01 dat je připojen na první 211 až osmý 218 vstup dekodéru 02 dat a současně na první 511 až osmý 518 vstup paměti 05 kódu znaku, přičemž první 221 a druhý 222 výstup dekodéru 02 dat je připojen na první 311 a druhý 312 vstup paměti 03 zápisu inversního bitu, zatímco na třetí vstup 313 této paměti zápisu je připojen na svorku 22 nulovacího signálu a na čtvrtý vstup 314 paměti 03 zápisu inversního bitu je připojen první výstup 711 časového zdroje £2, přičemž první výstup 321 paměti 03 zápisu inversního bitu je připojen na první vstup 411 paměti 04 inversního zobrazení znaku.

Druhý výstup 322 paměti 03 zápisu inversního bitu je připojen na první vstup 731 časového zdroje 02, přičemž druhý 412 a třetí 413 vstup paměti 04 inversního zobrazení znaku je připojen na druhý 712 a třetí 713 výstup časového zdroje 07, který je současně připojen na dvacátý první 551 a dvacátý druhý 552 vstup paměti 05 kódu znaku, zatímco na čtvrtý 432 až devátý 436 vstup paměti 04 inversního zobrazení znaku a současně na patnáctý 531 až dvacátý 536 vstup paměti 0J5 kódu znaku je připojena první část 30 sběrnice adresy, zatímco druhá část 40 sběrnice adresy je připojena na desátý 441 až patnáctý 446 vstup paměti 04 inversního zobrazení znaku a současně na devátý 541 čtrnáctý 54Š vstup paměti 05 kódu znaku.

Výstup 421 paměti 04 inversního zobrazení znaku je připojen na první vstup 911 vyrovnávací paměti 08 inversního bitu, přičemž na druhý vstup 912 této paměti je připojen čtvrtý výstup 714 časového zdroje 02, přičemž výstup 921 vyrovnávací paměti 09 inversního bitu je spojen s prvním vstupem 101 paměti 10 zobrazení inversního bitu, přičemž na druhý 102 a třetí 1 °3 vstup paměti 10 zobrazení inversního bitu je připojen pátý 2.1.5 a Šestý 716 výstup časového zdroje 02, zatímco první 104 a druhý 105 výstup této paměti j_0 je spojen s prvním 131 a druhým 132 vstupem modulačního obvodu 13. přičemž třetí 133. čtvrtý 134, pátý 135. šestý 136 a sedmý J_J2 vstup modulačního 'obvodu J.J je propojen sedmým 717. osmým 718. devátým 212> desátým 222. a jedenáctým 721 výstupem časového zdroje 07.

Dvanáctý výstup 722 časového zdroje 07 je spojen se šestým vstupem 816 registru 08 zobrazení, přičemž třináctý 723 až patnáctý 225 výstup časového zdroje 07 je spojen s devátým 609 až jedenáctým 611 vstupem pevné paměti 06 znaků, přičemž na první 631 až osmý 638 vstup této pamětí je připojen první 521 až,osmý 528 výstup paměti 05 kódu znaku, zatímco první 621 až pátý 625 výstup pevné paměti 06 znaků je připojen na první 811 až pátý 815 vstup registru 08 zobrazení, přičemž výstup 821 tohoto registru je připojen na devátý vstup 139 modulačního obvodu 15, zatímco na osmý vstup 138 tohoto obvodu je připojena svorka 2J ovládacího signálu zobrazení, přičemž na výstupu 140 modulačního obvodu 13 se generuje modulační signál 50.

Činnost obvodu pro inversní zobrazení znaků je následující:

Vícenásobný vstup 20 vstupních dat je přiveden na vstupy 111 až 118 paměti 01 dat a přes svorku gl zápisového signálu, přivedeného z neznázoměné základní jednotky, jsou data přepsána do paměti 01 dat. Zapsaná data, představující zakódované znaky, jsou dekódována v dekodéru 02 dat. Neobjeví-li se v dekodéru 02 dat kód,znamenající počátek inversního zobrazení, jsou výstupní data z paměti 01 dat zaznamenávána do paměti 05 kódů znaků,a to do pamělové buňky, která je určena první 30 a druhou 40 částí adresy.

Objeví-li se kód, znamenající počátek inversního zobrazení, není tento kód znaku zaznamenán do paměti 05 kódu znaků, ale je zaznamenán jeho výskyt v paměti 03 zápisu inversního bitu a od určité adresy je zaznamenáván i do paměti 04 inversního zobrazení znaku.

Ukončení inversně zobrazovaných znaků je dáno vysláním kódu znaku, znamenajícího přechod na normální zobrazení.

Při čtení kódu znaku z paměti 0£ kódu znaků je výstup této paměti přiveden na vstupy 631 až 638 pevné paměti 06 znaků, přičemž na další vstupy 639 až 641 je přiveden další časový údaj o zobrazovaném řádku z časového zdroje 07.

Výstupy 621 až 625 pevné paměti 06 znaků jsou přivedeny na vstupy 811 až 815 registru 08 zobrazení, časovány z dvanáctého výstupu 722 časového zdroje 07 a vysílány v sériovém tvaru na výstupu 821 registru 08 zobrazení a přiváděny na devátý vstup 139 modulačního obvodu ii.

Souběžně s adresováním 30. 40 paměti 05 kódu znaků je adresována i pamět 04 inversního zobrazeni znaku, její výstup 421 je periodicky přepisován do vyrovnávací paměti 09 inversního bitu a s definovaným časovým zpožděním přehráván do paměti 10 zobrazení inversního bitu, jehož výstupy 104 a 105 určují, zda zobrazovaný znak bude ve tvaru normálním nebo inversním.

Z časového zdroje 07 jsou přiváděny časové průběhy určující dobu zobrazení textového řádku, dobu zobrazení snímku, dobu zobrazení horního a dolního řádku rastru při inversním zobrazení. Ze svorky 23 ovládacího signálu zobrazení tento signál přiváděný ze základní jednotky na osmý vstup 138 modulačního obvodu 13 určuje, zda zobrazovací jednotka je v činnosti a zobrazuje příslušný text, nebo obrazovka je zatemněna a pro obsluhu zařízení není zdánlivě v činnosti.

Obdobného obvodu pro inversní zobrazování znaků, jak je na výkrese, lze použít například v oboru tiskáren, kde je užíváno řádkovaoí tiskací bodové hlavy. Příkladem může být sériová bodová tiskárna s tiskem na teplotně citlivý papír.

Příklad zapojení obvodů pro inversní zobrazování znaků podle výkresu platí pro znázornění znaků, které jsou sestaveny v bodové mozaice 5x7 bodů. Uvedené zapojení lze rozšířit' podle potřeby i pro jiné rozměry mozaikového pole základního znaku.

Claims (1)

1. PŘEDMĚT VYNÁLEZU

   Zapojení obvodů pro Inversní zobrazování znaků, sestavené z paměti kódu znaků, pevné paměti znaků, posuvného registru a časového zdroje, vyznačené tím, že vícenásobný vstup (20) vstupních dat je připojen na první (111) až osmý (118) vstup paměti (01) dat, přičemž na devátý vstup (119) paměti (01) dat je zapojena svorka (21) zápisového signálu, zatímco první (121) až osmý (128) výstup paměti (01) dat je připojen na první (211) až osmý (218) vstup dekodéru (02) dat a současně na první (511) až osmý (518) vstup paměti (05) kódu znaku, přičemž první (221) a druhý (222) výstup dekodéru (02) dat je připojen na první (311) a druhý (312) vstup paměti (03) zápisu inversního bitu, zatímco na třetí vstup (313) paměti (03) zápisu je připojena svorka (23) nulovacího signálu a na čtvrtý vstup (314) paměti (03) zápisu inversního bitu je připojen první výstup (711) časového zdroje (07), přičemž první výstup (321) paměti (03) zápisu inversního bitu je připojen na první vstup (411) paměti (04) inversního zobrazení znaku, zatímco druhý výstup (322) paměti (03) zápisu inversního bitu je připojen na první vstup (731) časového zdroje (07), přičemž druhý (412) a třetí (413) vstup paměti (04) inversního zobrazení znaku je připojen na druhý (712) a třetí (713) výstup časového zdroje (07), který je současně připojen na dvacátý první (551) a dvacátý druhý (552) vstup paměti (05) kódu znaku, zatímco na čtvrtý (431) až devátý (436) vstup paměti (04)' inversního zobrazení znaku a současně na patnáctý (531) až dvacátý (536) vstup paměti (05) kódu znaku je připojena první část (30) sběrnice adresy, zatímco druhá část (40) sběrnice adresy je připojena na desátý (441) až patnáctý (446) vstup paměti (04) inversního zobrazení znaku a současně na devátý (541) až čtrnáctý (546) vstup paměti (05) kódu znaku, přičemž výstup (421) paměti (04) inversního zobrazení znaku je připojen na první vstup (911) vyrovnávací paměti (09) inversního bitu, přičemž na druhý vstup (912) této paměti je připojen Čtvrtý výstup (714) časového zdroje (07), přičemž výstup (921) vyrovnávací paměti (09) inversního bitu je spojen s prvním vstupem (101) paměti (10) zobrazení inversního bitu, zatímco na druhý (102) a třetí (103) vstup paměti (10) zobrazení inversního bitu je připojen pátý (715) a Šestý (716) výstup časového zdroje (07), první (104) a druhý (105) výstup této paměti (10) je spojen s prvním (131) a druhým (132) vstupem modulačního obvodu (13), přičemž třetí (133), čtvrtý (134), pátý (135), šestý (136) a sedmý (137) vstup modulačního obvodu (13) je propojen se sedmým (717), osmým (718), devátým (719), desátým (720) a jedenáctým (721) výstupem časového zdroje (07), zatímco dvanáctý výstup (722) časového zdroje (07) je spojen se šestým vstupem (816) registru (08) zobrazení, přičemž třináctý (723) až patnáctý (725) výstup časového zdroje (07) je spojen s devátým (609) až jedenáctým (611) vstupem pevné paměti (06) znaků, přičemž na první (631) až osmý (638) vstup této paměti je připojen první (521) až osmý (528) výstup paměti (05) kódu znaku, zatímco první (621) až pátý (625) výstup pevné paměti (06) znaků je připojen na první (811) až pátý (815) vstup registru (08) zobrazeni, přičemž výstup (821) tohoto registru je připojen na devátý vstup (139) modulačního obvodu (13), zatímco na osmý vstup (138) tohoto obvodu je připojena svorka (23) ovládacího signálu zobrazení, přičemž výstup (140) modulačního obvodu (13) je výstupem modulačního signálu.