CN210405270U

CN210405270U - 多级驱动数据传输电路

Info

Publication number: CN210405270U
Application number: CN201921381434.5U
Authority: CN
Inventors: 冀康灵
Original assignee: Changxin Memory Technologies Inc
Current assignee: Changxin Memory Technologies Inc
Priority date: 2019-08-23
Filing date: 2019-08-23
Publication date: 2020-04-24
Anticipated expiration: 2029-08-23

Abstract

本实用新型公开一种多级驱动数据传输电路。该多级驱动数据传输电路，包括：第一驱动模块与第二驱动模块；其中，第一驱动模块包括：第一信号产生单元及第一三态驱动器；第二驱动模块包括：第二三态驱动器；第二三态驱动器的第一输入端与第一三态驱动器的输出端耦接；第一信号产生单元包括：第一输入端、第二输入端及输出端；第一信号产生单元的输出端与第一三态驱动器的第二输入端耦接；第一信号产生单元用于通过其第一输入端接收第一信号，通过其第二输入端接收来自第二驱动模块的、第一信号的第一反馈信号，根据第一信号及第一反馈信号，产生有效信号宽度宽于第一信号的第一控制信号，并向第一三态驱动器提供第一控制信号。

Description

多级驱动数据传输电路

技术领域

本实用新型涉及三态驱动总线传输技术，具体而言，涉及一种多级驱动数据传输电路。

背景技术

在半导体集成电路中，将三态驱动器连接在总线上，使用三态驱动器来驱动总线传输是很常用的技术。

三态驱动器的三态输出受到控制信号的控制，当控制信号有效时，器件实现正常逻辑状态输出，即将输入的数据直接送到输出端；当控制信号无效时，输出处于高阻状态，即等效于与所连的电路断开。

但由于不同的制程、电压、温度的变化，三态驱动器的控制信号可能会发生比较大的变化，导致输出驱动时间过短，输出信号不完整，或者导致连续的不同节拍的数据发生混乱。

在所述背景技术部分公开的上述信息仅用于加强对本实用新型的背景的理解，因此它可以包括不构成对本领域普通技术人员已知的现有技术的信息。

发明内容

有鉴于此，本实用新型提供一种多级驱动数据传输电路。

本实用新型的其他特性和优点将通过下面的详细描述变得显然，或部分地通过本实用新型的实践而习得。

根据本实用新型的一方面，提供一种多级驱动数据传输电路，包括：第一驱动模块与第二驱动模块；其中，第一驱动模块包括：第一信号产生单元及第一三态驱动器；第二驱动模块包括：第二三态驱动器；第二三态驱动器的第一输入端与第一三态驱动器的输出端耦接；第一信号产生单元包括：第一输入端、第二输入端及输出端；第一信号产生单元的输出端与第一三态驱动器的第二输入端耦接；第一信号产生单元用于通过其第一输入端接收第一信号，通过其第二输入端接收来自第二驱动模块的、第一信号的第一反馈信号，根据第一信号及第一反馈信号，产生有效信号宽度宽于第一信号的第一控制信号，并向第一三态驱动器提供第一控制信号。

根据本实用新型的一实施方式，所述第一信号产生单元包括：第一RS锁存器，所述第一信号产生单元的第一输入端为所述第一RS锁存器的设置端，所述第一信号产生单元的第二输入端为所述第一RS锁存器的重置端，所述第一信号产生单元的输出端为所述第一RS锁存器的第一输出端。

根据本实用新型的一实施方式，所述第一信号产生单元包括：第一D触发器，所述第一信号产生单元的第一输入端为所述第一D触发器的时钟输入端，所述第一信号产生单元的第二输入端为所述第一D触发器的重置端，所述第一信号产生单元的输出端为所述第一D触发器的输出端。

根据本实用新型的一实施方式，所述第二驱动模块还包括：信号整形单元，包括：输入端和输出端；所述信号整形单元用于通过其输入端接收所述第一信号，对所述第一信号进行整形，产生并通过其输出端输出所述第一反馈信号。

根据本实用新型的一实施方式，所述信号整形单元包括：偶数个相互串接的第一反相器。

根据本实用新型的一实施方式，所述第一驱动模块还包括：脉冲信号产生单元，包括：输入端和输出端，通过其输出端与所述第一信号产生单元的第一输入端耦接，用于接收所述第一信号，根据所述第一信号的上升沿，产生脉冲信号，并通过所述第一信号产生单元的第一输入端向所述第一信号产生单元提供所述脉冲信号。

根据本实用新型的一实施方式，所述脉冲信号产生单元包括：奇数级门电路、与非门及第二反相器；其中，所述奇数级门电路通过其输入端接收所述第一信号；所述与非门通过其第一输入端接收所述第一信号，通过其第二输入端与所述奇数级门电路的输出端耦接，接收所述奇数级门电路的输出信号，通过其输出端与所述第二反相器的输入端耦接；所述第二反相器的输出端与所述第一信号产生单元的第一输入端耦接。

根据本实用新型的一实施方式，还包括：第三驱动模块，包括：第三三态驱动器；所述第三三态驱动器的第一输入端与所述第二三态驱动器的输出端耦接；所述第二驱动模块还包括：第二信号产生单元；所述第二信号产生单元包括：第一输入端、第二输入端及输出端；所述第二信号产生单元的输出端与所述第二三态驱动器的第二输入端耦接；所述第二信号产生单元用于通过其第一输入端接收所述第一信号，通过其第二输入端接收来自所述第三驱动模块的、所述第一信号的第二反馈信号，根据所述第一信号及所述第二反馈信号，产生有效信号宽度宽于所述第一信号的第二控制信号，并向所述第二三态驱动器提供所述第二控制信号。

根据本实用新型的一实施方式，所述第二信号产生单元包括：第二RS锁存器，所述第二信号产生单元的第一输入端为所述第二RS锁存器的设置端，所述第二信号产生单元的第二输入端为所述第二RS锁存器的重置端，所述第二信号产生单元的输出端为所述第二RS锁存器的第一输出端。

根据本实用新型的一实施方式，所述第二信号产生单元为第二D触发器，所述第二信号产生单元的第一输入端包括：所述第二D触发器的时钟输入端，所述第二信号产生单元的第二输入端为所述第二D触发器的重置端，所述第二信号产生单元的输出端为所述第二D触发器的输出端。

根据本实用新型的多级驱动数据传输电路及多级驱动数据传输方法，可以对输入到三态驱动器的控制信号进行处理，将原控制信号送至下一级驱动模块后，再反馈回本级的驱动模块。由于反馈路径的存在，可以根据反馈回来的控制信号与原控制信号，产生有效信号宽度宽于原控制信号的新的控制信号，从而避免因控制信号有效时间不足而导致无法将数据完整传输到下一级驱动模块中的问题。

应当理解的是，以上的一般描述和后文的细节描述仅是示例性的，并不能限制本实用新型。

附图说明

通过参照附图详细描述其示例实施例，本实用新型的上述和其它目标、特征及优点将变得更加显而易见。

图1是根据一示例性实施方式示出的一种多级驱动数据传输电路的框图。

图2是根据一示例性实施例示出的第一信号产生单元101的示意图。

图3是根据一示例性实施例示出的第二信号产生单元201的示意图。

图4是根据一示例实施例示出的一种脉冲信号产生单元的框图。

图5是根据一示例性实施方式示出的一种多级驱动数据传输方法的流程图。

图6是根据一示例示出的信号时序示意图。

图7是根据一示例性实施例示出的另一种第一信号产生单元101的示意图。

具体实施方式

现在将参考附图更全面地描述示例实施方式。然而，示例实施方式能够以多种形式实施，且不应被理解为限于在此阐述的范例；相反，提供这些实施方式使得本实用新型将更加全面和完整，并将示例实施方式的构思全面地传达给本领域的技术人员。附图仅为本实用新型的示意性图解，并非一定是按比例绘制。图中相同的附图标记表示相同或类似的部分，因而将省略对它们的重复描述。

此外，所描述的特征、结构或特性可以以任何合适的方式结合在一个或更多实施方式中。在下面的描述中，提供许多具体细节从而给出对本实用新型的实施方式的充分理解。然而，本领域技术人员将意识到，可以实践本实用新型的技术方案而省略所述特定细节中的一个或更多，或者可以采用其它的方法、组元、装置、步骤等。在其它情况下，不详细示出或描述公知结构、方法、装置、实现或者操作以避免喧宾夺主而使得本实用新型的各方面变得模糊。

此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。

如前所述，三态驱动器在控制信号有效期间被开启，用于将输入的数据输出；在控制信号无效期间被关闭，输出处于高阻状态，总线上的数据由保持电路保持住。但如果控制信号的有效宽度由于制程或者工作电压和温度等原因变得太窄，三态驱动器的开启时间可能会不足以使数据完整地传输到下一级驱动模块中，从而发生错误。

本实用新型实施方式提供一种多级驱动数据传输电路及多级驱动数据传输方法，可以对输入到三态驱动器的控制信号进行处理，将原控制信号送至下一级驱动模块后，再反馈回本级的驱动模块。由于反馈路径的存在，可以根据反馈回来的控制信号与原控制信号，产生有效信号宽度宽于原控制信号的新的控制信号，从而避免因控制信号有效时间不足而导致无法将数据完整传输到下一级驱动模块中的问题。

下面首先说明本实用新型实施方式提供的多级驱动数据传输电路。

参考图1，多级驱动数据传输电路1包括：第一驱动模块10及第二驱动模块20。

其中，第一驱动模块10包括：第一信号产生单元101和第一三态驱动器102。第二驱动模块20包括：第二三态驱动器202。

第一三态驱动器102的输出端102c(数据输出端)通过总线Bus与第二三态驱动器202的第一输入端202a(数据输入端)耦接，将第一驱动模块10输出的数据通过总线Bus输出到第二驱动模块20中。

第一信号产生单元101包括：第一输入端101a、第二输入端101b及输出端101c。第一信号产生单元101的输出端101c与第一三态驱动器102的第二输入端102b(控制信号输入端)耦接。第一信号产生单元101的第一输入端101a用于接收第一信号(如数据传输电路1中的控制信号)，第二输入端101b用于接收来自第二驱动模块20的、第一信号的第一反馈信号。也即，用原有控制信号(第一信号)的前沿打开第一三态驱动器102，发送数据信号。同时，使用同样的信号线，将控制信号一起发送出去。当第一信号与数据信号被同时传输到第二驱动模块20后，第一信号再反馈回第一驱动模块10中的第一信号产生单元101的第二输入端101b。第一信号产生单元101在分别接收到第一信号与其反馈信号后，根据第一信号与其反馈信号，产生有效信号宽度宽于第一信号的第一控制信号，用于提供给第一三态驱动器102，以对第一三态驱动器102进行数据传输控制。

图2是根据一示例性实施例示出的第一信号产生单元101的示意图。如图2所示，在一些实施例中，第一信号产生单元101可以被实施为一个RS锁存器。

其中，第一信号产生单元101的第一输入端101a如为RS锁存器的设置端(即S端)，第二输入端101b如为RS锁存器的重置端(即R端)，输出端101c如为RS锁存器的第一输出端(即Q端)。

由于反馈路径的存在，即使第一信号的有效信号宽度(如为1的时长)不足以使得数据信号完整地传输到下一个驱动模块(如第二驱动模块20)，但因为在RS锁存器的另一输入端还输入了反馈信号，只要反馈信号仍为0，就不会对RS锁存器进行重置，从而仍可使RS锁存器继续保持有效信号输出，使得第一三态驱动器102继续保持开启状态，进而保证数据信号的完整传输。

图6是根据一示例示出的信号时序示意图。如图6所示，当第一信号的有效宽度较较窄(如图中所示的t1～t2)时，由于在t2～t3时刻，反馈信号为0，因此第一输出端输出的第一控制信号在t2～t3时刻的输出仍为1，从而延展了第一信号的有效宽度(如图中所示，有效信号宽度为t1～t3)。

图7是根据一示例性实施例示出的另一种第一信号产生单元101的示意图。如图7所示，在一些实施例中，第一信号产生单元101还可以被实施为一个D触发器。

其中，第一信号产生单元101的第一输入端101a如为D触发器的时钟信号端(即图中的CLK端)，用于接收第一信号；第二输入端101b如为D触发器的重置端(即图中的RESET端)，用于接收反馈信号；输出端101c如为D触发器的输出端(即图中的Q端)，输出第一控制信号。

此外，D触发器的数据端101d(即图中的DATA端)可以输入一固定电压信号VDD。

同样地，由于反馈路径的存在，即使第一信号的有效信号宽度(如为1的时长)不足以使得数据信号完整地传输到下一个驱动模块(如第二驱动模块20)，但因为在D触发器的RESET输入端还输入了反馈信号，仍以图6为例，在t2～t3时刻，反馈信号为0，无法对D触发器进行重置(RESET)，即对D触发器当前输出状态进行了锁存，因此第一输出端输出的第一控制信号在t2～t3时刻的输出仍为1，从而延展了第一信号的有效宽度，进而保证数据信号的完整传输。继续参考图1，在一些实施例中，第二驱动模块20还可以包括：信号整形单元203。信号整形单元203包括：输入端203a和输出端203b，用于通过其输入端接收第一信号，对第一信号进行整形，进而产生通过其输出端203b输出的第一反馈信号。由于经过较长的总线传输后，第一信号的质量会变得较差，通过信号整形单元203对其进行整形，可以提高其信号质量，从而保证反馈信号反馈回第一驱动模块10时，具有较好的信号质量。

在一些实施例中，信号整形单元203可以被实施为偶数个串接的反相器，起到缓冲器的作用。在第一信号经过总线传输后，经过缓冲器对其进行整形。本领域技术人员应理解的是，图1中两个相互串接的反相器的位置仅为示例，偶数个相互串接的反相器可以串接在一起，也可以通过导线串接在第二驱动模块20中的不同位置，用于对接收到的第一信号进行整形。

需要说明的是，当第一驱动模块10之前也耦接有其他驱动模块时，第一驱动模块10中也包含信号整形单元，以向前一级驱动模块提供经过整形后的第一信号的反馈信号。

如果是多级的传输路径，每一级驱动模块中，都可以为三态驱动器的控制信号输入端耦接一个上述的信号产生单元。参考图1，在一些实施例中，数据传输电路1还可以包括：第三驱动模块30。第三驱动模块30包括：第三三态驱动器302。第三三态驱动器302的第一输入端302a(数据输入端)与第二三态驱动器202的输出端202c(数据输出端)通过总线耦接。

第二驱动模块20还可以包括：第二信号产生单元201。第二信号产生单元201包括：第一输入端201a、第二输入端201b及输出端201c。第二信号产生单元201的输出端201c与第二三态驱动器202的第二输入端202b(控制信号输入端)耦接，用于通过其第一输入端201a接收第一信号，通过其第二输入端201b接收来自第三驱动模块30的、第一信号的第二反馈信号，也即当第一信号与数据信号被同时传输到第三驱动模块30后，第一信号再反馈回第二驱动模块20中的第二信号产生单元201的第二输入端201b。第二信号产生单元201在分别接收到第一信号与其反馈信号后，根据第一信号与其反馈信号，产生有效信号宽度宽于第一信号的第二控制信号，用于提供给第二三态驱动器202，以对第二三态驱动器202进行数据传输控制。

图3是根据一示例性实施例示出的第二信号产生单元201的示意图。如图3所示，在一些实施例中，第二信号产生单元201同样可以被实施为一个RS锁存器。

其中，第二信号产生单元201的第一输入端201a如为RS锁存器的设置端(即S端)，第二输入端201b如为RS锁存器的重置端(即R端)，输出端201c如为RS锁存器的第一输出端(即Q端)。

由于反馈路径的存在，即使第一信号的有效信号宽度(如为1的时长)不足以使得数据信号完整地传输到下一个驱动模块(如第二驱动模块20)，但因为在RS锁存器的另一输入端还输入了反馈信号，只要反馈信号仍为0，就不会对RS锁存器进行重置，从而仍可使RS锁存器继续保持有效信号输出，使得第二三态驱动器202继续保持开启状态，从而保证数据信号的完整传输。

同样地，如图6所示，当第二信号的有效宽度较较窄(如图中所示的t1～t2)时，由于在t2～t3时刻，反馈信号仍为0，因此第一输出端输出的新的第二控制信号在t2～t3时刻的输出仍为1，从而延展了第二信号的有效宽度(如图中所示，有效信号宽度为t1～t3)。

此外，第二信号产生单元201也可以被实施为图7所示的D触发器，其连接关系及工作原理在此不再赘述。

同样地，第三驱动模块30还可以包括：信号整形单元303。信号整形单元303包括：输入端303a和输出端303b，用于通过其输入端接收第一信号，对第一信号进行整形，进而产生通过其输出端303b输出的第二反馈信号。由于经过较长的总线传输后，第一信号的质量会变得较差，通过信号整形单元303对其进行整形，可以提高其信号质量，从而保证第二反馈信号反馈回第二驱动模块20时，具有较好的信号质量。

在一些实施例中，信号整形单元303同样可以被实施为两个耦接的反相器，起到缓冲器的作用。在第一信号经过总线传输后，经过缓冲器对其进行整形。

此外，如图1中所示的第三驱动模块30中也可以包括如上述的信号产生单元，其输出与第三三态驱动器302的第二输入端302b(控制信号输入端)耦接。为了简化附图，图中未示出该信号产生单元。

需要说明的是，图1中的数据传输电路1以多个驱动模块串行连接为例，但本实用新型不以此为限，例如还可以为两个驱动模块并行连接支路通过总线串行连接至下一级驱动模块中等。

在一些实施例中，为了防止输入的第一信号宽度太大而导致RS锁存器工作异常，可以根据第一信号的上升沿，产生一个脉冲信号，作为信号产生单元(101或201)中第一输入端(101a或201a)的输入。

图4是根据一示例实施例示出的一种脉冲信号产生单元的框图。联合参考图1和图4，第一驱动模块10还可以包括：脉冲信号产生单元104。脉冲信号产生单元104包括：输入端104a和输出端104b，通过其输出端104b与第一信号产生单元101的第一输入端101a耦接，用于接收第一信号，根据第一信号的上升沿，产生一个脉冲信号，并通过第一信号产生单元101的第一输入端101a向第一信号产生单元101提供该脉冲信号。

如图4所示，脉冲信号产生单元104例如可以包括：奇数级门电路1041、与非门1042及反相器1043。其中，奇数级门电路1041通过其输入端1041a接收第一信号；与非门1042通过其第一输入端1042a接收第一信号，通过其第二输入端1042b与奇数级门电路1041的输出端1041b耦接，接收奇数级门电路1041的输出信号，通过其输出端1042c与反相器1043的输入端1043a耦接；反相器1043的输出端1043b与第一信号产生单元101的第一输入端101a耦接。

其中，奇数级门电路1041的延时就是脉冲信号的宽度，通过该脉冲信号产生单元104来产生脉冲信号作为输入，可以防止出现因为输入的第一信号的宽度太大而导致RS锁存器工作异常的问题。

类似地，第二驱动模块20与第三驱动模块30中也可以包括上述的脉冲信号产生单元，为了简化附图，图1中未示出，且在此不再赘述。

此外，第一信号产生单元101例如还可以被实施为反相器与下降沿检测电路的组合。下降沿检测电路例如可以将图4中所示的与非门1042替换为一或非门，并去掉反相器1043来实现。同时，为了实现对第一信号上升沿的检测，并根据上升沿产生脉冲信号，还需要在下降沿检测电路之前增加一反相器，从而使接收到的第一信号的上升沿变为下降沿。

应清楚地理解，本实用新型描述了如何形成和使用特定示例，但本实用新型的原理不限于这些示例的任何细节。相反，基于本实用新型公开的内容的教导，这些原理能够应用于许多其它实施方式。

下述为本实用新型方法实施例，可以应用于本实用新型装置实施例中。对于本实用新型方法实施例中未披露的细节，请参照本实用新型装置实施例。

图5是根据一示例性实施方式示出的一种多级驱动数据传输方法的流程图。图5所示的多级驱动数据传输方法可以应用于上述多级驱动数据传输电路中。

参考图5，多级驱动数据传输方法2包括：

在步骤S22中，分别接收第一信号及来自下一级驱动模块的、该第一信号的反馈信号。

例如，通过图1中的第一信号产生单元101或第二信号产生单元201接收第一信号及来自第二驱动模块20或第三驱动模块30的、该第一信号的反馈信号。

在步骤S24中，根据第一信号及反馈信号，产生有效信号宽度宽于第一信号的控制信号，并向本级驱动模块中的三态驱动器提供该控制信号。

例如，通过如图1中所示的第一信号产生单元101或第二信号产生单元201，根据第一信号及反馈信号，产生有效信号宽度宽于第一信号的控制信号，并向第一三态驱动器102或第二三态驱动器202提供该控制信号。

由于反馈路径的存在，可以根据反馈回来的控制信号与原控制信号，产生有效信号宽度宽于原控制信号的新的控制信号，从而避免因控制信号有效时间不足而导致无法将数据完整传输到下一级驱动模块中的问题。

在一些实施例中，步骤S24可以进一步通过下述实施例实现：分别将第一信号及反馈信号输入到RS锁存器的设置端和重置端，将RS锁存器第一输出端的信号作为该控制信号。

在一些实施例中，步骤24可以通过下述实施例实现：分别将第一信号及反馈信号输入到D触发器的时钟输入端和重置端，将D触发器输出端输出的信号作为该控制信号，将一固定电压信号VDD输入到D触发器的数据端。

在一些实施例中，多级驱动数据传输方法1在步骤S22之前，还可以进一步包括：在下一级驱动模块中，对接收到的第一信号进行整形，以获得并输出该反馈信号。例如，可以通过如图1中所示的信号整形单元203或信号整形单元303来对接收到的第一信号进行整形，从而向第一信号产生单元101或第二信号产生单元102提供第一反馈信号或第二反馈信号。

在一些实施例中，多级驱动数据传输方法1在步骤S22之前，还可以进一步包括：根据所述第一信号的上升沿，产生脉冲信号，并将该脉冲信号作为第一信号输出。

此外，需要注意的是，上述附图仅是根据本实用新型示例性实施方式的方法所包括的处理的示意性说明，而不是限制目的。易于理解，上述附图所示的处理并不表明或限制这些处理的时间顺序。另外，也易于理解，这些处理可以是例如在多个模块中同步或异步执行的。

以上具体地示出和描述了本实用新型的示例性实施方式。应可理解的是，本实用新型不限于这里描述的详细结构、设置方式或实现方法；相反，本实用新型意图涵盖包含在所附权利要求的精神和范围内的各种修改和等效设置。

Claims

1.一种多级驱动数据传输电路，其特征在于，包括：

第一驱动模块，包括：第一信号产生单元及第一三态驱动器；以及

第二驱动模块，包括：第二三态驱动器；

其中，所述第二三态驱动器的第一输入端与所述第一三态驱动器的输出端耦接；

所述第一信号产生单元包括：第一输入端、第二输入端及输出端；所述第一信号产生单元的输出端与所述第一三态驱动器的第二输入端耦接；所述第一信号产生单元用于通过其第一输入端接收第一信号，通过其第二输入端接收来自所述第二驱动模块的、所述第一信号的第一反馈信号，根据所述第一信号及所述第一反馈信号，产生有效信号宽度宽于所述第一信号的第一控制信号，并向所述第一三态驱动器提供所述第一控制信号。

2.根据权利要求1所述的多级驱动数据传输电路，其特征在于，所述第一信号产生单元包括：第一RS锁存器，所述第一信号产生单元的第一输入端为所述第一RS锁存器的设置端，所述第一信号产生单元的第二输入端为所述第一RS锁存器的重置端，所述第一信号产生单元的输出端为所述第一RS锁存器的第一输出端。

3.根据权利要求1所述的多级驱动数据传输电路，其特征在于，所述第一信号产生单元包括：第一D触发器，所述第一信号产生单元的第一输入端为所述第一D触发器的时钟输入端，所述第一信号产生单元的第二输入端为所述第一D触发器的重置端，所述第一信号产生单元的输出端为所述第一D触发器的输出端。

4.根据权利要求1-3任一项所述的多级驱动数据传输电路，其特征在于，所述第二驱动模块还包括：信号整形单元，包括：输入端和输出端；所述信号整形单元用于通过其输入端接收所述第一信号，对所述第一信号进行整形，产生并通过其输出端输出所述第一反馈信号。

5.根据权利要求4所述的多级驱动数据传输电路，其特征在于，所述信号整形单元包括：偶数个相互串接的第一反相器。

6.根据权利要求1-3任一项所述的多级驱动数据传输电路，其特征在于，所述第一驱动模块还包括：脉冲信号产生单元，包括：输入端和输出端，通过其输出端与所述第一信号产生单元的第一输入端耦接，用于接收所述第一信号，根据所述第一信号的上升沿，产生脉冲信号，并通过所述第一信号产生单元的第一输入端向所述第一信号产生单元提供所述脉冲信号。

7.根据权利要求6所述的多级驱动数据传输电路，其特征在于，所述脉冲信号产生单元包括：奇数级门电路、与非门及第二反相器；其中，所述奇数级门电路通过其输入端接收所述第一信号；所述与非门通过其第一输入端接收所述第一信号，通过其第二输入端与所述奇数级门电路的输出端耦接，接收所述奇数级门电路的输出信号，通过其输出端与所述第二反相器的输入端耦接；所述第二反相器的输出端与所述第一信号产生单元的第一输入端耦接。

8.根据权利要求1-3任一项所述的多级驱动数据传输电路，其特征在于，还包括：第三驱动模块，包括：第三三态驱动器；所述第三三态驱动器的第一输入端与所述第二三态驱动器的输出端耦接；所述第二驱动模块还包括：第二信号产生单元；所述第二信号产生单元包括：第一输入端、第二输入端及输出端；所述第二信号产生单元的输出端与所述第二三态驱动器的第二输入端耦接；所述第二信号产生单元用于通过其第一输入端接收所述第一信号，通过其第二输入端接收来自所述第三驱动模块的、所述第一信号的第二反馈信号，根据所述第一信号及所述第二反馈信号，产生有效信号宽度宽于所述第一信号的第二控制信号，并向所述第二三态驱动器提供所述第二控制信号。

9.根据权利要求8所述的多级驱动数据传输电路，其特征在于，所述第二信号产生单元包括：第二RS锁存器，所述第二信号产生单元的第一输入端为所述第二RS锁存器的设置端，所述第二信号产生单元的第二输入端为所述第二RS锁存器的重置端，所述第二信号产生单元的输出端为所述第二RS锁存器的第一输出端。

10.根据权利要求8所述的多级驱动数据传输电路，其特征在于，所述第二信号产生单元包括：第二D触发器，所述第二信号产生单元的第一输入端为所述第二D触发器的时钟输入端，所述第二信号产生单元的第二输入端为所述第二D触发器的重置端，所述第二信号产生单元的输出端为所述第二D触发器的输出端。