CN1972122A - 跨周期脉冲延迟输出控制方法 - Google Patents
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Abstract
本发明涉及一种跨周期脉冲延迟输出控制方法,属于电子技术技术领域。一种跨周期脉冲延迟输出控制方法,是通过分频,把周期T输入脉冲分成至少两路输入V1a、V1b……,分别对V1a、V1b……进行延迟输出得到V2a、V2b……,然后把各路延迟脉冲V2a、V2b……合并成一路输出V2,这样就可以稳定地得到延迟输出脉冲。分频数n=1+int(最大延迟时间t/输入脉冲周期T)。通过分频把输入脉冲分成多路分别进行不大于分频后的脉冲的周期T的延迟,然后把多路延迟脉冲合成一路输出的办法,方便的解决了延迟脉冲在周期跨跃延迟时电路的不稳定状态。
Description
技术领域
本发明涉及一种跨周期脉冲延迟输出控制方法,属于电子技术技术领域。
背景技术
目前,对一个周期脉冲输入信号进行延迟控制输出有两种基本模式:模拟延迟控制和数字延迟控制。模拟延迟控制可以利用单稳态触发电路实现;数字延迟控制可以利用高精度定时器通过逻辑组合实现,这些常规的技术方法可以完成一个周期内的延迟控制。当所要求的延迟脉冲的延迟时间是变化的并且有跨跃输入脉冲周期的现象时,尤其当延迟脉冲的延迟时间恰好等于输入脉冲周期时,会产生延迟输出脉冲状态不稳定。
发明内容
针对上述问题,本发明创造的目的是提供一种跨周期脉冲延迟输出控制方法,以在要求的延迟脉冲的延迟时间是变化的并且有跨跃输入脉冲周期的现象时,尤其当延迟脉冲的延迟时间恰好等于输入脉冲周期时,能够产生平稳的延迟输出脉冲。
为实现上述目的,本发明的技术方案是:一种跨周期脉冲延迟输出控制方法,是通过分频,把周期T输入脉冲分成至少两路输入V1a、V1b……,分别对V1a、V1b……进行延迟输出得到V2a、V2b……,然后把各路延迟脉冲V2a、V2b……合并成一路输出V2,这样就可以稳定地得到延迟输出脉冲。
所述分频数n=1+int(最大延迟时间t/输入脉冲周期T)。
通过分频把输入脉冲分成多路分别进行不大于分频后的脉冲的周期T的延迟,然后把多路延迟脉冲合成一路输出的办法,方便的解决了延迟脉冲在周期跨跃延迟时电路的不稳定状态。
附图说明
图1为输入脉冲和延时输出脉冲的延时示意图;
图2为本发明的方法示意图。
具体实施方式
图1显示了目标输入、输出脉冲的关系。图中,V1是输入脉冲,脉冲信号周期为T,V2是延迟输出脉冲,延迟时间大于周期T时,可以按T的余数来处理,只需要考虑延迟时间不大于T的情况就可以解决延迟脉冲周期跨跃问题。图中三个输出脉冲相对输入脉冲的延迟时间分别为t1、t2、t3,其中t1、t2均小于T,t3几乎和T相等,当延迟时间是t1、t2时,常规延迟电路可以正常输出延迟脉冲,当延迟时间是t3时,由于输入脉冲周期性出现,当前输入脉冲的延迟输出脉冲还没有正常输出,下一个输入脉冲已经出现,破坏了延迟电路当前的工作状态,使得延迟脉冲不能正常输出,也就是说当延迟时间几乎和输入脉冲周期相等时,无法正确得到延迟脉冲输出。
解决途径是通过设定数的分频,把周期T输入脉冲分成至少两路输入V1a、V1b……,分别对V1a、V1b……进行延迟输出得到V2a、V2b……,然后把各路延迟脉冲V2a、V2b……合并成一路输出V2,这样就可以稳定地得到延迟输出脉冲。分频数n=1+int(最大延迟时间t/输入脉冲周期T),即对最大延迟时间t和输入脉冲周期T的比值取整,取整值加1后的值即为分频数。
图2所示为需将把输入脉冲分成两路的情况。当所要求的延迟脉冲的延迟时间是变化的并且有跨跃输入脉冲周期T的现象时,如果有T≤最大延迟时间t<2T的输出脉冲出现,可把输入脉冲分成两路(即分频数n=2)输入Va、V1b,分别对V1a、V1b进行延迟输出得到V2a、V2b,然后把两路延迟脉冲合并成一路输出V2,这样就可以稳定地得到延迟时间是T时的延迟输出脉冲。
若延迟时间达到或超过输入脉冲周期T的两倍,有需把输入脉冲分成三路或更多路的情况,照样可以依据本发明的方法解决,也应属于本发明的方法的保护范围之内,在此不再赘述。
最后所应说明的是:以上实施例仅用以说明而非限制本发明的技术方案,尽管参照上述实施例对本发明进行了详细说明,本领域的普通技术人员应当理解:依然可以对本发明进行修改或者等同替换,而不脱离本发明的精神和范围的任何修改或局部替换,其均应涵盖在本发明的权利要求范围当中。
Claims (2)
1、一种跨周期脉冲延迟输出控制方法,是通过分频,把周期T输入脉冲分成至少两路输入V1a、V1b……,分别对V1a、V1b……进行延迟输出得到V2a、V2b……,然后把各路延迟脉冲V2a、V2b……合并成一路输出V2,这样就可以稳定地得到延迟输出脉冲。
2、根据权利要求1所述的跨周期脉冲延迟输出控制方法,所述分频数n=1+int(最大延迟时间t/输入脉冲周期T)。
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