CN1967648A - 图像显示系统及相关的提供驱动电压的方法 - Google Patents

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Abstract

一种图像显示系统，包括一数据驱动电路，具有多个驱动单元，用以产生多个模拟电压，以便根据来自一数据总线的数据信号驱动对应的多个像素。每个驱动单元包括一缓存单元，用以于一第一周期中，根据N个控制信号，依序存储N笔第一数字数据，并于一第二周期中，根据M个开关信号，依序输出N个第一数字数据；一数字模拟转换单元，耦接于缓存单元，用以将N笔第一数字数据依序转换成N个模拟电压；一模拟缓冲单元，用以缓存N个模拟电压；以及一去多路复用器，用以根据一致能信号，选择性地输出N个模拟电压至对应的多个像素。

Description

图像显示系统及相关的提供驱动电压的方法
技术领域
本发明有关于一种图像显示系统。
背景技术
现今，液晶显示器广泛地使用于不同的应用上，例如计算器、手表、彩色电视机、计算机屏幕以及其它电子装置中，然而最常见的液晶显示器为主动矩阵式液晶显示器。于传统主动矩阵式液晶显示器中，每一像素单元使用一薄膜晶体管所构成的矩阵以及一或多个电容器来应对，所有的像素单元亦排成具有多行与多列之矩阵。
为操作一特定像素时，一适当行的像素切换至导通(就是充电至一电压)，然后于一对应列上送出一电压。由于该对应行上其它列皆被切换至截止，因此只有该特定像素上的晶体管与电容器可以接收到充电。因应于此电压，该特定像素上的液晶会变换极性排列，因而改变其反射的光线量或通过其的光线量。
由于使用系统面板(system on glass)的液晶显示器整合了液晶显示器中许多的驱动电路与功能，因此不需要外部的集成电路(IC)，而能提供低成本且高可靠度的显示器。此种液晶显示器所整合的驱动电路包括一垂置驱动电路，用以由像素阵列中选出一列像素，以及一水平驱动电路，用以写入显示数据至所选择列中的像素。
如图1A中所示，由于低温多晶硅处理中设计法则的限制，传统上为了每一组RGB像素，在两个RGB像素间距(double RGB pixel pitch；2PP)中需要含有一组RGB模拟缓冲器与RGB数字模拟转换器。举例而言，取样锁存器(sampling latch)用以根据水平移位寄存器所提供的控制信号，由数字数据总线DDB中取样数字信号，且取样锁存器中所取样的数据是根据致能(enable)信号OE，输出至对应的保持锁存器(holding latch)中。保持锁存器中的数字信号会被转换成RGB模拟信号，并通过对应的RGB模拟缓冲器输出至对应的像素中。因此，一个显示面板需要在显示区(frame area)的上部与下部设置两个水平驱动电路，如图1B中所示。然而，这样却会占用很大的面积，使得面板边框的尺寸变大，并且为了将来自主机系统的数据信号分别提供给这两个水平驱动电路，则需要一个数据处理电路33。
图2A中所示的为一具有较小面积的另一水平驱动电路，其操作时序图如图2B中所示。如图所示，取样锁存器会根据水平移位寄存器所提供的控制信号，由数字数据总线DDB中取样数字信号，且取样锁存器中所取样的数据根据致能信号OE，输出至对应的保持锁存器中。保持锁存器中的R数字信号、G数字信号和B数字信号是根据数据致能信号DE和去多路复用器，通过同一个数字模拟转换器依序会被转换成RGB模拟信号，并通过同一个模拟缓冲器输出至对应的像素中。换言之，通过共享同一个数字模拟转换器与模拟缓冲器来驱动RGB像素，以便减少水平驱动电路所占用的面积。然而，由于取样锁存器与保持锁存器才对水平驱动电路的布局宽度具有决定性的影响，因此这个电路中每一组RGB像素驱动电路仍然需要占用两个RGB像素间距(2PP)。
发明内容
本发明提供一种图像显示系统，包括一数据驱动电路，包括多个驱动单元，用以产生多个模拟电压，以便根据来自一数据总线的数据信号驱动对应的多个像素。每个驱动单元包括一缓存单元，用以于一第一周期中，根据N个控制信号，依序存储N笔第一数字数据，并于一第二周期中，根据M个开关信号，依序输出N个第一数字数据；一数字模拟转换单元，耦接缓存单元，用以将N笔第一数字数据依序转换成N个模拟电压；一模拟缓冲单元，用以缓存来自数字模拟转换单元的N个模拟电压；以及一去多路复用器，用以根据一致能信号，选择性地输出N个模拟电压至对应的多个像素。
本发明亦提供一种图像显示系统，包括一驱动电路，包括至少一驱动单元，用以根据来自一数据总线的数据信号产生多个模拟电压；其中驱动单元包括一缓存单元，用以于一第一周期中，根据一第一控制信号以及一第二控制信号，依序存储一第一数字数据以及一第二数字数据，并于一第二周期中，根据一第一至第三开关信号，依序输出第一数字数据和第二数字数据；一数字模拟转换单元，耦接缓存单元，用以将第一及第二数字数据分别转换成一第一模拟电压和一第二模拟电压；一模拟缓冲单元，用以缓存来自数字模拟转换单元的第一及第二模拟电压；以及一去多路复用器，用以根据一致能信号，依序将第一、第二模拟电压至一第一像素及一第二像素。
本发明亦提供一种图像显示系统，包括一第一像素；一第二像素；以及一驱动单元，具有一数字模拟转换单元以及一模拟缓冲单元，用以通过数字模拟转换单元和模拟缓冲单元提供模拟电压至第一及第二像素，以便驱动第一、第二像素。
本发明又提供一种提供驱动电压的方法，适用于一图像显示装置，包括下列步骤于一第一周期时，根据一第一、一第二控制信号，将一第一及一第二数字数据依序存储至串联连接的多组锁存器中；于一第二周期时，根据一第一、一第二及一第三开关信号，将第一、第二数字数据依序输出至一数字模拟转换单元；依序将第一、第二数字数据转换成一第一模拟电压与一第二模拟电压；以及根据一致能信号，将第一、第二模拟电压依序输出至一第一像素以及一第二像素。
为了让本发明的上述和其它目的、特征、和优点能更明显易懂，下文特举一较佳实施例，并配合所附图示，作详细说明如下。
附图说明
图1A中所示的是一传统数据驱动电路；
图1B中所示的是一传统显示面板；
图2A中所示的是具有较小面积的另一传统驱动电路；
图2B中所示的是图2A中驱动电路的操作时序图；
图3A与图3B是图像显示系统的一实施例；
图3C中所示的是第3A和3B图中显示系统的操作时序图；
图4A与图4B是图像显示系统的另一实施例；
图4C中所示的是第4A和4B图中显示系统的操作时序图；
图5为图像显示系统的另一实施例；和
图6为图像显示系统的另一实施例。
附图标记说明
300、400：数据驱动器；
31、41：水平移位寄存器；
32、42：缓存单元；
34、44：数字模拟转换单元；
36、46：模拟缓冲单元；
38、48：去多路复用器；
500：显示面板；
510：时序控制器；
520：像素阵列；
530：扫描驱动器；
540：同步器；
600：电子装置；
610：外壳；
620：DC/DC转换器；
DDB：数字数据总线；
OE：致能信号；
OR1～ORN、OR1”～OR2N”：或门；
301～30N、401～40N：驱动单元；
P1～p3N：像素；
SR1_OUT1～SR1_OUTN、SR2_OUT1～SR2_OUTN、
SR3_OUT1～SR3_OUTN：控制信号；
OE1～OE7：开关信号；
SL11～SL1m、SL21～SL2m、SL31～SL3m：取样锁存器；
HL11～HL1m、HL21～HL2m、HL31～HL3m；保持锁存器；
SW1～SW6：开关组件；
AV1～AV3N：模拟电压。
具体实施方式
如图3A与图3B显示本发明一图像显示系统的一实施例，图像显示系统被实现成一数据驱动器，用以提供驱动电压至一显示面板。如图所示，数据驱动器300包括一水平移位寄存器(horizontal shift register)31、或门OR1～ORN以及耦接至一数字数据总线的N个驱动单元301～30N。数据驱动器300接收来自一主机系统的数字数据，并提供对应的模拟电压至一显示面板中的对应的像素P1～P2N。举例而言，数字数据可为18位或24位的数据，但不限定于此。
水平移位寄存器31用以产生二组控制信号SR1_OUT1～SR1_OUTN以及SR2_OUT1～SR2_OUTN，以便控制N个驱动单元30_1～30_N。举例而言，水平移位寄存器31如同图3C中所示地依序产生控制信号SR1_OUT1～SR1_OUTN，及依序产生控制信号SR2_OUT1～SR2_OUTN，并且开关信号OE1～OE3由图5所示的时序控制器510所提供。于此实施例中，开关信号OE4由或门OR1～ORN根据开关信号OE3和控制信号SR2_OUT1～SR2_OUTN所产生。
每一驱动单元30_1～30_N可以布局于两个RGB像素间距(double RGBpixel pitch；2PP)的宽度限制内，并包括一缓存单元32、一数字模拟转换单元34、一模拟缓冲单元36以及一去多路复用器38。每一个驱动单元用以根据来自数字数据总线DDB的数字数据，依序地产生模拟电压以便驱动对应的像素P1～P2N。
缓存单元32用以于一第一周期时，根据控制信号SR1_OUT1和SR2_OUT1，依序地存储数字数据(未图标)，并于一第二周期时，根据开关信号OE1～OE3依序地输出所存储的数字数据。存储单元32包括四组锁存器(每一组中的锁存器串联地连接)，即取样锁存器SL11～SL1m与SL21～SL2m、保持锁存器HL11～HL1m和HL21～HL2m以及四组开关组件SW1～SW4。
开关组件SW1耦接于数字数据总线DDB与取样锁存器SL11～SL1m之间，并且受控制信号SR1_OUT1控制。开关组件SW2耦接于取样锁存器SL11～SL1m与SL21-SL2m之间，并且受开关信号OE4控制。开关组件SW3耦接于取样锁存器SL21～SL2m与保持锁存器HL11～HL1m之间，并且受开关信号OE2控制。开关组件SW4耦接于保持锁存器HL11～HL1m与保持锁存器HL21～HL2m之间，并且受开关信号OE1控制。
数字模拟转换单元34用以依序地将来自缓存单元32的N笔数字数据转换成N个模拟电压。举例而言，数字模拟转换单元34将来自缓存单元32的18或24位的数字数据转换成RGB模拟电压，例如AV1或AV2，以便一次提供给对应的像素。换言之，数字模拟转换单元34将来自缓存单元32的数字数据依序地转换成模拟电压AV1与AV2，以便提供给对应的像素。模拟缓冲单元36用以缓存(buffer)来自数字模拟转换单元34的模拟电压，例如AV1或AV2。去多路复用器38根据一致能信号DE，选择性地输出来自模拟缓冲单元36的模拟电压，例如AV1或AV2。举例而言，去多路复用器38根据致能信号DE，依序地将模拟电压AV1与AV2分别输出至像素P1与P2，于此实施例中，致能信号DE可能由图5中的时序控制器510所提供。
请同时参考第3A至图3C，于时间周期t0～t1时，由于控制信号SR2_OUT1变为高电位，于是来自或门OR1的开关信号OE4会因而变为高电位。当控制信号SR1_OUT1与开关信号OE4皆会变为高电位时，于驱动组件301中，开关组件SW1与SW2会同时导通，使得数据总线DDB上来自主机系统的一第一笔数字数据会存储到锁存器SL11～SL1m与SL21～SL2m中。
于时间周期t1～t2时，由于控制信号SR2_OUT1变为低电位，于是来自或门OR1的开关信号OE4会因而变为低电位。当控制信号SR1_OUT1维持在高电位而开关信号OE4会变为低电位时，于驱动组件30_1中，开关组件SW1会保持导通，而开关组件SW2截止，使得数据总线DDB上来自主机系统的一第二笔数字数据会存储到锁存器SL11～SL1m中。换言之，第一、第二笔数字数据根据控制信号SR1_OUT1与SR2_OUT1依序地存储至驱动组件301的锁存器SL11～SL1m与SL21～SL2m中。
于时间周期t2～t3时，由于控制信号SR2_OUT2变为高电位，于是来自或门OR2的开关信号OE4会因而变为高电位。当控制信号SR1_OUT2与开关信号OE4皆变为高电位时，于驱动组件30_2中，开关组件SW1与SW2皆会导通，使得数据总线DDB上来自主机系统的一第三笔数字数据会存储到锁存器SL11～SL1m中。
于时间周期t3～t4时，由于控制信号SR2_OUT2变为低电位，于是来自或门OR1的开关信号OE4会因而变为低电位。当控制信号SR1_OUT2维持在高电位而开关信号OE4会变为低电位时，于驱动组件30_2中，开关组件SW1会保持导通，而开关组件SW2截止，使得数据总线DDB上来自主机系统的一第四笔数字数据会存储到锁存器SL11～SL1m中。换言之，第三、第四笔数字数据根据控制信号SR1_OUT2与SR2_OUT2依序地存储至驱动组件30_2的锁存器SL11～SL1m与SL21～SL2m中。
于时间周期t4～t5时，于数据总线DDB上来自主机系统的第五笔数字数据依序地存储至驱动组件303的锁存器SL11～SL1m与SL21～SL2m中。于时间周期t5～t6时，于数据总线DDB上来自主机系统的第六笔数字数据依序地存储至驱动组件303的锁存器SL11～SL1m中。换言之，第五、第六笔数字数据根据控制信号SR1_OUT3与SR2_OUT3依序地存储至驱动组件30_3的锁存器SL11～SL1m与SL21～SL2m中，依此类推。
于时间周期t7～t8时，于数据总线DDB上来自主机系统的第2N-1笔数字数据依序地存储至驱动组件30_N的锁存器SL11～SL1m与SL21～SL2m中。于时间周期t8～t9时，于数据总线DDB上来自主机系统的第2N笔数字数据依序地存储至驱动组件30_N的锁存器SL11～SL1m中。换言之，第2N-1、第2N笔数字数据根据控制信号SR1_OUTN与SR2_OUTN依序地存储至驱动组件30N的锁存器SL11～SL1m与SL21～SL2m中。综上所言，第一笔至第2N笔数字数据于第一周期T1中，根据水平移位寄存器31所提供的控制信号SR1_OUT1～SR1_OUTN与SR2_OUT1～SR2_OUTN，依序地被存储到驱动单元30_1～30_N的锁存器中。
于时间周期t9～t10时，开关信号OE1与OE2皆变为高电位，因此驱动单元30_1～30_N中的开关组件SW3与SW4皆会导通，使得驱动单元30_1～30_N中存储在锁存器SL21～SL2m的数字数据会被输出至保持锁存器HL21～HL2m以及对应的数字模拟转换单元34。举例而言，存储在驱动单元30_1与30_2的锁存器SL11～SL1m中的第一与第三数字数据会被输出至保持锁存器HL21～HL2m以及对应的数字模拟转换单元34，依此类推。
于是所对应的模拟转换单元34会将所接收到的数字数据转换成模拟电压，并输出至对应的模拟缓冲单元36，以便存储模拟电压。举例而言，驱动单元30_1与30_2中的数字模拟转换单元34会将第一与第三数字数据转换成模拟电压AV1与AV3，并输出至模拟缓冲单元36，并加以存储，依此类推
于时间t10时，由于开关信号OE1变为低电位，开关组件SW4会截止，而开关组件SW3则保持导通。于时间周期t11～t12时，由于开关信号OE3变为高电位，因此开关信号OE4亦变为高电位，使得开关组件SW2会导通。当开关组件SW2与SW3皆导通时，存储在驱动单元301～30N的锁存器SL11～SL1m中的数字数据会输出至保持锁存器HL11～HL1m。举例而言，存储在驱动单元30_1与30_2的锁存器SL11～SL1m中的第二及第四笔数字数据会输出至保持锁存器HL11～HL1m。
于时间t12时，开关信号OE2与OE3皆会变成低电位，使得开关组件SW2与SW3皆截止。于时间周期t12～t14时，数据致能信号DE[0]会变成高电位，使得去多路复用器38会输出存储在模拟缓冲器36的模拟电压至对应的像素中。举例而言，根据数据致能信号DE[0]与去多路复用器38，模拟电压AV1会输出至像素P1，模拟电压AV3会输出至像素P3，模拟电压AV2N-3会输出至像素P2N-3，模拟电压AV2N-1会输出至像素P2N-1，依此类推。于时间t14时，数据致能信号DE[0]会变为低电位，使得去多路复用器38停止输出存储在模拟缓冲单元36的模拟电压。
于时间周期t15～t16时，由于开关信号OE1会变为高电位，驱动单元30_1～30_N的开关组件SW4会导通，使得存储在驱动单元30_1～30_N的保持锁存器HL11～HL1m的数字数据会输出至对应的数字模拟转换器34。举例而言，存储在驱动单元30_1～30_2的锁存器SL11～SL1m中的第二与第四数字数据会被输出至保持锁存器HL21～HL2m以及对应的数字模拟转换单元34，依此类推。
于是所对应的模拟转换单元34会将所接收到的数字数据转换成模拟电压，并输出至对应的模拟缓冲单元36，以便存储模拟电压。举例而言，驱动单元30_1与30_2中的数字模拟转换单元34会将第二与第四数字数据转换成模拟电压AV2与AV4，并输出至模拟缓冲单元36，并加以存储，依此类推
于时间周期t17～t20时，数据致能信号DE[1]会变成高电位，使得去多路复用器38会输出存储在模拟缓冲器36的模拟电压至对应的像素中。举例而言，根据数据致能信号DE[1]与去多路复用器38，模拟电压AV2会输出至像素P2，模拟电压AV4会输出至像素P4，模拟电压AV2N-2会输出至像素P2N-2，模拟电压AV2N会输出至像素P2N，依此类推。于时间t20时，数据致能信号DE[1]会变为低电位，使得去多路复用器38停止输出存储在模拟缓冲单元36的模拟电压。
由于驱动单元30_1～30_2会在时间周期t9～t20产生模拟电压输出至对应的像素中，并同时于时且存储新的数字数据至锁存器SL11～SL1m与SL21～SL2m中，其动作与周期T1中相同，于此不再累述。换言之，驱动单元30_1～30_N于周期T2时会输出2N个模拟电压至对应的像素P1～P2N，并接收新的数字数据。
于此实施例中，由于每一个驱动单元可以通过共享一组数字模拟转换单元、数字数据取样与保持锁存器、模拟缓冲单元与去多路复用器，而依序地驱动两个对应的像素，故整个驱动器中模拟缓冲单元与数字模拟转换单元的数量会减少。因此每个驱动单元可以布局于两个RGB像素间距(2PP)的宽度限制内，藉以减少显示面板中外围区域的使用。
如图4A与图4B显示本发明一图像显示系统的另一实施例，图像显示系统被实现成一数据驱动器，用以提供驱动电压至一显示面板。如图所示，数据驱动器400包括一水平移位寄存器(horizontal shift register)41、或门OR1”～OR2N”以及耦接至一数字数据总线的N个驱动单元40_1～40_N。数据驱动器400接收来自一主机系统的数字数据，并提供对应的模拟电压至一显示面板中的对应的像素P1～P3N。
水平移位寄存器41用以产生三组控制信号SR1_OUT1～SR1_OUTN、SR2_OUT1～SR2_OUTN以及SR3_OUT1～SR3_OUTN，以便控制N个驱动单元40_1～40_N。举例而言，水平移位寄存器41如同图3C中所示地依序产生控制信号SR1_OUT1～SR1_OUTN、依序产生控制信号SR2_OUT1～SR2_OUTN以及依序产生控制信号SR3OUT1～SR3_OUTN，并且开关信号OE1～OE5由图5所示的时序控制器510所提供。
于此实施例中，每一驱动单元40_1～40_N可以布局于三个RGB像素间距(triple RGB pixel pitch；3PP)的宽度限制内，并包括一缓存单元42、一数字模拟转换单元44、一模拟缓冲单元46以及一去多路复用器48。每一个驱动单元用以根据来自数字数据总线DDB的数字数据，依序地产生模拟电压以便驱动对应的像素P1～P3N。
缓存单元42用以于一第一周期时，根据控制信号SR1_OUT1、SR2_OUT1和SR3_OUT1，依序地存储数字数据(未图标)，并于一第二周期时，根据开关信号OE1～OE5依序地输出所存储的数字数据。存储单元42包括六组锁存器(每一组中的锁存器串联地连接)，即取样锁存器SL11～SL1m、SL21～SL2m与SL31～SL3m、保持锁存器HL11～HL1m、HL21～HL2m与HL31～HL3m以及六组开关组件SW1～SW6。
开关组件SW1耦接于数字数据总线DDB与取样锁存器SL11～SL1m之间，并且受控制信号SR1_OUT1～SR1_OUTN控制。开关组件SW2耦接于取样锁存器SL11～SL1m与SL21～SL2m之间，并且受开关信号OE6控制。开关组件SW3耦接于取样锁存器SL21～SL2m与SL31-SL3m之间，并且受开关信号OE7控制。开关组件SW4耦接于取样锁存器SL31～SL3m与保持锁存器HL11～HL1m之间，并且受开关信号OE3控制。开关组件SW5耦接于保持锁存器SL11～SL1m与HL21-HL2m之间，并且受开关信号OE2控制。开关组件SW6耦接于保持锁存器HL21～HL2m与保持锁存器HL31～HL3m之间，并且受开关信号OE1控制。举例而言，于驱动单元401中，开关信号OE6为或门OR2”根据控制信号SR2_OUT1与开关信号OE5所产生，而开关信号OE7为或门OR1”根据控制信号SR3_OUT1与开关信号OE4所产生。于驱动单元402中，开关信号OE6为或门OR4”根据控制信号SR2_OUT2与开关信号OE5所产生，而开关信号OE7为或门OR3”根据控制信号SR3_OUT2与开关信号OE4所产生，依此类推。
数字模拟转换单元44用以依序地将来自缓存单元42的N笔数字数据转换成N个模拟电压。举例而言，数字模拟转换单元44将来自缓存单元42的18或24位的数字数据转换成RGB模拟电压，例如AV1、AV2或AV3，以便一次提供给对应的像素。换言之，数字模拟转换单元44将来自缓存单元42的数字数据依序地转换成模拟电压AV1、AV2与AV3，以便提供给对应的像素。模拟缓冲单元46用以缓存(buffer)来自数字模拟转换单元44的模拟电压，例如AV1、AV2或AV3。
去多路复用器48根据一致能信号DE，选择性地输出来自模拟缓冲单元46的模拟电压，例如AV1、AV2或AV3。举例而言，去多路复用器48根据致能信号DE，依序地将模拟电压AV1～AV3分别输出至像素P1～P3，于此实施例中，致能信号DE可能由图5中的时序控制器510所提供。
图4C为第4A、4B图中所示的数据驱动器的时序控制示意图。数据驱动器400的动作与第3A与3B图中所示的数据驱动器300类似，于此不再累述。简言之，第一至第3N笔数字数据是于一第一周期，根据水平移位寄存器41所提供的控制信号SR1_OUT1～SR1_OUTN、SR2_OUT1～SR2_OUTN以及SR3_OUT1～SR3_OUTN，依序地存储至驱动单元40_1～40_N中。驱动单元40_1～40_N是于一第二周期时，输出3N个模拟电压至对应的像素P1～P3N中，并同时接收新的数字数据。
于此实施例中，由于每一个驱动单元可以通过共享一组数字模拟转换单元、数字数据取样与保持锁存器、模拟缓冲单元与去多路复用器，而依序地驱动三个对应的像素，故整个驱动器中模拟缓冲单元与数字模拟转换单元的数量会减少。因此每个驱动单元可以布局于三个RGB像素间距(3PP)的宽度限制内，藉以减少显示面板中外围区域的使用。
图5为图像显示系统的另一实施例。如图所示，显示面板500包括前述的数据驱动器300/400、一时序控制器510、一像素阵列520、一扫描驱动器530以及一同步器540，在最佳的情况，前述的组件通过系统面板技术(SOG)整合于一玻璃基板上。时序控制器510用以提供开关信号OE1～OE5与致能信号DE至数据驱动器300/400以及频率信号至同步器540。像素阵列520包括排列成矩阵的多个彩色像素、多条数据信号线以及多条扫描信号线，其中每个像素包括RGB(红色、绿色和蓝色)次像素。数据驱动器300/400用以产生模拟电压给像素阵列520，而扫描驱动器530用以产生扫描信号给像素阵列520，以便控制扫描信号线被驱动或中止。像素阵列520用以根据来自数据驱动器300/400的模拟电压产生对应的彩色图像。同步器540用以对来自主机系统的数字信号与来自时序控制器510的频率信号进行同步化，此外显示面板510可为一有机发光显示面板、一电致发光显示面板或一液晶显示面板，但不限定于此。
本发明的数字数据驱动器通过共享锁存器、模拟缓冲单元、数字模拟转换单元，可以减少其布局面积，因此可以有效避免布局与绕线的困难度。由于在某些实施例中数据驱动器的每个驱动单元可以布局于二个RGB像素间距(2PP)的宽度限制内并驱动二个对应的像素，或者可以布局于三个RGB像素间距(3PP)的宽度限制内并驱动三个对应的像素，因此显示面板可以使用单一数据驱动器，而非如图1A中所示的使用两个数据驱动器。再者，由于显示面板只需要单一数据驱动器，所以也只需要单一同步器用以对来自主机系统的数字信号与来自时序控制器的频率信号进行同步化，因此可以省去用以将输入数据分送给两个数据驱动器的数据处理电路。
此外，随着显示面板的分辨率或像素阵列密度增加，较小的像素间距将会增加锁存器、模拟缓冲单元和数字模拟转换单元在布局绕在线困难度。在本发明某些实施例中，数据驱动器300的每个驱动单元在二个RGB像素间距(2PP)的宽度限制内可以驱动二个对应的像素，数据驱动器400可以在三个RGB像素间距(3PP)的宽度限制内驱动三个对应的像素，依此类推。当图1B数据驱动器34A与34B由数据驱动器300/400来实现时，其可以在相同的布局面积下驱动更多的像素，换言之，显示面板的分辨率或像素阵列密度都会增加。
图6为图像显示系统的另一实施例。如图所示，电子装置600使用图5中所示的显示面板500，并且举例而言电子装置600可为一个人数字助理(PDA)、一监示器、一笔记型计算机、一数字相机、一车上型显示器、一平板计算机或一行动电话。
一般而言，电子装置600包括一外壳610、一显示面板500以及一DC/DC转换器620，但不限定于此。在动作上，DC/DC转换器620用以供电至显示面板500，使其显示彩色图像。
虽然本发明已以较佳实施例揭露如上，然其并非用以限定本发明，任何本领域技术人员，在不脱离本发明的精神和范围内，当可作些许更动与润饰，因此本发明的保护范围当视后附的权利要求所界定者为准。

Claims (23)

1.一种图像显示系统，包括：
一数据驱动电路，包括多个驱动单元，用以产生多个模拟电压，以便根据来自一数据总线的数据信号驱动对应的多个像素，每个驱动单元包括：
一缓存单元，用以于一第一周期中，根据N个控制信号，依序存储N笔第一数字数据，并于一第二周期中，根据M个开关信号，依序输出上述N笔第一数字数据；
一数字模拟转换单元，耦接于上述缓存单元，用以将上述N个第一数字数据依序转换成N个模拟电压；
一模拟缓冲单元，用以缓存来自上述数字模拟转换单元的上述N个模拟电压；以及
一去多路复用器，用以根据一致能信号，选择性地输出上述N个模拟电压至对应的多个像素。
2.如权利要求1所述的图像显示系统，其中上述每个驱动单元于上述第二周期中，依序输出上述N个模拟电压至对应的多个像素。
3.如权利要求2所述的图像显示系统，其中上述每个缓存单元包括2N组锁存器，每一组中的锁存器串联连接。
4.如权利要求3所述的图像显示系统，其中上述每个缓存单元还包括2N组开关组件，耦接于每二组锁存器之间以及上述锁存器与上述数据总线之间，并且通过上述N个控制信号和上述M开关信号的控制，使得上述每个缓存单元于上述第一周期中依序存储上述N笔第一数字数据，并且于上述第二周期中输出上述N个模拟电压。
5.如权利要求4所述的图像显示系统，其中上述每个去多路复用器根据上述致能信号，依序输出上述N个模拟电压至上述对应的像素。
6.如权利要求1所述的图像显示系统，还包括一水平移位寄存器，用以产生上述N个控制信号。
7.如权利要求1所述的图像显示系统，还包括一时序控制器，用以产生上述M个开关信号以及一频率信号。
8.如权利要求1所述的图像显示系统，还包括一同步器，用以对上述N笔数字数据和上述频率信号进行同步化。
9.如权利要求1所述的图像显示系统，还包括一显示面板，其中上述数据驱动电路为上述显示面板的一部分。
10.如权利要求9所述的图像显示系统，还包括一电子装置，其中上述电子装置包括：
上述显示面板；以及
一电源供应器，用以供电至上述显示面板，以产生图像。
11.如权利要求10所述的图像显示系统，其中上述电子装置为一个人数字助理(PDA)、一监示器、一笔记型计算机、一数字相机、一车上型显示器、一平板计算机或一行动电话。
12.如权利要求9所述的图像显示系统，其中上述有机发光显示面板、一电致发光显示面板或一液晶显示面板。
13.一种图像显示系统，包括：
一驱动电路，包括至少一驱动单元，用以根据来自一数据总线的数据信号产生多个模拟电压，上述驱动单元包括：
一缓存单元，用以于一第一周期中，根据一第一控制信号以及一第二控制信号，依序存储一第一数字数据以及一第二数字数据，并于一第二周期中，根据一第一至第三开关信号，依序输出上述第一数字数据和上述第二数字数据；
一数字模拟转换单元，耦接于上述缓存单元，用以将上述第一及第二数字数据分别转换成一第一模拟电压和一第二模拟电压；
一模拟缓冲单元，用以缓存来自上述数字模拟转换单元的上述第一及第二模拟电压；以及
一去多路复用器，用以根据一致能信号，依序将上述第一、第二模拟电压至一第一像素及一第二像素。
14.如权利要求13所述的图像显示系统，其中上述缓存单元包括一第一至一第四组锁存器，每一组中的锁存器串联连接，用以存储上述第一及第二数字数据。
15.如权利要求14所述的图像显示系统，其中上述缓存单元还包括一第一至一第四组开关组件，耦接于上述第一组锁存器与上述数据总线之间以及上述第二至第四组锁存器之间，并且通过上述第一、第二控制信号和上述第一至第三开关信号的控制，以便于上述第一周期中依序存储上述第一、第二数字数据，且于上述第二周期中输出上述第一、第二数字数据。
16.如权利要求15所述的图像显示系统，其中于上述第一周期时，根据上述第一、第二控制信号，上述第一、第二组开关组件同时导通，以便将上述第一数字数据存储至上述第二组锁存器，接着上述第一组开关组件导通而上述第二组开关组件截止，以便将上述第二数字数据存储至上述第一组锁存器。
17.如权利要求16所述的图像显示系统，其中于上述第二周期时，根据上述第一至第三开关信号，上述第三、第四组开关组件同时导通，以便将上述第一数字数据存储至上述第四组锁存器并输出至上述数字模拟转换单元，接着上述第二、第三组开关组件同时导通，以便将上述第二数字数据存储至上述第三组锁存器。
18.如权利要求17所述的图像显示系统，其中于上述第二周期时，根据上述第一开关信号，上述第四组开关组件导通，以便将上述第二数字数据存储至上述第四组锁存器，同时输出至上述数字模拟转换单元。
19.如权利要求18所述的图像显示系统，其中上述驱动单元于上述第二周期时，依序输出上述第一、第二模拟电压至上述第一、第二像素，且同时接收一第三数字数据以及一第四数字数据。
20.一种图像显示系统，包括：
一第一像素；
一第二像素；以及
一驱动单元，具有一数字模拟转换单元以及一模拟缓冲单元，用以通过将上述数字模拟转换单元和上述模拟缓冲单元提供模拟电压至上述第一及第二像素，以便驱动上述第一、第二像素。
21.如权利要求20所述的图像显示系统，其中上述第一、第二像素被设置于一像素阵列中且彼此相邻。
22.如权利要求20所述的图像显示系统，其中上述驱动单元所需的宽度小于两个RGB像素间距(2PP)。
23.一种提供驱动电压的方法，适用于一图像显示装置，包括下列步骤：
于一第一周期时，根据一第一、一第二控制信号，将一第一及一第二数字数据依序存储至串联连接的多组锁存器中；
于一第二周期时，根据一第一、一第二及一第三开关信号，将上述第一、第二数字数据依序输出至一数字模拟转换单元；
依序将上述第一、第二数字数据转换成一第一模拟电压与一第二模拟电压；以及
根据一致能信号，将上述第一、第二模拟电压依序输出至一第一像素以及一第二像素。
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